JPS6230424B2 - - Google Patents
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- JPS6230424B2 JPS6230424B2 JP13587979A JP13587979A JPS6230424B2 JP S6230424 B2 JPS6230424 B2 JP S6230424B2 JP 13587979 A JP13587979 A JP 13587979A JP 13587979 A JP13587979 A JP 13587979A JP S6230424 B2 JPS6230424 B2 JP S6230424B2
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- scanning
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- 230000015654 memory Effects 0.000 claims description 43
- 238000000034 method Methods 0.000 claims description 17
- 239000000872 buffer Substances 0.000 description 25
- 238000010586 diagram Methods 0.000 description 7
- 238000012545 processing Methods 0.000 description 7
- 239000000463 material Substances 0.000 description 4
- 230000001360 synchronised effect Effects 0.000 description 3
- 238000012937 correction Methods 0.000 description 2
- 238000011161 development Methods 0.000 description 2
- 238000001454 recorded image Methods 0.000 description 2
- 230000010076 replication Effects 0.000 description 2
- 230000004044 response Effects 0.000 description 2
- 238000013481 data capture Methods 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/387—Composing, repositioning or otherwise geometrically modifying originals
- H04N1/3872—Repositioning or masking
- H04N1/3873—Repositioning or masking defined only by a limited number of coordinate points or parameters, e.g. corners, centre; for trimming
- H04N1/3875—Repositioning or masking defined only by a limited number of coordinate points or parameters, e.g. corners, centre; for trimming combined with enlarging or reducing
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Editing Of Facsimile Originals (AREA)
- Fax Reproducing Arrangements (AREA)
- Preparing Plates And Mask In Photomechanical Process (AREA)
- Storing Facsimile Image Data (AREA)
- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】
本発明は、製版用カラースキヤナ、フアクシミ
リ装置等の画像走査記録装置において、複数の原
画に対応する複製画像を、１枚の感光材料上に、
所望の複製倍率及びレイアウトに従つて記録し得
るようにした、レイアウト記録方法、特に、複数
個の原画走査装置を使用して、実時間でレイアウ
ト記録する方法に関する。
リ装置等の画像走査記録装置において、複数の原
画に対応する複製画像を、１枚の感光材料上に、
所望の複製倍率及びレイアウトに従つて記録し得
るようにした、レイアウト記録方法、特に、複数
個の原画走査装置を使用して、実時間でレイアウ
ト記録する方法に関する。
近年、画像組処理技術の発展に伴い、複数の原
画の複製画像を、感光材料上の所望の位置へ、所
望の複製倍率で記録しうるレイアウトスキヤナの
開発が活発化してきている。
画の複製画像を、感光材料上の所望の位置へ、所
望の複製倍率で記録しうるレイアウトスキヤナの
開発が活発化してきている。
その１つの方法として、複数の原画走査装置を
並列的に駆動し、各原画走査装置からの画像信号
を、レイアウト指令に従つて、バツフアメモリ装
置へ一旦書込んだ後、該メモリ装置から読出し
て、記録走査装置の感光材料上に、所望のレイア
ウトで、複数の複製画像を記録する方法が提案さ
れている。
並列的に駆動し、各原画走査装置からの画像信号
を、レイアウト指令に従つて、バツフアメモリ装
置へ一旦書込んだ後、該メモリ装置から読出し
て、記録走査装置の感光材料上に、所望のレイア
ウトで、複数の複製画像を記録する方法が提案さ
れている。
この方法においては、通常、各原画走査装置に
おける原画シリンダ、および記録走査装置におけ
る記録シリンダの各回転速度と回転位相が高精度
に一致しなければ、バツフアメモリ装置に対する
画像信号の書込みと読出しのタイミングに不整合
が生じ、結果的に複製画像に乱れを生じることに
なる。
おける原画シリンダ、および記録走査装置におけ
る記録シリンダの各回転速度と回転位相が高精度
に一致しなければ、バツフアメモリ装置に対する
画像信号の書込みと読出しのタイミングに不整合
が生じ、結果的に複製画像に乱れを生じることに
なる。
本発明は、各原画走査装置における原画シリン
ダと、記録走査装置における記録シリンダとの間
の相対的回転速度、及び回転位相における局部的
な偏倚を所要範囲で許容し、結果的に複製画像に
乱れを生じることのないようにしたレイアウト記
録方法を提供するもので、以下図面に基づいて詳
述する。
ダと、記録走査装置における記録シリンダとの間
の相対的回転速度、及び回転位相における局部的
な偏倚を所要範囲で許容し、結果的に複製画像に
乱れを生じることのないようにしたレイアウト記
録方法を提供するもので、以下図面に基づいて詳
述する。
第１図は、複数個の原画シリンダ２，２にそれ
ぞれ装着された原画Ａ，Ｂの複製画像A′，
B′を、記録シリンダ４に装着された記録フイルム
Ｆ上に、所望のレイアウト及び所望の複製倍率で
記録する場合を示すもので、各原画走査装置１，
１および記録走査装置８は、ほぼ同様な構成とな
つている。
ぞれ装着された原画Ａ，Ｂの複製画像A′，
B′を、記録シリンダ４に装着された記録フイルム
Ｆ上に、所望のレイアウト及び所望の複製倍率で
記録する場合を示すもので、各原画走査装置１，
１および記録走査装置８は、ほぼ同様な構成とな
つている。
すなわち、原画シリンダ２，２及び記録シリン
ダ４は、それぞれ、同期モータ５，５および６に
より、巨視的には等速度に回転駆動され、各シリ
ンダ２，２，４の回転速度と、各シリンダ２，２
および４の各基準位置７，７，８は、各シリンダ
２，２，４にそれぞれ同軸的に接続されたロータ
リーエンコーダ９，９，１０から、それぞれ対応
するパルス信号として出力される。また、ピツク
アツプヘツド１１，１１および記録ヘツド１２
は、それぞれパルスモータ１３，１３および１４
により回転駆動される送りネジ１５，１５および
１６を介して、各シリンダ２，２，４の軸線方
向、すなわち副走査方向に送られ、各シリンダ
２，２，４と協動して、それぞれ原画Ａ，Ｂおよ
び記録フイルムＦの走査を行なう。
ダ４は、それぞれ、同期モータ５，５および６に
より、巨視的には等速度に回転駆動され、各シリ
ンダ２，２，４の回転速度と、各シリンダ２，２
および４の各基準位置７，７，８は、各シリンダ
２，２，４にそれぞれ同軸的に接続されたロータ
リーエンコーダ９，９，１０から、それぞれ対応
するパルス信号として出力される。また、ピツク
アツプヘツド１１，１１および記録ヘツド１２
は、それぞれパルスモータ１３，１３および１４
により回転駆動される送りネジ１５，１５および
１６を介して、各シリンダ２，２，４の軸線方
向、すなわち副走査方向に送られ、各シリンダ
２，２，４と協動して、それぞれ原画Ａ，Ｂおよ
び記録フイルムＦの走査を行なう。
なお、記録ヘツド１２は、パルスモータ１４に
よつて常に一定速度で副走査方向に送られる一
方、各ピツクアツプヘツド１１，１１の送り速度
は、各原画シリンダ２，２に装着された原画Ａ，
Ｂの複製画像が、副走査方向に関して、レイアウ
トどおり正確な位置に記録されるように、後述の
位置制御回路３４によつて制御されるとともに、
各原画Ａ，Ｂの走査開始時には、各原画Ａ，Ｂの
複製倍率に応じた送り速度で副走査方向に送られ
る。
よつて常に一定速度で副走査方向に送られる一
方、各ピツクアツプヘツド１１，１１の送り速度
は、各原画シリンダ２，２に装着された原画Ａ，
Ｂの複製画像が、副走査方向に関して、レイアウ
トどおり正確な位置に記録されるように、後述の
位置制御回路３４によつて制御されるとともに、
各原画Ａ，Ｂの走査開始時には、各原画Ａ，Ｂの
複製倍率に応じた送り速度で副走査方向に送られ
る。
ピツクアツプヘツド１１，１１からの画像信号
は、次に、画像信号処理回路１９，１９に送ら
れ、該画像信号処理回路１９では、色修正、階調
修正、デイテール強調等、カラースキヤナにより
所要の色分解版を作成する際に必要な、すべての
信号処理が行なわれる。この回路１９は、図示し
た実施例では、アナログ回路として表示されてい
るが、例えば特願昭54−49077号明細書に開示さ
れている如きデイジタル回路で構成してもよく、
その場合には、アナログ・デイジタル変換器（以
下、Ａ／Ｄ変換器と称する。）２１をその前段に
設けることにより何らの不都合は生じない。
は、次に、画像信号処理回路１９，１９に送ら
れ、該画像信号処理回路１９では、色修正、階調
修正、デイテール強調等、カラースキヤナにより
所要の色分解版を作成する際に必要な、すべての
信号処理が行なわれる。この回路１９は、図示し
た実施例では、アナログ回路として表示されてい
るが、例えば特願昭54−49077号明細書に開示さ
れている如きデイジタル回路で構成してもよく、
その場合には、アナログ・デイジタル変換器（以
下、Ａ／Ｄ変換器と称する。）２１をその前段に
設けることにより何らの不都合は生じない。
画像信号処理回路１９，１９からの出力は、次
のＡ／Ｄ変換器２１に入力され、該Ａ／Ｄ変換器
２１からは、各原画シリンダ２，２の回転速度に
同期してロータリーエンコーダ９，９から出力さ
れるタイミングパルスg1に基づいて、クロツク発
生器２３で作られるクロツクパルスg3によりデイ
ジタル化された画像信号a1，b1が出力される。
のＡ／Ｄ変換器２１に入力され、該Ａ／Ｄ変換器
２１からは、各原画シリンダ２，２の回転速度に
同期してロータリーエンコーダ９，９から出力さ
れるタイミングパルスg1に基づいて、クロツク発
生器２３で作られるクロツクパルスg3によりデイ
ジタル化された画像信号a1，b1が出力される。
各原画走査装置１，１から出力された画像信号
a1，b1は、次に、バツフアメモリ装置２７への画
像信号a1もしくはb1の書込みタイミングを制御す
るために配置されたメモリ書込み制御回路２５
a，２５bに入力される。
a1，b1は、次に、バツフアメモリ装置２７への画
像信号a1もしくはb1の書込みタイミングを制御す
るために配置されたメモリ書込み制御回路２５
a，２５bに入力される。
メモリ書込み制御回路２５a，２５bは、いずれ
も同一構成のもので、本願出願人の出願に係る特
願昭54− 号明細書に記載されているも
の、例えば第２図に示す如きものを使用すること
ができる。
も同一構成のもので、本願出願人の出願に係る特
願昭54− 号明細書に記載されているも
の、例えば第２図に示す如きものを使用すること
ができる。
このメモリ書込み制御回路２５aは、ｎ進バイ
ナリカウンタ４１と、該ｎ進バイナリカウンタ４
１の出力コードを択一信号に変換するｎ進デコー
ダ４２から成るリングカウンタ４０、ｎ進バイナ
リカウンタ４６と、ｎ進デコーダ４７から成るｎ
進リングカウンタ４５、ｎ進リングカウンタ４
０，４５の各出力側に設けられた各ｎ個のアンド
ゲート群４３，４８、各アンドゲート群４３，４
８それぞれの出力によつて択一的に選択されるｎ
個のラツチ回路群４４、およびｎチヤンネルのデ
ータセレクタ４９から構成されている。
ナリカウンタ４１と、該ｎ進バイナリカウンタ４
１の出力コードを択一信号に変換するｎ進デコー
ダ４２から成るリングカウンタ４０、ｎ進バイナ
リカウンタ４６と、ｎ進デコーダ４７から成るｎ
進リングカウンタ４５、ｎ進リングカウンタ４
０，４５の各出力側に設けられた各ｎ個のアンド
ゲート群４３，４８、各アンドゲート群４３，４
８それぞれの出力によつて択一的に選択されるｎ
個のラツチ回路群４４、およびｎチヤンネルのデ
ータセレクタ４９から構成されている。
メモリ書込み制御回路２５aに入力されたデイ
ジタル画像信号は、アンドゲート群４３から出力
されるデータ取込み信号に応じて、ラツチ回路群
４４に順次取込まれ、該ラツチ回路群４４は、時
間的に直列に入力される画像信号を時間的に並列
なデータ群として、データセレクタ４９へ出力し
ている。
ジタル画像信号は、アンドゲート群４３から出力
されるデータ取込み信号に応じて、ラツチ回路群
４４に順次取込まれ、該ラツチ回路群４４は、時
間的に直列に入力される画像信号を時間的に並列
なデータ群として、データセレクタ４９へ出力し
ている。
データセレクタ４９は、メモリ装置２７への書
込みと読出しのタイミングの重複を除き、かつデ
イジタル画像信号がラツチ回路群４４に保留され
た順序を乱さないよう、アンドゲート群４８から
出力される選択信号に応じて、画像信号a2を出力
する。
込みと読出しのタイミングの重複を除き、かつデ
イジタル画像信号がラツチ回路群４４に保留され
た順序を乱さないよう、アンドゲート群４８から
出力される選択信号に応じて、画像信号a2を出力
する。
このようにして、各メモリ書込み制御回路２５
a，２５bから出力された画像信号a2およびb2は、
データ切替回路２６に送られ、該データ切替回路
２６において、２相クロツク発生回路３３からの
２相クロツクｅa，ｅbにより、画像信号ごとに時
分割されて、バツフアメモリ装置２７の書込み入
力端子に入力される。
a，２５bから出力された画像信号a2およびb2は、
データ切替回路２６に送られ、該データ切替回路
２６において、２相クロツク発生回路３３からの
２相クロツクｅa，ｅbにより、画像信号ごとに時
分割されて、バツフアメモリ装置２７の書込み入
力端子に入力される。
２相クロツクｅa，ｅbは、第３図ロ，ハに示す
如く、その周期を、同図イに示すクロツクパルス
e3と同じくし、相互に180゜の位相差を有し、か
つハイレベルのパルス幅をデユーテイ50％未満に
したもので、該２相クロツク発生回路３３から
は、同図ニに示す如き、メモリ装置２７用読出し
指令信号ｅRも同時に出力される。
如く、その周期を、同図イに示すクロツクパルス
e3と同じくし、相互に180゜の位相差を有し、か
つハイレベルのパルス幅をデユーテイ50％未満に
したもので、該２相クロツク発生回路３３から
は、同図ニに示す如き、メモリ装置２７用読出し
指令信号ｅRも同時に出力される。
一方、前記した如き画像信号の切替に際して、
各画像信号書込み用のアドレス信号Ｙa，Ｙbは、
アドレス切替回路３２に入力される２相クロツク
ｅa，ｅbにより、画像信号の切替に同期して切替
えられ、デイジタル画像a2，b2には、それぞれ対
応するアドレスが指定される。このアドレス信号
Ｙa，Ｙbは、デジタイザー等のレイアウト指定装
置２９からの指令により、所望のレイアウトに応
じて、あらかじめ決められるものである。
各画像信号書込み用のアドレス信号Ｙa，Ｙbは、
アドレス切替回路３２に入力される２相クロツク
ｅa，ｅbにより、画像信号の切替に同期して切替
えられ、デイジタル画像a2，b2には、それぞれ対
応するアドレスが指定される。このアドレス信号
Ｙa，Ｙbは、デジタイザー等のレイアウト指定装
置２９からの指令により、所望のレイアウトに応
じて、あらかじめ決められるものである。
これと同時に、メモリ書込み制御回路２５a，
２５bからは、デイジタル画像信号a2，b2の出力
と同期して、２相クロツクｅa，ｅbが書込み指令
信号として出力され、これら書込み指令信号は、
オア回路２８を介して、バツフアメモリ装置２７
への書込みを指令する一方、アドレス制御回路３
１にも入力され、各画像信号書込み用のアドレス
信号Ｙa，Ｙbのアドレス番地を順次進める。
２５bからは、デイジタル画像信号a2，b2の出力
と同期して、２相クロツクｅa，ｅbが書込み指令
信号として出力され、これら書込み指令信号は、
オア回路２８を介して、バツフアメモリ装置２７
への書込みを指令する一方、アドレス制御回路３
１にも入力され、各画像信号書込み用のアドレス
信号Ｙa，Ｙbのアドレス番地を順次進める。
このようにして、バツフアメモリ装置２７の所
定アドレスに書込まれた画像信号a2，b2は、次に
該バツフアメモリ装置２７の読出し指令端子に入
力する読出し指令信号ｅRにより、アドレス制御
回路３１からの読出し用アドレス信号Ｙに応じて
順次読出される。読出された画像信号a2もしくは
b2は、Ｄ／Ａ変換器２２において、読出し指令信
号ｅRに同期した記録側のクロツクパルスe3によ
りアナログ画像信号に変換され、アナログ変換さ
れた画像信号は、記録ヘツド制御回路２０に入力
されて、記録ヘツド１２の記録用光ビームを制御
し、記録フイルムＦ上に複製画像A′，B′を記録
する。
定アドレスに書込まれた画像信号a2，b2は、次に
該バツフアメモリ装置２７の読出し指令端子に入
力する読出し指令信号ｅRにより、アドレス制御
回路３１からの読出し用アドレス信号Ｙに応じて
順次読出される。読出された画像信号a2もしくは
b2は、Ｄ／Ａ変換器２２において、読出し指令信
号ｅRに同期した記録側のクロツクパルスe3によ
りアナログ画像信号に変換され、アナログ変換さ
れた画像信号は、記録ヘツド制御回路２０に入力
されて、記録ヘツド１２の記録用光ビームを制御
し、記録フイルムＦ上に複製画像A′，B′を記録
する。
なお、複製画像A′，B′の複製倍率が原寸と異
なる場合には、例えば本願出願人の出願に係る特
願昭52−131366号明細書に開示した如く、アドレ
ス制御回路３１からの読出し用アドレス信号Ｙ
を、複製倍率に応じて重複させたり、間引いたり
することにより、主走査方向における複製画像
A′，B′の複製倍率を制御することができる。
なる場合には、例えば本願出願人の出願に係る特
願昭52−131366号明細書に開示した如く、アドレ
ス制御回路３１からの読出し用アドレス信号Ｙ
を、複製倍率に応じて重複させたり、間引いたり
することにより、主走査方向における複製画像
A′，B′の複製倍率を制御することができる。
この方法では、主走査方向における複製画像
は、レイアウト指定回路２９の座標位置と、バツ
フアメモリ装置２７のアドレスと、記録シリンダ
４上の記録フイルムＦの位置関係が正確に対応し
てさえいれば、指定レイアウトどおりの位置に記
録されるが、副走査方向における複製画像の記録
位置は、別途に制御する必要がある。
は、レイアウト指定回路２９の座標位置と、バツ
フアメモリ装置２７のアドレスと、記録シリンダ
４上の記録フイルムＦの位置関係が正確に対応し
てさえいれば、指定レイアウトどおりの位置に記
録されるが、副走査方向における複製画像の記録
位置は、別途に制御する必要がある。
すなわち、本発明に係る方法のように、記録ヘ
ツド１２を副走査方向に一定速度で送り、各ピツ
クアツプヘツド１１，１１の副走査方向における
送り速度を、複製倍率に応じて変化させることに
より、副走査方向における複製画像の複製倍率を
変化させる場合には、本願出願人の出願に係る、
特願昭54−107884号明細書にも記載されているよ
うに、各ピツクアツプヘツド１１，１１を駆動す
るパルスモータ１３，１３の、印加電圧に対する
応答時間、云い換れば、印加電圧を変化してか
ら、該印加電圧に対応した回転量に達するまでの
時間が、それまでモータ１３，１３に印加されて
いた電圧および印加電圧の変化分等によりばらつ
くため、複製画像の副走査方向における始点が、
数走査線分ずれる欠点があつた。
ツド１２を副走査方向に一定速度で送り、各ピツ
クアツプヘツド１１，１１の副走査方向における
送り速度を、複製倍率に応じて変化させることに
より、副走査方向における複製画像の複製倍率を
変化させる場合には、本願出願人の出願に係る、
特願昭54−107884号明細書にも記載されているよ
うに、各ピツクアツプヘツド１１，１１を駆動す
るパルスモータ１３，１３の、印加電圧に対する
応答時間、云い換れば、印加電圧を変化してか
ら、該印加電圧に対応した回転量に達するまでの
時間が、それまでモータ１３，１３に印加されて
いた電圧および印加電圧の変化分等によりばらつ
くため、複製画像の副走査方向における始点が、
数走査線分ずれる欠点があつた。
本発明では、前記特願昭54−107884号と同様、
副走査方向に一定速度で送られる記録ヘツド１２
の位置を基準として、記録ヘツド１２の記録開始
点まで距離、および各ピツクアツプヘツド１１，
１１の走査開始点までの距離、すなわち各ピツク
アツプヘツドと記録ヘツドの位置偏差をリニアエ
ンコーダ１７，１７，１８により、あらかじめ検
出し、該位置偏差および複製すべき画像の複製倍
率により、各ピツクアツプヘツド１１，１１の送
り速度を位置制御回路３４により制御して、各原
画Ａ，Ｂ走査開始点と出力フイルムＦ上の対応す
る記録開始点とが、実質的に同時に走査されるよ
うにすることにより、前記欠点を解消したもの
で、これにより、各原画シリンダ２，２上に装着
された原画を、記録シリンダ４に装着された記録
フイルムＦ上に、所望の複製倍率、所望のレイア
ウトで、最終的に記録することが可能となる。
副走査方向に一定速度で送られる記録ヘツド１２
の位置を基準として、記録ヘツド１２の記録開始
点まで距離、および各ピツクアツプヘツド１１，
１１の走査開始点までの距離、すなわち各ピツク
アツプヘツドと記録ヘツドの位置偏差をリニアエ
ンコーダ１７，１７，１８により、あらかじめ検
出し、該位置偏差および複製すべき画像の複製倍
率により、各ピツクアツプヘツド１１，１１の送
り速度を位置制御回路３４により制御して、各原
画Ａ，Ｂ走査開始点と出力フイルムＦ上の対応す
る記録開始点とが、実質的に同時に走査されるよ
うにすることにより、前記欠点を解消したもの
で、これにより、各原画シリンダ２，２上に装着
された原画を、記録シリンダ４に装着された記録
フイルムＦ上に、所望の複製倍率、所望のレイア
ウトで、最終的に記録することが可能となる。
また、第１図に示す実施例は、バツフアメモリ
装置２７として、１ラインメモリ、すなわち記録
フイルムＦ上の走査線１本分に相当する容量のメ
モリ装置を使用する場合を示すもので、この場
合、画像信号a2，b2は、レイアウトされた記録フ
イルムＦ上の複製画像A′，B′の位置に対応する
レイアウト指定回路２９からの信号に応じて時分
割され、バツフアメモリ装置２７に書込まれる。
装置２７として、１ラインメモリ、すなわち記録
フイルムＦ上の走査線１本分に相当する容量のメ
モリ装置を使用する場合を示すもので、この場
合、画像信号a2，b2は、レイアウトされた記録フ
イルムＦ上の複製画像A′，B′の位置に対応する
レイアウト指定回路２９からの信号に応じて時分
割され、バツフアメモリ装置２７に書込まれる。
第４図は、記録フイルムＦ上に記録された複製
画像A′，B′に対応する画像信号a2，b2が、各走査
線ごとにバツフアメモリ装置２７にどのように書
込まれるかを示すものである。
画像A′，B′に対応する画像信号a2，b2が、各走査
線ごとにバツフアメモリ装置２７にどのように書
込まれるかを示すものである。
この場合、バツフアメモリ装置２７のアドレス
と、記録シリンダ４に装着された記録フイルムＦ
の主走査方向における位置と、デジタイザー等の
レイアウト指定装置２９により指定される位置と
がそれぞれ対応するように、あらかじめ設定され
ているため、記録フイルムＦ上の位置、ｙa1，ｙ
a2，ｙb1，ｙb2は、それぞれバツフアメモリ装置
２７のアドレスＹa1，Ｙa2，Ｙb1，Ｙb2と対応し、
走査線S1の場合は、画像信号b2がアドレスＹb1か
らＹb2に書込まれ、走査線S2の場合は、画像信号
a2がアドレスＹa1からＹa2に、画像信号b2がアド
レスＹb1からＹb2に書込まれることになる。
と、記録シリンダ４に装着された記録フイルムＦ
の主走査方向における位置と、デジタイザー等の
レイアウト指定装置２９により指定される位置と
がそれぞれ対応するように、あらかじめ設定され
ているため、記録フイルムＦ上の位置、ｙa1，ｙ
a2，ｙb1，ｙb2は、それぞれバツフアメモリ装置
２７のアドレスＹa1，Ｙa2，Ｙb1，Ｙb2と対応し、
走査線S1の場合は、画像信号b2がアドレスＹb1か
らＹb2に書込まれ、走査線S2の場合は、画像信号
a2がアドレスＹa1からＹa2に、画像信号b2がアド
レスＹb1からＹb2に書込まれることになる。
一方、書込まれた画像信号a2，b2は、記録側の
１回転クロツクパルスe4に同期して、アドレス制
御回路３１から出力される読出し用アドレス信号
Ｙにより、アドレス０番地から順次読出される。
１回転クロツクパルスe4に同期して、アドレス制
御回路３１から出力される読出し用アドレス信号
Ｙにより、アドレス０番地から順次読出される。
第５図は、バツフアメモリ装置として書込みア
ドレスが区分された、複数個のメモリエリア、例
えば８個のメモリエリアM1〜M8を備えるメモリ
装置５１を使用する場合について、第１図の実施
例と異なる部分のみを抽出して図示したもので、
第１図の実施例の如く、画像信号a2，b2を時分割
してバツフアメモリ装置２７へ書込む必要がな
く、並列的に書込むことができるため、メモリ装
置５１へ書込むべき画像信号がさらに増加した場
合でも、読出しに要する時間と同程度の時間をも
つて書込むことができる。
ドレスが区分された、複数個のメモリエリア、例
えば８個のメモリエリアM1〜M8を備えるメモリ
装置５１を使用する場合について、第１図の実施
例と異なる部分のみを抽出して図示したもので、
第１図の実施例の如く、画像信号a2，b2を時分割
してバツフアメモリ装置２７へ書込む必要がな
く、並列的に書込むことができるため、メモリ装
置５１へ書込むべき画像信号がさらに増加した場
合でも、読出しに要する時間と同程度の時間をも
つて書込むことができる。
また、同図中のクロツク発生器３３′も、第１
図における２相クロツク発生回路３３とは若干異
なり、第６図に示す如き記録側のクロツクパルス
e3から第５図ロに示す如き書込み指令信号ｅW
と、同図ハに示す如き読出し指令信号ｅRを出力
する。
図における２相クロツク発生回路３３とは若干異
なり、第６図に示す如き記録側のクロツクパルス
e3から第５図ロに示す如き書込み指令信号ｅW
と、同図ハに示す如き読出し指令信号ｅRを出力
する。
第７図は、第５図に示すデータ分配器５０、メ
モリ装置５１、アドレス分配器５２の一部を、さ
らに詳細に図示したもので、メモリ書込み制御回
路２５aおよび２５bから書込み指令信号ｅWとと
も出力された画像信号a′およびb′は、選択信号g5
により順次選択されるバスバツフア５５１，５５
２、……もしくはバスバツフア５６１，５６２…
…を介して所定のメモリブロツクに書込まれる。
モリ装置５１、アドレス分配器５２の一部を、さ
らに詳細に図示したもので、メモリ書込み制御回
路２５aおよび２５bから書込み指令信号ｅWとと
も出力された画像信号a′およびb′は、選択信号g5
により順次選択されるバスバツフア５５１，５５
２、……もしくはバスバツフア５６１，５６２…
…を介して所定のメモリブロツクに書込まれる。
画像信号a′もしくはb′を所定のメモリブロツク
へ書込む際のアドレス信号ＹaおよびＹbは、前記
同様選択信号g5により順次選択されるバスバツフ
ア５７１，５７２、……もしくはバスバツフア５
８１，５８２、……を介して、所定のメモリブロ
ツクに印加される。
へ書込む際のアドレス信号ＹaおよびＹbは、前記
同様選択信号g5により順次選択されるバスバツフ
ア５７１，５７２、……もしくはバスバツフア５
８１，５８２、……を介して、所定のメモリブロ
ツクに印加される。
この選択信号g5は、例えば、バスバツフア５５
１と５７１、バスバツフア５６１と５８１のよう
に、データ分配器５０およびアドレス分配器５２
において、それぞれ対応する一対のバスバツフア
に入力するように、あらかじめ構成されている。
１と５７１、バスバツフア５６１と５８１のよう
に、データ分配器５０およびアドレス分配器５２
において、それぞれ対応する一対のバスバツフア
に入力するように、あらかじめ構成されている。
そのため、第４図に示す走査線S2の場合でも、
画像信号a2′はメモリブロツクM1の所定のアドレ
スＹa1から、画像信号b2′はメモリブロツクM6の
所定のアドレスＹb1から、それぞれ同時に書込ま
れ、第４図の場合と比較して、書込みに要する時
間が大幅に短縮されることになる。
画像信号a2′はメモリブロツクM1の所定のアドレ
スＹa1から、画像信号b2′はメモリブロツクM6の
所定のアドレスＹb1から、それぞれ同時に書込ま
れ、第４図の場合と比較して、書込みに要する時
間が大幅に短縮されることになる。
また、複製画像の主走査方向における記録間隔
が狭い場合、すなわち、一方の画像信号の終端と
他方の画像信号の始端との間隔が狭い場合には、
各画像信号を同時に、同一メモリブロツクに書込
まなければならない場合が生ずるが、同時に、同
一メモリブロツクに複数の画像信号を書込むこと
はできないため、メモリブロツクをさらに細かく
分割して、各画像信号が同一メモリブロツクに書
込まれないようにするか、あるいは同一メモリブ
ロツク書込まれる一方の画像信号のアドレスを、
所要のアドレス数ずらし、両画像信号が書込まれ
るメモリブロツクが重ならないようにしてもよ
い。
が狭い場合、すなわち、一方の画像信号の終端と
他方の画像信号の始端との間隔が狭い場合には、
各画像信号を同時に、同一メモリブロツクに書込
まなければならない場合が生ずるが、同時に、同
一メモリブロツクに複数の画像信号を書込むこと
はできないため、メモリブロツクをさらに細かく
分割して、各画像信号が同一メモリブロツクに書
込まれないようにするか、あるいは同一メモリブ
ロツク書込まれる一方の画像信号のアドレスを、
所要のアドレス数ずらし、両画像信号が書込まれ
るメモリブロツクが重ならないようにしてもよ
い。
このようにして各メモリブロツクM1〜M8に書
込まれた画像信号a2′およびb2′は、読出し指令信
号ｅR、読出し用アドレス信号Ｙに応じて、画像
信号ｃとして順次読出される。
込まれた画像信号a2′およびb2′は、読出し指令信
号ｅR、読出し用アドレス信号Ｙに応じて、画像
信号ｃとして順次読出される。
第９図は、第１図の実施例に示したバツフアメ
モリ２７に代え、それぞれ記録側の走査線１本に
相当する記録容量のラインメモリＭA，ＭBを設け
たメモリ装置６０を使用する場合を示すもので、
この場合にも、第１図の実施例の如く、画像信号
a2，b2を時分割してバツフアメモリ装置２７へ書
込む必要がなく、第５図の実施例と同様に、並列
的に書込むことができる。
モリ２７に代え、それぞれ記録側の走査線１本に
相当する記録容量のラインメモリＭA，ＭBを設け
たメモリ装置６０を使用する場合を示すもので、
この場合にも、第１図の実施例の如く、画像信号
a2，b2を時分割してバツフアメモリ装置２７へ書
込む必要がなく、第５図の実施例と同様に、並列
的に書込むことができる。
すなわち、メモリ書込み制御回路２５aから出
力される画像信号a2は、アドレス制御回路３１か
らのアドレス信号Ｙaに応じて、ラインメモリＭA
の所定のアドレスＹa1（第１０図図示）から順次
書込まれる一方、画像信号b2は、アドレス信号Ｙ
bに応じて、ラインメモリＭBの所定のアドレスＹ
b1（第１０図図示）から順次書込まれる。かくし
て、ラインメモリＭA，ＭBに書込まれた画像信号
a2もしくはb2は、読出し用アドレス信号Ｙに応じ
て各ラインメモリＭA，ＭBからレイアウト通りに
読出される。
力される画像信号a2は、アドレス制御回路３１か
らのアドレス信号Ｙaに応じて、ラインメモリＭA
の所定のアドレスＹa1（第１０図図示）から順次
書込まれる一方、画像信号b2は、アドレス信号Ｙ
bに応じて、ラインメモリＭBの所定のアドレスＹ
b1（第１０図図示）から順次書込まれる。かくし
て、ラインメモリＭA，ＭBに書込まれた画像信号
a2もしくはb2は、読出し用アドレス信号Ｙに応じ
て各ラインメモリＭA，ＭBからレイアウト通りに
読出される。
この際の各ラインメモリＭA，ＭBへの書込み、
および読出しのタイミングは、第５図の実施例と
同様、書込み指令信号ｅWおよび読出し指令信号
ｅRにより制御されている。
および読出しのタイミングは、第５図の実施例と
同様、書込み指令信号ｅWおよび読出し指令信号
ｅRにより制御されている。
要するに、本発明に係る方法は、複数の原画走
査装置に装着された各原画の複製画像を、感光材
料上に、所望の複製倍率及び所望のレイアウト
で、かつ実時間処理により記録し得るもので、上
述の説明では、複数の原画走査装置にそれぞれ１
枚の原画を装着した場合の実施例について述べた
が、各原画走査装置それぞれに複数の原画を装着
し、該複数原画の複製画像を、所望の複製倍率及
び所望のレイアウトに記録する場合でも、各原画
走査装置に装着された複数の原画が走査される順
番に、記録すべき複製画像がレイアウトされてい
るような場合であれば、本発明に係る方法は容易
に適用し得る。
査装置に装着された各原画の複製画像を、感光材
料上に、所望の複製倍率及び所望のレイアウト
で、かつ実時間処理により記録し得るもので、上
述の説明では、複数の原画走査装置にそれぞれ１
枚の原画を装着した場合の実施例について述べた
が、各原画走査装置それぞれに複数の原画を装着
し、該複数原画の複製画像を、所望の複製倍率及
び所望のレイアウトに記録する場合でも、各原画
走査装置に装着された複数の原画が走査される順
番に、記録すべき複製画像がレイアウトされてい
るような場合であれば、本発明に係る方法は容易
に適用し得る。
第１図は、レイアウトカラースキヤナに本発明
方法を適用した例を示すブロツクダイヤグラム、
第２図は、第１図におけるメモリ書込み制御回路
の具体例を示す電気回路図、第３図は、第１図に
おける２相クロツク発生回路の出力波形図、第４
図は、第１図の実施例における記録フイルム上の
記録画像と、その記録画像を得るときの要部走査
線におけるメモリマツプの関係を示す図、第５図
は、本発明方法を適用したレイアウトカラースキ
ヤナの第１図とは異る例を示すブロツクダイヤグ
ラムで、第１図と同様の部分は省略したもの、第
６図は、第５図に示すクロツク発生回路のタイム
チヤート、第７図は、第５図に示すメモリ装置の
周辺の一部を具体的に示す電気回路図、第８図
は、第５図に示す実施例におけるメモリ装置の要
部走査線のメモリマツプ、第９図は、本発明方法
を適用したレイアウトカラースキヤナのさらに異
る例を、第１図と同様の部分を省略して示すブロ
ツクダイヤグラム、第１０図は、第９図に示す実
施例におけるメモリ装置の要部走査線のメモリマ
ツプである。 １……原画走査装置、２……原画シリンダ、３
……記録走査装置、４……記録シリンダ、５，６
……同期モータ、７，８……基準位置、９，１０
……ロータリーエンコーダ、１１……ピツクアツ
プヘツド、１２……記録ヘツド、１３，１４……
パルスモータ、１５，１６……送りネジ、１７，
１８……リニアエンコーダ、１９……画像信号処
理回路、２０……記録ヘツド制御回路、２１……
Ａ／Ｄ変換器、２２……Ｄ／Ａ変換器、２５a，
２５b……メモリ書込み制御回路、２６……デー
タ切替回路、２７……バツフアメモリ装置、２８
……オア回路、２９……レイアウト指定装置、３
１……アドレス制御回路、３２……アドレス切替
回路、３３，３３′……２相クロツク発生回路、
３４……位置制御回路、４０，４５……リングカ
ウンタ、４１，４６……ｎ進バイナリカウンタ、
４２，４７……ｎ進デコーダ、４３，４８……ア
ンドゲート群、４４……ラツチ回路、４９……デ
ータセレクタ、５０……データ分配器、５１，６
０……メモリ装置、５２……アドレス分配器、５
５１…５６１…５７１…５８１……バスバツフ
ア。
方法を適用した例を示すブロツクダイヤグラム、
第２図は、第１図におけるメモリ書込み制御回路
の具体例を示す電気回路図、第３図は、第１図に
おける２相クロツク発生回路の出力波形図、第４
図は、第１図の実施例における記録フイルム上の
記録画像と、その記録画像を得るときの要部走査
線におけるメモリマツプの関係を示す図、第５図
は、本発明方法を適用したレイアウトカラースキ
ヤナの第１図とは異る例を示すブロツクダイヤグ
ラムで、第１図と同様の部分は省略したもの、第
６図は、第５図に示すクロツク発生回路のタイム
チヤート、第７図は、第５図に示すメモリ装置の
周辺の一部を具体的に示す電気回路図、第８図
は、第５図に示す実施例におけるメモリ装置の要
部走査線のメモリマツプ、第９図は、本発明方法
を適用したレイアウトカラースキヤナのさらに異
る例を、第１図と同様の部分を省略して示すブロ
ツクダイヤグラム、第１０図は、第９図に示す実
施例におけるメモリ装置の要部走査線のメモリマ
ツプである。 １……原画走査装置、２……原画シリンダ、３
……記録走査装置、４……記録シリンダ、５，６
……同期モータ、７，８……基準位置、９，１０
……ロータリーエンコーダ、１１……ピツクアツ
プヘツド、１２……記録ヘツド、１３，１４……
パルスモータ、１５，１６……送りネジ、１７，
１８……リニアエンコーダ、１９……画像信号処
理回路、２０……記録ヘツド制御回路、２１……
Ａ／Ｄ変換器、２２……Ｄ／Ａ変換器、２５a，
２５b……メモリ書込み制御回路、２６……デー
タ切替回路、２７……バツフアメモリ装置、２８
……オア回路、２９……レイアウト指定装置、３
１……アドレス制御回路、３２……アドレス切替
回路、３３，３３′……２相クロツク発生回路、
３４……位置制御回路、４０，４５……リングカ
ウンタ、４１，４６……ｎ進バイナリカウンタ、
４２，４７……ｎ進デコーダ、４３，４８……ア
ンドゲート群、４４……ラツチ回路、４９……デ
ータセレクタ、５０……データ分配器、５１，６
０……メモリ装置、５２……アドレス分配器、５
５１…５６１…５７１…５８１……バスバツフ
ア。
Claims (1)
- 【特許請求の範囲】 １ 複数の原画走査装置におけるピツクアツプヘ
ツドの、記録ヘツドに対する相対送り速度を各原
画の所望複製倍率に応じて制御するとともに、前
記複数のピツクアツプヘツドから得られる画像信
号を、時系列信号に変換して、所望のレイアウト
に応じたメモリ装置のアドレスへ書きこみ、前記
時系列信号を該メモリ装置から順次読みだす際
に、読みだすべき画像信号のアドレスを制御する
ことにより、複数の原画走査装置からの画像信号
に対応する複製画像を所望の複製倍率で、実時間
レイアウト記録するようにしたことを特徴とする
画像走査記録装置におけるレイアウト記録方法。 ２ メモリ装置を、記録側の走査線１本分に相当
する記憶容量のラインメモリで構成し、時系列画
像信号を時分割して書込むようにしたことを特徴
とする特許請求の範囲第１項記載の画像走査記録
装置におけるレイアウト記録方法。 ３ 複数の原画走査装置におけるピツクアツプヘ
ツドの、記録ヘツドに対する相対送り速度を各原
画の所望複製倍率に応じて制御するとともに、前
記複数のピツクアツプヘツドから得られる画像信
号を、所望のレイアウトに応じたメモリ装置のア
ドレスへ並列的に書きこみ、前記画像信号を該メ
モリ装置から時系列的に順次読みだす際、読みだ
すべき画像信号のアドレスを制御することによ
り、複製画像を所望の複製倍率で実時間レイアウ
ト記録するようにしたことを特徴とする画像走査
記録装置におけるレイアウト記録方法。 ４ メモリ装置を、記録側の走査線１本分に相当
する記憶容量を有し、かつその書込みアドレスが
区分された複数個のメモリエリアを備えるライン
メモリで構成し、異なるメモリエリアの所定のア
ドレスへ、当該メモリエリアと対応させた画像信
号を並列的に書込むようにしたことを特徴とする
特許請求の範囲第３項記載の画像走査記録装置に
おけるレイアウト記録方法。 ５ メモリ装置を、記録側の走査線１本分に相当
する記憶容量のラインメモリ複数個で構成し、各
ラインメモリの所定のアドレスへ、当該ラインメ
モリと対応させた画像信号を並列的に書込むよう
にしたことを特徴とする特許請求の範囲第３項記
載の画像走査記録装置におけるレイアウト記録方
法。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13587979A JPS5660438A (en) | 1979-10-23 | 1979-10-23 | Layout recording method in image scanning recorder |
| GB8033343A GB2061667B (en) | 1979-10-23 | 1980-10-16 | Lay-out recording method |
| DE19803039466 DE3039466A1 (de) | 1979-10-23 | 1980-10-18 | Lay-out-aufzeichnungsverfahren in einem bildabtastaufzeichnungssystem |
| US06/199,341 US4350997A (en) | 1979-10-23 | 1980-10-21 | Lay-out recording method in a picture scanning recording system |
| FR8022897A FR2468261B1 (fr) | 1979-10-23 | 1980-10-23 | Procede de reproduction d'images dans un dispositif d'enregistrement d'images a balayage |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13587979A JPS5660438A (en) | 1979-10-23 | 1979-10-23 | Layout recording method in image scanning recorder |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5660438A JPS5660438A (en) | 1981-05-25 |
| JPS6230424B2 true JPS6230424B2 (ja) | 1987-07-02 |
Family
ID=15161900
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13587979A Granted JPS5660438A (en) | 1979-10-23 | 1979-10-23 | Layout recording method in image scanning recorder |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4350997A (ja) |
| JP (1) | JPS5660438A (ja) |
| DE (1) | DE3039466A1 (ja) |
| FR (1) | FR2468261B1 (ja) |
| GB (1) | GB2061667B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0212306A (ja) * | 1988-06-30 | 1990-01-17 | Fuji Electric Co Ltd | プログラマブルコントローラの出力駆動装置 |
Families Citing this family (13)
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|---|---|---|---|---|
| JPS57166773A (en) * | 1981-04-07 | 1982-10-14 | Dainippon Screen Mfg Co Ltd | Reproducing method of picture scan |
| JPS57181260A (en) * | 1981-05-01 | 1982-11-08 | Canon Inc | Picture information outputting method |
| GB2124055B (en) * | 1982-07-09 | 1987-06-24 | Fuji Photo Film Co Ltd | Picture image input/output system |
| US4527193A (en) * | 1982-09-30 | 1985-07-02 | Hazeltine Corporation | Image storage system |
| AU575786B2 (en) * | 1982-10-04 | 1988-08-11 | Canon Kabushiki Kaisha | Image forming system |
| JPS59108453A (ja) * | 1982-12-14 | 1984-06-22 | Dainippon Screen Mfg Co Ltd | 画像デ−タの処理方法 |
| JPS59116658A (ja) * | 1982-12-23 | 1984-07-05 | Dainippon Screen Mfg Co Ltd | 複数原稿同時記録装置 |
| JPS6031359A (ja) * | 1983-07-29 | 1985-02-18 | Dainippon Screen Mfg Co Ltd | 画像走査記録装置 |
| DE3442793A1 (de) * | 1983-11-25 | 1985-06-05 | Canon K.K., Tokio/Tokyo | Bildverarbeitungseinrichtung |
| JPS611164A (ja) * | 1984-06-14 | 1986-01-07 | Toshiba Corp | 画像形成装置 |
| CA1284225C (en) * | 1986-07-23 | 1991-05-14 | Katsuya Nakagawa | Game software service system |
| JPS63141061A (ja) * | 1986-12-02 | 1988-06-13 | Dainippon Screen Mfg Co Ltd | 円筒走査型画像走査装置の入力処理装置 |
| US5186102A (en) * | 1990-10-11 | 1993-02-16 | Ricoh Company, Ltd. | Printer using a stencil |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3819854A (en) * | 1970-02-20 | 1974-06-25 | Harris Intertype Corp | Composing apparatus |
| GB1334529A (en) * | 1970-11-04 | 1973-10-17 | Crosfield Electronics Ltd | Printing processes |
| DE2161038C3 (de) * | 1971-12-09 | 1985-06-20 | Dr.-Ing. Rudolf Hell Gmbh, 2300 Kiel | Verfahren zur Herstellung von gerasterten Druckformen |
| DE2413034C3 (de) * | 1974-03-19 | 1983-11-17 | Dr.-Ing. Rudolf Hell Gmbh, 2300 Kiel | Verfahren und Anordnung zur Vermeidung von Fehlern bei der Reproduktion von Bildvorlagen |
| GB1518578A (en) * | 1975-11-08 | 1978-07-19 | Hell Gmbh | Arrangement for setting the correcting circuit in a colour scanner in a fashion |
| JPS6039220B2 (ja) * | 1976-12-28 | 1985-09-05 | 大日本スクリ−ン製造株式会社 | 製版用カラ−スキヤナ |
| GB2006567B (en) * | 1977-08-25 | 1982-08-25 | Dainippon Screen Mfg | Machine for and method of image production with variable reproduction scale |
| JPS5629237A (en) * | 1979-08-16 | 1981-03-24 | Dainippon Screen Mfg Co Ltd | Image scanning and recording method |
-
1979
- 1979-10-23 JP JP13587979A patent/JPS5660438A/ja active Granted
-
1980
- 1980-10-16 GB GB8033343A patent/GB2061667B/en not_active Expired
- 1980-10-18 DE DE19803039466 patent/DE3039466A1/de active Granted
- 1980-10-21 US US06/199,341 patent/US4350997A/en not_active Expired - Lifetime
- 1980-10-23 FR FR8022897A patent/FR2468261B1/fr not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0212306A (ja) * | 1988-06-30 | 1990-01-17 | Fuji Electric Co Ltd | プログラマブルコントローラの出力駆動装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| FR2468261B1 (fr) | 1986-02-07 |
| GB2061667A (en) | 1981-05-13 |
| US4350997A (en) | 1982-09-21 |
| JPS5660438A (en) | 1981-05-25 |
| FR2468261A1 (fr) | 1981-04-30 |
| DE3039466A1 (de) | 1981-06-11 |
| DE3039466C2 (ja) | 1989-12-07 |
| GB2061667B (en) | 1983-09-14 |
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