JPS6233310B2 - - Google Patents

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Publication number
JPS6233310B2
JPS6233310B2 JP18084681A JP18084681A JPS6233310B2 JP S6233310 B2 JPS6233310 B2 JP S6233310B2 JP 18084681 A JP18084681 A JP 18084681A JP 18084681 A JP18084681 A JP 18084681A JP S6233310 B2 JPS6233310 B2 JP S6233310B2
Authority
JP
Japan
Prior art keywords
etching
film
solution
alloy
iodine
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP18084681A
Other languages
English (en)
Other versions
JPS5881973A (ja
Inventor
Susumu Furuike
Toshio Matsuda
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP56180846A priority Critical patent/JPS5881973A/ja
Publication of JPS5881973A publication Critical patent/JPS5881973A/ja
Publication of JPS6233310B2 publication Critical patent/JPS6233310B2/ja
Granted legal-status Critical Current

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Classifications

    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23FNON-MECHANICAL REMOVAL OF METALLIC MATERIAL FROM SURFACE; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL; MULTI-STEP PROCESSES FOR SURFACE TREATMENT OF METALLIC MATERIAL INVOLVING AT LEAST ONE PROCESS PROVIDED FOR IN CLASS C23 AND AT LEAST ONE PROCESS COVERED BY SUBCLASS C21D OR C22F OR CLASS C25
    • C23F1/00Etching metallic material by chemical means
    • C23F1/10Etching compositions
    • C23F1/14Aqueous compositions

Landscapes

  • Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • General Chemical & Material Sciences (AREA)
  • Engineering & Computer Science (AREA)
  • Materials Engineering (AREA)
  • Mechanical Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Drying Of Semiconductors (AREA)
  • ing And Chemical Polishing (AREA)

Description

【発明の詳細な説明】 本発明は−族化合物半導体の電極のエツチ
ングに関する。
金−ゲルマニウム(Au/Ge)合金は、燐化ガ
リウム(GaP)、砒化ガリウム(GaAs)等の−
族化合物半導体のn形に対して良好なオーミツ
ク性を有するため、現在発光ダイオードや半導体
レーザ等のn側電極として広く用いられている。
このAu/Ge合金を選択的にエツチングするた
めには、第1図に示すように通常ホトレジスト膜
1をマスクとし、同マスクの開孔部を通じて同位
置のAu/Ge合金膜2をエツチングで除去するの
に、ヨウ素、ヨウ化カリからなるいわゆるヨード
エツチ液が用いられている。しかしながら、この
ヨードエツチ液で実際にエツチングを行うとエツ
チ時間が長くなりサイドエツチが起りパターンく
ずれ等を引き起し精度のよいエツチングが困難で
あるという問題が生じてくる。これはAu/Ge合
金膜2の付着時に合金組成物中のゲルマニウムが
基板4と反応し膜2との界面に変成層3が形成さ
れ、基板4との界面近くで付着合金膜のエツチン
グ速度が遅くなることに起因している。
このように、Au/Ge合金の電極形成用膜を通
常のヨードエツチ液で精度よくエツチすることは
極めて難しく、かかるエツチング工程でも、しば
しば、上記変成層3が残る。このためこの部分で
の光の吸収が起り、発光出力が大幅に低下する等
の悪影響を与える。
本発明はこれらの難点を解消することを目的と
してなされたものであり、金−ゲルマニウム合金
を選択的に容易に精度よくエツチングするととも
に、前述の変成層をも除去出来るエツチング法を
提供するものである。
以下、本発明について実施例を参考にして詳細
に述べる。ここではn形基板としてGaAsを用い
た場合について述べるが、本発明は他の−族
化合物半導体、例えば燐化ガリウム(GaP)、砒
化ガリウム・アルミニウム(GaAlAs)等にも適
用出来る。
第2図は本発明の実施例のフローチヤートで、
主要構造を断面図で示したものである。第2図a
に示すように、n形基板4として1.0〜2×1018
cm-3のキヤリア濃度を有するGaAsを用い、表面
を鏡面研磨した後、硫酸:過酸化水素水:水(容
積比8:1:1)でエツチし、真空蒸着法にて、
重量比Au:Ge=100:2.5のAu/Ge合金膜2を付
着する。蒸着条件は基板温度250℃、真空度1.5×
10-6Torr、膜厚は1.5μである。この状態でn形
基板表面には変成層3が生成されている。
次にホトレジスト膜1をマスクとして、140μ
φの円形パターンの選択エツチングを行う。エツ
チング液は第1溶液としてヨウ素、ヨウ化カリ、
水を所定の混合比例えば52g、100g、1で形
成したヨードエツチ液を用い、第2溶液として過
酸化水素水(31%容積比)を用意する。まず、最
初に第1溶液を用いて室温でエツチングする。
Au/Ge膜2は、本来、上記第1溶液でエツチさ
れる筈であるが、膜によつては全くエツチされな
い場合がある。この傾向はAu/Ge合金中のGeの
組成が高くなるほどよくあらわれ、また蒸着時の
形成条件等にも関係しており、イオンマイクロア
ナライザーで解析すると、Au/Ge膜表面にGeの
薄い層が形成されているのが確認された。そこ
で、第2溶液を用いて室温でこのGeをエツチン
グ除去する。この第2溶液ではAu/Ge膜自体を
エツチすることは出来ないので、表面のGe層を
除去後は再び第1溶液に侵す。Au/Ge膜は約
200Å/分の速度でスムーズにエツチングされは
じめるが、基板と膜の界面に近ずくほど、そのエ
ツチング速度が遅くなる。
解析によると、界面近くの膜中にもGeが高濃
度に存在している。そこで、再び第2溶液に侵し
このGe高濃度層を溶解し、次に再び第1溶液で
エツチングする。
このように、第1、第2溶液を用いて、Au/
Ge膜のエツチングを交互に行うことにより、第
2図bのようになる。この状態では、まだ変成層
3が残つているため、第2溶液を用い温度60℃で
除去を開始する。変成層3には、ガリウム
(Ga)、Geが主に含まれており、室温ではエツチ
ング速度が低いため、60℃に加熱エツチングする
方が望ましい。通常、1分以内で第2図cのよう
に変成層3は完全に除去され、除去後の基板表面
5も鏡面を保つている。エツチング完了後、本発
明のエツチング法と通常のヨードエツチング法に
よるパターン精度を比較すると、通常のエツチン
グ法では5μ程度のオーバーエツチが観察された
が、本発明では1.0μ以内におさまつていた。
以上のように、本発明のエツチング法はヨード
エツチ液からなる第1溶液と過酸化水素水からな
る第2溶液を用いて交互にエツチングを行うこと
により、Au/Ge合金膜のエツチを精度よくエツ
チすることを可能ならしめ、かつ上記合金膜形成
時に基板表面に発生する変成層をも確実に除去出
来るものである。
【図面の簡単な説明】
第1図は通常の金−ゲルマニウム合金のエツチ
ング法を説明するための断面図、第2図a〜cは
本発明の一実施例にかかる金−ゲルマニウム合金
のエツチング法の工程断面図。 1……ホトレジスト膜、2……Au/Ge合金
膜、3……変成層、4……n形GaAs基板、5…
…変成層除去後の基板表面。

Claims (1)

    【特許請求の範囲】
  1. 1 ヨウ素、ヨウ化カリ、水を含む第1溶液と過
    酸化水素水を含む第2溶液とを用いて、交互にエ
    ツチングを行うことを特徴とする金−ゲルマニウ
    ム合金膜のエツチング方法。
JP56180846A 1981-11-11 1981-11-11 金−ゲルマニウム合金膜のエツチング方法 Granted JPS5881973A (ja)

Priority Applications (1)

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JP56180846A JPS5881973A (ja) 1981-11-11 1981-11-11 金−ゲルマニウム合金膜のエツチング方法

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JP56180846A JPS5881973A (ja) 1981-11-11 1981-11-11 金−ゲルマニウム合金膜のエツチング方法

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JPS5881973A JPS5881973A (ja) 1983-05-17
JPS6233310B2 true JPS6233310B2 (ja) 1987-07-20

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ID=16090375

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* Cited by examiner, † Cited by third party
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JPH0866209A (ja) * 1994-08-16 1996-03-12 Aucera Technol Corp ウオッチバンドの構造

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US4654116A (en) * 1984-11-09 1987-03-31 American Electronic Laboratories, Inc. Method for producing high resolution etched circuit patterns from clad laminates
TW200823318A (en) * 2006-08-28 2008-06-01 Mitsubishi Chem Corp Etchant and etching method

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JPS5881973A (ja) 1983-05-17

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