JPS623331A - 真偽判別素子、およびそれを用いた外部記憶装置 - Google Patents
真偽判別素子、およびそれを用いた外部記憶装置Info
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- JPS623331A JPS623331A JP60143026A JP14302685A JPS623331A JP S623331 A JPS623331 A JP S623331A JP 60143026 A JP60143026 A JP 60143026A JP 14302685 A JP14302685 A JP 14302685A JP S623331 A JPS623331 A JP S623331A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、外部記憶装置のソフトウェア管理システム
に関し、特に、外部記憶装置に記憶されたソフトウェア
の真偽を管理するシステムに関する。
に関し、特に、外部記憶装置に記憶されたソフトウェア
の真偽を管理するシステムに関する。
［先行技術の説明］
従来、情報処理装置本体に対して外ａＢ記憶装置を装着
し、この外部記憶装置に記憶されたソフトウェアを情報
処理装置本体で実行させるような情報処理システムが種
々提案されている。本願出願人もこのような情報処理シ
ス乎ムとして、情報処理装置本体を家庭用テレビジョン
受像機と接続することによりテレビジョン受像機の画面
上で種々のゲームを楽しむことができ、また、はそのイ
也の目的にも使用できるような家庭用ビデオゲーム装置
を開発し製品化している（商品名ファミリーコンピュー
タ）。
し、この外部記憶装置に記憶されたソフトウェアを情報
処理装置本体で実行させるような情報処理システムが種
々提案されている。本願出願人もこのような情報処理シ
ス乎ムとして、情報処理装置本体を家庭用テレビジョン
受像機と接続することによりテレビジョン受像機の画面
上で種々のゲームを楽しむことができ、また、はそのイ
也の目的にも使用できるような家庭用ビデオゲーム装置
を開発し製品化している（商品名ファミリーコンピュー
タ）。
ところで、上記のような情報処理システムでは、ユーザ
が市販されている複数種類のソフトウェアの中から所望
のものを購入して情報処理装置本体に装着することによ
り、種々のソフトウェアが利用できるような構成となっ
ている。しかしながら、市販されているソフトウェアの
中には、品質が劣悪なものもあり、そのような粗悪品が
人聞に販売されると、情報処理システム自体の商品イメ
ージが低下してしまい市場性が失われてしまうことにな
る。そのため、優れた情報処理システムをｍ４Ｒした者
は、それに使用されるソフトウェアの品質について管理
する必要があった。
が市販されている複数種類のソフトウェアの中から所望
のものを購入して情報処理装置本体に装着することによ
り、種々のソフトウェアが利用できるような構成となっ
ている。しかしながら、市販されているソフトウェアの
中には、品質が劣悪なものもあり、そのような粗悪品が
人聞に販売されると、情報処理システム自体の商品イメ
ージが低下してしまい市場性が失われてしまうことにな
る。そのため、優れた情報処理システムをｍ４Ｒした者
は、それに使用されるソフトウェアの品質について管理
する必要があった。
［発明が解決しようとする問題点］
しかしながら、従来は、上記のようなソフトウェアの品
質を管理するための有効な手段はなく、他人によるソフ
トウェアの販売は全く野放しの状態であった。そのため
、多大な経費と労力をかけて優れた情報処理システムを
開発しても、他人によって粗悪なソフトウェアが乱売さ
れれば、商品価値の低下により大きな損害を被ることと
なるという問題があった。このことは、逆に、消費者に
対して品質の低いソフトウェアが提供されるのを訂会す
ることになり、社会的見地からも好ましくない。
質を管理するための有効な手段はなく、他人によるソフ
トウェアの販売は全く野放しの状態であった。そのため
、多大な経費と労力をかけて優れた情報処理システムを
開発しても、他人によって粗悪なソフトウェアが乱売さ
れれば、商品価値の低下により大きな損害を被ることと
なるという問題があった。このことは、逆に、消費者に
対して品質の低いソフトウェアが提供されるのを訂会す
ることになり、社会的見地からも好ましくない。
この発明は、上記のような問題点を解消するためになさ
れたもので、情報処理装置本体に装着される外部記憶装
置の真偽を高精度に判別でき、それによって使用される
ソフトウェアの管理をほぼ完全に行なうことができるよ
うな外部記憶装置のソフトウェア管理システムを提供す
ることを目的とする。
れたもので、情報処理装置本体に装着される外部記憶装
置の真偽を高精度に判別でき、それによって使用される
ソフトウェアの管理をほぼ完全に行なうことができるよ
うな外部記憶装置のソフトウェア管理システムを提供す
ることを目的とする。
［問題点を解決するための手段］
この発明は、要約すれば、情報処理装置本体と、この情
報処理装置本体に対して着脱自在に構成された外部記憶
装置とを含む。上記外部記憶装置は、所望の情報処理の
ためのプログラムを記憶する記憶手段と、当該外部記憶
装置の真偽を判別するためのプログラムを記憶する第１
の半導体メモリと、この第１の半導体メモリに記憶され
ているプログラムを実行する第１の処理手段とを含む。
報処理装置本体に対して着脱自在に構成された外部記憶
装置とを含む。上記外部記憶装置は、所望の情報処理の
ためのプログラムを記憶する記憶手段と、当該外部記憶
装置の真偽を判別するためのプログラムを記憶する第１
の半導体メモリと、この第１の半導体メモリに記憶され
ているプログラムを実行する第１の処理手段とを含む。
上記情報処理装置本体は、外部記憶装置の記憶手段に記
憶されているプログラムに基づいて所望の情報処理を実
行する中央処理手段と、外部記憶装置の第１の半導体メ
モリに記憶されているプログラムに関連するプログラム
でありかつ外部記憶装置の真偽判別のためのプログラム
を記憶する第２の半導体メモリと、外部記憶装置の第１
の処理手段と同じ性能を有しかつ第２の半導体メモリに
記憶されているプログラムを実行する第２の処理手段と
を含む。ざらに、この発明は、判断手段と、能動化手段
とを備える。上記判断手段は、中央処理手段の動作に先
立って第１の処理手段が第１の半導体メモリに記憶され
ているプログラムを実行しかつ第２の処理手段が第２の
半導体メモリに記憶されているプログラムを実行すると
き、第１の処理手段の動作状態と第２の処理手段の動作
状態とが所定の関係であることを判断するものである。
憶されているプログラムに基づいて所望の情報処理を実
行する中央処理手段と、外部記憶装置の第１の半導体メ
モリに記憶されているプログラムに関連するプログラム
でありかつ外部記憶装置の真偽判別のためのプログラム
を記憶する第２の半導体メモリと、外部記憶装置の第１
の処理手段と同じ性能を有しかつ第２の半導体メモリに
記憶されているプログラムを実行する第２の処理手段と
を含む。ざらに、この発明は、判断手段と、能動化手段
とを備える。上記判断手段は、中央処理手段の動作に先
立って第１の処理手段が第１の半導体メモリに記憶され
ているプログラムを実行しかつ第２の処理手段が第２の
半導体メモリに記憶されているプログラムを実行すると
き、第１の処理手段の動作状態と第２の処理手段の動作
状態とが所定の関係であることを判断するものである。
上記能動化手段は、判断手段が所定の関係を判断したこ
とに基づいて中央処理手段の動作を能動化させるもので
ある。
とに基づいて中央処理手段の動作を能動化させるもので
ある。
［作用］
中央処理手段が外部の記憶手段のプログラムに基づいて
本来の動作を開始するのに先立って、外部記憶装置の第
１の処理手段は第１の半導体メモリに記憶された真偽判
別のためのプログラムを実行する。情報処理装置本体の
第２の処理手段は第２の半導体メモリに記憶された真偽
判別のためのプログラムを実行する。判断手段は第１お
よび第２の処理手段が上記プログラムを実行するとき、
第１の処理手段の動作状態と第２の処理手段の動作状態
とが所定の関係であることを判断する。能動化手段は判
断手段が所定の関係を判断したことに基づいて中央処理
手段の動作を能動化させる。
本来の動作を開始するのに先立って、外部記憶装置の第
１の処理手段は第１の半導体メモリに記憶された真偽判
別のためのプログラムを実行する。情報処理装置本体の
第２の処理手段は第２の半導体メモリに記憶された真偽
判別のためのプログラムを実行する。判断手段は第１お
よび第２の処理手段が上記プログラムを実行するとき、
第１の処理手段の動作状態と第２の処理手段の動作状態
とが所定の関係であることを判断する。能動化手段は判
断手段が所定の関係を判断したことに基づいて中央処理
手段の動作を能動化させる。
それによって、正規または真性の外部記憶装置のみを使
用可能とする。
用可能とする。
［実施例］
：・
第２図はビデオゲーム装置に適用、されたこの発
：１゜・（ 明の一実施例を示す外観斜視図である。図におＩＩＮ
、ｊｌ、１ て、情報処理装置本体（以下、単に「本体」と称
、。
：１゜・（ 明の一実施例を示す外観斜視図である。図におＩＩＮ
、ｊｌ、１ て、情報処理装置本体（以下、単に「本体」と称
、。
、ン１゜
す）１には、外部機器としてのゲームコントロー
：゛）１゛ル ラ３ａおよび３ｂと、ＣＲＴ表示器４とが接続さ
９゛昂 れる。また、本体１は外部記憶装置としてのＲＯ。
：゛）１゛ル ラ３ａおよび３ｂと、ＣＲＴ表示器４とが接続さ
９゛昂 れる。また、本体１は外部記憶装置としてのＲＯ。
、１
Ｍカートリッジ（またはＲＯＭカセット）２が看
１、脱自在な精成とされる。ＲＯＭカートリッジ２に
、：：゛、′・ は、ゲーム構成のために必要なソフトウェアない
、；しプログラムが格納されている。
・；□”□５；ｊ 第３図は第２図に示す実施例の電気回路部分を １
、。
１、脱自在な精成とされる。ＲＯＭカートリッジ２に
、：：゛、′・ は、ゲーム構成のために必要なソフトウェアない
、；しプログラムが格納されている。
・；□”□５；ｊ 第３図は第２図に示す実施例の電気回路部分を １
、。
；−９憚
示す概略ブロック図である。まず、本体１の構成
“、ピ・Ｉｔ について説明する。接続コネクター１には、中央
＋１ 処理手段としてのＣＰＬ１１２と、ＶＤＣ（ビデオ
。
“、ピ・Ｉｔ について説明する。接続コネクター１には、中央
＋１ 処理手段としてのＣＰＬ１１２と、ＶＤＣ（ビデオ
。
ディスプレイコントローラ）１３と、ディジタルＩＣ１
４と、クロック発振器（以下、単に発振器と称す）１５
とが接続される。接続コネクタ１１は、本体１にＲＯＭ
カートリッジ２が装着されたとき、ＲＯＭカートリッジ
２の接続コネクタ２１と結合きれ、それによって本体１
の内部回路とＲＯＭカートリッジ２の内部回路との電気
的接続を図る。ＣＰＬ１１２は、本体１の動作を制御す
るためのものである。ＶＤＣ１３は、ＣＲＴ表示器４の
表示動作を制御するためのものである。ディジタルＩＣ
１４は、後述するＲＯＭカートリッジ２のディジタル１
Ｇ２４と協働して、本体１に装着されたＲＯＭカートリ
ッジ２の真偽を判別するためのものである。発振器１５
の発振出力はりＯツク信号としてディジタルＩＣ１４に
与えられる。
４と、クロック発振器（以下、単に発振器と称す）１５
とが接続される。接続コネクタ１１は、本体１にＲＯＭ
カートリッジ２が装着されたとき、ＲＯＭカートリッジ
２の接続コネクタ２１と結合きれ、それによって本体１
の内部回路とＲＯＭカートリッジ２の内部回路との電気
的接続を図る。ＣＰＬ１１２は、本体１の動作を制御す
るためのものである。ＶＤＣ１３は、ＣＲＴ表示器４の
表示動作を制御するためのものである。ディジタルＩＣ
１４は、後述するＲＯＭカートリッジ２のディジタル１
Ｇ２４と協働して、本体１に装着されたＲＯＭカートリ
ッジ２の真偽を判別するためのものである。発振器１５
の発振出力はりＯツク信号としてディジタルＩＣ１４に
与えられる。
また、発振器１５の発振出力は、本体１にＲＯＭカート
リッジ２が装着されたとき、接続コネクタ１１および２
１を介してディジタルＩＣ２４にクロック信号として与
えられる。ＣＰＬ１１２には、Ｉ１０インターフェイス
１６が接続される。この実施例では、外部機器としてゲ
ームコントローラ３ａおよび３ｂと、ＣＲＴ表示器４と
がＩ１０インターフェイス１６に接続される。なお、Ｉ
１０インターフェイス１６に接続される外部機器は第３
図のものに限らず種々のものが接続可能である。
リッジ２が装着されたとき、接続コネクタ１１および２
１を介してディジタルＩＣ２４にクロック信号として与
えられる。ＣＰＬ１１２には、Ｉ１０インターフェイス
１６が接続される。この実施例では、外部機器としてゲ
ームコントローラ３ａおよび３ｂと、ＣＲＴ表示器４と
がＩ１０インターフェイス１６に接続される。なお、Ｉ
１０インターフェイス１６に接続される外部機器は第３
図のものに限らず種々のものが接続可能である。
次に、ＲＯＭカートリッジ２の構成について説明する。
接続コネクタ２１には、プログラムＲＯＭ２２と、キャ
ラクタＲＯＭ２３と、ディジタルＩＣ２４とが接続され
る。プログラムＲＯＭ２２は、本体１で実行されるプロ
グラムすなわちソフトウェアが格納される。この実施例
は、ビデオゲーム装置に適用されているため、プログラ
ムＲＯＭ２２には、ゲームのだめのソフトウェアが格納
されている。キャラクタＲＯＭ２３は、ＣＲＴ表示器４
に表示させる種々のキャラクタに関する情報が格納され
ている。ディジタルＩＣ２４は、ＲＯＭカートリッジ２
が本体１に装着されたとき、本体側のディジタルＩＣ１
４と協働してＲＯＭカートリッジ２の真偽の判別を行な
う。
ラクタＲＯＭ２３と、ディジタルＩＣ２４とが接続され
る。プログラムＲＯＭ２２は、本体１で実行されるプロ
グラムすなわちソフトウェアが格納される。この実施例
は、ビデオゲーム装置に適用されているため、プログラ
ムＲＯＭ２２には、ゲームのだめのソフトウェアが格納
されている。キャラクタＲＯＭ２３は、ＣＲＴ表示器４
に表示させる種々のキャラクタに関する情報が格納され
ている。ディジタルＩＣ２４は、ＲＯＭカートリッジ２
が本体１に装着されたとき、本体側のディジタルＩＣ１
４と協働してＲＯＭカートリッジ２の真偽の判別を行な
う。
ここで、上記ディジタルＩＣ１４ｉよび２４についてさ
らに詳しく説明する。前述のように、ディジタルＩＣ１
４および２４はそれぞれが協働してＲＯＭカートリッジ
２の真偽を判別するが、これら２つのディジタルＩＣ１
４および２４のそれぞれの機能はいわゆる錠と鍵の関係
に譬えることができる。したがって、以下の説明では、
ディジタルＩＣ１４をロック用ＩＣと称し、ディジタル
ＩＣ２４をキー用ＩＣと称する。ロック用ＩＣ１４は成
る端子が接地され、キー用ＩＣ２４は成る端子が電源ラ
インに接続される。これによって、ロック用ＩＣ１４お
よびキー用ＩＣ２４は同一の例えば４ピツトマイコンか
ら構成されるものであっても自己がロックの役目または
キーの役目のいずれであるかを判別することができる。
らに詳しく説明する。前述のように、ディジタルＩＣ１
４および２４はそれぞれが協働してＲＯＭカートリッジ
２の真偽を判別するが、これら２つのディジタルＩＣ１
４および２４のそれぞれの機能はいわゆる錠と鍵の関係
に譬えることができる。したがって、以下の説明では、
ディジタルＩＣ１４をロック用ＩＣと称し、ディジタル
ＩＣ２４をキー用ＩＣと称する。ロック用ＩＣ１４は成
る端子が接地され、キー用ＩＣ２４は成る端子が電源ラ
インに接続される。これによって、ロック用ＩＣ１４お
よびキー用ＩＣ２４は同一の例えば４ピツトマイコンか
ら構成されるものであっても自己がロックの役目または
キーの役目のいずれであるかを判別することができる。
ロック用ＩＣ１４およびキー用ＩＣ２４はデータの入出
力を行なうために、゛一方側のデータ出力端子が他方側
のデータ入力端子に接続される。また、ロック用ＴＣ１
４からはキー用ＩＣ２４にリセット信号が与えられる。
力を行なうために、゛一方側のデータ出力端子が他方側
のデータ入力端子に接続される。また、ロック用ＴＣ１
４からはキー用ＩＣ２４にリセット信号が与えられる。
また、ロック用ＩＣ１４およびキー用ＩＣ２４には、前
述の発ノ辰器１５がらクロック信号ＣＬＫが与えられる
。したがって、ロック用ｌ０１４およびキー用ＩＣ２４
はそれぞれの動作周期および位相が完全に同期して動作
を行なうように構成されている。また、ロック用ＩＣ１
４には、リセットスイッチＲ８が接続される。ロック用
［Ｃ１４は、このリセットスイッチＲ８のオンにより動
作を開始するように構成されている。
述の発ノ辰器１５がらクロック信号ＣＬＫが与えられる
。したがって、ロック用ｌ０１４およびキー用ＩＣ２４
はそれぞれの動作周期および位相が完全に同期して動作
を行なうように構成されている。また、ロック用ＩＣ１
４には、リセットスイッチＲ８が接続される。ロック用
［Ｃ１４は、このリセットスイッチＲ８のオンにより動
作を開始するように構成されている。
さらに、ロック用ｔｃｉ４には、リセットスイッチＲ８
と並列にリセット用コンデンサＣＲが接続される。この
リセット用コンデンサＣＲは、本体１の電源（図示せず
）をオンするときに充電されて所定時間ロック用ｒｃ１
４をリセット状態に保つ（パワーオンクリア）。ロック
用ＩＣ１４は、このリセット用コンデンサＣＲによるリ
セットによっても初期リセットされるように構成されて
いる。さらに、ロック用ＩＣ１４からは、ＣＰＵ １２
およびＶＤＣ１３にリセット信号が与えられる。
と並列にリセット用コンデンサＣＲが接続される。この
リセット用コンデンサＣＲは、本体１の電源（図示せず
）をオンするときに充電されて所定時間ロック用ｒｃ１
４をリセット状態に保つ（パワーオンクリア）。ロック
用ＩＣ１４は、このリセット用コンデンサＣＲによるリ
セットによっても初期リセットされるように構成されて
いる。さらに、ロック用ＩＣ１４からは、ＣＰＵ １２
およびＶＤＣ１３にリセット信号が与えられる。
第４図は第３図に示すロック用ｒｃ１４の詳細を示すブ
ロック図である。図において、ロック用ＩＣ１４は、た
とえば４ビツトのマイクロコンビュータによって構成さ
れる。すなわち、ロック用ｒｃ１４は、第２の処理手段
の一例のＣＰｔＪ１４１と、第２の半導体メモリの一例
のＲＯＭ１４２と、ＣＰＵ １４１のデータ処理に必要
な種々のデータを記憶するＲＡＭ１４３とを含む。ここ
で、ＲＯＭ１４２はＣＰ（Ｊ １４１の動作プログラム
を格納するが、この動作プログラムには第１の演算処理
用プログラムと第２の演算処理用プログラムとが含まれ
ている。第２の演算処理用プログラムには、複数種類の
演算式および演算のための乱数データが含まれている。
ロック図である。図において、ロック用ＩＣ１４は、た
とえば４ビツトのマイクロコンビュータによって構成さ
れる。すなわち、ロック用ｒｃ１４は、第２の処理手段
の一例のＣＰｔＪ１４１と、第２の半導体メモリの一例
のＲＯＭ１４２と、ＣＰＵ １４１のデータ処理に必要
な種々のデータを記憶するＲＡＭ１４３とを含む。ここ
で、ＲＯＭ１４２はＣＰ（Ｊ １４１の動作プログラム
を格納するが、この動作プログラムには第１の演算処理
用プログラムと第２の演算処理用プログラムとが含まれ
ている。第２の演算処理用プログラムには、複数種類の
演算式および演算のための乱数データが含まれている。
また、上記動作プログラムには、第１の演算処理用プロ
グラムの演算結果をキー用ＩＣ２４の演算結果と比較照
合する判断プログラムおよび第２の演算処理用プログラ
ムの演算結果をキー用ＩＣ２４の演算結果と照合するだ
めの判断プログラムが含まれる。この判断プログラムが
実行されるとき、ＣＰＵ １４１は判断手段として機能
する。さらに、上記動作プログラムには、上記判断プロ
グラムの判断結果に基づいて本体１のリセットもしくは
りセット解除を制御するだめの制御プログラムが含まれ
ている。この制御プログラムが実行されるとき、ＣＰＵ
１４１は能動化手段として機能する。
グラムの演算結果をキー用ＩＣ２４の演算結果と比較照
合する判断プログラムおよび第２の演算処理用プログラ
ムの演算結果をキー用ＩＣ２４の演算結果と照合するだ
めの判断プログラムが含まれる。この判断プログラムが
実行されるとき、ＣＰＵ １４１は判断手段として機能
する。さらに、上記動作プログラムには、上記判断プロ
グラムの判断結果に基づいて本体１のリセットもしくは
りセット解除を制御するだめの制御プログラムが含まれ
ている。この制御プログラムが実行されるとき、ＣＰＵ
１４１は能動化手段として機能する。
また、ＣＰＵ １４１にはアキュムレータ１４４が接続
される。一方、ＲＯＭ１４２にはレジスタ１４５が接続
される。このレジスタ１４５は、ＲＯＭ１４２から読出
されたプログラムデータを一時格納しておくためのもの
である。ＣＰＵ １４１と、アキュムレータ１４４と、
レジスタ１４５は、データバスＤＢによって接続される
。このデータバスＤＢは、■１０ボート１４７に接続さ
れる。
される。一方、ＲＯＭ１４２にはレジスタ１４５が接続
される。このレジスタ１４５は、ＲＯＭ１４２から読出
されたプログラムデータを一時格納しておくためのもの
である。ＣＰＵ １４１と、アキュムレータ１４４と、
レジスタ１４５は、データバスＤＢによって接続される
。このデータバスＤＢは、■１０ボート１４７に接続さ
れる。
このｉ１０ボート１４７からは、−１−−用［ｃ２４に
向けてデータが出力され、またキー用ＩＣ２４からのデ
ータを受ける。また、ＣＰＵ１４１からは、Ｉ１０ボー
ト１４７を介して２つのリセット信号が出力される。一
方のリセット信号は、キー用ＩＣ２４に与えられる。他
方のリセット信号はＣＰＵ１４１およびＶＤＣｌ ３に
与えられる。なお、キー用ＩＣ２４も同様のリセット信
号を出力する端子を有しているが、これらの端子はいず
れの回路にも接続されていない。さらに、ロック用ＩＣ
１４には、前述の発振器１５から与えられるクロック信
号ＣＬＫを分周するための分周器１４６が設けられる。
向けてデータが出力され、またキー用ＩＣ２４からのデ
ータを受ける。また、ＣＰＵ１４１からは、Ｉ１０ボー
ト１４７を介して２つのリセット信号が出力される。一
方のリセット信号は、キー用ＩＣ２４に与えられる。他
方のリセット信号はＣＰＵ１４１およびＶＤＣｌ ３に
与えられる。なお、キー用ＩＣ２４も同様のリセット信
号を出力する端子を有しているが、これらの端子はいず
れの回路にも接続されていない。さらに、ロック用ＩＣ
１４には、前述の発振器１５から与えられるクロック信
号ＣＬＫを分周するための分周器１４６が設けられる。
この分周器１４６の分周比は、たとえば１／４に選ばれ
ている。
ている。
なお、キー用ＩＣ２４もロック用ＩＣ１４と全く同様に
構成されるので、その詳細を省略するが、以下の説明で
はロック用ＩＣ１４の各部と対応する部分は第５図の括
弧磨きに示す符号を付けて説明する。
構成されるので、その詳細を省略するが、以下の説明で
はロック用ＩＣ１４の各部と対応する部分は第５図の括
弧磨きに示す符号を付けて説明する。
次に、第５図のタイムチャートを参照して、分周器１４
６の動作について簡単に説明する。上述のように、分周
器１４６は発振器１５からのクロック信号ＣＬＫを１／
４の分周比で分周するが、その結果位相の異なる４つの
クロック信号Φ１゜Φ２．Φ３およびΦ４を発生する。
６の動作について簡単に説明する。上述のように、分周
器１４６は発振器１５からのクロック信号ＣＬＫを１／
４の分周比で分周するが、その結果位相の異なる４つの
クロック信号Φ１゜Φ２．Φ３およびΦ４を発生する。
これらクロック信号Φ１〜Φ４は、ＣＰＩＪ １４１に
与えられる。
与えられる。
ＣＰｔＪ１４１は、これら４つのクロック信号Φ１〜Φ
４に同期して、順次所定の動作を行なう。たとえば、ク
ロック信号Φ１でデータの読込みを行ない、Φ２および
Φ３で所定の演算処理等を行なう。そして、クロック信
号Φ４でデータの出力等を行なう。キー用ｒＧ２４のＣ
ＰＵ１４１にも上述と同様のクロック信号Φ１〜Φ４が
与えられており、ロック用ＩＣ１４のＣＰＵ １４１と
完全に同期して動作を実行する。すなわら、ロック用■
Ｃ１４とキー用ＩＣ２４は、動作プログラムのステップ
数およびアーキテクチャが同一であり、しかもハード回
路もクロック信号も全く同様であるため、それぞれのマ
シンサイクルも完全に一致しでいる。
４に同期して、順次所定の動作を行なう。たとえば、ク
ロック信号Φ１でデータの読込みを行ない、Φ２および
Φ３で所定の演算処理等を行なう。そして、クロック信
号Φ４でデータの出力等を行なう。キー用ｒＧ２４のＣ
ＰＵ１４１にも上述と同様のクロック信号Φ１〜Φ４が
与えられており、ロック用ＩＣ１４のＣＰＵ １４１と
完全に同期して動作を実行する。すなわら、ロック用■
Ｃ１４とキー用ＩＣ２４は、動作プログラムのステップ
数およびアーキテクチャが同一であり、しかもハード回
路もクロック信号も全く同様であるため、それぞれのマ
シンサイクルも完全に一致しでいる。
第１図は上記実施例におけるロック用ＩＣ１４およびキ
ー用ＩＣ２４の基本的な動作を示す７０ ′−
チャートである。以下、この第１図を参照してよ。□。
ー用ＩＣ２４の基本的な動作を示す７０ ′−
チャートである。以下、この第１図を参照してよ。□。
。。□ヤ□□６□お、４ ］・体的な動作の説明に
ついては、第６図を参照して後に述べる。まず、ＲＯＭ
カートリッジ２が本体１に装着されて本体１の電源（図
示せず）がオンされると、動作を開始する（ステップ８
１）。続 ゛いて、ロック用ＩＣ１４が本体１
の種々の機器（ＣＰＵＩ ２．ＶＤｏｌ ３等）をリセ
ットし、その状態を保持する（ステップ８２）。これに
よって、本体１はゲームの実行が行なえない状態となっ
ている。次に、ロック用１０１４とキー用ＩＣ２４との
同期がとられる（ステップ８３）。このときの同期のと
り方について第５図を参照して説明する。ロック用ＩＣ
１４からキー用ＩＣ２４に与えられるリセット信号は、
クロック信号ＣＬＫの成る周期のクロック信号Φ４と次
の周期のクロック信号Φ１との間で出力されるようにロ
ック用ＩＣ１４のマシンサイクルが設定されている。そ
のため、キー用ＩＣ２４には、必ずクロック信号Φ１か
ら動作を開始することになる。したがって、キー用ＩＣ
２４はロック用ｒｃ１４と全く同一のマシンサイクルか
ら動作を開始することになる。
ついては、第６図を参照して後に述べる。まず、ＲＯＭ
カートリッジ２が本体１に装着されて本体１の電源（図
示せず）がオンされると、動作を開始する（ステップ８
１）。続 ゛いて、ロック用ＩＣ１４が本体１
の種々の機器（ＣＰＵＩ ２．ＶＤｏｌ ３等）をリセ
ットし、その状態を保持する（ステップ８２）。これに
よって、本体１はゲームの実行が行なえない状態となっ
ている。次に、ロック用１０１４とキー用ＩＣ２４との
同期がとられる（ステップ８３）。このときの同期のと
り方について第５図を参照して説明する。ロック用ＩＣ
１４からキー用ＩＣ２４に与えられるリセット信号は、
クロック信号ＣＬＫの成る周期のクロック信号Φ４と次
の周期のクロック信号Φ１との間で出力されるようにロ
ック用ＩＣ１４のマシンサイクルが設定されている。そ
のため、キー用ＩＣ２４には、必ずクロック信号Φ１か
ら動作を開始することになる。したがって、キー用ＩＣ
２４はロック用ｒｃ１４と全く同一のマシンサイクルか
ら動作を開始することになる。
これによって、ロック用ＩＣ１４とキー用ＩＣ２４との
同期が取られ、以後完全に同期した状態でそれぞれが動
作を行なう。
同期が取られ、以後完全に同期した状態でそれぞれが動
作を行なう。
次に、ロック用ＩＣ１４およびキー用ＩＣ２４は、それ
ぞれが完全に同期した状態で所定の演算処理を行なう（
ステップ８４．８４”）。このとき、ロック用ＩＣ１４
で行なわれる演算処理とキー用ＩＣ２４で行なわれる演
算処理とは同じものである。したがって、もしＲＯＭカ
ートリッジ２が正規のものであれば、ステップＳ４およ
びステップＳ４＝で行なわれる演算の結果も同じものと
なる。次に、ロック用ＩＣ１４とキー用ＩＣ２４との間
で演算結果の授受が行なわれる（ステップ３５）。続い
て、ロック用ＩＣ１４およびキー用ＩＣ２４は、自己が
行なった演算の結果と、相手方が行なった演算の結果と
を比較照合し、それぞれが一致するか否かを判断する（
ステップ３６）。
ぞれが完全に同期した状態で所定の演算処理を行なう（
ステップ８４．８４”）。このとき、ロック用ＩＣ１４
で行なわれる演算処理とキー用ＩＣ２４で行なわれる演
算処理とは同じものである。したがって、もしＲＯＭカ
ートリッジ２が正規のものであれば、ステップＳ４およ
びステップＳ４＝で行なわれる演算の結果も同じものと
なる。次に、ロック用ＩＣ１４とキー用ＩＣ２４との間
で演算結果の授受が行なわれる（ステップ３５）。続い
て、ロック用ＩＣ１４およびキー用ＩＣ２４は、自己が
行なった演算の結果と、相手方が行なった演算の結果と
を比較照合し、それぞれが一致するか否かを判断する（
ステップ３６）。
上述のように、ＲＯＭカートリッジ２が正規のものであ
れば、この演算結果は一致する筈であるから、一致しな
い場合はＲＯＭカートリッジ２が正規のものでないと判
断され、本体１のリセット状態が解除されない（ステッ
プＳ７）。したがって、本体１ではゲームの実行が行な
われない。一方、ロック用ＩＣ１４の演算結果とキー用
Ｉ Ｃ２４の演算結果とが一致した場合は、本体１のＣ
Ｐ、Ｕ１２やＶＤＣｌ３等のリセット状態が解除される
（ステップ８８）。これによって、本体１のＣＰＵ１２
はＲＯＭカートリッジ２のプログラムＲＯＭ２２に記憶
されたゲームプログラムの実行を開始する。
れば、この演算結果は一致する筈であるから、一致しな
い場合はＲＯＭカートリッジ２が正規のものでないと判
断され、本体１のリセット状態が解除されない（ステッ
プＳ７）。したがって、本体１ではゲームの実行が行な
われない。一方、ロック用ＩＣ１４の演算結果とキー用
Ｉ Ｃ２４の演算結果とが一致した場合は、本体１のＣ
Ｐ、Ｕ１２やＶＤＣｌ３等のリセット状態が解除される
（ステップ８８）。これによって、本体１のＣＰＵ１２
はＲＯＭカートリッジ２のプログラムＲＯＭ２２に記憶
されたゲームプログラムの実行を開始する。
第６図は上記実施例のさらに詳しい動作を説明するため
のフローチャートである。以下、この第６図を参照して
、上記実施例の詳細な動作を説明する。ＲＯＭカートリ
ッジ２が本体１に装着されて、本体１の電源（図示せず
）がオンされるがまたはリセットスイッチＲ８がオンさ
れると、ロック用ＩＣ１４のリセット動作が行なわれ、
ロック用ＩＣ１４は動作を開始する（ステップ５１０）
。
のフローチャートである。以下、この第６図を参照して
、上記実施例の詳細な動作を説明する。ＲＯＭカートリ
ッジ２が本体１に装着されて、本体１の電源（図示せず
）がオンされるがまたはリセットスイッチＲ８がオンさ
れると、ロック用ＩＣ１４のリセット動作が行なわれ、
ロック用ＩＣ１４は動作を開始する（ステップ５１０）
。
続いて、ステップＳ１１に進み、ロック用ＩＣ１４は自
己がロック用ＩＣか゛キー用ＩＣかを判断する。この判
断は、第３図で説明したように、成る端子が接地されて
いるかあるいは電源ラインに接続されているかを判別す
ることによって行なわれる。この場合、ロック用ＩＣと
判断される筈であるが、たとえば配線ミスや動作不良等
によってキー用ＩＣと判断された場合は、不安定な状態
となり何の動作も行なわれない。ロック用ＩＣと判断さ
れた場合は、ステップ８１２に進み、本体１がゲームプ
ログラムを実行しないように各回路にリセットをかけ、
このリセット状態を続ける。すなわち、ＣＰＵ１２やＶ
ＤＣｌ ３は、後述ノステップ８２１においてリセット
解除されるまでリセット状態に強制されて不能動化され
ることになる。
己がロック用ＩＣか゛キー用ＩＣかを判断する。この判
断は、第３図で説明したように、成る端子が接地されて
いるかあるいは電源ラインに接続されているかを判別す
ることによって行なわれる。この場合、ロック用ＩＣと
判断される筈であるが、たとえば配線ミスや動作不良等
によってキー用ＩＣと判断された場合は、不安定な状態
となり何の動作も行なわれない。ロック用ＩＣと判断さ
れた場合は、ステップ８１２に進み、本体１がゲームプ
ログラムを実行しないように各回路にリセットをかけ、
このリセット状態を続ける。すなわち、ＣＰＵ１２やＶ
ＤＣｌ ３は、後述ノステップ８２１においてリセット
解除されるまでリセット状態に強制されて不能動化され
ることになる。
また、このステップ８１２では、キー用ＩＣ２４をリセ
ットする。次に、ステップ８１３に進み、ロック用ＩＣ
１４はキー用ＩＣ２４のリセットを解除し、ロック用ｒ
ｃ１４との同期をとる。このステップ３１３の動作は、
第１図のステップＳ３に対応し、その詳細な動作は第１
図において説明したのでここでは省略する。
ットする。次に、ステップ８１３に進み、ロック用ＩＣ
１４はキー用ＩＣ２４のリセットを解除し、ロック用ｒ
ｃ１４との同期をとる。このステップ３１３の動作は、
第１図のステップＳ３に対応し、その詳細な動作は第１
図において説明したのでここでは省略する。
ステップ８１３でキー用Ｉ Ｃ２４のリセットが解除さ
れると、キー用ＩＣ２４は、自己がロック用ｒＣかキー
用ＩＣかを判断する（ステップ８１１−）。このステッ
プ８１１−の判断は、前述のステップ８１１と同様に、
キー用ＩＣ２４の成る端子が接地されているか電源ライ
ンに接続されているかを判別することによって行なわれ
る。このステップ５１１−ではキー用ＩＣと判断される
筈であるが、配線ミスや動作不良等によりロック用ＩＣ
と判断された場合は、不安定な状態となり何の動作も行
なわれない。一方、キー用ＩＣと判断された場合は、ス
テップ８１４−以下の動作が実行される。これに対し、
ロック用ＩＣ１４では、ステップ８１３の動作の後、ス
テップ８１４以下の動作が実行される。以後、ロック用
ＩＣ１４およびキー用ＩＣ２４では、全く同様の動作が
同期して（時間軸が一致して）行なわれる。
れると、キー用ＩＣ２４は、自己がロック用ｒＣかキー
用ＩＣかを判断する（ステップ８１１−）。このステッ
プ８１１−の判断は、前述のステップ８１１と同様に、
キー用ＩＣ２４の成る端子が接地されているか電源ライ
ンに接続されているかを判別することによって行なわれ
る。このステップ５１１−ではキー用ＩＣと判断される
筈であるが、配線ミスや動作不良等によりロック用ＩＣ
と判断された場合は、不安定な状態となり何の動作も行
なわれない。一方、キー用ＩＣと判断された場合は、ス
テップ８１４−以下の動作が実行される。これに対し、
ロック用ＩＣ１４では、ステップ８１３の動作の後、ス
テップ８１４以下の動作が実行される。以後、ロック用
ＩＣ１４およびキー用ＩＣ２４では、全く同様の動作が
同期して（時間軸が一致して）行なわれる。
まず、ロック用ｒｃ１４およびキー用ＩＣ・２４は、乱
数的に暗号符号を出力する（ステップＳ１４および８１
４Ｍ。この暗号符号の出力は全く同じランダム関数を用
いて行なわれる。そして。
数的に暗号符号を出力する（ステップＳ１４および８１
４Ｍ。この暗号符号の出力は全く同じランダム関数を用
いて行なわれる。そして。
ランダム関数に与えられる条件もロック用ｆｃ１４とキ
ー用ＩＣ２４とで同じである。したがって、ＲＯＭカー
トリッジ２が正規のものである場合は、ロック用Ｉ Ｃ
１’４で発生される暗号符号とキー用ｒｃ２４で発生さ
れる暗号符号とは全く同一のものとなる。次に、ロック
用ＩＣ１４およびキー用ＩＣ２４はデータの交信を行な
い、それぞれ相手方の発生した暗号符号を入力する（ス
テップ＄１５および８１５Ｍ。続いて、相手方から入力
した暗号符号に基づいて、所定の演算処理を行なう（ス
テップ８１６およびＳ １６− ＞、。この演算処理に
用いられる演算式は、ロック用ＩＣ１４とキー用ＩＣ２
４とで全く同一のため、入力される暗号符号が同一の場
合はこの演算結果も同一となる。
ー用ＩＣ２４とで同じである。したがって、ＲＯＭカー
トリッジ２が正規のものである場合は、ロック用Ｉ Ｃ
１’４で発生される暗号符号とキー用ｒｃ２４で発生さ
れる暗号符号とは全く同一のものとなる。次に、ロック
用ＩＣ１４およびキー用ＩＣ２４はデータの交信を行な
い、それぞれ相手方の発生した暗号符号を入力する（ス
テップ＄１５および８１５Ｍ。続いて、相手方から入力
した暗号符号に基づいて、所定の演算処理を行なう（ス
テップ８１６およびＳ １６− ＞、。この演算処理に
用いられる演算式は、ロック用ＩＣ１４とキー用ＩＣ２
４とで全く同一のため、入力される暗号符号が同一の場
合はこの演算結果も同一となる。
次に、ロック用１０１４およびキー用ＩＣ２４は演算の
結果をそれぞれ相手方のＩＣに出力する（ステップ８１
７および８１７Ｍ。応じて、ロック用１０１４およびキ
ー用Ｉ Ｃ２４は相手方から出力された演算結果を入力
する（ステップ８１８および８１８Ｍ。ここで、ロック
用ＩＣ１４およびキー用ＩＣ２４は全く同じ動作を同期
して行なっているため、相手方のＩＣから入力される演
算結果も同一のタイミングで入力されることになる。し
たがって、この実施例では、演算結果の一致のみならず
、時間軸方向（すなわち実行しているステップ番号）の
一致も真偽判別のために考慮していることになる。
結果をそれぞれ相手方のＩＣに出力する（ステップ８１
７および８１７Ｍ。応じて、ロック用１０１４およびキ
ー用Ｉ Ｃ２４は相手方から出力された演算結果を入力
する（ステップ８１８および８１８Ｍ。ここで、ロック
用ＩＣ１４およびキー用ＩＣ２４は全く同じ動作を同期
して行なっているため、相手方のＩＣから入力される演
算結果も同一のタイミングで入力されることになる。し
たがって、この実施例では、演算結果の一致のみならず
、時間軸方向（すなわち実行しているステップ番号）の
一致も真偽判別のために考慮していることになる。
次に、ロック用ＩＣ１４は、キー用ＩＣ２４から入力し
た演算結果と、自己が行なった演算結果とを比較照合し
、一致するか否かを判断する。この照合の結果一致しな
いと判断された場合は、本体１の各回路（ＣＰＵ１２や
ＶＤＣＩ ３１）（７）！Ｊセット状態を保持する（ス
テップ８２０＞。これによって、本体１はゲームプログ
ラムの実行が禁止される。なお、このようなりセラ１〜
状態の保持動作に代えて警報を発生させるようにしても
よいし、または初期状態すなわちステップ８１１の動作
に戻るように制御してもよい。
た演算結果と、自己が行なった演算結果とを比較照合し
、一致するか否かを判断する。この照合の結果一致しな
いと判断された場合は、本体１の各回路（ＣＰＵ１２や
ＶＤＣＩ ３１）（７）！Ｊセット状態を保持する（ス
テップ８２０＞。これによって、本体１はゲームプログ
ラムの実行が禁止される。なお、このようなりセラ１〜
状態の保持動作に代えて警報を発生させるようにしても
よいし、または初期状態すなわちステップ８１１の動作
に戻るように制御してもよい。
一方、照合の結Ｗｓの演算結果が一致したと判断された
場合は、ＣＰＵ１２やＶＤＣ１３等のリセット状態を解
除する（ステップ５２１）。続いて、ロック用ＩＣ１４
は所定のランダム関数に基づいて第１および第２の乱数
データを発生する（ステップ５２２）。次に、ロック用
ＩＣ１４は、上述の第２の乱数データで演算式の種類を
選択し、第１および第２の乱数データをその選択された
演算式に代入する代入値としてセットする（ステップ５
２３）。すなわち、この実施例では、第２の演算処理と
してｎ （正の整数）種類の′／１４算式が予め設定さ
れており、その中から第２の乱数データに対応する演算
式が選択されるのである。次に、選択された演算式に第
１および第２の乱数データが代入されてその演算が実行
される（ステップ５２４）。以上のステップ８１９〜８
２４の動作は、 ・キー用ＩＣ２４においても全
く同じタイミングで行なわれている。そして、第１およ
び第２の乱数データを発生させるためのランダム間数も
ロック用ＩＣ１４で用いられるものと同じものが用いら
れる。さらに、第１および第２の乱数データを発生させ
るとき、ランダム関数に与えられる条件は、ロック用Ｉ
Ｃ１４とキー用ＩＣ２４とで全く同一である。したがっ
て、演算式も全く同じものが選択され、その結果も同一
となる。次に、ロック用ＩＣ１４はステップ＄２４の演
算結果をキー用■Ｃ２４に与えるとともに、キー用ＩＣ
２４で演算された結果を受取る（ステップ５２５）。同
様の動作がキー用ＩＣ２４でも行なわれる。次に、ロッ
ク用ＩＣ１４はキー用ＩＣ２４から受取った演算結果と
、自己の演算結果とを比較照合し一致しているか否かを
判断する。
場合は、ＣＰＵ１２やＶＤＣ１３等のリセット状態を解
除する（ステップ５２１）。続いて、ロック用ＩＣ１４
は所定のランダム関数に基づいて第１および第２の乱数
データを発生する（ステップ５２２）。次に、ロック用
ＩＣ１４は、上述の第２の乱数データで演算式の種類を
選択し、第１および第２の乱数データをその選択された
演算式に代入する代入値としてセットする（ステップ５
２３）。すなわち、この実施例では、第２の演算処理と
してｎ （正の整数）種類の′／１４算式が予め設定さ
れており、その中から第２の乱数データに対応する演算
式が選択されるのである。次に、選択された演算式に第
１および第２の乱数データが代入されてその演算が実行
される（ステップ５２４）。以上のステップ８１９〜８
２４の動作は、 ・キー用ＩＣ２４においても全
く同じタイミングで行なわれている。そして、第１およ
び第２の乱数データを発生させるためのランダム間数も
ロック用ＩＣ１４で用いられるものと同じものが用いら
れる。さらに、第１および第２の乱数データを発生させ
るとき、ランダム関数に与えられる条件は、ロック用Ｉ
Ｃ１４とキー用ＩＣ２４とで全く同一である。したがっ
て、演算式も全く同じものが選択され、その結果も同一
となる。次に、ロック用ＩＣ１４はステップ＄２４の演
算結果をキー用■Ｃ２４に与えるとともに、キー用ＩＣ
２４で演算された結果を受取る（ステップ５２５）。同
様の動作がキー用ＩＣ２４でも行なわれる。次に、ロッ
ク用ＩＣ１４はキー用ＩＣ２４から受取った演算結果と
、自己の演算結果とを比較照合し一致しているか否かを
判断する。
もし、本体１に装着されたＲＯＭカートリッジ２が正規
のものでない場合は、演算結果に不一致が生じるため、
そのときはＣＰＵ１２やＶＤＣＩ３等を強制的にリセッ
ト状態にして、以後の動作を停止させる（ステップ５２
７）。
のものでない場合は、演算結果に不一致が生じるため、
そのときはＣＰＵ１２やＶＤＣＩ３等を強制的にリセッ
ト状態にして、以後の動作を停止させる（ステップ５２
７）。
一方、キー用ＩＣ２４から受取った演算結果と自己の演
算結果とが一致した場合は、再びステップＳ２２の動作
に戻り、以後ステップ８２２〜８２６の動作を繰返す。
算結果とが一致した場合は、再びステップＳ２２の動作
に戻り、以後ステップ８２２〜８２６の動作を繰返す。
すなわち、この実施例では、本体１が動作している限り
第２の演算処理用プログラムを実行し、１回でも演算結
果の不一致が生じた場合は、ステップ３２７でＣＰＵ１
２やＶＤＣ１３の動作が停止される。これによって、本
体１でのゲームプログラムの実行が禁止される。なお、
ステップ８２６および８２７と同様の動作もキー用ＩＣ
２４で行なわれている。但し、キー用ＩＣ２４では、本
体１の各回路のリセット、リセット状態の解除の動作に
ついては、リセット信号の出力光がないので、本体１の
各回路には何ら影響を与えない。
第２の演算処理用プログラムを実行し、１回でも演算結
果の不一致が生じた場合は、ステップ３２７でＣＰＵ１
２やＶＤＣ１３の動作が停止される。これによって、本
体１でのゲームプログラムの実行が禁止される。なお、
ステップ８２６および８２７と同様の動作もキー用ＩＣ
２４で行なわれている。但し、キー用ＩＣ２４では、本
体１の各回路のリセット、リセット状態の解除の動作に
ついては、リセット信号の出力光がないので、本体１の
各回路には何ら影響を与えない。
上述の実施例では、ステップ８１．９における第１の演
算処理の演算結果の照合動作だけでも十分な真偽判別が
行なえるが、本体１が動作している限り常時ステップ８
２２〜８２６で第２の演算処理およびその演算結果の比
較照合を行なっているため、はぼ完全な真偽判別が行な
える。したがって、ＲＯＭ２２およびＲＯＭ２３のプロ
グラム内容をコピーしたもの、またはこれに類似のプロ
グラムを記憶したＲＯＭを含むＲＯＭカートリッジ２を
不正販売しようとする場合は、キー用ＩＣ２４と全く同
一のハード回路を入手しない限り上記実施例のプロテク
トを破ることは不可能である。
算処理の演算結果の照合動作だけでも十分な真偽判別が
行なえるが、本体１が動作している限り常時ステップ８
２２〜８２６で第２の演算処理およびその演算結果の比
較照合を行なっているため、はぼ完全な真偽判別が行な
える。したがって、ＲＯＭ２２およびＲＯＭ２３のプロ
グラム内容をコピーしたもの、またはこれに類似のプロ
グラムを記憶したＲＯＭを含むＲＯＭカートリッジ２を
不正販売しようとする場合は、キー用ＩＣ２４と全く同
一のハード回路を入手しない限り上記実施例のプロテク
トを破ることは不可能である。
また、キー用ＩＣ２４に通常の規格とは異なるカスタム
メイドのものを用いれば、コストの面でこの実施例のプ
ロテクトを破ることはほぼ完全に不可能となる。
メイドのものを用いれば、コストの面でこの実施例のプ
ロテクトを破ることはほぼ完全に不可能となる。
第７図はこの発明の他の実施例の動作を説明するための
′フローチャートである。なお、この実施例では、ハー
ド回路は上記実施例とほぼ同様のものが用いられるが、
ロック用ＩＣ１４のＲＡＭ１４３およびキー用ＩＣ２４
のＲＡＭ２４３にはカウンタエリア（以下、単にカウン
タと称す）ＣＴが設けられる。また、ロック用ＩＣ１４
のＲＯＭ１４２およびキー用ＩＣ２４のＲＯＭ２４２に
は、上記実施例と同様に、第１および第２の演算処理用
プログラム、演算結果の比較照合のための判断プログラ
ムおよび本体１の制御プログラムが含まれる。第２の演
算処理用プログラムはカラ２９０丁で計数される所定回
数分繰返して行なわれ、判断プログラムは第２の演算処
理用プログラムが終了するごとに演算結果の比較照合を
行ない、制御プログラムは判断プログラムの比較照合結
果が複数回分すべて一致したときに以後本体１を連続的
に能動化させる。
′フローチャートである。なお、この実施例では、ハー
ド回路は上記実施例とほぼ同様のものが用いられるが、
ロック用ＩＣ１４のＲＡＭ１４３およびキー用ＩＣ２４
のＲＡＭ２４３にはカウンタエリア（以下、単にカウン
タと称す）ＣＴが設けられる。また、ロック用ＩＣ１４
のＲＯＭ１４２およびキー用ＩＣ２４のＲＯＭ２４２に
は、上記実施例と同様に、第１および第２の演算処理用
プログラム、演算結果の比較照合のための判断プログラ
ムおよび本体１の制御プログラムが含まれる。第２の演
算処理用プログラムはカラ２９０丁で計数される所定回
数分繰返して行なわれ、判断プログラムは第２の演算処
理用プログラムが終了するごとに演算結果の比較照合を
行ない、制御プログラムは判断プログラムの比較照合結
果が複数回分すべて一致したときに以後本体１を連続的
に能動化させる。
次に、第７図を参照してこの発明の他の実施例の動作を
説明する。なお、この第７図のフローチャートは以下の
点を除いて第６図のフローチャートと同様であり、相当
する部分には同一のステップ番号を付しその説明を省略
する。図において、この実施例では、第６図のステップ
８２１に対応する部分でステップ５２１ａの動作が行な
われる。
説明する。なお、この第７図のフローチャートは以下の
点を除いて第６図のフローチャートと同様であり、相当
する部分には同一のステップ番号を付しその説明を省略
する。図において、この実施例では、第６図のステップ
８２１に対応する部分でステップ５２１ａの動作が行な
われる。
すなわち、このステップ５２１ａでは、ＲＡＭ １４３
のカウンタＣＴがリセットされる。その後、ステップ８
２２〜８２４で第２の演算処理が実行され、その後ロッ
ク用ＩＣ１４とキー用ＩＣ２４との間で演算結果の授受
が行なわれる（ステップ５２５）。次に、ステップＳ２
６で自己の演算結果とキー用ｒｃ２４の演算結果との比
較照合が行なわれ、不一致の場合はステップ５２７ａで
本体１のリセット状態が保持される。一方、演算結果が
一致した場合はステップ８２８でカウンタＣＴが歩進さ
れ、カウンタＣＴの計数値が所定値になったか否かがス
テップ８２９で判断される。カウンタＣＴの計数値が所
定値に達していない場合は、再びステップＳ２２の動作
に戻り、第２の演算処理が実行される。この動作はカウ
ンタＣＴの計数値が所定値に達するまで繰返して行なわ
れる。この動作の繰り返しの中で、１回でも演算結果の
不一致が生じた場合は、ステップ５２７ａに進み本体１
のリセット状態が保持される。これによって、ゲームプ
ログラムの実行が禁止される。一方、カウンタＣＴの計
数値が所定値に達するまですべて演算結果の一致が判断
された場合は、ステップ８３０ｋｍｍみ、ＣＰＵ１２や
ＶＤＣＩ ３等（７） ’Ｊ セｙト状態が解除される
。これによって、ゲームプログラムの実行が開始される
。なお、キー用ＩＣ２４でも上記のロック用ＩＣ１４の
動作と全く同様の動作が行なわれている。
のカウンタＣＴがリセットされる。その後、ステップ８
２２〜８２４で第２の演算処理が実行され、その後ロッ
ク用ＩＣ１４とキー用ＩＣ２４との間で演算結果の授受
が行なわれる（ステップ５２５）。次に、ステップＳ２
６で自己の演算結果とキー用ｒｃ２４の演算結果との比
較照合が行なわれ、不一致の場合はステップ５２７ａで
本体１のリセット状態が保持される。一方、演算結果が
一致した場合はステップ８２８でカウンタＣＴが歩進さ
れ、カウンタＣＴの計数値が所定値になったか否かがス
テップ８２９で判断される。カウンタＣＴの計数値が所
定値に達していない場合は、再びステップＳ２２の動作
に戻り、第２の演算処理が実行される。この動作はカウ
ンタＣＴの計数値が所定値に達するまで繰返して行なわ
れる。この動作の繰り返しの中で、１回でも演算結果の
不一致が生じた場合は、ステップ５２７ａに進み本体１
のリセット状態が保持される。これによって、ゲームプ
ログラムの実行が禁止される。一方、カウンタＣＴの計
数値が所定値に達するまですべて演算結果の一致が判断
された場合は、ステップ８３０ｋｍｍみ、ＣＰＵ１２や
ＶＤＣＩ ３等（７） ’Ｊ セｙト状態が解除される
。これによって、ゲームプログラムの実行が開始される
。なお、キー用ＩＣ２４でも上記のロック用ＩＣ１４の
動作と全く同様の動作が行なわれている。
なお、第７図の実施例では、第２の演算処理を複数回繰
返して行なうようにしているが、第２の演算処理を１回
だけ実行してその演算結果の比較照合を行ない、その照
合結果に基づいて本体１のリセット、リセット解除の制
御を行なうようにしてもよい。
返して行なうようにしているが、第２の演算処理を１回
だけ実行してその演算結果の比較照合を行ない、その照
合結果に基づいて本体１のリセット、リセット解除の制
御を行なうようにしてもよい。
また、第１の演算処理用プログラムの演算結果が一致し
たことによって本体１を能動化し、その後筒２の演算処
理用プログラムを複数回行ない、その間に演算結果の不
一致があれば本体１を不能動化し、複数回実行しても演
算結果に不一致がなければ以後は本体１を電源がオフさ
れるまで本体１を能動化し続けるようにしてもよい。
たことによって本体１を能動化し、その後筒２の演算処
理用プログラムを複数回行ない、その間に演算結果の不
一致があれば本体１を不能動化し、複数回実行しても演
算結果に不一致がなければ以後は本体１を電源がオフさ
れるまで本体１を能動化し続けるようにしてもよい。
なお、以上説明した実施例では、外部記憶装置として、
ＲＯＭカートリッジを用いているが、このようなＲＯＭ
カートリッジに代えて、ＩＣカードやフロッピィディス
クや光メモリまたは光カード等を用いてもよい。
ＲＯＭカートリッジを用いているが、このようなＲＯＭ
カートリッジに代えて、ＩＣカードやフロッピィディス
クや光メモリまたは光カード等を用いてもよい。
第８図は外部記憶装置としてフロッピィディスクを用い
た場合を示す平面図である。図において、フロッピィデ
ィスク５は、周知のごとくケース５１とこのケース５１
内に回転自在に収納される円盤状磁気シート５２とを含
む。そして、ケース５１には、キー用ＩＣ２４と、この
キー用ＩＣ２４と外部装置との接続を図るためにケース
５１の表面に露出して形成されている電極５３とが設け
られる。このようなフロッピィディスク５を受入れる本
体１の内部には、第９図に示すように、フ０ツビイディ
スクドライバＦＤと、電極５３と内部回路との接続を図
るためのコンタクトビン１７とが設けられる。
た場合を示す平面図である。図において、フロッピィデ
ィスク５は、周知のごとくケース５１とこのケース５１
内に回転自在に収納される円盤状磁気シート５２とを含
む。そして、ケース５１には、キー用ＩＣ２４と、この
キー用ＩＣ２４と外部装置との接続を図るためにケース
５１の表面に露出して形成されている電極５３とが設け
られる。このようなフロッピィディスク５を受入れる本
体１の内部には、第９図に示すように、フ０ツビイディ
スクドライバＦＤと、電極５３と内部回路との接続を図
るためのコンタクトビン１７とが設けられる。
なお、第２図の実施例では、本体１はフロッピィディス
ク５を直接装着し得るようには構成されていないので、
第１０図に示すような構成としてもよい。すなわち、Ｒ
ＯＭカートリッジ２と同形状を有し、本体１に対して着
脱自在に構成された接続アダプタ２−を設け、この接続
アダプタ２−にフロッピィディスク読取装置６を接続す
る。そして、このフロッピィディスク読取装置６に第８
図に示すようなフロッピィディスク５を装着するように
すればよい。この場合、フロッピィディスク読取装置６
内には、本体１内に設けられたロック用ＩＣ１４と全く
同様のロック用ＩＣを設け、ＲＯＭカートリッジ２に代
えてフロッピィディスク５を用いる場合はフロッピィデ
ィスク読取装置６内のロック用ＩＣで本体１の内部回路
のりセットまたはリセット解除を制ｉするようにすれば
よい。また、フロッピィディスク読取装置６内にロック
用ＩＣを設けずに、本体１に内蔵された０ツク用１０１
４とフロッピィディスク５に設けられたキー用ＩＣ２４
とで真偽判別を行なうようにすることもできる。
ク５を直接装着し得るようには構成されていないので、
第１０図に示すような構成としてもよい。すなわち、Ｒ
ＯＭカートリッジ２と同形状を有し、本体１に対して着
脱自在に構成された接続アダプタ２−を設け、この接続
アダプタ２−にフロッピィディスク読取装置６を接続す
る。そして、このフロッピィディスク読取装置６に第８
図に示すようなフロッピィディスク５を装着するように
すればよい。この場合、フロッピィディスク読取装置６
内には、本体１内に設けられたロック用ＩＣ１４と全く
同様のロック用ＩＣを設け、ＲＯＭカートリッジ２に代
えてフロッピィディスク５を用いる場合はフロッピィデ
ィスク読取装置６内のロック用ＩＣで本体１の内部回路
のりセットまたはリセット解除を制ｉするようにすれば
よい。また、フロッピィディスク読取装置６内にロック
用ＩＣを設けずに、本体１に内蔵された０ツク用１０１
４とフロッピィディスク５に設けられたキー用ＩＣ２４
とで真偽判別を行なうようにすることもできる。
なお、第１０図において、接続アダプタ２−に接続され
る装置自身に記憶手段を含むような場合（たとえばシン
セサイザ用ＲＯＭを含む音源装置等を接続した場合）に
おいては、接続アダプタ２−内にキー用Ｉ Ｃ２４を設
け、このキー用ＩＣ２４と本体１に内蔵されたロック用
ＩＣ１４とで協働して外部記憶装置の真偽判別を行なう
ようにすればよい。
る装置自身に記憶手段を含むような場合（たとえばシン
セサイザ用ＲＯＭを含む音源装置等を接続した場合）に
おいては、接続アダプタ２−内にキー用Ｉ Ｃ２４を設
け、このキー用ＩＣ２４と本体１に内蔵されたロック用
ＩＣ１４とで協働して外部記憶装置の真偽判別を行なう
ようにすればよい。
なお、以上説明した実施例では、この発明を家
゛す庭用ビデオゲーム装置に適用したものについて示
′したが、この発明は家庭用ビデオゲーム装置
に限らず業務用ビデオゲーム装置あるいはその他種々の
用途で利用されるコンピュータシステム等にも
゛適用することができる。
゛す庭用ビデオゲーム装置に適用したものについて示
′したが、この発明は家庭用ビデオゲーム装置
に限らず業務用ビデオゲーム装置あるいはその他種々の
用途で利用されるコンピュータシステム等にも
゛適用することができる。
［発明の効果］
以上のように、この発明によれば、外部記憶装置側と本
体側でそれぞれ関連性を有する真偽判別のためのプログ
ラムを記憶しておき、外部記憶装置が本体に接続された
とき、外部記憶装置の第１の処理手段および本体の第２
の処理手段にそれぞれのプログラムを実行させ、これら
第１の処理手段および第２の処理手段の動作状態が所定
の関係になったときのみ本体の中央処理手段の動作を能
動化させるようにしたので、正規でない外部記憶装置が
装着されたときは本体の動作を確実に禁止することがで
きる。また、第１および第２の処理手段は同じ性能を有
しているため、単に真偽判別のためのプログラムをコピ
ーしただけでは本体を作動させることができず、全く同
一の性能を有するハード回路を入手しない限りこの発明
のプロテクトを破ることができない。これによって、正
規でない外部記憶装置の使用をほぼ完全に排除すること
ができる。したがって、粗悪なソフトウェアが市場に氾
濫するのを未然に防止することができ、情報処理装置本
体の商品価値が損われることがない。また、消費者に対
しても品質の粗悪なソフトウェアが提供されることを間
接的に防止することができる。
体側でそれぞれ関連性を有する真偽判別のためのプログ
ラムを記憶しておき、外部記憶装置が本体に接続された
とき、外部記憶装置の第１の処理手段および本体の第２
の処理手段にそれぞれのプログラムを実行させ、これら
第１の処理手段および第２の処理手段の動作状態が所定
の関係になったときのみ本体の中央処理手段の動作を能
動化させるようにしたので、正規でない外部記憶装置が
装着されたときは本体の動作を確実に禁止することがで
きる。また、第１および第２の処理手段は同じ性能を有
しているため、単に真偽判別のためのプログラムをコピ
ーしただけでは本体を作動させることができず、全く同
一の性能を有するハード回路を入手しない限りこの発明
のプロテクトを破ることができない。これによって、正
規でない外部記憶装置の使用をほぼ完全に排除すること
ができる。したがって、粗悪なソフトウェアが市場に氾
濫するのを未然に防止することができ、情報処理装置本
体の商品価値が損われることがない。また、消費者に対
しても品質の粗悪なソフトウェアが提供されることを間
接的に防止することができる。
第１図はこの発明の一実施例の基本的な動作を示すフロ
ーチャートである。第２図はビデオゲーム装置に適用さ
れたこの発明の一実施例を示す外観斜視図である。第３
図は第２図に示す実施例の電気回路部分を示す概略ブロ
ック図である。第４図は第３図に示すロック用ＩＣ１４
の詳細を示すブロック図である。第５図は第４図に示す
分周器１４６の動作を説明するためのタイムチャートで
ある。第６図はこの発明の一実施例の詳細な動作を示す
フローチャートである。第７図はこの発明の他の実施例
の詳細な動作を示すフローチャートである。第８図は外
部記憶装置として用いられるフロッピィディスクを示す
平面図である。第９図は第８図に示すフロッピィディス
クを受入れる本体の内部構造を簡単に示す図である。第
１０図はフロッピィディスクを外部記憶装置として用い
る場合の一例を示す外観斜視図である。 図において、１は本体、２はＲＯＭカートリッジ、５は
フロッピィディスク、６はフロッピィディスク読取装置
、２−は接続アダプタ、１２はＣｐｕ、１３はＶＤｃ、
１４Ｇ、ｔＯｙり用ＩＣ１１５は発振器、２２はプログ
ラムＲＯＭ、２３はキャラクタＲＯＭ、２４はキー用Ｉ
Ｃを示す。 第１図 第２図 第３図 第５図 リセット信号 ２４．・ １７ ５ トＤ
ーチャートである。第２図はビデオゲーム装置に適用さ
れたこの発明の一実施例を示す外観斜視図である。第３
図は第２図に示す実施例の電気回路部分を示す概略ブロ
ック図である。第４図は第３図に示すロック用ＩＣ１４
の詳細を示すブロック図である。第５図は第４図に示す
分周器１４６の動作を説明するためのタイムチャートで
ある。第６図はこの発明の一実施例の詳細な動作を示す
フローチャートである。第７図はこの発明の他の実施例
の詳細な動作を示すフローチャートである。第８図は外
部記憶装置として用いられるフロッピィディスクを示す
平面図である。第９図は第８図に示すフロッピィディス
クを受入れる本体の内部構造を簡単に示す図である。第
１０図はフロッピィディスクを外部記憶装置として用い
る場合の一例を示す外観斜視図である。 図において、１は本体、２はＲＯＭカートリッジ、５は
フロッピィディスク、６はフロッピィディスク読取装置
、２−は接続アダプタ、１２はＣｐｕ、１３はＶＤｃ、
１４Ｇ、ｔＯｙり用ＩＣ１１５は発振器、２２はプログ
ラムＲＯＭ、２３はキャラクタＲＯＭ、２４はキー用Ｉ
Ｃを示す。 第１図 第２図 第３図 第５図 リセット信号 ２４．・ １７ ５ トＤ
Claims (5)
- （１）情報処理装置本体と、この情報処理装置本体に対
して着脱自在に構成された外部記憶装置とからなる情報
処理システムにおいて、前記外部記憶装置のソフトウェ
アの真偽を管理するシステムであつて、 前記外部記憶装置は、所望の情報処理のためのプログラ
ムを記憶する記憶手段、 当該外部記憶装置の真偽を判別するためのプログラムを
記憶する第１の半導体メモリ、および前記第１の半導体
メモリに記憶されているプログラムを実行する第１の処
理手段を含み、前記情報処理装置本体は、前記記憶手段
に記憶されているプログラムに基づいて所望の情報処理
を実行する中央処理手段、前記第１の半導体メモリに記
憶されているプログラムに関連するプログラムであり、
かつ前記外部記憶装置の真偽判別のためのプログラムを
記憶する第２の半導体メモリ、および 前記第１の処理手段と同じ性能を有し、かつ前記第２の
半導体メモリに記憶されているプログラムを実行する第
２の処理手段を含み、 さらに、前記中央処理手段の動作に先立つて、前記第１
の処理手段が前記第１の半導体メモリに記憶されている
プログラムを実行しかつ前記第２の処理手段が前記第２
の半導体メモリに記憶されているプログラムを実行する
とき、第１の処理手段の動作状態と第２の処理手段の動
作状態とが所定の関係であることを判断する判断手段、
および前記判断手段が所定の関係を判断したことに基づ
いて、前記中央処理手段の動作を能動化させる能動化手
段を備える、外部記憶装置のソフトウェア管理システム
。 - （２）前記第１の半導体メモリおよび前記第２の半導体
メモリは、同一のプログラム配列のプログラムを記憶し
、 前記第１の処理手段と前記第２の処理手段は、同一のハ
ードウェアで構成され、 前記判断手段は、前記第１の処理手段の動作状態と前記
第２の処理手段の動作状態とが一致していることを判断
することを特徴とする、特許請求の範囲第１項記載の外
部記憶装置のソフトウェア管理システム。 - （３）前記第１および第２の半導体メモリは、それぞれ
が第１の演算処理用プログラムと第２の演算処理用プロ
グラムの両方を記憶し、 前記第１および第２の処理手段は、対応する半導体メモ
リに記憶されている前記第１および第２の演算処理用プ
ログラムを順次実行し、 前記判断手段は、前記第１および第２の処理手段でそれ
ぞれ実行された前記第１の演算処理用プログラムの演算
結果が一致し、かつ前記第１および第２の処理手段でそ
れぞれ実行された前記第２の演算処理用プログラムの演
算結果が一致したことを判断することを特徴とする、特
許請求の範囲第２項記載の外部記憶装置のソフトウェア
管理システム。 - （４）前記第１および第２の半導体メモリは、前記第２
の演算処理用プログラムとして複数回分の演算処理用プ
ログラムを記憶し、 前記第１および第２の処理手段は、前記第１の演算処理
用プログラムを実行した後、前記第２の演算処理用プロ
グラムを所定回数実行し、 前記能動化手段は、前記第１および第２の処理手段でそ
れぞれ実行された前記第１の演算処理用プログラムの演
算結果が一致し、かつ前記第１および第２の処理手段で
それぞれ所定回数実行された前記第２の演算処理用プロ
グラムの演算結果がすべて一致したことを前記判断手段
が判断したことに基づいて、前記中央処理手段の動作を
能動化させることを特徴とする、特許請求の範囲第３項
記載の外部記憶装置のソフトウェア管理システム。 - （５）前記第１および第２の半導体メモリは、前記第２
の演算処理用プログラムとして複数回分の演算処理用プ
ログラムを記憶し、 前記第１および第２の処理手段は、前記第１の演算処理
用プログラムを実行した後、前記第２の演算処理用プロ
グラムを順次繰返して実行し、前記能動化手段は、前記
第１および第２の処理手段でそれぞれ実行された前記第
１の演算処理用プログラムの演算結果が一致し、かつ前
記第１および第２の処理手段でそれぞれ順次繰返して実
行されている前記第１および第２の演算処理用プログラ
ムの演算結果が一致していることを前記判断手段が判断
している限り、前記中央処理手段の動作を能動化させる
ことを特徴とする、特許請求の範囲第３項記載の外部記
憶装置のソフトウェア管理システム。
Priority Applications (14)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60143026A JPH0760412B2 (ja) | 1985-06-28 | 1985-06-28 | 真偽判別素子、およびそれを用いた外部記憶装置 |
| CA000497868A CA1270339A (en) | 1985-06-24 | 1985-12-17 | System for determining a truth of software in an information processing apparatus |
| US06/812,929 US4799635A (en) | 1985-06-24 | 1985-12-23 | System for determining authenticity of an external memory used in an information processing apparatus |
| DE3689574T DE3689574T2 (de) | 1985-06-24 | 1986-06-16 | System zum Feststellen der Echtheit von Software in einer Informationsverarbeitungsanlage. |
| EP86304592A EP0206704B1 (en) | 1985-06-24 | 1986-06-16 | System for determining the authenticity of software in an information processing apparatus |
| FI862598A FI92767C (fi) | 1985-06-24 | 1986-06-18 | Järjestelmä ohjelmiston aitouden määrittämiseksi tietojenkäsittelylaitteessa |
| AU58816/86A AU599317B2 (en) | 1985-06-24 | 1986-06-18 | A system for determining a truth of software in an information processing apparatus |
| NO862523A NO177548C (no) | 1985-06-24 | 1986-06-23 | System for bestemmelse av en programvares riktighet i et databehandlingsapparat |
| US07/297,105 US5070479A (en) | 1985-06-24 | 1989-01-13 | External memory having an authenticating processor and method of operating same |
| AU64834/90A AU636401B2 (en) | 1985-06-24 | 1990-10-19 | An external memory unit for connection to a main data processing unit |
| US08/043,745 US5426762A (en) | 1985-06-24 | 1993-04-07 | System for determining a truth of software in an information processing apparatus |
| SG49494A SG49494G (en) | 1985-06-24 | 1994-04-12 | System for determining the authenticity of software in an information processing apparatus |
| HK195A HK195A (en) | 1985-06-24 | 1995-01-05 | System for determining the authenticity of software in an information processing apparatus |
| HK98104258A HK1005196A1 (en) | 1985-06-24 | 1998-05-18 | System for determining the authenticity of software in an information processing apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60143026A JPH0760412B2 (ja) | 1985-06-28 | 1985-06-28 | 真偽判別素子、およびそれを用いた外部記憶装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS623331A true JPS623331A (ja) | 1987-01-09 |
| JPH0760412B2 JPH0760412B2 (ja) | 1995-06-28 |
Family
ID=15329181
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60143026A Expired - Lifetime JPH0760412B2 (ja) | 1985-06-24 | 1985-06-28 | 真偽判別素子、およびそれを用いた外部記憶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0760412B2 (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5155768A (en) * | 1990-03-16 | 1992-10-13 | Sega Enterprises, Ltd. | Security system for software |
| JPH10512072A (ja) * | 1994-12-30 | 1998-11-17 | エックステック，インコーポレイテッド | 半導体メモリーセルに保存されたデータを保護するための方法と装置 |
| DE4294540C2 (de) * | 1991-12-27 | 2002-11-07 | Nintendo Co Ltd | Datenverarbeitungssystem |
| JP2007188520A (ja) * | 2005-06-28 | 2007-07-26 | Matsushita Electric Ind Co Ltd | 検証方法、情報処理装置、記録媒体、検証システム、証明プログラム及び検証プログラム |
| JP4559623B2 (ja) * | 1998-06-04 | 2010-10-13 | 株式会社バンダイナムコゲームス | セキュリティ装置、キー装置、プログラム・プロテクション・システムおよび方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58101349A (ja) * | 1981-11-25 | 1983-06-16 | ザ・マグナボツクス・コンパニ− | プログラム・メモリ識別方法及びデ−タ処理システム |
| US4471216A (en) * | 1979-11-09 | 1984-09-11 | Compagnie Internationale Pour L'informatique Cii-Honeywell Bull (Societe Anonyme | System and process for identification of persons requesting access to particular facilities |
| JPS60138699A (ja) * | 1983-12-27 | 1985-07-23 | 株式会社田村電機製作所 | 硬貨選別装置 |
-
1985
- 1985-06-28 JP JP60143026A patent/JPH0760412B2/ja not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4471216A (en) * | 1979-11-09 | 1984-09-11 | Compagnie Internationale Pour L'informatique Cii-Honeywell Bull (Societe Anonyme | System and process for identification of persons requesting access to particular facilities |
| JPS58101349A (ja) * | 1981-11-25 | 1983-06-16 | ザ・マグナボツクス・コンパニ− | プログラム・メモリ識別方法及びデ−タ処理システム |
| JPS60138699A (ja) * | 1983-12-27 | 1985-07-23 | 株式会社田村電機製作所 | 硬貨選別装置 |
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| DE4294540C2 (de) * | 1991-12-27 | 2002-11-07 | Nintendo Co Ltd | Datenverarbeitungssystem |
| JPH10512072A (ja) * | 1994-12-30 | 1998-11-17 | エックステック，インコーポレイテッド | 半導体メモリーセルに保存されたデータを保護するための方法と装置 |
| JP4559623B2 (ja) * | 1998-06-04 | 2010-10-13 | 株式会社バンダイナムコゲームス | セキュリティ装置、キー装置、プログラム・プロテクション・システムおよび方法 |
| JP2007188520A (ja) * | 2005-06-28 | 2007-07-26 | Matsushita Electric Ind Co Ltd | 検証方法、情報処理装置、記録媒体、検証システム、証明プログラム及び検証プログラム |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0760412B2 (ja) | 1995-06-28 |
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| EXPY | Cancellation because of completion of term |