JPS6233777B2 - - Google Patents
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- JPS6233777B2 JPS6233777B2 JP56152907A JP15290781A JPS6233777B2 JP S6233777 B2 JPS6233777 B2 JP S6233777B2 JP 56152907 A JP56152907 A JP 56152907A JP 15290781 A JP15290781 A JP 15290781A JP S6233777 B2 JPS6233777 B2 JP S6233777B2
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Classifications
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
- H04B1/74—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission for increasing reliability, e.g. using redundant or spare channels or apparatus
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
- Monitoring And Testing Of Transmission In General (AREA)
Description
【発明の詳細な説明】
本発明は、通信回線を現用と予備の間で切替え
るスイツチ部の状態監視のための表示部を持つ通
信回線切替動作試験装置に係り、特にスイツチ部
の状態とその状態を記憶しているメモリ部の状態
を破壊することなく運用状態に近い形で装置動作
をシミユレート出来るようにした動作試験装置に
関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a communication line switching operation test device having a display unit for monitoring the status of a switch unit that switches a communication line between active and backup, and particularly relates to a communication line switching operation test device that monitors the status of a switch unit and its status. The present invention relates to an operation test device capable of simulating the operation of the device in a form close to the operational state without destroying the state of the memory section storing the information.
一般に、通信回線切替装置は、スイツチ制御情
報を授受するインタフエース部と、インタフエー
ス部に接続されており後段を制御する制御部と、
制御部からの信号を受けてこれをスイツチ駆動情
報に変換する駆動部と、駆動部からの情報に従つ
て状態が設定され、通信回線を現用と予備の間で
切替えるスイツチ部と、スイツチ部の状態を監視
するために制御部から出力されたデータを格納す
る第１のメモリと、第１のメモリの内容を表示す
るための表示操作部とを備えている。この装置に
よつて、回線接続に障害が発生した場合等に、装
置の上記各部の状態を動作試験する必要が生じ
る。 Generally, a communication line switching device includes an interface unit that sends and receives switch control information, a control unit that is connected to the interface unit and controls the subsequent stage, and
There is a drive unit that receives signals from the control unit and converts them into switch drive information, a switch unit that sets the state according to the information from the drive unit and switches the communication line between active and standby, and the switch unit. The device includes a first memory that stores data output from the control unit for monitoring the status, and a display operation unit that displays the contents of the first memory. With this device, when a failure occurs in the line connection, it becomes necessary to perform an operational test on the status of each of the above-mentioned parts of the device.
従来の通信回線切替動作試験方式としては、装
置のインタフエース部に特定の情報を授受させ、
且つ、制御部の一部について特定の情報を授受さ
せて擬似動作を行なうことにより動作チエツクを
行なう方式があるが、この方式では、スイツチ部
の状態を監視できないばかりか、制御部の動作チ
エツクも一部に限られているため、通信回線切替
装置の動作試験としては不充分である。 The conventional communication line switching operation test method involves sending and receiving specific information to the interface section of the device.
There is also a method of checking the operation of a part of the control section by sending and receiving specific information and performing a pseudo operation, but with this method, not only is it impossible to monitor the state of the switch section, but also the operation of the control section cannot be checked. Since it is limited to only a few areas, it is insufficient for testing the operation of communication line switching devices.
従来の他の動作試験方式としては、上記第１の
メモリとは別の第２のメモリを用意し、動作試験
時には、スイツチ部の状態を記憶している第１の
メモリの内容を第２のメモリに写すと共に駆動部
の動作を禁止しておき、次いで、動作試験用デー
タをインタフエース部および制御部を介して第１
のメモリに格納しかつ表示し、表示されたデータ
をチエツクすることにより、インタフエース部お
よび制御部の動作試験を行う方式が知られてい
る。この従来方式では、動作試験用データが遂次
第１のメモリに格納されるので、スイツチ部の状
態を試験出来ると共に、インタフエース部および
制御部の試験も行うことが出来るが、動作試験終
了後、第２のメモリの内容で再び第１のメモリを
更新しなくてはならず、この更新過程で誤動作あ
るいは誤操作があると、第１のメモリの内容とス
イツチ部の状態とが食い違つてしまい、スイツチ
部の状態が正確に表示できなくなるという問題が
ある。 As another conventional operation test method, a second memory separate from the first memory is prepared, and during the operation test, the contents of the first memory that stores the state of the switch section are transferred to the second memory. Copy the data to the memory and prohibit the operation of the drive unit, and then transfer the operation test data to the first drive unit via the interface unit and control unit.
A method is known in which the operation of the interface section and the control section is tested by storing and displaying the data in the memory of the interface unit and checking the displayed data. In this conventional method, the operation test data is stored in the memory 1 as soon as the operation test is completed, so the state of the switch section can be tested as well as the interface section and control section. The first memory must be updated again with the contents of the second memory, and if there is a malfunction or erroneous operation during this updating process, the contents of the first memory and the state of the switch section will be inconsistent. There is a problem that the state of the switch section cannot be displayed accurately.
本発明の目的は、上述の従来技術における問題
にかんがみ、アドレスが共用される実情報メモリ
領域と試験情報メモリ領域を備えたメモリを用
い、試験モードにおいては試験情報メモリ領域を
用いて動作試験を行なうという構想に基づき、通
信回線切替動作試験装置において、試験モードか
ら運用モードに復帰する際にメモリの内容の更新
を不要にし、それにより、運用モードへの復帰時
に、スイツチ部の状態とメモリの内容の一致を確
実化することにある。 In view of the problems in the prior art described above, an object of the present invention is to use a memory having a real information memory area and a test information memory area in which addresses are shared, and to perform an operation test using the test information memory area in a test mode. Based on this concept, communication line switching operation test equipment eliminates the need to update the memory contents when returning from test mode to operation mode, thereby making it possible to update the switch state and memory when returning to operation mode. The purpose is to ensure consistency of content.
以下、本発明の実施例を添附の図面に基づいて
説明する。 Embodiments of the present invention will be described below with reference to the accompanying drawings.
第１図は本発明の一実施例による通信回線切替
動作試験装置を示すブロツク図である。第１図に
おいて、運用モードにおいては、回線監視装置１
から送られて来るスイツチ制御情報がインタフエ
ース部３を介して制御部５に入力される。制御部
５はその制御の内容に従つてスイツチ制御情報を
スイツチ部の状態設定用情報SDに変換して駆動
部７に与える。駆動部７は情報SDをスイツチ駆
動情報に変換してスイツチ部９に与え、それによ
り、スイツチ部９は通信回線の接続を行なう。ス
イツチ部は、例えば32本の現用回線と32本の予備
回線の間で切替えを行うためにマトリツクス状に
配置されたスイツチ（図示せず）を備えている。
制御部５は状態設定用情報SDと同一内容の情報
SD′をデータバツフア回路１１に供給すると共
に、スイツチ部９内の指定スイツチに対応するア
ドレス信号ADをアドレスバツフア回路１３に供
給する。制御部５からメモリ１５に書込み命令が
与えられると、アドレスバツフア１３に格納され
ていたアドレス信号によりメモリ１５のアドレス
が指定され、この指定されたアドレスに、データ
バツフア１１のデータが書込まれる。メモリ１５
は、第２図に示すように、実情報メモリ領域１６
と試験情報メモリ領域１７を備えており、両領域
１６および１７は５ビツトのアドレス信号A0〜
A4を共用するようになつている。アドレス信号
の最上位ビツトA5はモード切替えアドレスビツ
トとして用いられ、運用モードにおいては、A5
にビツト“０”が入力される。A5にビツト
“０”が入力されると、実情報メモリ領域１６に
対して読み、書きが行なわれる。制御部５からメ
モリ１５に読出し命令が与えられると、表示操作
部１９はメモリ１５の実メモリ領域１６をアクセ
スしてデータを読出し、レジスタ／デコーダ２
１、表示操作部１９を介して表示装置（図示せ
ず）に表示する。 FIG. 1 is a block diagram showing a communication line switching operation test device according to an embodiment of the present invention. In FIG. 1, in the operation mode, the line monitoring device 1
The switch control information sent from the controller is input to the control section 5 via the interface section 3. The control section 5 converts the switch control information into switch section state setting information SD in accordance with the content of the control, and supplies it to the drive section 7. The drive section 7 converts the information SD into switch drive information and supplies it to the switch section 9, whereby the switch section 9 connects the communication line. The switch unit includes switches (not shown) arranged in a matrix for switching between, for example, 32 working lines and 32 protection lines.
The control unit 5 uses information with the same content as the status setting information SD.
SD' is supplied to the data buffer circuit 11, and an address signal AD corresponding to the specified switch in the switch section 9 is supplied to the address buffer circuit 13. When a write command is given to the memory 15 from the control unit 5, an address of the memory 15 is designated by the address signal stored in the address buffer 13, and data in the data buffer 11 is written to the designated address. memory 15
As shown in FIG. 2, the real information memory area 16
and a test information memory area 17, and both areas 16 and 17 receive 5-bit address signals A 0 -
A 4 is now shared. The most significant bit A5 of the address signal is used as a mode switching address bit, and in operation mode, A5
Bit “0” is input to When bit "0" is input to A5 , reading and writing to the real information memory area 16 are performed. When a read command is given to the memory 15 from the control unit 5, the display operation unit 19 accesses the real memory area 16 of the memory 15, reads the data, and writes the data to the register/decoder 2.
1. Display on a display device (not shown) via the display operation section 19.
次に、回線接続に障害が発生した場合等に、第
１図の装置の各部の動作試験を行う試験モードに
おいては、モード切替スイツチSWを閉じること
により、駆動部７にビツト“０”の禁止信号INH
を与えてその動作を禁止すると共に、電源ＶCCか
ら抵抗Ｒを通して接地側に電流を流すことにより
インバータ２３の入力を“０”に、従つてインバ
ータ２３の出力である最上位ビツトA5を“１”
にする。メモリ１５のアドレスの最上位ビツト
A5に“１”が入力されると、必要に応じて、実
情報メモリ領域１６の内容は試験情報メモリ領域
１７に書込まれる。次いで、テストパターン発生
回路２５からインタフエース部に試験情報を送出
する。試験情報は制御部５の制御の下にメモリ５
の試験情報メモリ領域１７に書込まれ、あるいは
そこから読出されて、装置の各部の試験が行なわ
れる。試験モードの間は実情報メモリ領域１６に
対する書込みが行われないので、その内容は保存
されたままであり、駆動部７の出力も禁止されて
いるのでその状態も保存されたままである。従つ
て、モード切替スイツチを開にして再び運用モー
ドに戻るとき、実情報メモリ領域１６を更新する
必要はなく、実情報メモリ領域の内容とスイツチ
部の状態との一致は保たれている。 Next, in the test mode in which the operation of each part of the device shown in Fig. 1 is tested in the event of a failure in the line connection, etc., by closing the mode changeover switch SW, the drive unit 7 is prohibited from setting bit “0”. Signal INH
At the same time, the input of the inverter 23 is set to "0" by passing a current from the power supply V CC to the ground side through the resistor R, and the most significant bit A5 , which is the output of the inverter 23, is set to "0". 1”
Make it. Most significant bit of address of memory 15
When "1" is input to A5 , the contents of the actual information memory area 16 are written to the test information memory area 17 as necessary. Next, test information is sent from the test pattern generation circuit 25 to the interface section. The test information is stored in the memory 5 under the control of the control unit 5.
The test information is written into or read from the test information memory area 17 of the device, and each part of the device is tested. During the test mode, no writing is done to the actual information memory area 16, so its contents remain preserved, and since the output of the drive unit 7 is also prohibited, its state also remains preserved. Therefore, when the mode changeover switch is opened to return to the operating mode, there is no need to update the real information memory area 16, and the contents of the real information memory area and the state of the switch section remain consistent.
試験モードに切替えたとき、運用時の実情報メ
モリ領域１６の内容を試験情報メモリ領域に書込
んでおくことにより、実際により近いシミユレー
シヨンを行なうことが可能であるが、この書込み
動作を行なわなくても、上記一致が保たれること
には変りはない。 When switching to test mode, by writing the contents of the actual information memory area 16 during operation to the test information memory area, it is possible to perform a simulation closer to the actual situation, but it is not necessary to perform this writing operation. However, the above coincidence is still maintained.
以上述べたように、本発明によれば、通信回線
切替動作試験装置において、試験モードから運用
モードに復帰する際にメモリの内容の更新が不要
となり、従つて、運用モードへの復帰時にスイツ
チ部の状態とメモリの内容の一致が確実化され
る。 As described above, according to the present invention, in the communication line switching operation test device, it is not necessary to update the contents of the memory when returning from the test mode to the operation mode, and therefore, when returning to the operation mode, the switch section A match between the state of the memory and the contents of the memory is ensured.
なお、前述の実施例においては、モード切替え
アドレスビツトをメモリ１５のアドレスの最上位
ビツトとしたが、例えば最下位ビツト等、任意の
ビツトを用いてもよいことは明らかである。ま
た、メモリのアドレス信号は５ビツトとしたが、
スイツチ部の構成に応じた任意のビツト数であつ
ても本発明に含まれる。 In the above embodiment, the mode switching address bit is the most significant bit of the address of the memory 15, but it is clear that any bit, such as the least significant bit, may be used. Also, the memory address signal is 5 bits, but
Any number of bits depending on the configuration of the switch section is also included in the present invention.
第１図は本発明の一実施例による通信回線切替
動作試験装置を示すブロツク図、第２図は第１図
の回路の中のメモリの構成を示すブロツク図であ
る。
１…回線監視装置、３…インタフエース、５…
制御部、７…駆動部、９…スイツチ部、１１…デ
ータバツフア回路、１３…アドレスバツフア回
路、１５…メモリ、１６…実情報メモリ領域、１
７…試験情報メモリ領域、１９…表示操作部、２
１…レジスタ／デコーダ、２３…インバータ、２
５…テストパターン発生回路。
FIG. 1 is a block diagram showing a communication line switching operation test device according to an embodiment of the present invention, and FIG. 2 is a block diagram showing the configuration of a memory in the circuit of FIG. 1...Line monitoring device, 3...Interface, 5...
Control unit, 7... Drive unit, 9... Switch unit, 11... Data buffer circuit, 13... Address buffer circuit, 15... Memory, 16... Actual information memory area, 1
7...Test information memory area, 19...Display operation section, 2
1...Register/decoder, 23...Inverter, 2
5...Test pattern generation circuit.
Claims (1)
部の出力を駆動情報に変換する駆動部、該駆動情
報に応じて通信回線を現用と予備の間で切替える
スイツチ部、該スイツチ部に入力されるデータと
同一内容を記憶するメモリ、および該メモリの内
容を表示するための表示操作部を具備する通信回
線切替装置において、該通信回線切替装置の運用
モードと試験モードの間で切替えを行うモード切
替手段を具備し、該メモリはアドレス信号が共用
される実情報メモリ領域と試験情報メモリ領域お
よびモード切替えアドレスビツトを備えており、
該モード切替手段が運用モードを指定したときは
該実情報メモリ領域にデータが書込まれ、該モー
ド切替手段が試験モードを指定したときは、該駆
動部の動作を禁止すると共に該モード切替えアド
レスビツトに切替え信号を与えて該実情報メモリ
領域の内容を該試験情報メモリ領域に写した後該
試験情報メモリ領域にデータを書き込むようにし
たことを特徴とする通信回線切替動作試験装置。1 A control unit that receives switch control information, a drive unit that converts the output of the control unit into drive information, a switch unit that switches the communication line between active and standby according to the drive information, and information that is input to the switch unit. In a communication line switching device that is equipped with a memory that stores the same content as data and a display operation unit that displays the contents of the memory, mode switching that switches between an operation mode and a test mode of the communication line switching device. the memory comprises a real information memory area and a test information memory area in which the address signal is shared, and a mode switching address bit;
When the mode switching means specifies the operation mode, data is written in the actual information memory area, and when the mode switching means specifies the test mode, the operation of the drive section is prohibited and the mode switching address is written. 1. A communication line switching operation testing device characterized in that a switching signal is applied to a bit to copy the contents of the actual information memory area to the test information memory area and then write data to the test information memory area.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56152907A JPS5854749A (en) | 1981-09-29 | 1981-09-29 | Test equipment for communication line switching operation |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56152907A JPS5854749A (en) | 1981-09-29 | 1981-09-29 | Test equipment for communication line switching operation |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5854749A JPS5854749A (en) | 1983-03-31 |
| JPS6233777B2 true JPS6233777B2 (en) | 1987-07-22 |
Family
ID=15550740
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56152907A Granted JPS5854749A (en) | 1981-09-29 | 1981-09-29 | Test equipment for communication line switching operation |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5854749A (en) |
-
1981
- 1981-09-29 JP JP56152907A patent/JPS5854749A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5854749A (en) | 1983-03-31 |
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