JPS623562A - Image forming device - Google Patents

Image forming device

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Publication number
JPS623562A
JPS623562A JP60141549A JP14154985A JPS623562A JP S623562 A JPS623562 A JP S623562A JP 60141549 A JP60141549 A JP 60141549A JP 14154985 A JP14154985 A JP 14154985A JP S623562 A JPS623562 A JP S623562A
Authority
JP
Japan
Prior art keywords
image
signal
test pattern
image signal
transmission
Prior art date
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Pending
Application number
JP60141549A
Other languages
Japanese (ja)
Inventor
Masayoshi Hayashi
林 公良
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Canon Inc
Original Assignee
Canon Inc
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Filing date
Publication date
Application filed by Canon Inc filed Critical Canon Inc
Priority to JP60141549A priority Critical patent/JPS623562A/en
Publication of JPS623562A publication Critical patent/JPS623562A/en
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、光電変換された画像信号に応じて画像形成
を行う画像形成装置に関するものである。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to an image forming apparatus that forms an image in accordance with a photoelectrically converted image signal.

〔従来の技術〕[Conventional technology]

第10図は従来の画像形成装置の制御ブロック図であり
、51はリーダで、例えばCODで構成される撮像素子
51a 、撮像素子51aの出力を保持するバッファメ
モリ51b9画像処理部51c 9画像間期メモリ51
d 、制御部51e等から構成されている。
FIG. 10 is a control block diagram of a conventional image forming apparatus. Reference numeral 51 denotes a reader, for example, an image sensor 51a composed of a COD, a buffer memory 51b for holding the output of the image sensor 51a, an image processing section 51c, 9 image interperiods. memory 51
d, a control section 51e, and the like.

52はプリンタ部で、画像同期メモリ51dより出力さ
れる画像信号を変調する変調回路52a 、変調回路5
2aから送出される変調信号を図示しないレーザの駆動
信号、すなわち、オン、オフ信号に変換するレーザ変調
部52b、制御部52c等から構成されている。
Reference numeral 52 denotes a printer section, which includes a modulation circuit 52a that modulates the image signal output from the image synchronization memory 51d, and a modulation circuit 5.
It is comprised of a laser modulator 52b, a controller 52c, etc., which converts the modulation signal sent out from 2a into a drive signal for a laser (not shown), that is, an on/off signal.

光学像を密着型のCCD等の撮像素子51aで読み取り
、制御部51eの指示で、この読み取り画像データをシ
リアルに取り込むメモリ、すなわちバッファメモリ51
bに一時格納し、さらに、プリンタの走査駆動系に同期
させて読み取り画像を送出するための画像同期メモリ5
1dにバッファメモリ51bより順次読み出し、プリン
タ部52の変調回路52aを介してレーザ変調回路52
bに画像信号を送出し、記録媒体、例えば記録紙に画像
を出力するのが通例である。
An optical image is read by an image sensor 51a such as a contact type CCD, and a memory, that is, a buffer memory 51, serially captures the read image data according to instructions from a control unit 51e.
an image synchronization memory 5 for temporarily storing the image in b and further transmitting the read image in synchronization with the scanning drive system of the printer;
1d, are sequentially read from the buffer memory 51b and transmitted to the laser modulation circuit 52 via the modulation circuit 52a of the printer section 52.
It is customary to send an image signal to b and output the image onto a recording medium, such as recording paper.

この場合、l 6 dot#+m程度の分解能で画像を
読み取り、1分間に20枚のスループットe実現しよう
とすると、1dot、当りの画素の転送時間は、概算で
60nsec前後になる。このような転送速度を有する
画像信号が各ユニットを経由して、プリンタの走査駆動
系に順次送出されて行く。
In this case, if an image is read with a resolution of approximately l 6 dot#+m and a throughput of 20 images per minute is to be achieved, the transfer time for each pixel per dot will be approximately 60 nsec. Image signals having such transfer speeds are sequentially sent to the scanning drive system of the printer via each unit.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

上記のように構成された装置においては1画像性号の通
信状態をチェックする必要性が生じる。
In the apparatus configured as described above, it is necessary to check the communication status of one image signal.

何故ならば、画像信号転送中に、特に、バッファメモリ
51bにてパラレルデータをシリアルデータに変換する
際に、例えば外的要因によりノイズが重畳すると、読み
取り画像とは異なる画像信号がプリンタの走査駆動系に
転送され、結果的にノイズの影響を受けた不鮮明な画像
が出力されてしまう等の問題が起こる。このため、上述
したような症状が画像に現れた場合は、計測機器を、例
えばオシロスコープ等を装置本体に接続し、画像信号の
入出力を監視して、各ユニットの診断を実行していたが
、前述したように、画像信号のうち、1 dot当りの
転送時間は約60nsec程度であり、かつ、画像信号
は不確定であるので、各ユニットの正確な診断を行うこ
とができない等の問題点があった。
This is because, if noise is superimposed due to an external factor during image signal transfer, especially when converting parallel data to serial data in the buffer memory 51b, an image signal different from the read image may be used to drive the printer's scanning drive. This results in problems such as a blurred image affected by noise being output. For this reason, when the above-mentioned symptoms appeared in the image, a measurement device such as an oscilloscope was connected to the main body of the device and the input/output of the image signal was monitored to diagnose each unit. As mentioned above, the transfer time per dot of the image signal is about 60 nsec, and the image signal is uncertain, so there are problems such as the inability to accurately diagnose each unit. was there.

〔問題点を解決するための手段〕[Means for solving problems]

この発明に係る画像形成装置は、画像信号のバッファへ
の書き込みに同期して所定のテストパターンを送出する
テストパターン送出手段と、バッファより読み出される
テストパターンと基準テストパターンとを比較し、伝送
エラーを計数するカウント手段と、このカウント手段が
計数した伝送エラー回数に応じて、画像信号の送出を制
御する信号制御手段とを設けたものである。
The image forming apparatus according to the present invention includes a test pattern sending unit that sends out a predetermined test pattern in synchronization with the writing of an image signal into a buffer, and compares the test pattern read from the buffer with a reference test pattern to detect transmission errors. The apparatus is provided with a counting means for counting the number of transmission errors, and a signal control means for controlling transmission of the image signal according to the number of transmission errors counted by the counting means.

〔作用〕[Effect]

この発明においては、テストパターン送出手段が発生さ
せたランダムなテストパターンを画像信号に同期させて
バッファに書き込み、カウント手段がバッファから読み
出されるテストパターンと基準テストパターンとの不一
致を計数して、各ユニット間におけるテストパターンの
伝送エラーを計数し、その計数値に応じて信号制御手段
が画像信号の送出を制御する。その際、必要に応じ伝送
エラー発生度およびシステム状態を表示させることがで
きる。
In this invention, the random test pattern generated by the test pattern sending means is written into the buffer in synchronization with the image signal, and the counting means counts the discrepancies between the test pattern read from the buffer and the reference test pattern. A signal control means counts transmission errors of test patterns between units, and controls transmission of image signals according to the counted value. At that time, the degree of occurrence of transmission errors and the system status can be displayed if necessary.

〔実施例〕〔Example〕

第1図はこの発明の一実施例を示す画像形成装置の構成
ブロック図であり、1は密着型光電素子で、チャンネル
1a〜1eから出力されるアナログ信号V1〜V5を信
号処理部2に送出する。信号処理部2はアナログ信号を
サンプルホールドして、通信ケーブル3を介して5チャ
ンネル分のアナログ信号を画像読み取り制御部4のA/
D変換器4aに転送する。4bはバッファとなるつなぎ
メモリで、A/D変換された画像信号を整列化する。4
cは画像処理ユニッ)(IPU)で、画像信号を多値化
して中間調を表現する信号に変換する。また、カラー画
像信号の処理、例えばガンマ変換等の画像信号処理を行
う。4dは同期メモリで、I PU4cからの画像信号
をプリンタ5に送出する。4eは同期制御回路で、制御
部4hからの指令に応じて信号処理部2とつなぎメモリ
4bとのIloを制御する。4fは同期制御回路で、つ
なぎメモリ4bから読み出す画像信号のIPU4cへの
書き込みを制御する。4gは同期制御回路で、I PU
4cから読み出す画像信号の同期メモリ4dへの書き込
みを制御する。なお、1〜4を総称する場合はり−ダと
呼ぶ。
FIG. 1 is a configuration block diagram of an image forming apparatus showing an embodiment of the present invention, in which 1 is a contact type photoelectric element, which sends analog signals V1 to V5 output from channels 1a to 1e to a signal processing section 2. do. The signal processing section 2 samples and holds the analog signal, and sends the analog signal for 5 channels to the A/D of the image reading control section 4 via the communication cable 3.
It is transferred to the D converter 4a. 4b is a link memory serving as a buffer, which arranges the A/D converted image signals. 4
c is an image processing unit (IPU) that multi-values the image signal and converts it into a signal expressing halftones. It also processes color image signals, for example image signal processing such as gamma conversion. 4d is a synchronous memory that sends the image signal from the IPU 4c to the printer 5. 4e is a synchronous control circuit that controls Ilo between the signal processing section 2 and the connection memory 4b in accordance with commands from the control section 4h. 4f is a synchronization control circuit that controls writing of the image signal read from the connection memory 4b to the IPU 4c. 4g is a synchronous control circuit, I PU
The writing of the image signal read from 4c into the synchronous memory 4d is controlled. In addition, when 1 to 4 are collectively referred to as beams.

プリンタ5は、同期メモリ4dから送出されるページ単
位に格納するページメモリ5a  、このページメモリ
5aに格納された画像信号を変調する変調回路5b 、
変調回路5bから送出される変調信号を図示しないレー
ザの駆動信号、すなわち点滅信号に変換するレーザ変調
部5c、レーザの走査開始位置を検知するBDセンサ5
d  、同期制御回路5e  、制御部5f等から構成
されている。6はI10ポートであり、リーグの制御部
4hに接続されている。7はI10ポートで、プリンタ
5の制御部5fに接続されている。なお、制御部5fは
ページメモリ5aの画像データ伝送エラーを判断して、
伝送エラー回数が任意に設定する伝送エラー回数以下の
うちは、画像データのページメモリ5aへの転送を繰り
返させる。
The printer 5 includes a page memory 5a that stores page units sent from the synchronous memory 4d, a modulation circuit 5b that modulates the image signal stored in the page memory 5a,
A laser modulator 5c that converts the modulation signal sent from the modulation circuit 5b into a laser drive signal (not shown), that is, a blinking signal, and a BD sensor 5 that detects the laser scanning start position.
d, a synchronous control circuit 5e, a control section 5f, etc. 6 is an I10 port, which is connected to the league control unit 4h. 7 is an I10 port, which is connected to the control section 5f of the printer 5. Note that the control unit 5f determines an image data transmission error in the page memory 5a, and
As long as the number of transmission errors is less than the arbitrarily set number of transmission errors, the image data is repeatedly transferred to the page memory 5a.

第2図は第1図に示すつなぎメモリ4bの詳細を示す構
成ブロック図であり、11.12は/<ス切換ICで、
バス切換IC11,12の間にインバータ13がvc続
されている。14.15はバッファメモリで、インバー
タ16.マルチプレクサ17.18が画像信号のリード
ライトアドレスを切換える。19はマルチプレクサで、
バッファメモリ14.15のチャンネルセレクト端子C
8を切換える。20はゲート回路で、出力データのテス
トパターン部のみを抽出する。21はゲート回路で、基
準パターンのみを抽出する。22はコンパレータで、バ
ッファメモリ14.15より出力されるテストパターン
と基準パターンとを比較し、一致しない信号、すなわち
、エラ一部分を抽出する。23はこの発明のカウント手
段となるエラーカウンタで、コンパレータ22より出力
されるエラ一部分をカウントする。24はラッチ回路で
、エラーカウンタ23のカウント値をVSYNC信号(
後述する)の立ち下りで保持する。25はゲート回路で
、テストパターンを付加する。
FIG. 2 is a configuration block diagram showing details of the link memory 4b shown in FIG. 1, and 11.12 is a /< switch IC,
An inverter 13 is connected between the bus switching ICs 11 and 12. 14.15 is a buffer memory, and inverter 16.15 is a buffer memory. Multiplexers 17 and 18 switch the read/write address of the image signal. 19 is a multiplexer,
Channel select terminal C of buffer memory 14.15
Switch 8. 20 is a gate circuit that extracts only the test pattern portion of the output data. 21 is a gate circuit that extracts only the reference pattern. A comparator 22 compares the test pattern output from the buffer memory 14.15 with the reference pattern and extracts a signal that does not match, that is, a part of the error. Reference numeral 23 denotes an error counter serving as a counting means of the present invention, which counts a portion of errors output from the comparator 22. 24 is a latch circuit that outputs the count value of the error counter 23 to the VSYNC signal (
(described later) is held at the falling edge. 25 is a gate circuit to which a test pattern is added.

26はゲート回路で、テストパターンを除去する。27
はインバータ回路、28はROMで、整列化されていな
いランダムデータ、例えば「01011j  、li’
o1100Jを複数個有するテストパターンが小容量書
き込まれている。29はROMで、基準パターンがテス
トパターンと同様に書き込まれている。なお、ROM2
8.29に書き込まれるランダムデータは同一のもので
ある。
26 is a gate circuit that removes the test pattern. 27
28 is an inverter circuit, and 28 is a ROM that stores unaligned random data, such as "01011j, li'
A test pattern having a plurality of o1100J is written in a small capacity. 29 is a ROM in which a reference pattern is written in the same way as a test pattern. In addition, ROM2
The random data written in 8.29 is the same.

30はこの発明のテストパターン送出手段をなすタイミ
ング回路で、ROM28に書き込まれたランダムデータ
の送出を制御し、水平同期信号(BD倍信号に同期して
画像信号区間以外の区間に挿入する。31はカウンタで
、VSYNC信号に同期してテストパターンの副走査方
向アドレスを力。
Reference numeral 30 denotes a timing circuit which constitutes a test pattern sending means of the present invention, which controls the sending of random data written in the ROM 28 and inserts it into an interval other than the image signal interval in synchronization with the horizontal synchronizing signal (BD double signal). 31 is a counter that inputs the sub-scanning direction address of the test pattern in synchronization with the VSYNC signal.

ラントする。32.33はタイミング回路で、画像有効
領域を制御する。34はライトカウンタで、バス37を
介してバッファメモリ14.15の書き込みアドレスを
カウントする。36はり一ドカウンタで、バス35を介
してバッファメモリ14.15の読み出しアドレスをカ
ウントする。
Runt. 32 and 33 are timing circuits that control the image effective area. A write counter 34 counts write addresses of the buffer memories 14 and 15 via a bus 37. A counter 36 counts read addresses of the buffer memory 14 and 15 via the bus 35.

38はアクセスコントローラで、バッファメモリ14.
15のアクセスを制御する。39はこの発明の信号制御
手段となる主制御部で、I10ボート6を介して入力さ
れるカウント値より、伝送エラーの状態をあらかじめ設
定されるエラー生起回数から判断し、テストパターンの
再送を指令するとともに、図示しない操作部の表示手段
に伝送良否を表示させる。また、伝送エラーの状態をあ
らかじめ設定されるエラー生起回数から判断し、再起可
能性を判断して画像信号の送出を抑止するとともに、そ
の旨を表示手段に表示させる。40はオアゲート回路で
、つなぎメモリ4に入力される5チャンネル分の画像信
号をプリンタ5に送出する。なお、つなぎメモリ4bは
各チャンネル分同様に構成されているが説明上チャン・
ネル1aのみについて示しである。
Reference numeral 38 denotes an access controller, and buffer memory 14.
Controls access to 15. Reference numeral 39 denotes a main control unit serving as a signal control means of the present invention, which determines the transmission error state based on the preset number of error occurrences based on the count value input via the I10 port 6, and instructs retransmission of the test pattern. At the same time, the transmission quality is displayed on the display means of the operation section (not shown). Further, the state of the transmission error is determined based on a preset number of occurrences of the error, the possibility of recurrence is determined, and transmission of the image signal is suppressed, and a display means displays a message to that effect. Reference numeral 40 denotes an OR gate circuit, which sends image signals for five channels inputted to the connecting memory 4 to the printer 5. Note that the connection memory 4b is configured in the same way for each channel, but for the sake of explanation,
Only the channel 1a is shown.

次に第3図(a)〜(C)、第4図(a)〜(h)を参
照しながら第2図の動作について説明する。
Next, the operation in FIG. 2 will be explained with reference to FIGS. 3(a) to 3(C) and FIGS. 4(a) to (h).

第3図(a)〜(C)は第2図に示すバッファメモリ1
4.15に書き込まれる画像信号とテストパターンの関
係を示すタイムチャートである。
Figures 3(a) to (C) show the buffer memory 1 shown in Figure 2.
4.15 is a time chart showing the relationship between the image signal and the test pattern written in FIG.

第3図(a)において、BDはBDセンサ5cより送出
される水平同期信号を示し、同図(b)において、VI
DEOは5チャンネル分の画像信号を示し、同図(C)
において、TPはテストパターンで、ROM28に書き
込まれた1ライン目のテストパターンを示している。
In FIG. 3(a), BD indicates the horizontal synchronizing signal sent from the BD sensor 5c, and in FIG. 3(b), VI
DEO shows image signals for 5 channels, as shown in the same figure (C).
, TP is a test pattern and indicates the first line test pattern written in the ROM 28.

第4図(a)〜(h)は第2図に示すバッファメモリ1
4.15より読み出される画像信号とテストパターンと
の関係を示すタイムチャートである。
FIGS. 4(a) to (h) show the buffer memory 1 shown in FIG.
4.15 is a time chart showing the relationship between the image signal read out and the test pattern.

同図(a)において、CKは読み出しクロックで、リー
ドカウンタ36に入力される。同図(b)において、C
H,は読み出しデータで、画像信号Vtの両側にテスト
パターンTPが付加されている。同図(b)〜(f)に
おいて、CH2,CH5は読み出しデータで、各画像信
号v2〜■5の両側にテストパターンTPがそれぞれ付
加されている。同図(g)において、RVは抽出画像デ
ータで、I PU4cに送出される。抽出画像データR
Vは両側にテストパターンが付加されている。同図(h
)において、MVは有効画像データで、同期メモリ4d
に送出される。
In FIG. 3A, CK is a read clock and is input to the read counter 36. In the same figure (b), C
H, is read data, and test patterns TP are added to both sides of the image signal Vt. In (b) to (f) of the figure, CH2 and CH5 are read data, and test patterns TP are added to both sides of each image signal v2 to v5, respectively. In FIG. 4(g), RV is extracted image data and is sent to the IPU 4c. Extracted image data R
Test patterns are added to both sides of V. The same figure (h
), MV is valid image data and is stored in the synchronous memory 4d.
will be sent to.

第3図(a)に示す水平同期信号BDが同期制御回路4
eに入力されると、この水モ同期信号BDに同期して密
着型光電素子1のチャンネル1a〜1eから出力される
アナログ信号Vl〜■5の区間の両側にROM28に書
き込まれたテストパターンの内、lライン目のランダム
データが付加され、バッファメモリ14,15にパラレ
ルに格納される。この操作を水平同期信号B−Dに同期
して、入力される画像信号について行う。このとき、テ
ストパターンTPはROM28から順次具なるランダム
データが対応する画像信号に付加されてバッファメモリ
74.15に格納されて行く。
The horizontal synchronizing signal BD shown in FIG.
e, the test pattern written in the ROM 28 is displayed on both sides of the section of the analog signals Vl to 5 which are output from the channels 1a to 1e of the contact type photoelectric element 1 in synchronization with the water synchronization signal BD. Among them, random data of the l-th line is added and stored in the buffer memories 14 and 15 in parallel. This operation is performed on the input image signal in synchronization with the horizontal synchronization signal BD. At this time, the test pattern TP is sequentially added with random data from the ROM 28 to the corresponding image signal and stored in the buffer memory 74.15.

次いで、リードカウンタ36に入力される読み出しクロ
ックCK(第4図(a)参照)に同期して、バッファメ
モリ14.15から読み出され、各チャンネル1a〜1
eに対応する読み出しデータCH+ CHs  (第4
図(b)〜(f)参照)がバス切換IC12,ゲート回
路2oを介して、コンパレータ22に入力される。一方
、コンパレータ22には同時にROM29より読み出さ
れる基準パターンがゲート回路29を介してコンパレー
タ22に入力される。この基準パターンの読み出しはタ
イミング回路32に制御されており、同一のランダムデ
ータであるところのテストパターンTPをコンパレータ
22が比較することになる。
Next, in synchronization with the read clock CK input to the read counter 36 (see FIG. 4(a)), the signals are read from the buffer memory 14.
Read data CH+ CHs corresponding to e (4th
(see Figures (b) to (f)) are input to the comparator 22 via the bus switching IC 12 and the gate circuit 2o. On the other hand, the reference pattern read out from the ROM 29 is simultaneously input to the comparator 22 via the gate circuit 29 . Reading of this reference pattern is controlled by the timing circuit 32, and the comparator 22 compares the test pattern TP, which is the same random data.

この比較により、テストパターンが一致しない場合は、
所定のパルス信号がコンバレ〜り22より出力される。
If this comparison shows that the test patterns do not match,
A predetermined pulse signal is output from the converter 22.

このパルス信号をエラーカウンタ23がカウントして行
き、副走査方向の画像終了を示すVSYNC信号(第5
図参照)に同期して、エラーカウンタ23のカウント値
がラッチ回路24に保持される。このラッチ出力がI1
0ポート6を介して、主制御部39にて判断され、1画
像中の伝送エラーがあらかじめ定めた設定値よりも大き
い場合は、再度同じ画像データの送出をつなぎメモリ4
bに指令する。ここで同様の伝送エラーが所定回数繰り
返されると、伝送エラー回復不能と判断し、図示しない
操作部の表示手段にその画表示して、操作者に警告する
とともに、システムを停止させる。なお、伝送エラーが
許容範囲内に収まる場合は、画像データの送出を継続す
る。これは、出力される画像上問題がない程度の伝送エ
ラーではシステムを停止することなく画像形成を実行さ
せ、運転効率を低下しないようにするものである。
The error counter 23 counts this pulse signal, and the VSYNC signal (fifth
(see figure), the count value of the error counter 23 is held in the latch circuit 24. This latch output is I1
If the transmission error in one image is larger than a predetermined setting value, it is determined by the main control unit 39 via the 0 port 6 that the transmission of the same image data is repeated and the memory 4
Command b. If the same transmission error is repeated a predetermined number of times, it is determined that the transmission error cannot be recovered, and the system is displayed on the display means of the operation section (not shown) to warn the operator and stop the system. Note that if the transmission error falls within the permissible range, sending out the image data is continued. This is to allow image formation to be executed without stopping the system in the case of a transmission error that does not cause any problem in the output image, so as not to reduce operational efficiency.

なお、伝送エラーの監視は、第6図に示される画像有効
領域(斜線で示す)に限り、必要のない領域については
エラーカウントを実行しないように構成されている。ま
た、第6図において、vlは有効画像領域の副走査範囲
を示し、V2は最大副走査範囲を示し、Hlは有効画像
領域の主走査範囲を示し、H2は最大主走査範囲を示し
ている。
Note that transmission error monitoring is limited to the effective image area (indicated by diagonal lines) shown in FIG. 6, and error counting is not performed for unnecessary areas. Further, in FIG. 6, vl indicates the sub-scanning range of the effective image area, V2 indicates the maximum sub-scanning range, Hl indicates the main-scanning range of the effective image area, and H2 indicates the maximum main-scanning range. .

次に第7図を参照しながらこの発明のシステム診断制御
動作について説明する。
Next, the system diagnosis control operation of the present invention will be explained with reference to FIG.

第7図はこの発明の一実施例を示す画像形成装置のシス
テム診断制御動作を説明するフローチャートである。な
お、(1)〜(9)は各ステップを示す。
FIG. 7 is a flowchart illustrating a system diagnosis control operation of an image forming apparatus according to an embodiment of the present invention. Note that (1) to (9) indicate each step.

まず、コピーオンの判別ルーチンの終了を待機しく1)
、ROM28に書き込まれたテストパターンをアナログ
信号■1〜v5の区間の両側に付加してバッファメモリ
14.15に書き込むテストパターン送出ルーチンを本
画像形成動作に先立って実行しく2)、読み出しクロッ
クCKに同期して、バッファメモリ14.15よりテス
トパターンTPを読み出して、エラーカウンタ23がR
CM29に書き込まれた基準パターンとを比較し、伝送
エラーを計数する。次いで、所定時間経過後、主制御部
39がラッチ回路24に保持される、伝送エラー回数を
読み出しく3)、その伝送経路上の伝送エラーがあらか
じめ設定される許容範囲内に収まっているかどうかを判
断しく4)、YESならば通常のコピー動作を実行する
(5)。この際、バッファメモリ14.15には読み出
しデータCHI 〜CH5の両側にテストパターンTP
が付加された状態で格納されている0次いで、読み出し
データCI(+”CR2の同期メモリ4dへの書き込み
に並行して、前述同様の伝送エラーがあらかじめ設定さ
れる許容範囲内に収まっているかどうかを判断する(6
)。この判断で、YESならばステップ(1)に戻り、
Noならば、伝送エラーがあらかじめ設定される回数以
上生起したかどうかを判断しく7)、Noならばステッ
プ(5)に戻り、YESならばステップ(9)に進む。
First, wait for the copy-on determination routine to finish.1)
, A test pattern sending routine for adding the test pattern written in the ROM 28 to both sides of the section of the analog signal 1 to v5 and writing it in the buffer memory 14.15 is executed prior to the main image forming operation 2), the read clock CK The test pattern TP is read out from the buffer memory 14.15 in synchronization with the error counter 23.
It compares it with the reference pattern written in the CM 29 and counts transmission errors. Next, after a predetermined period of time has elapsed, the main control unit 39 reads out the number of transmission errors held in the latch circuit 24 (3), and checks whether the transmission errors on that transmission path are within a preset tolerance range. If the judgment is YES (4), the normal copy operation is executed (5). At this time, test patterns TP are placed on both sides of the read data CHI to CH5 in the buffer memories 14 and 15.
Next, in parallel with writing the read data CI (+"CR2 to the synchronous memory 4d), check whether the same transmission error as described above is within the preset tolerance range. Judging (6
). If this judgment is YES, return to step (1),
If No, it is determined whether the transmission error has occurred more than a preset number of times (7). If No, the process returns to step (5), and if YES, the process proceeds to step (9).

一方、ステップ(4)の判断で、伝送エラーがあらかじ
め設定される回数以上生起したかどう−かを判断しく8
)、Noならばステップ(2)に戻り、YESならば表
示手段(図示しない)に伝送エラー回復見込み無しと判
断し、主制御部39が警告表示するとともに、システム
を停止させる(9)。
On the other hand, in step (4), it is determined whether transmission errors have occurred more than a preset number of times.
), if NO, the process returns to step (2), and if YES, it is determined that there is no hope of recovery from the transmission error on the display means (not shown), and the main control unit 39 displays a warning and stops the system (9).

次に第8図を参照しながら第1図に示すリーグ部とプリ
ンタ5の相互動作について説明する。
Next, with reference to FIG. 8, the interaction between the league section and printer 5 shown in FIG. 1 will be explained.

第8図は第1図に示すリーグ部とプリンタ5の相互動作
を説明するフローチャートである。なお、(1)〜(8
)は各ステップを示す。
FIG. 8 is a flowchart illustrating the mutual operation of the league section and printer 5 shown in FIG. In addition, (1) to (8
) indicates each step.

プリンタ5は、まずリーグ部から画像データを通信する
通信ルーチンを実行しく1)、プリント信号がリーグ部
から送出されたかどうかを判断しく2)、Noならば図
示しないRAMに画像データをストアし、YESならば
画像データの転送を開始する転送ルーチンを行う(3)
。次いで、画像データの伝送エラーがあらかじめ設定さ
れる許容範囲内に収まっているかどうかを判断しく4)
、YESならば通常のコピー動作を実行しステップ(1
)に戻り(5)、NOならば伝送エラーがあらかじめ設
定される回数以上生起したかどうかを判断しくEi)、
YESならばリーグ通信ルーチンが故障と判断して、表
示手段にその旨警告表示するとともに、システムを停止
する故障シーケンスを行い、制御を終了する(7)。一
方、ステップ(6)の判断で、伝送エラーがあらかじめ
設定される回数以下の場合は、伝送エラーカウントをア
ップして(8)、再度画像データをリーダ部よりページ
メモリ5aに転送する要求を行いステ・具ブ(2)に戻
り、伝送エラーチェックを行う。
The printer 5 first executes a communication routine to communicate image data from the league section 1), determines whether a print signal has been sent from the league section 2), and if No, stores the image data in a RAM (not shown); If YES, perform a transfer routine to start transferring image data (3)
. Next, it is determined whether the image data transmission error is within a preset tolerance range 4)
, if YES, execute the normal copy operation and step (1)
), return to (5), and if NO, determine whether transmission errors have occurred more than a preset number of times (Ei),
If YES, it is determined that the league communication routine has failed, a warning to that effect is displayed on the display means, a failure sequence is performed to stop the system, and the control is terminated (7). On the other hand, if it is determined in step (6) that the number of transmission errors is less than the preset number, the transmission error count is increased (8) and a request is made again to transfer the image data from the reader section to the page memory 5a. Return to step (2) and check for transmission errors.

なお、上記実施例ではカラー画像信号の場合について詳
細に説明していないが、密着型光電素子1に色分解フィ
ルタを設け、RGB信号に変換すれば同様に伝送エラー
をチェックできる。
Although the case of a color image signal is not explained in detail in the above embodiment, if a color separation filter is provided in the contact type photoelectric element 1 and the signal is converted into an RGB signal, transmission errors can be similarly checked.

第9図はこの発明による画像形成装置の一実施例を示す
断面図であり、41は原稿であり、42はリーダ部であ
り、原稿41を載置するプラテンガラス42a、原稿4
1を照らす光源42b、光源42bの光を集光するため
の反射鏡42c、光源42bから原稿41を集光するた
めの光収束性レンズ42d 、集光した光像を電気信号
に変換する密着型光電変換素子42e 、密着型光電変
換素子42eより出力される信号を波形整形する信号処
理回路42f 、信号処理回路42fから出力される信
号を送出する伝送ケーブル42g、信号処理回路42f
より出力される信号を処理し、かつ各部のコントロール
を行う画像読み取り制御部42hより構成されており、
ワイヤ44に接続された走査台4Sがプーリー45の回
転に応じて矢印方向に往復動する。46はモータで、プ
ーリー45を駆動する。
FIG. 9 is a sectional view showing an embodiment of the image forming apparatus according to the present invention, in which 41 is a document, 42 is a reader section, a platen glass 42a on which the document 41 is placed, and a platen glass 42a on which the document 41 is placed;
A light source 42b that illuminates the original 41, a reflecting mirror 42c that focuses the light from the light source 42b, a light converging lens 42d that focuses the light from the light source 42b onto the original 41, and a close-contact type that converts the focused optical image into an electrical signal. A photoelectric conversion element 42e, a signal processing circuit 42f that shapes the waveform of the signal output from the contact type photoelectric conversion element 42e, a transmission cable 42g that transmits the signal output from the signal processing circuit 42f, and a signal processing circuit 42f.
It is composed of an image reading control section 42h that processes signals output from the image reading control section 42h and controls each section.
The scanning table 4S connected to the wire 44 reciprocates in the direction of the arrow in accordance with the rotation of the pulley 45. A motor 46 drives the pulley 45.

47はプリンタ部であり、リーダ部42より出力される
信号を通信するインタフェース回路47a 、インタフ
ェース回路47aより出力される信号をし」ザ光に変換
するレーザ変調部47b、レーザ光を走査するスキャナ
部47c 、走査されたレーザ光の方向を変えるポリゴ
ンミラー47d 。
Reference numeral 47 denotes a printer section, which includes an interface circuit 47a for communicating signals output from the reader section 42, a laser modulation section 47b for converting the signals output from the interface circuit 47a into laser light, and a scanner section for scanning the laser light. 47c, a polygon mirror 47d that changes the direction of the scanned laser beam;

レーザ光により潜像を形成する感光ドラム47e 、感
光ドラム47eに電荷を帯電させる帯電器47f 、感
光ドラム47e上の潜像を現像する現像器47g、現像
器47eにトナー(現像材)を補給するトナーホッパ4
7h、記録紙を収容するカセット4’7i、給紙ローラ
47j 9画先合せを行うレジストローラ47k 、記
録紙にトナー像を転写する転写帯電器471.)ナーが
転写された記録紙を搬送する搬送ユニット47m 、転
写されたトナー像と記録紙を定着させる定着ユニット4
7n 、定着された記録紙を載置する排紙トレイ47o
 、BDセンサ47p等から構成される。
A photosensitive drum 47e that forms a latent image using laser light, a charger 47f that charges the photosensitive drum 47e, a developer 47g that develops the latent image on the photosensitive drum 47e, and a toner (developing material) supplied to the developer 47e. Toner hopper 4
7h, a cassette 4'7i that stores the recording paper, a paper feed roller 47j, a registration roller 47k that aligns the leading edge of nine images, a transfer charger 471 that transfers the toner image onto the recording paper. ) a conveying unit 47m that conveys the recording paper onto which the toner has been transferred; a fixing unit 4 that fixes the transferred toner image and the recording paper;
7n, a paper output tray 47o on which the fixed recording paper is placed;
, BD sensor 47p, etc.

なお1画像形成動作は公知の電子写真方式に準するので
詳細な説明は省略する。
Note that since the single image forming operation is based on a known electrophotographic method, detailed explanation will be omitted.

〔発明の効果〕〔Effect of the invention〕

以上説明したように、この発明は画像信号のバッファへ
の書き込みに同期して所定のテストパターンを送出する
テストパターン送出手段と、バッファより読み出される
テストパターンと基準テストパターンとを比較し、伝送
エラーを計数するカウント手段と、このカウント手段が
計数した伝送エラー回数に応じて、画像信号の送出を制
御する信号制御手段とを設けたので、有効画像領域に対
する画像データの伝送チェックを画像信号の送出前およ
び送出中に迅速、かつ、正確に行い、必要に応じて各ユ
ニットの伝送エラー状態を表示することができる。また
、伝送エラーに応じて画像信号の再送または停止が制御
されるので、システムの診断が容易に行えるとともに、
システムの故障を予見できるので、システムの信頼性を
大幅に向上できる等の利点を有する。
As explained above, the present invention includes a test pattern sending unit that sends out a predetermined test pattern in synchronization with the writing of an image signal into a buffer, and compares the test pattern read out from the buffer with a reference test pattern to detect transmission errors. Since the count means for counting the number of transmission errors counted by the count means and the signal control means for controlling the transmission of the image signal according to the number of transmission errors counted by the counting means are provided, the transmission check of the image data for the valid image area can be performed by transmitting the image signal. This can be done quickly and accurately before and during transmission, and the transmission error status of each unit can be displayed if necessary. In addition, since retransmission or stop of image signals is controlled according to transmission errors, system diagnosis can be easily performed, and
Since system failures can be predicted, system reliability can be greatly improved.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明の一実施例を示す画像形成装置の構成
ブロック図、第2図は第1図に示すつなぎメモリの詳細
を示す構成ブロック図、第3図(a)〜(C)は第2図
に示すつなぎメモリに書き込まれる画像信号とテストパ
ターンの関係を示すタイムチャート、第4図(a)〜(
h)は第2図に示すつなぎメモリより読み出される画像
信号とテストパターンとの関係を示すタイムチャート、
第5図は有効画像領域を決定するVSYNC信号を説明
するタイムチャート、第6図は有効画像領域を説明する
模式図、第7図はこの発明の一実施例を示す画像形成装
置のシステム診断制御動作を説明するフローチャート、
第8図は第1図に示すリーダ部とプリンタの相互動作を
説明するフローチャート、第9図はこの発明による画像
形成装置の一実施例を示す断面図、第10図は従来の画
像形成装置の制御ブロック図である。 図中、1は密着型光電素子、2は信号処理部、3は通信
ケーブル、4は画像読み取り制御部、4aはA/D変換
器、4bはつなぎメモリ、4cは画像処理ユニット、4
dは同期メモリ、4e〜4gは同期制御回路、4hは制
御部、5はプリンタ、5aはページメモリ、5bは変調
回路、5cはレーザ変調部、5dはBDセンサ、5eは
同期制御回路、5fは制御部、11.12はバス切換I
C113はインバータ、14.15はバッファメモリ、
16はインバータ、17〜19はマルチプレクサ、20
 、21はゲート回路、22は:ンバレータ、23はエ
ラーカウンタ、24はラッチ回路、28.29はROM
、3oはタイミング回路、39は主制御部である。 第3因 第4図 (h)MV    VI V2 V3 V4 V5第5
図 第6図 第7図 第8図
FIG. 1 is a block diagram showing the configuration of an image forming apparatus according to an embodiment of the present invention, FIG. 2 is a block diagram showing details of the connection memory shown in FIG. 1, and FIGS. A time chart showing the relationship between the image signal and the test pattern written in the connection memory shown in FIG. 2, and FIGS. 4(a) to (4).
h) is a time chart showing the relationship between the image signal read out from the connection memory shown in FIG. 2 and the test pattern;
FIG. 5 is a time chart illustrating the VSYNC signal that determines the effective image area, FIG. 6 is a schematic diagram illustrating the effective image area, and FIG. 7 is a system diagnostic control of an image forming apparatus showing an embodiment of the present invention. A flowchart explaining the operation,
FIG. 8 is a flowchart explaining the interaction between the reader section and printer shown in FIG. 1, FIG. 9 is a sectional view showing an embodiment of the image forming apparatus according to the present invention, and FIG. It is a control block diagram. In the figure, 1 is a contact type photoelectric element, 2 is a signal processing unit, 3 is a communication cable, 4 is an image reading control unit, 4a is an A/D converter, 4b is a connection memory, 4c is an image processing unit, 4
d is a synchronous memory, 4e to 4g are synchronous control circuits, 4h is a control unit, 5 is a printer, 5a is a page memory, 5b is a modulation circuit, 5c is a laser modulation unit, 5d is a BD sensor, 5e is a synchronous control circuit, 5f is the control unit, 11.12 is the bus switching I
C113 is an inverter, 14.15 is a buffer memory,
16 is an inverter, 17 to 19 are multiplexers, 20
, 21 is a gate circuit, 22 is an inverter, 23 is an error counter, 24 is a latch circuit, 28.29 is a ROM
, 3o is a timing circuit, and 39 is a main control section. 3rd cause Figure 4 (h) MV VI V2 V3 V4 V5 5th
Figure 6 Figure 7 Figure 8

Claims (4)

【特許請求の範囲】[Claims] (1)光電変換される画像信号をシリアルデータに変換
するバッファを有し、このバッファから前記画像信号を
所定単位毎に同期手段に書き込み、この同期手段より読
み出される前記画像信号に応じて画像を形成する画像形
成装置において、前記画像信号の前記バッファへの書き
込みに同期して所定のテストパターンを送出するテスト
パターン送出手段と、前記バッファより読み出される前
記テストパターンと基準テストパターンとを比較し、伝
送エラーを計数するカウント手段と、このカウント手段
が計数した伝送エラー回数に応じて、前記画像信号の送
出を制御する信号制御手段とを具備したことを特徴をす
る画像形成装置。
(1) It has a buffer that converts an image signal to be photoelectrically converted into serial data, writes the image signal from this buffer to a synchronizing means in predetermined units, and converts an image according to the image signal read out from the synchronizing means. In the image forming apparatus for forming an image, a test pattern sending means for sending out a predetermined test pattern in synchronization with writing of the image signal to the buffer, and comparing the test pattern read from the buffer with a reference test pattern, An image forming apparatus comprising: a counting means for counting transmission errors; and a signal control means for controlling transmission of the image signal according to the number of transmission errors counted by the counting means.
(2)テストパターンはランダムパターンであることを
特徴とする特許請求の範囲第(1)項記載の画像形成装
置。
(2) The image forming apparatus according to claim (1), wherein the test pattern is a random pattern.
(3)カウント手段の伝送エラーカウントは、画像信号
送出前および送出中に実行するとともに、カウントした
伝送エラーを表示することを特徴とする特許請求の範囲
第(1)項記載の画像形成装置。
(3) The image forming apparatus according to claim 1, wherein the counting means counts transmission errors before and during transmission of the image signal, and displays the counted transmission errors.
(4)同期メモリから送出される画像信号の伝送エラー
回数をカウントし、このエラーカウントが任意に設定さ
れるエラー回数を越えるまで、前記画像信号の送出を繰
り返させることを特徴とする特許請求の範囲第(1)項
記載の画像形成装置。
(4) The number of transmission errors of the image signal sent from the synchronous memory is counted, and the transmission of the image signal is repeated until the error count exceeds an arbitrarily set number of errors. The image forming apparatus according to scope (1).
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