JPS6236570A - 波形検索方式 - Google Patents
波形検索方式Info
- Publication number
- JPS6236570A JPS6236570A JP60176407A JP17640785A JPS6236570A JP S6236570 A JPS6236570 A JP S6236570A JP 60176407 A JP60176407 A JP 60176407A JP 17640785 A JP17640785 A JP 17640785A JP S6236570 A JPS6236570 A JP S6236570A
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- JP
- Japan
- Prior art keywords
- waveform
- circuit
- waveform memory
- fault
- memory
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- Pending
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- Information Retrieval, Db Structures And Fs Structures Therefor (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔擾既要〕
波形メモリに記憶された波形の、基準値以上のレベルが
所定時間以上連続した部分をコンピュータにて検索する
場合、この検索を、大小判定回路。
所定時間以上連続した部分をコンピュータにて検索する
場合、この検索を、大小判定回路。
連続時間検出回路、ラッチ回路によるハードウェア構成
にて検索することで、検索を高速に出来るようにしたも
のである。
にて検索することで、検索を高速に出来るようにしたも
のである。
本発明は、波形メモリ上のサージ波形を解析して事故点
を標定するサージ受信形故障点標定システムの故障点標
定装置の場合等における、コンピュータで、波形メモリ
に記憶された波形の、基準値以上のレベルが所定時間以
上連続した部分を検索する波形検索方式の改良に関する
。
を標定するサージ受信形故障点標定システムの故障点標
定装置の場合等における、コンピュータで、波形メモリ
に記憶された波形の、基準値以上のレベルが所定時間以
上連続した部分を検索する波形検索方式の改良に関する
。
サージ受信形故障点標定システムについて以下説明する
。
。
第４図はサージ受信形故障点標定システムのブロック図
、第５図は第４図の故障点標定装置のブロック図、第６
図は１例の波形メモリ上の雷サージの波形を示す図であ
る。
、第５図は第４図の故障点標定装置のブロック図、第６
図は１例の波形メモリ上の雷サージの波形を示す図であ
る。
図中１．２は故障点標定装置、３．４は故障検出リレー
、５は送電線、６，７は遮断器、８は通信線、９はマイ
クロプロセッサ、１０はＡ／Ｄ変換器、１１は波形メモ
リ、１２は故障信号受信回路、Ｉ３はＲＯＭ、１４は基
準パルス発生回路を示す。
、５は送電線、６，７は遮断器、８は通信線、９はマイ
クロプロセッサ、１０はＡ／Ｄ変換器、１１は波形メモ
リ、１２は故障信号受信回路、Ｉ３はＲＯＭ、１４は基
準パルス発生回路を示す。
第４図において、送電線５のイ点が雷等により地絡する
と、故障検出リレー３，４を通り地絡点イに向かう電流
が流れ、故障検出リレー３，４が動作すると共に地絡点
イにてサージが発生し、このサージは地絡点イより左右
に送電線５上を伝播し、故障点標定装置１．２に達する
。
と、故障検出リレー３，４を通り地絡点イに向かう電流
が流れ、故障検出リレー３，４が動作すると共に地絡点
イにてサージが発生し、このサージは地絡点イより左右
に送電線５上を伝播し、故障点標定装置１．２に達する
。
このサージの伝播速度は定まっており又送電線５の長さ
は判っているので、故障点標定装置１゜２に持っている
第５図に示す同期した各々の基準パルス発生回路１４の
基準パルス発生時間とサージ到着迄の時間差を求め、こ
の値を通信線８を介して連絡することで時間差の差を求
め事故点（地絡点イ）の標定を行っている。
は判っているので、故障点標定装置１゜２に持っている
第５図に示す同期した各々の基準パルス発生回路１４の
基準パルス発生時間とサージ到着迄の時間差を求め、こ
の値を通信線８を介して連絡することで時間差の差を求
め事故点（地絡点イ）の標定を行っている。
この故障点標定装置１，２は、第５図に示す如き構成で
あり、Ａ／Ｄ変換器１０は送電線５に接続されており、
送電線にのって（る雑音をへ／Ｄ変換して波形メモリ１
１に記憶している。
あり、Ａ／Ｄ変換器１０は送電線５に接続されており、
送電線にのって（る雑音をへ／Ｄ変換して波形メモリ１
１に記憶している。
地絡が起こりサージが発生し、第４図の故障検出リレー
３又は４より故障信号が故障信号受信回路１２に入力す
ると、波形メモリ１１への記憶動作は停止される。
３又は４より故障信号が故障信号受信回路１２に入力す
ると、波形メモリ１１への記憶動作は停止される。
この場合の波形メモリ１１に記憶された波形は例えば第
６図に示す如くなる。
６図に示す如くなる。
ここでマイクロプロセッサ９は、ＲＯＭＩ ３に記憶さ
れているプログラムにより、波形メモリ１１上の事故点
を検索する。
れているプログラムにより、波形メモリ１１上の事故点
を検索する。
１例として、マイクロプロセッサ９は８ビツトマイクロ
コンピユータで、Ａ／Ｄ変換器１０はアナログ波形を８
ビツトのディジタル値に変換するものとし、クロック周
期は１μｓで波形メモリ１１は３２０にバイト（３２０
ｍｓのメモリ）メモリであるとすると、波形メモリに記
憶された波形の、基準値以上のレベルが所定時間以上連
続した部分を、コンピュータにて検索する場合高速に出
来ることが望ましい。
コンピユータで、Ａ／Ｄ変換器１０はアナログ波形を８
ビツトのディジタル値に変換するものとし、クロック周
期は１μｓで波形メモリ１１は３２０にバイト（３２０
ｍｓのメモリ）メモリであるとすると、波形メモリに記
憶された波形の、基準値以上のレベルが所定時間以上連
続した部分を、コンピュータにて検索する場合高速に出
来ることが望ましい。
〔従来の技術と発明が解決しようとする問題点〕従来波
形メモリに記憶された波形の、基準値以上のレベルが所
定時間以上連続した部分を、コンピュータにて検索する
場合は、ソフトウェアにて行なっていたので最大でＩＯ
秒程度かかるという問題点がある。
形メモリに記憶された波形の、基準値以上のレベルが所
定時間以上連続した部分を、コンピュータにて検索する
場合は、ソフトウェアにて行なっていたので最大でＩＯ
秒程度かかるという問題点がある。
上記問題点は、第１図において、波形メモリ２０より読
み出された波形のデータ２１と基準データ２２とを大小
判定回路１６にて比較判定し、該基準データ２２より大
きい場合の出力２３を連続時間検出回路１７に入力し、
この出力２３の連続時間値が所定の時間以上になった時
の該連続時間検出回路１７の出力により、該波形メモリ
２０の読み出しアドレス２４をラッチ回路１８にラッチ
しておき、このアドレスをプロセッサ１９にて読むよう
にした本発明の波形検索方式により解決される。
み出された波形のデータ２１と基準データ２２とを大小
判定回路１６にて比較判定し、該基準データ２２より大
きい場合の出力２３を連続時間検出回路１７に入力し、
この出力２３の連続時間値が所定の時間以上になった時
の該連続時間検出回路１７の出力により、該波形メモリ
２０の読み出しアドレス２４をラッチ回路１８にラッチ
しておき、このアドレスをプロセッサ１９にて読むよう
にした本発明の波形検索方式により解決される。
本発明によれば、波形メモリ２０に記憶された波形の、
基準値以上のレベルが所定時間以上連続した部分の検索
を行うのを、基準値以上のレベルの判定は大小判定回路
１６にて行い、基準値以上の場合の出力の連続時間値の
検出は連続時間検出回路１７で行い、所定の時間以上の
時出力する出力にて、その時の波形メモリ２０のアドレ
ス２４をラッチ回路１８にてラッチし、このラッチされ
たアドレスをプロセッサ１９にて読む、ハードウェア構
成にて行うので、３２０ｍｓ ｅ ｃ程度の高速で検索
出来る。
基準値以上のレベルが所定時間以上連続した部分の検索
を行うのを、基準値以上のレベルの判定は大小判定回路
１６にて行い、基準値以上の場合の出力の連続時間値の
検出は連続時間検出回路１７で行い、所定の時間以上の
時出力する出力にて、その時の波形メモリ２０のアドレ
ス２４をラッチ回路１８にてラッチし、このラッチされ
たアドレスをプロセッサ１９にて読む、ハードウェア構
成にて行うので、３２０ｍｓ ｅ ｃ程度の高速で検索
出来る。
〔実施例〕
第２図は本発明の実施例のブロック図、第３図は第２図
の各部の波形のタイムチャートでΦ２はクロック、Ａ−
Ｅは第１図のａ ”−ｅ点に対応している。
の各部の波形のタイムチャートでΦ２はクロック、Ａ−
Ｅは第１図のａ ”−ｅ点に対応している。
図中２５．２６は比較器、２７．２８はカウンタ、２９
はフリップフロップ、３０はラッチ回路、３２はノット
回路、３３はアンド回路、３４はナンド回路を示す。
はフリップフロップ、３０はラッチ回路、３２はノット
回路、３３はアンド回路、３４はナンド回路を示す。
以下フルスケール（Ｆ Ｓ）が２０ｐ３連続した部分を
ＤＭＡ （直接メモリアクセス）にて検索する場合を例
にとり説明する。
ＤＭＡ （直接メモリアクセス）にて検索する場合を例
にとり説明する。
第２図のクロックΦ２の周期は第３図中２に示す如く１
μｓであり又波形メモリからアドレスＡＯ〜Ａ１８に従
って読み出され比較器２５．２６に入力するデータＤ７
〜ＤＯは、オール１の時がフルスケールである。
μｓであり又波形メモリからアドレスＡＯ〜Ａ１８に従
って読み出され比較器２５．２６に入力するデータＤ７
〜ＤＯは、オール１の時がフルスケールである。
従ってマイクロプロセッサよりの比較器２５゜２６に入
力する基準データＲＤ７〜ＲＤＯを全て１としておき、
又カウンタ２７，２８にはマイクロプロセッサより２０
をプリセントしておく。
力する基準データＲＤ７〜ＲＤＯを全て１としておき、
又カウンタ２７，２８にはマイクロプロセッサより２０
をプリセントしておく。
又アンド回路３３には、ＤＭＡによるデータの読み出し
時ルベルを出力するＤＭＡＲをくわえ、ＤＭＡによるデ
ータの読み出し時以外では動作しないようにしておく。
時ルベルを出力するＤＭＡＲをくわえ、ＤＭＡによるデ
ータの読み出し時以外では動作しないようにしておく。
このようにしておけば、フルスケールの波形を読み出し
た時は、比較器２５の出力はルベルとなりアンド回路３
３を経た出力は第３図Ａに示す如くなり、カウンタ２７
．２８を起動する。
た時は、比較器２５の出力はルベルとなりアンド回路３
３を経た出力は第３図Ａに示す如くなり、カウンタ２７
．２８を起動する。
カウンタ２７，２８は、アンド回路３３の出力がルベル
の時にカウントアンプし、この出力が２０μＳ連続する
と、カウンタ２７，２８はカウントオーバし、カウンタ
２８より第３図Ｂに示す如きパルスを発し、フリップフ
ロップ２９に入力する。
の時にカウントアンプし、この出力が２０μＳ連続する
と、カウンタ２７，２８はカウントオーバし、カウンタ
２８より第３図Ｂに示す如きパルスを発し、フリップフ
ロップ２９に入力する。
これによりフリップフロップ２９の出力Ｑは第３図Ｃに
示す如（ルベルとなり、ラッチ回路３０に出力する。
示す如（ルベルとなり、ラッチ回路３０に出力する。
この時のフリップフロップ２９のＱの出力によりナンド
回路３４を介してクロックΦ２の入力を禁止しこの状態
を保持している。
回路３４を介してクロックΦ２の入力を禁止しこの状態
を保持している。
ラッチ回路３０は、このルベルの信号により、この時の
波形メモリの読み出しアドレスＡＯ〜Δ１８をラッチす
るので、これをマイクロプロセッサにて読めば、所望の
部分のアドレスを検索出来る。
波形メモリの読み出しアドレスＡＯ〜Δ１８をラッチす
るので、これをマイクロプロセッサにて読めば、所望の
部分のアドレスを検索出来る。
文例として、 １／２ＦＳ以上のレベルが５ ｐｍ以
上連続する部分のアドレスを検索する場合は、基準デー
タＲＤ７〜ＲＤＯのＲＤ７以外をルベルとし、カウンタ
２７，２８に５をプリセットすれば、以上と同様にして
所望のアドレスを検索出来る。
上連続する部分のアドレスを検索する場合は、基準デー
タＲＤ７〜ＲＤＯのＲＤ７以外をルベルとし、カウンタ
２７，２８に５をプリセットすれば、以上と同様にして
所望のアドレスを検索出来る。
このように、専用のハードウェアにて検索するようにす
れば、ソフトウェアにて検索するよりは蟲かに高速に検
索することが出来る。
れば、ソフトウェアにて検索するよりは蟲かに高速に検
索することが出来る。
以上詳細に説明せる如く本発明によれば、波形メモリに
記憶された波形の、基準値以上のレベルが所定時間以上
連続した部分をコンピュータにて検索する場合、ハード
ウェアにて行うので、高速に行うことが出来る効果があ
る。
記憶された波形の、基準値以上のレベルが所定時間以上
連続した部分をコンピュータにて検索する場合、ハード
ウェアにて行うので、高速に行うことが出来る効果があ
る。
第１図は本発明の原理ブロック図、
第２図は本発明の実施例のブロック図、第３図は第２図
の各部の波形のタイムチャート、第４図はサージ受信形
故障点標定システムのブロック図、 第５図は第４図の故障点標定装置のブロック図、第６図
は１例の波形メモリ上の雷サージの波形を示す図である
。 図において、 １．２は故障点標定装置、 ３．４は故障検出リレー、 ５は送電線、 ６．７は遮断器、 ８は通信線、 ９はマイクロプロセッサ、 １０はＡ／Ｄ変換器、 １１．２０は波形メモリ、 工２は故障信号受信回路、 １３はＲＯＭ、 １４は基準パルス発生回路、 １６は大小判定回路、 １７は連続時間検出回路、 １８．３０はラッチ回路、 １９はプロセッサ、 ２１はデータ、 ２２ば基準データ、 ２３は出力、 ２４はアドレス、 ２５．２６は比較器、 ２７．２８はカウンタ、 ２９はフリップフロップ、 ３２はノット回路、 ３３はアンド回路、 苅俗引月ρ斤萄ｒブロソ２０ 廉 １ （２） 発 ２ （イ） へ、 凸 へ ０ 灰 艶 （
の各部の波形のタイムチャート、第４図はサージ受信形
故障点標定システムのブロック図、 第５図は第４図の故障点標定装置のブロック図、第６図
は１例の波形メモリ上の雷サージの波形を示す図である
。 図において、 １．２は故障点標定装置、 ３．４は故障検出リレー、 ５は送電線、 ６．７は遮断器、 ８は通信線、 ９はマイクロプロセッサ、 １０はＡ／Ｄ変換器、 １１．２０は波形メモリ、 工２は故障信号受信回路、 １３はＲＯＭ、 １４は基準パルス発生回路、 １６は大小判定回路、 １７は連続時間検出回路、 １８．３０はラッチ回路、 １９はプロセッサ、 ２１はデータ、 ２２ば基準データ、 ２３は出力、 ２４はアドレス、 ２５．２６は比較器、 ２７．２８はカウンタ、 ２９はフリップフロップ、 ３２はノット回路、 ３３はアンド回路、 苅俗引月ρ斤萄ｒブロソ２０ 廉 １ （２） 発 ２ （イ） へ、 凸 へ ０ 灰 艶 （
Claims (1)
- 【特許請求の範囲】 波形メモリ（２０）に記憶された波形の、基準値以上の
レベルが所定時間以上連続した部分をコンピュータにて
検索するに際し、 該波形メモリ（２０）より読み出された波形のデータ（
２１）と基準データ（２２）とを大小判定回路（１６）
にて比較判定し、 該基準データ（２２）より大きい場合の出力（２３）を
連続時間検出回路（１７）に入力し、この出力（２３）
の連続時間値が所定の時間以上になった時の該連続時間
検出回路（１７）の出力により、 該波形メモリ（２０）の読み出しアドレス（２４）をラ
ッチ回路（１８）にラッチしておき、このアドレスをプ
ロセッサ（１９）にて読むようにしたことを特徴とする
波形検索方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60176407A JPS6236570A (ja) | 1985-08-10 | 1985-08-10 | 波形検索方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60176407A JPS6236570A (ja) | 1985-08-10 | 1985-08-10 | 波形検索方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6236570A true JPS6236570A (ja) | 1987-02-17 |
Family
ID=16013133
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60176407A Pending JPS6236570A (ja) | 1985-08-10 | 1985-08-10 | 波形検索方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6236570A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010054223A (ja) * | 2008-08-26 | 2010-03-11 | Yokogawa Electric Corp | 波形測定装置 |
-
1985
- 1985-08-10 JP JP60176407A patent/JPS6236570A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010054223A (ja) * | 2008-08-26 | 2010-03-11 | Yokogawa Electric Corp | 波形測定装置 |
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