JPS6239300U - - Google Patents
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- Publication number
- JPS6239300U JPS6239300U JP13209985U JP13209985U JPS6239300U JP S6239300 U JPS6239300 U JP S6239300U JP 13209985 U JP13209985 U JP 13209985U JP 13209985 U JP13209985 U JP 13209985U JP S6239300 U JPS6239300 U JP S6239300U
- Authority
- JP
- Japan
- Prior art keywords
- shift
- clock
- data
- shift register
- terminal
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Shift Register Type Memory (AREA)
- Tests Of Electronic Circuits (AREA)
Description
図は本考案の一実施例を示す回路系統図である
。 １……Ｄ型フリツプフロツプ、２……クロツク
パルス入力端子、３……データ入力端子、４……
シフトレジスタ、５……シフトクロツク入力端子
。
。 １……Ｄ型フリツプフロツプ、２……クロツク
パルス入力端子、３……データ入力端子、４……
シフトレジスタ、５……シフトクロツク入力端子
。
Claims (1)
- シフトクロツクに基づいて入力データのシフト
動作を行なうシフトレジスタと、シフトされるべ
きデータがそのデータ端子に供給されると共に、
該シフトクロツク以上の繰り返し周波数のクロツ
クパルスがそのクロツク端子に供給され、その出
力端子より出力するデータを該シフトレジスタへ
前記入力データとして供給するＤ型フリツプフロ
ツプとより構成してなるシフトレジスタ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13209985U JPS6239300U (ja) | 1985-08-29 | 1985-08-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13209985U JPS6239300U (ja) | 1985-08-29 | 1985-08-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6239300U true JPS6239300U (ja) | 1987-03-09 |
Family
ID=31031169
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13209985U Pending JPS6239300U (ja) | 1985-08-29 | 1985-08-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6239300U (ja) |
-
1985
- 1985-08-29 JP JP13209985U patent/JPS6239300U/ja active Pending
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