JPS623932Y2 - - Google Patents
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- Publication number
- JPS623932Y2 JPS623932Y2 JP3805381U JP3805381U JPS623932Y2 JP S623932 Y2 JPS623932 Y2 JP S623932Y2 JP 3805381 U JP3805381 U JP 3805381U JP 3805381 U JP3805381 U JP 3805381U JP S623932 Y2 JPS623932 Y2 JP S623932Y2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- output terminal
- signals
- cut
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000015572 biosynthetic process Effects 0.000 claims description 13
- 238000003786 synthesis reaction Methods 0.000 claims description 13
- 238000010586 diagram Methods 0.000 description 5
- 230000000903 blocking effect Effects 0.000 description 3
- 230000002950 deficient Effects 0.000 description 3
- 230000002238 attenuated effect Effects 0.000 description 1
- 238000012423 maintenance Methods 0.000 description 1
- 230000008054 signal transmission Effects 0.000 description 1
Landscapes
- Electronic Switches (AREA)
Description
【考案の詳細な説明】
本考案は信号合成回路、特に同一の成分をもつ
た２つの信号を合成したり、あるいはその片方の
信号のみを通過させ、他方を遮断したり、あるい
は両方の信号を遮断する機能をもつ信号合成回路
に関するものである。
た２つの信号を合成したり、あるいはその片方の
信号のみを通過させ、他方を遮断したり、あるい
は両方の信号を遮断する機能をもつ信号合成回路
に関するものである。
従来、この種の信号合成回路は、第１図に示す
ように信号入力端子１，２、信号出力端子３、信
号切替えのためリレー等より成るスイツチＳ１〜
Ｓ４及び信号合成のための抵抗Ｒ１〜Ｒ３より構
成される。
ように信号入力端子１，２、信号出力端子３、信
号切替えのためリレー等より成るスイツチＳ１〜
Ｓ４及び信号合成のための抵抗Ｒ１〜Ｒ３より構
成される。
この図の状態で入力端子１及び２より挿入され
た信号は抵抗Ｒ１〜Ｒ３で構成される信号合成回
路により合成され、出力端子３より送出される。
片方の信号を遮断するときは、例えばスイツチＳ
１とＳ４を同時に実線位置から破線位置に切替え
れば入力端子１からの信号は遮断され、入力端子
２からの信号だけが出力端子３から送出されるこ
とになる。以上の合成時、片側遮断時ともに送出
レベルは入力レベルと同じになり、回路としての
損失は生じない。両方の信号を遮断するときは、
全部のスイツチＳ１〜Ｓ４を同時に破線位置に切
替えれば出力端子３から信号は送出されなくな
る。
た信号は抵抗Ｒ１〜Ｒ３で構成される信号合成回
路により合成され、出力端子３より送出される。
片方の信号を遮断するときは、例えばスイツチＳ
１とＳ４を同時に実線位置から破線位置に切替え
れば入力端子１からの信号は遮断され、入力端子
２からの信号だけが出力端子３から送出されるこ
とになる。以上の合成時、片側遮断時ともに送出
レベルは入力レベルと同じになり、回路としての
損失は生じない。両方の信号を遮断するときは、
全部のスイツチＳ１〜Ｓ４を同時に破線位置に切
替えれば出力端子３から信号は送出されなくな
る。
このように構成されている従来回路は、その構
成上合成部の回路は分割することが出来なかつ
た。そのためこの合成部の回路構成素子が不良と
なつた時、これを交換するために一度信号の流れ
を完全に遮断しなければならないという欠点があ
つた。
成上合成部の回路は分割することが出来なかつ
た。そのためこの合成部の回路構成素子が不良と
なつた時、これを交換するために一度信号の流れ
を完全に遮断しなければならないという欠点があ
つた。
この欠点を除去するには第２図に示すような回
路が考えられる。即ち第１図に示す回路では３本
の抵抗Ｒ１〜Ｒ３により構成されていた信号合成
回路が第２図ではワイヤ結合となつている。この
ような回路を用いても信号の合成は行なわれ、又
スイツチＳ１又はＳ２の各々片方だけを実線位置
から破線位置へ切替えれば片方の信号のみ通過さ
せ、他方の信号を遮断することが出来るが、回路
から明らかなように出力端子３から送出される信
号のレベルは合成時と片側の信号のみを通過させ
る時とでは変化してしまう欠点がある。
路が考えられる。即ち第１図に示す回路では３本
の抵抗Ｒ１〜Ｒ３により構成されていた信号合成
回路が第２図ではワイヤ結合となつている。この
ような回路を用いても信号の合成は行なわれ、又
スイツチＳ１又はＳ２の各々片方だけを実線位置
から破線位置へ切替えれば片方の信号のみ通過さ
せ、他方の信号を遮断することが出来るが、回路
から明らかなように出力端子３から送出される信
号のレベルは合成時と片側の信号のみを通過させ
る時とでは変化してしまう欠点がある。
本考案の目的は、上記従来回路のもつ欠点を取
り除き、回路構成素子が不良になつた時、信号を
完全に遮断することなく、これを交換でき、また
合成時と片側遮断時で信号の送出レベルが変化し
ないようにした信号合成回路を提供することにあ
る。
り除き、回路構成素子が不良になつた時、信号を
完全に遮断することなく、これを交換でき、また
合成時と片側遮断時で信号の送出レベルが変化し
ないようにした信号合成回路を提供することにあ
る。
本考案は２つの入力端子と１つの出力端子を有
し、前記入力端子の夫々と出力端子間に直列に接
続された第１のスイツチと、抵抗を並列に接続し
た第２のスイツチとを含んで構成される。
し、前記入力端子の夫々と出力端子間に直列に接
続された第１のスイツチと、抵抗を並列に接続し
た第２のスイツチとを含んで構成される。
以下本考案を図面について説明する。第３図は
本考案の一実施例の回路図で、第３図においては
第２図の回路に対し、スイツチＳ１，Ｓ２及び抵
抗Ｒ１，Ｒ２が追加されている。
本考案の一実施例の回路図で、第３図においては
第２図の回路に対し、スイツチＳ１，Ｓ２及び抵
抗Ｒ１，Ｒ２が追加されている。
この図における状態では入力端子１及び２より
挿入された信号は、抵抗Ｒ１及びＲ２により各々
6dB減衰された後合成されて再び元のレベルにな
つて出力端子３から送出される。片方の信号を遮
断する時は、例えばスイツチＳ１とＳ４（又はス
イツチＳ２とＳ３）を同時に破線位置に切替えれ
ば入力端子２（又は入力端子１）からの信号は遮
断され、入力端子１（又は入力端子２）からの信
号だけが出力端子３より送出されることになる。
以上の合成時、片側遮断時ともに送出レベルは入
力レベルと同じになり、回路としての損失なしと
なる。
挿入された信号は、抵抗Ｒ１及びＲ２により各々
6dB減衰された後合成されて再び元のレベルにな
つて出力端子３から送出される。片方の信号を遮
断する時は、例えばスイツチＳ１とＳ４（又はス
イツチＳ２とＳ３）を同時に破線位置に切替えれ
ば入力端子２（又は入力端子１）からの信号は遮
断され、入力端子１（又は入力端子２）からの信
号だけが出力端子３より送出されることになる。
以上の合成時、片側遮断時ともに送出レベルは入
力レベルと同じになり、回路としての損失なしと
なる。
両方の信号を遮断する時は、全部のスイツチＳ
１〜Ｓ４を同時に反転させれば出力端子３から信
号は送出されなくなる。抵抗Ｒ１，Ｒ２は回路の
特性インピーダンスZ0Ω（オーム）と同じ値の
ものを用いる。
１〜Ｓ４を同時に反転させれば出力端子３から信
号は送出されなくなる。抵抗Ｒ１，Ｒ２は回路の
特性インピーダンスZ0Ω（オーム）と同じ値の
ものを用いる。
一方、第３図の回路図から明らかなように、こ
の回路は図のＡ点及びＢ点を接続点と考えれば入
力端子１からＡ点まで、入力端子２からＢ点まで
及びＡ，Ｂ点から出力端子３までの３回路にわけ
ることが出来る。これにより、信号を完全に遮断
することなく構成素子の交換が可能でありながら
従来と同等の機能を達成することが出来る。
の回路は図のＡ点及びＢ点を接続点と考えれば入
力端子１からＡ点まで、入力端子２からＢ点まで
及びＡ，Ｂ点から出力端子３までの３回路にわけ
ることが出来る。これにより、信号を完全に遮断
することなく構成素子の交換が可能でありながら
従来と同等の機能を達成することが出来る。
以上説明したように、本考案によれば回路素子
が不良になつても信号を完全に遮断することなく
これを交換することができるように構成され、ま
た信号の合成時と片側遮断時で送出レベルが変ら
ない回路が実現でき、通信回線の信頼性及び品質
の向上及び保守の容易化に寄与するところ大であ
る。
が不良になつても信号を完全に遮断することなく
これを交換することができるように構成され、ま
た信号の合成時と片側遮断時で送出レベルが変ら
ない回路が実現でき、通信回線の信頼性及び品質
の向上及び保守の容易化に寄与するところ大であ
る。
第１図、第２図は従来の信号合成回路の一例を
示す回路図、第３図は本考案の一実施例を示す回
路図である。 １，２……入力端子、３……出力端子、Ｓ１〜
Ｓ４……スイツチ回路、Ｒ１〜Ｒ３……抵抗。
示す回路図、第３図は本考案の一実施例を示す回
路図である。 １，２……入力端子、３……出力端子、Ｓ１〜
Ｓ４……スイツチ回路、Ｒ１〜Ｒ３……抵抗。
Claims (1)
- ２つの入力端子と１つの出力端子を有し、前記
入力端子の夫々と出力端子間に直列に接続された
第１のスイツチと、抵抗を並列に接続した第２の
スイツチとを含むことを特徴とする信号合成回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3805381U JPS623932Y2 (ja) | 1981-03-18 | 1981-03-18 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3805381U JPS623932Y2 (ja) | 1981-03-18 | 1981-03-18 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57151036U JPS57151036U (ja) | 1982-09-22 |
| JPS623932Y2 true JPS623932Y2 (ja) | 1987-01-29 |
Family
ID=29835223
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3805381U Expired JPS623932Y2 (ja) | 1981-03-18 | 1981-03-18 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS623932Y2 (ja) |
-
1981
- 1981-03-18 JP JP3805381U patent/JPS623932Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57151036U (ja) | 1982-09-22 |
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