JPS6253737U - - Google Patents

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JPS6253737U
JPS6253737U JP14429185U JP14429185U JPS6253737U JP S6253737 U JPS6253737 U JP S6253737U JP 14429185 U JP14429185 U JP 14429185U JP 14429185 U JP14429185 U JP 14429185U JP S6253737 U JPS6253737 U JP S6253737U
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JP
Japan
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address
converter
data
processing device
main memory
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JP14429185U
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Description

【図面の簡単な説明】
第１図は、この考案の一実施例によるアドレス
変換機構を備えたデータ処理装置のブロツク図、
第２図は、従来のアドレス変換機構を備えたデー
タ処理装置のブロツク図である。 ２は論理アドレスレジスタ（ＬＭＡＲ）、３は
実アドレスレジスタ（ＰＭＡＲ）、４は主記憶、
５はアドレス変換テーブル、６はメモリデータレ
ジスタ（ＭＤＲ）、７はランダマイズ回路、９は
アドレス変換バツフア（ＴＬＢ）、１０は比較回
路。なお、各図中、同一符号は同一又は相当部分
を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) アドレス変換バツフアを含むアドレス変換
    機構を備えたデータ処理装置において、前記アド
    レス変換機構にはその内容を入れ換えることので
    きるＲＡＭから成る変換器が設けられており、前
    記変換器は、前記主記憶をアクセスするための主
    記憶アドレス中の論理ページアドレスを自己に対
    するアドレスとし、前記主記憶アドレスを入力デ
    ータとして受入れ、前記変換器内に所定の対応関
    係をもつて格納されているデータを出力し、この
    出力データが前記アドレス変換バツフアのエント
    リに対するアドレスとして用いられることを特徴
    とするデータ処理装置。 (2) 前記変換器内のデータは現に実行中のプロ
    グラムの所定の命令で入れ換えられることを特徴
    とする実用新案登録請求の範囲第１項記載のデー
    タ処理装置。
JP14429185U 1985-09-24 1985-09-24 Pending JPS6253737U (ja)

Priority Applications (1)

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JP14429185U JPS6253737U (ja) 1985-09-24 1985-09-24

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JP14429185U JPS6253737U (ja) 1985-09-24 1985-09-24

Publications (1)

Publication Number Publication Date
JPS6253737U true JPS6253737U (ja) 1987-04-03

Family

ID=31054748

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14429185U Pending JPS6253737U (ja) 1985-09-24 1985-09-24

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