JPS5828465U - フアクシミリ信号処理回路 - Google Patents

フアクシミリ信号処理回路

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JPS5828465U
JPS5828465U JP12188681U JP12188681U JPS5828465U JP S5828465 U JPS5828465 U JP S5828465U JP 12188681 U JP12188681 U JP 12188681U JP 12188681 U JP12188681 U JP 12188681U JP S5828465 U JPS5828465 U JP S5828465U
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JP
Japan
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signal processing
memory
processing circuit
facsimile signal
transferring data
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Pending
Application number
JP12188681U
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English (en)
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宏 吉木
正明 滝沢
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はプログラム記憶制御装置を用いたファクシミリ
受信機の構成図、第２図は、記録動作を説明する図ζ第
３図は記録部の構成例、第４図は本考案のファクシミリ
受信機の実施例を示すブロック図、第５図は、本考案の
実施例の説明図、第６図は、本考案の一実施例の回路図
、第７図は記録動作を説明する図、第８図は本考案によ
る他の実施例の動作説明図、第９図は本考案の他の実施
例に使用される論理回路の回路図である。 １・・・ｃｐｕ、２・・・ＲＯＭ、３・・・ＲＡＭ、４
．５・・・レジスタ、６・・・記録ヘッド、７・・・Ｍ
ＯＤＥＭ、ｆ３・・。 直列並列変換器、９・・・並列直列変換器、１０・・・
ＤＭＡＣ，１３・・・アドレス変換論理回路、２４゜２
６・・・切替制御線、２５．２８・・・スイッチ、２７
・・・排他論理回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. プログラム記憶制御処理装置により制御されるファクシ
    ミリ装置において、画データを記憶するメモリ、該メモ
    リのデータを転送する時、あるいは該メモリにデータを
    転送する時に動作し、該メモリのアドレスを変換する論
    理回路を具備するこ・　とを特徴とするファクシミリ信
    号処理回路。
JP12188681U 1981-08-19 1981-08-19 フアクシミリ信号処理回路 Pending JPS5828465U (ja)

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JP12188681U JPS5828465U (ja) 1981-08-19 1981-08-19 フアクシミリ信号処理回路

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JP12188681U JPS5828465U (ja) 1981-08-19 1981-08-19 フアクシミリ信号処理回路

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Publication Number Publication Date
JPS5828465U true JPS5828465U (ja) 1983-02-24

Family

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Family Applications (1)

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JP12188681U Pending JPS5828465U (ja) 1981-08-19 1981-08-19 フアクシミリ信号処理回路

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JP (1) JPS5828465U (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04500300A (ja) * 1989-06-16 1992-01-16 モービン・マグネ・テクノロジ・エス・アー 小型単相電磁アクチュエータ
JPH0577771A (ja) * 1991-09-20 1993-03-30 Seiko Instr Inc 小型走行ロボツト

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04500300A (ja) * 1989-06-16 1992-01-16 モービン・マグネ・テクノロジ・エス・アー 小型単相電磁アクチュエータ
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