JPS63107465A - 整流装置 - Google Patents
整流装置Info
- Publication number
- JPS63107465A JPS63107465A JP25233086A JP25233086A JPS63107465A JP S63107465 A JPS63107465 A JP S63107465A JP 25233086 A JP25233086 A JP 25233086A JP 25233086 A JP25233086 A JP 25233086A JP S63107465 A JPS63107465 A JP S63107465A
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- wave
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は低電圧・大電流の可変直流電源として用すら
れる整流装置に関するものである。
れる整流装置に関するものである。
第４図は従来の３相全波整流装置の基本構成を示す回路
図であり、１は３相交流電源、２，３゜４はそれぞれこ
の３相交流電源の比相、Ｓ相、Ｔ相、５は３相全波整流
ユニツト、６．７．８はそれぞれ３相全波整流ユニツト
の入力線Ｕ相、■相。
図であり、１は３相交流電源、２，３゜４はそれぞれこ
の３相交流電源の比相、Ｓ相、Ｔ相、５は３相全波整流
ユニツト、６．７．８はそれぞれ３相全波整流ユニツト
の入力線Ｕ相、■相。
Ｗ相、９，１０はそれぞれ３相全波整流ユニツト５の出
力線Ｐ及びＮ、ＵＰは３相全波整流ユニツト５を構成す
るＵ相Ｐ側のサイリスタ、ＵＮはＵ相Ｎ側のサイリスタ
、ｖＰはＶ相Ｐ側のサイリスタ、ＶＮはＶ相Ｎ側のサイ
リスタ、ＷＰはＷ相Ｐ側のサイリスタ、ＷＮはＷ相Ｎ側
のサイリスタを示す。
力線Ｐ及びＮ、ＵＰは３相全波整流ユニツト５を構成す
るＵ相Ｐ側のサイリスタ、ＵＮはＵ相Ｎ側のサイリスタ
、ｖＰはＶ相Ｐ側のサイリスタ、ＶＮはＶ相Ｎ側のサイ
リスタ、ＷＰはＷ相Ｐ側のサイリスタ、ＷＮはＷ相Ｎ側
のサイリスタを示す。
なお、３相交流奄源１の相名称Ｒ，Ｓ、Ｔ相と３相全波
整流ユニツト５の入力線Ｕ、Ｖ、Ｗ相を別名称としたの
は後の説明を分り易くするためであシ、通常ＲとＵ、Ｓ
とＶ、ＴとＷの各線が接続されている。
整流ユニツト５の入力線Ｕ、Ｖ、Ｗ相を別名称としたの
は後の説明を分り易くするためであシ、通常ＲとＵ、Ｓ
とＶ、ＴとＷの各線が接続されている。
第５図は第４図のような３相全波整流装置で可変直流出
力電圧を発生させる場合の従来の一般的な点弧制御によ
る出力″＊ＥＥ波形と導通サイリスタの時間的変化を示
すもので、図から明らかな如く一定直流出力屯圧に対し
ては、各サイリスタとも同一の位相角αで対称的に点弧
制御されている。
力電圧を発生させる場合の従来の一般的な点弧制御によ
る出力″＊ＥＥ波形と導通サイリスタの時間的変化を示
すもので、図から明らかな如く一定直流出力屯圧に対し
ては、各サイリスタとも同一の位相角αで対称的に点弧
制御されている。
従来の整流装置は以上のように構成されているので、電
圧に対する電流の位相を制御するものであるため、低出
力時には力率が悪く、大きな無効電力を発生する問題点
があった。
圧に対する電流の位相を制御するものであるため、低出
力時には力率が悪く、大きな無効電力を発生する問題点
があった。
この発明は上記のような問題点を解消するためになされ
たもので、低出力時にも高力率運転ができるとともに安
価な整流装置を得ることを目的とする。
たもので、低出力時にも高力率運転ができるとともに安
価な整流装置を得ることを目的とする。
この発明に係る整流装置は、複数の多相半波ブリッジを
相間リアクトルを介して並列接続し、その各多相半波ブ
リッジと多相交流電源の中性点との間に負荷電流還流用
のフライホイールダイオードを設け、前記各多相半波ブ
リッジの各アームのサイリスタを異なる位相角で非対称
制御するようにしたものである。
相間リアクトルを介して並列接続し、その各多相半波ブ
リッジと多相交流電源の中性点との間に負荷電流還流用
のフライホイールダイオードを設け、前記各多相半波ブ
リッジの各アームのサイリスタを異なる位相角で非対称
制御するようにしたものである。
この発明における整流装置は、複数の多相半波ブリッジ
を相間リアクトルを介して並列接続し、その各多相半波
ブリッジと交流電源の中性点の間にフライホイールダイ
オードを設け、上記名多相十波ブリッジの各アームを異
なる位相角で非対称制御することにより、交流の入力力
率が出力領域全域に亘って改善され、無効電力の発生が
抑制される。
を相間リアクトルを介して並列接続し、その各多相半波
ブリッジと交流電源の中性点の間にフライホイールダイ
オードを設け、上記名多相十波ブリッジの各アームを異
なる位相角で非対称制御することにより、交流の入力力
率が出力領域全域に亘って改善され、無効電力の発生が
抑制される。
以下、この発明す一実施例を図について説明する。第１
図において、５−１．５−２．５−３はそれぞれ３相牛
波ブリツジを示す。３相半波ブリッジ５−１の入力線と
３相交流電源１との接続はＲ，−Ｕ 、Ｓ−Ｖ 、Ｔ−
Ｗ、３相半波ブリッジ５−２ｔｄ８−Ｕ 、 Ｔ−Ｖ
、 Ｒ−Ｗ、 ３相半波７”！Ｊ ７シ５−３１ｄ’
ｌ’−Ｕ 、Ｒ−Ｖ 、Ｓ−Ｗと一４ｆＪ順が入り替っ
ている。上記各３相半波ブリッジ５−１〜５−３は相間
リアクトル１１を介して並列接続され出力１ｆｓＰを形
成する。
図において、５−１．５−２．５−３はそれぞれ３相牛
波ブリツジを示す。３相半波ブリッジ５−１の入力線と
３相交流電源１との接続はＲ，−Ｕ 、Ｓ−Ｖ 、Ｔ−
Ｗ、３相半波ブリッジ５−２ｔｄ８−Ｕ 、 Ｔ−Ｖ
、 Ｒ−Ｗ、 ３相半波７”！Ｊ ７シ５−３１ｄ’
ｌ’−Ｕ 、Ｒ−Ｖ 、Ｓ−Ｗと一４ｆＪ順が入り替っ
ている。上記各３相半波ブリッジ５−１〜５−３は相間
リアクトル１１を介して並列接続され出力１ｆｓＰを形
成する。
一方、３相交流電源１の中性点Ｏは出力線Ｎを形成する
。この出力ＩＮと各３相半波ブリツジ５−１〜５−３の
出力側との間には、それぞれフライホイールダイオード
１２を接続し、各３相手波ブリッジ５−１〜５−３の各
アームを不図示の制御回路で非対称制御する。これによ
り、低出力領域における負方向電圧の発生を抑制すると
共に負荷電流をバイパスさせ、入力力率を改善する。
。この出力ＩＮと各３相半波ブリツジ５−１〜５−３の
出力側との間には、それぞれフライホイールダイオード
１２を接続し、各３相手波ブリッジ５−１〜５−３の各
アームを不図示の制御回路で非対称制御する。これによ
り、低出力領域における負方向電圧の発生を抑制すると
共に負荷電流をバイパスさせ、入力力率を改善する。
第２図は３相半波ブリッジ５−１〜５−３の各アームの
サイリスタ動作を示すもので、各アームのサイリスタＵ
Ｐ 、ＶＰ 、ＷＰは異なる位相角αａ、αｂ、αＣで
非対称制御される。ここでは、理解を容易にするため、
負荷電流を一定とした。
サイリスタ動作を示すもので、各アームのサイリスタＵ
Ｐ 、ＶＰ 、ＷＰは異なる位相角αａ、αｂ、αＣで
非対称制御される。ここでは、理解を容易にするため、
負荷電流を一定とした。
なお、多相交流電源１が３相の場合には、変圧器の直流
偏磁を防ぐために千鳥結線の変圧器を用いる。
偏磁を防ぐために千鳥結線の変圧器を用いる。
第３図はこの発明の他の実施例を示すもので、３相半波
ブリッジ５−１〜５−６のうち、（５−１，５−２）、
（５−３，５−４）、（５−５。
ブリッジ５−１〜５−６のうち、（５−１，５−２）、
（５−３，５−４）、（５−５。
５−６）を一対として、それぞれ相聞リアクトル１１を
介して並列接続し、６相交流電源１の中性点Ｏより形成
された出力線Ｎと各３相半波ブリツジ５−１〜５−６の
出力側との間にそれぞれフライホイールダイオード１２
を接続した構成であり、前記第１図の実施例と同様に各
３相手波ブリッジ５−１〜５−６の各アームのサイリス
タＵＰ、ｖＰ。
介して並列接続し、６相交流電源１の中性点Ｏより形成
された出力線Ｎと各３相半波ブリツジ５−１〜５−６の
出力側との間にそれぞれフライホイールダイオード１２
を接続した構成であり、前記第１図の実施例と同様に各
３相手波ブリッジ５−１〜５−６の各アームのサイリス
タＵＰ、ｖＰ。
ＷＰ 、 ＵＰ’ 、 ＶＰ’ 、ＷＰ’を異なる位相
角 αａ。
角 αａ。
αｂ、αＣ２αａ′、αｂ′、αＣ′で非対称制御する
。
。
なお、上記実施例では複数の多相半波ブリッジを相順を
入れ替えて並列接続したものを示したが、並列接続時は
相順を入れ替えず、相順を入れ替えたのと同じ結果が得
られるように、各アームのサイリスタ点弧時期を制御す
るようにしてもよい。
入れ替えて並列接続したものを示したが、並列接続時は
相順を入れ替えず、相順を入れ替えたのと同じ結果が得
られるように、各アームのサイリスタ点弧時期を制御す
るようにしてもよい。
〔発明の効果〕
以上のように、この発明によれば、多相半波ブリッジを
相間リアクトルを介して並列接続し、各ブリッジと負荷
との間にフライホイールダイオードを接続し、各多相半
波ブリッジの各アームのサイリスタを異なる位相角で非
対称制御するように構成したので、低出力領域での力率
が改善される。
相間リアクトルを介して並列接続し、各ブリッジと負荷
との間にフライホイールダイオードを接続し、各多相半
波ブリッジの各アームのサイリスタを異なる位相角で非
対称制御するように構成したので、低出力領域での力率
が改善される。
また、半波ブリッジを使用しているので、使用素子数が
少なく、経済的な整流装置が得られる効果がある。
少なく、経済的な整流装置が得られる効果がある。
第１図はこの発明の一実施例による整流装置を示す回路
図、第２図は第１図の構成によシ可変直流出力電圧を発
生する場合の出力電圧波形と導通サイリスタの時間的変
化を示す説明図、第３図はこの発明の他の実施例による
整流装置を示す回路図、第４図は３相全波整流装置によ
る従来の整流装置を示す回路図、第５図は第４図の構成
によシ可変直流出力電圧を発生する場合の出力波形と導
通サイリスタの時間的変化を示す説明図である。 ５−１〜５−６は多相半波ブリッジ、１１は相間リアク
トル、１２はフライホイールダイオード、０は中性点。 なお、図中、同一符号は同一、または相当部分を示す。
図、第２図は第１図の構成によシ可変直流出力電圧を発
生する場合の出力電圧波形と導通サイリスタの時間的変
化を示す説明図、第３図はこの発明の他の実施例による
整流装置を示す回路図、第４図は３相全波整流装置によ
る従来の整流装置を示す回路図、第５図は第４図の構成
によシ可変直流出力電圧を発生する場合の出力波形と導
通サイリスタの時間的変化を示す説明図である。 ５−１〜５−６は多相半波ブリッジ、１１は相間リアク
トル、１２はフライホイールダイオード、０は中性点。 なお、図中、同一符号は同一、または相当部分を示す。
Claims (1)
- 各アームのサイリスタが異なる位相角で非対称に制御さ
れる複数の多相半波ブリッジと、前記各多相半波ブリッ
ジを順次並列に接続する相間リアクトルと、前記各多相
半波ブリッジと多相交流電源の中性点との間に接続した
フライホィールダイオードとを備えた整流装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25233086A JPS63107465A (ja) | 1986-10-22 | 1986-10-22 | 整流装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25233086A JPS63107465A (ja) | 1986-10-22 | 1986-10-22 | 整流装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63107465A true JPS63107465A (ja) | 1988-05-12 |
Family
ID=17235764
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25233086A Pending JPS63107465A (ja) | 1986-10-22 | 1986-10-22 | 整流装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63107465A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54118146A (en) * | 1978-03-02 | 1979-09-13 | Instruments Sa | Method of encoding access card |
| JPS61224865A (ja) * | 1985-03-27 | 1986-10-06 | Isao Takahashi | サイリスタ制御方法 |
-
1986
- 1986-10-22 JP JP25233086A patent/JPS63107465A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54118146A (en) * | 1978-03-02 | 1979-09-13 | Instruments Sa | Method of encoding access card |
| JPS61224865A (ja) * | 1985-03-27 | 1986-10-06 | Isao Takahashi | サイリスタ制御方法 |
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