JPS6313538A - 送受信回路 - Google Patents
送受信回路Info
- Publication number
- JPS6313538A JPS6313538A JP61158203A JP15820386A JPS6313538A JP S6313538 A JPS6313538 A JP S6313538A JP 61158203 A JP61158203 A JP 61158203A JP 15820386 A JP15820386 A JP 15820386A JP S6313538 A JPS6313538 A JP S6313538A
- Authority
- JP
- Japan
- Prior art keywords
- data
- circuit
- timing
- buffer
- transmission
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 20
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Communication Control (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデータの送受信における送信側、受信側のタイ
ミング周波数の異なる場合の送受信回路に関する。
ミング周波数の異なる場合の送受信回路に関する。
従来、この種の送受信回路において、送信側。
受信側のタイミング周波数の異なる場合は、送受信中、
バッファが満杯または空とならないような比較的短い間
欠的データの送受信に適用できた。
バッファが満杯または空とならないような比較的短い間
欠的データの送受信に適用できた。
ｒ発明が解決しようとする問題点〕
上述した従来の送受信回路は、連続的なデータについて
はある時点即ちバッファ満杯またはバッファ空の状態か
らタイミングに対するデータのずれが発生し、以後デー
タを正しく送受信できないという欠点がある。
はある時点即ちバッファ満杯またはバッファ空の状態か
らタイミングに対するデータのずれが発生し、以後デー
タを正しく送受信できないという欠点がある。
本発明の目的は、このような欠点を除き、送受信回路の
間にバッファを介在させることにより、所定バッファ量
のデータだけは正しく送受信できるようにした送受信回
路を提供することにある。
間にバッファを介在させることにより、所定バッファ量
のデータだけは正しく送受信できるようにした送受信回
路を提供することにある。
本発明の構成は、所定送信タイミングでデータを送出す
る送信回路と、前記送信タイミングと異−）た周波数の
受信タイミングでデータを入力する受信回路とを含む送
受信回路において、前記送信回路からのデータを前記送
信タイミングで受信蓄積し、前記受信回路からの前記受
信タイミングでデータを読出して出力するバッファ蓄積
回路と、このバッファ蓄積回路のバッファ蓄積状態とし
ての満杯、空を検出し、満杯となった場合送信側のデー
タを一定時間前記バッファ入力を停止し、また空の場合
受信側へ一定時間前記バッファの出力を停止する制御回
路とを備えることを特徴とする。
る送信回路と、前記送信タイミングと異−）た周波数の
受信タイミングでデータを入力する受信回路とを含む送
受信回路において、前記送信回路からのデータを前記送
信タイミングで受信蓄積し、前記受信回路からの前記受
信タイミングでデータを読出して出力するバッファ蓄積
回路と、このバッファ蓄積回路のバッファ蓄積状態とし
ての満杯、空を検出し、満杯となった場合送信側のデー
タを一定時間前記バッファ入力を停止し、また空の場合
受信側へ一定時間前記バッファの出力を停止する制御回
路とを備えることを特徴とする。
［実施例］
次に、本発明を図面を参照して詳細に説明する。
第１図は本発明の一実施例を示すブロック図である。本
実施例は、送信回路１、受信回路４、バッファ蓄積回路
７および制御回路８から構成される。まず、送信回路１
から出力されるデータ２を送信タイミング３でバッファ
蓄積回路７に蓄積する。この蓄積されたデータ２は、受
信回路４から出力される受信タイミング６で読出され、
データ５として受信される。
実施例は、送信回路１、受信回路４、バッファ蓄積回路
７および制御回路８から構成される。まず、送信回路１
から出力されるデータ２を送信タイミング３でバッファ
蓄積回路７に蓄積する。この蓄積されたデータ２は、受
信回路４から出力される受信タイミング６で読出され、
データ５として受信される。
（＋）受信タイミング周波数が送信タイミング周波数よ
り大きい場合 送信タイミング周波数が小さく、バ・ソファ蓄積回路７
に入力するデータが多くなるためいずれバッファ蓄積回
路７が満杯になる。この状態を制御回路８が検出し、デ
ータ２の入力を停止する。
り大きい場合 送信タイミング周波数が小さく、バ・ソファ蓄積回路７
に入力するデータが多くなるためいずれバッファ蓄積回
路７が満杯になる。この状態を制御回路８が検出し、デ
ータ２の入力を停止する。
受信回路４は受信タイミング６で受信データ５を読み続
け、一定の受信タイミング数経過するとデータ２の入力
を再開する。この間（一定の受信タイミング数）は、入
力データが捨てられたことになるがパース１〜的にエラ
ーを局在化させたことになる。
け、一定の受信タイミング数経過するとデータ２の入力
を再開する。この間（一定の受信タイミング数）は、入
力データが捨てられたことになるがパース１〜的にエラ
ーを局在化させたことになる。
〈２）受信タイミング周波数が送信タイミング周波数よ
り小さい場合 受信タイミング周波数が小さく、バ・ソファ蓄積回路７
から読出すデータが多くなるためいずれバッファは空に
なる。この状態を制御回路８が検出しデータ５の読出し
を停止し、マークピッＩ・「１」を出力する。送信回路
１は、送信タイミング３で送信データ２を入力し続け、
一定の送信タイミング数経過するとデータ５の送出を再
開する。この間（一定の送信タイミング数）は、出力デ
ータにマークピッＩ−ｒ １． Ｊが挿入されたことに
なり、バースＩ・的にエラーを局在化したことになる。
り小さい場合 受信タイミング周波数が小さく、バ・ソファ蓄積回路７
から読出すデータが多くなるためいずれバッファは空に
なる。この状態を制御回路８が検出しデータ５の読出し
を停止し、マークピッＩ・「１」を出力する。送信回路
１は、送信タイミング３で送信データ２を入力し続け、
一定の送信タイミング数経過するとデータ５の送出を再
開する。この間（一定の送信タイミング数）は、出力デ
ータにマークピッＩ−ｒ １． Ｊが挿入されたことに
なり、バースＩ・的にエラーを局在化したことになる。
以−Ｆ説明したように、本発明は、送信Ｉｌｌ 、受信
側のタイミング周波数が異なる場合においてバッファの
満杯または空の状態からバッファの入力または出力を制
御することにより、ビットエラーをバースト的に局在化
できるため、同一情報を周期的にくり返すような連続的
なデータ伝送を有効に行うことができる。
側のタイミング周波数が異なる場合においてバッファの
満杯または空の状態からバッファの入力または出力を制
御することにより、ビットエラーをバースト的に局在化
できるため、同一情報を周期的にくり返すような連続的
なデータ伝送を有効に行うことができる。
第１図は本発明の一実施例を示すブロック図で＝５−
ある。
１・・・送信回路、２・・・送信データ、３・・・送信
タイミング、４・・・受信回路、５・・・受信データ、
６・・・受信タイミング、７・・・バッファ蓄積回路、
８・・・制御回路。 −６≧
タイミング、４・・・受信回路、５・・・受信データ、
６・・・受信タイミング、７・・・バッファ蓄積回路、
８・・・制御回路。 −６≧
Claims (1)
- 所定送信タイミングでデータを送出する送信回路と、前
記送信タイミングと異った周波数の受信タイミングでデ
ータを入力する受信回路とを含む送受信回路において、
前記送信回路からのデータを前記送信タイミングで受信
蓄積し、前記受信回路からの前記受信タイミングでデー
タを読出して送出するバッファ蓄積回路と、このバッフ
ァ蓄積回路のバッファ蓄積状態としての満杯、空を検出
し、満杯となった場合送信側のデータを一定時間前記バ
ッファの入力を停止し、また空の場合受信側へ一定時間
前記バッファの出力を停止する制御回路とを備えること
を特徴とする送受信回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61158203A JPS6313538A (ja) | 1986-07-04 | 1986-07-04 | 送受信回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61158203A JPS6313538A (ja) | 1986-07-04 | 1986-07-04 | 送受信回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6313538A true JPS6313538A (ja) | 1988-01-20 |
Family
ID=15666533
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61158203A Pending JPS6313538A (ja) | 1986-07-04 | 1986-07-04 | 送受信回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6313538A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08517U (ja) * | 1988-09-19 | 1996-03-12 | シーメンス プライヴェイト コミュニケイション システムズ インコーポレイテッド | データ通信装置 |
-
1986
- 1986-07-04 JP JP61158203A patent/JPS6313538A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08517U (ja) * | 1988-09-19 | 1996-03-12 | シーメンス プライヴェイト コミュニケイション システムズ インコーポレイテッド | データ通信装置 |
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