JPS63146594A - 電子化チヨ−ク回路 - Google Patents
電子化チヨ−ク回路Info
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- JPS63146594A JPS63146594A JP29328486A JP29328486A JPS63146594A JP S63146594 A JPS63146594 A JP S63146594A JP 29328486 A JP29328486 A JP 29328486A JP 29328486 A JP29328486 A JP 29328486A JP S63146594 A JPS63146594 A JP S63146594A
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- resistor
- pulse
- dial pulse
- dial
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（）既 要〕
電子化チョーク回路のトランジスタを遮断状態から飽和
状態へ移行せしめるためのコンデンサ充電回路の抵抗を
短絡させる手段を設けた。
状態へ移行せしめるためのコンデンサ充電回路の抵抗を
短絡させる手段を設けた。
本発明は電子化チョーク回路に関し、更に詳しく言えば
、電話通信等におけるパルス（ダイヤルパルス）に対し
高応答性を有する電子化チョーク回路に関する。
、電話通信等におけるパルス（ダイヤルパルス）に対し
高応答性を有する電子化チョーク回路に関する。
電話交換システムにおいて、交換局からその加入端末装
面へダイヤルパルス送出等のための直流給電が行なわれ
るほか、局間においても自局（着信局）から対局（発信
局）へ同様の直流給電が行なわれる。これら直流給電は
通話信号が伝送される回線を介して行なわれる。そのた
め、上述直流給電をチョークコイル、回線を介して行な
っている。。
面へダイヤルパルス送出等のための直流給電が行なわれ
るほか、局間においても自局（着信局）から対局（発信
局）へ同様の直流給電が行なわれる。これら直流給電は
通話信号が伝送される回線を介して行なわれる。そのた
め、上述直流給電をチョークコイル、回線を介して行な
っている。。
しかしながら、チョークコイルの嵩高性が回線数が多く
なればなるほど顕著に現れて来る。そこで、その小型化
のために、電子化チョーク回路が用いられるに至ってい
る。この回路はなるほど、小型化の目的は満たし得ては
いるが、チョークコイルはどのチョーク特性、とりわけ
ダイヤルパルスに対する応答性に欠けるためその改善が
要求されている。
なればなるほど顕著に現れて来る。そこで、その小型化
のために、電子化チョーク回路が用いられるに至ってい
る。この回路はなるほど、小型化の目的は満たし得ては
いるが、チョークコイルはどのチョーク特性、とりわけ
ダイヤルパルスに対する応答性に欠けるためその改善が
要求されている。
第４図は局間の直流給電のための回路図を示し、この図
において、１００は対局１０２のダイヤルパルス送出回
路であり、ダイヤルパルス送出回路１００からのダイヤ
ルパルスの送出に際して、ダイヤルパルス送出回路１０
０へ自局１０４から次のような直流給電ループが形成さ
れる。そのループはアースＧ、自局内直流ループ抵抗１
０６、電子化チョーク回路１０Ｂ、ループ検出回路１１
０、線路抵抗１１２、ダイヤルパルス送出回路１００、
線路抵抗１１４、電子化チョーク回路１１６、そして自
局内直流ループ抵抗１１８を介して一４８ボルトの電源
へ通ずる直流給電ループである。
において、１００は対局１０２のダイヤルパルス送出回
路であり、ダイヤルパルス送出回路１００からのダイヤ
ルパルスの送出に際して、ダイヤルパルス送出回路１０
０へ自局１０４から次のような直流給電ループが形成さ
れる。そのループはアースＧ、自局内直流ループ抵抗１
０６、電子化チョーク回路１０Ｂ、ループ検出回路１１
０、線路抵抗１１２、ダイヤルパルス送出回路１００、
線路抵抗１１４、電子化チョーク回路１１６、そして自
局内直流ループ抵抗１１８を介して一４８ボルトの電源
へ通ずる直流給電ループである。
そして、このループが形成された状態において、ダイヤ
ルパルス送出回路１００のリレースイッチ１００、の開
閉（第５図の（ａ））により、上述ループにパルス電流
が流れる、即ちダ・イヤルパルスが対局１０２から自局
１０４へ送出される。そのダイヤルパルスは公知のルー
プ検出回路１１０において検出され、そのパルス列５Ｃ
Ｎ（第５図の（ｂ））はダイヤル番号等の抽出のための
走査パルスによるパルス幅の検出に供される。なお、回
線からの通話信号は線１０９，１１５を介して交換機に
取り込まれる。
ルパルス送出回路１００のリレースイッチ１００、の開
閉（第５図の（ａ））により、上述ループにパルス電流
が流れる、即ちダ・イヤルパルスが対局１０２から自局
１０４へ送出される。そのダイヤルパルスは公知のルー
プ検出回路１１０において検出され、そのパルス列５Ｃ
Ｎ（第５図の（ｂ））はダイヤル番号等の抽出のための
走査パルスによるパルス幅の検出に供される。なお、回
線からの通話信号は線１０９，１１５を介して交換機に
取り込まれる。
そのダイヤルパルスは上述の如く、電子化チョーク回路
１０８，１１６を経て流れる。
１０８，１１６を経て流れる。
しかしながら、それら電子化チョーク回路はコンデンサ
６を有するため、該コンデンサ６の充電がＮＰＮ ）ラ
ンジスタ１０を飽和領域へ移行せしめるための予め決め
られた値に達して初めて電子化チョーク回路１０８，１
１６は低インピーダンスを呈するに至る。上述値に到達
する時間はコンデンサ６の静電容量Ｃと抵抗８の抵抗値
Ｒとの積、つまり時定数ＲＣによって決まって来る。こ
の時定数のため、ループ検出回路１１０で検出されるダ
イヤルパルス列の各パルスの立上がり （パルス列ＳＣ
Ｎの各ダイヤルパルスの立上がり）はリレースイッチ１
００１の閉時側（第５図の（ａ））より前記時定数ＲＣ
によって決まる値だけ遅れる（第５図の（ｂ））。その
ため、ダイヤルパルス列の各パルスのパルス幅が狭くな
る。従って、元のパルスが狭いほど狭幅化率が高くなり
、極端な場合には前述の走査パルスによる狭幅化率の高
いパルスの検出が不能に陥ることがある。これはダイヤ
ル番号が正しく交換機へ伝えられなくなることを意味し
、事態は重大である。
６を有するため、該コンデンサ６の充電がＮＰＮ ）ラ
ンジスタ１０を飽和領域へ移行せしめるための予め決め
られた値に達して初めて電子化チョーク回路１０８，１
１６は低インピーダンスを呈するに至る。上述値に到達
する時間はコンデンサ６の静電容量Ｃと抵抗８の抵抗値
Ｒとの積、つまり時定数ＲＣによって決まって来る。こ
の時定数のため、ループ検出回路１１０で検出されるダ
イヤルパルス列の各パルスの立上がり （パルス列ＳＣ
Ｎの各ダイヤルパルスの立上がり）はリレースイッチ１
００１の閉時側（第５図の（ａ））より前記時定数ＲＣ
によって決まる値だけ遅れる（第５図の（ｂ））。その
ため、ダイヤルパルス列の各パルスのパルス幅が狭くな
る。従って、元のパルスが狭いほど狭幅化率が高くなり
、極端な場合には前述の走査パルスによる狭幅化率の高
いパルスの検出が不能に陥ることがある。これはダイヤ
ル番号が正しく交換機へ伝えられなくなることを意味し
、事態は重大である。
なお、電子化チョーク回路の抵抗１６は第６図に示すよ
うにトランジスタ１０のＶＣＥ、ＶＢＥを適宜な値に決
めるためのものであり、抵抗１８はトランジスタ１０の
温度補償用のものである。
うにトランジスタ１０のＶＣＥ、ＶＢＥを適宜な値に決
めるためのものであり、抵抗１８はトランジスタ１０の
温度補償用のものである。
本発明は、斯かる問題点に鑑みて創作されたもので、動
作時系列内の所定の時間に印加されるパルスを歪ませな
い電子化チョーク回路を提供することを目的とする。
作時系列内の所定の時間に印加されるパルスを歪ませな
い電子化チョーク回路を提供することを目的とする。
第１図は本発明の原理ブロック図を示す。この図におい
て、２．４は電子化チョーク回路のチヨーり端子であり
、６．８は夫々、チョーク端子２゜４間に直列接続され
た容量性素子及び抵抗である。
て、２．４は電子化チョーク回路のチヨーり端子であり
、６．８は夫々、チョーク端子２゜４間に直列接続され
た容量性素子及び抵抗である。
１６は直列接続の素子６及び抵抗８の端子間に並列接続
された抵抗である。素子６と抵抗８との接続点電位によ
り駆動されるトランジスタ１０が端子２．４間に接続さ
れている。この様にして構成される電子化チョーク回路
の抵抗８の端子間に短絡手段１２を設けたことに本発明
の電子化チョーク回路の特徴がある。
された抵抗である。素子６と抵抗８との接続点電位によ
り駆動されるトランジスタ１０が端子２．４間に接続さ
れている。この様にして構成される電子化チョーク回路
の抵抗８の端子間に短絡手段１２を設けたことに本発明
の電子化チョーク回路の特徴がある。
本発明回路を交換機の対局回線に設けて対局からのダイ
ヤルパルスを受信する場合には、その受信前予め決めら
れた時刻に短絡手段１２を動作させて抵抗を短絡する。
ヤルパルスを受信する場合には、その受信前予め決めら
れた時刻に短絡手段１２を動作させて抵抗を短絡する。
これにより、ループ開閉（ダイヤルパルス受信）時の容
量性素子６は極めて小さい時定数で充電される。従って
、トランジスタ１０はその遮断領域から飽和領域へ高速
に移行することになるから、上述のようなダイヤルパル
スの立上がりに遅れを生せしめる（歪を与える）ことな
く受信できる。
量性素子６は極めて小さい時定数で充電される。従って
、トランジスタ１０はその遮断領域から飽和領域へ高速
に移行することになるから、上述のようなダイヤルパル
スの立上がりに遅れを生せしめる（歪を与える）ことな
く受信できる。
第２図は本発明の一実施例を示し、これは上述第４図の
電子化チョーク回路の代わりに用いられるものである。
電子化チョーク回路の代わりに用いられるものである。
この図において、第１図に謂う短絡手段１２を構成する
電源ＶＣＣから抵抗２０、ホトカプラ２２、そしてリレ
ードライバ２４へ通ずるホトカプラ通電系を除いて、第
４図回路と同じであるので、これら同一構成要素には同
一参照番号を付してその説明を省略する。そして、ホト
カプラ２２のホトトランジスタ２２２のコレクタ及びエ
ミッタが抵抗８の端子間に接続されて抵抗８の短絡を生
ぜしめ得るようになっている。リレードライバ２４は対
局に対しリバース応答を返すリレードライバ゛と兼用さ
れてもよい。
電源ＶＣＣから抵抗２０、ホトカプラ２２、そしてリレ
ードライバ２４へ通ずるホトカプラ通電系を除いて、第
４図回路と同じであるので、これら同一構成要素には同
一参照番号を付してその説明を省略する。そして、ホト
カプラ２２のホトトランジスタ２２２のコレクタ及びエ
ミッタが抵抗８の端子間に接続されて抵抗８の短絡を生
ぜしめ得るようになっている。リレードライバ２４は対
局に対しリバース応答を返すリレードライバ゛と兼用さ
れてもよい。
このように構成される本発明回路の動作を第２図、第３
図及び第４図を参照しつつ説明する。ただし、リレード
ライバ２４はリバースリレードライバと兼用されている
ものとする。
図及び第４図を参照しつつ説明する。ただし、リレード
ライバ２４はリバースリレードライバと兼用されている
ものとする。
対局からのダイヤルパルスの送出に際して、対局との間
に回線１１３を介してループが形成されてそのループに
電流が流れると（第３図（ａｌのθ部分参照）、ループ
検出回路１１０からの信号に応答する自局（受信局）の
制御部（図示せず）は対局に対しリバース応答を返すべ
くリバースリレードライバ２４に対しリバース応答パル
ス（ダイヤルパルス受信準備完了信号）ＲＢ（第３図（
ｂ））を与えて対局に対しリバース応答を返す。低レベ
ルにあるリバース信号によりリバースリレードライバ２
４の出力は“０′となり、リバース応答の返送前からホ
トカプラ２２に通電させているが、リバース応答パルス
によりドライバ２４の出カバ“１”となりそのパルスの
パルス幅の間前記通電は一時解除される。しかし、コン
デンサには直流が既に印加され続けているから電子化チ
ョーク回路の働きには影響は現れない。
に回線１１３を介してループが形成されてそのループに
電流が流れると（第３図（ａｌのθ部分参照）、ループ
検出回路１１０からの信号に応答する自局（受信局）の
制御部（図示せず）は対局に対しリバース応答を返すべ
くリバースリレードライバ２４に対しリバース応答パル
ス（ダイヤルパルス受信準備完了信号）ＲＢ（第３図（
ｂ））を与えて対局に対しリバース応答を返す。低レベ
ルにあるリバース信号によりリバースリレードライバ２
４の出力は“０′となり、リバース応答の返送前からホ
トカプラ２２に通電させているが、リバース応答パルス
によりドライバ２４の出カバ“１”となりそのパルスの
パルス幅の間前記通電は一時解除される。しかし、コン
デンサには直流が既に印加され続けているから電子化チ
ョーク回路の働きには影響は現れない。
上述リバース応答に対局が応答した後に、対局のリレー
スイッチ１００＋の開閉が生ぜしめらｍて第３図の（ａ
）のＢ部分に示すようなダイヤルパルスが送出される。
スイッチ１００＋の開閉が生ぜしめらｍて第３図の（ａ
）のＢ部分に示すようなダイヤルパルスが送出される。
この時刻にはホトカプラ２２に通電されて抵抗８が短絡
されており、コンデンサ６への充電は極めて速く行なわ
れる。従って、トランジスタ１０は素早く遮断領域から
飽和領域へ切り換わる。つまり、各ダイヤルパルスの前
縁の立上がりは急峻となり、ダイヤルパルスを正確に受
信し得ることになる。
されており、コンデンサ６への充電は極めて速く行なわ
れる。従って、トランジスタ１０は素早く遮断領域から
飽和領域へ切り換わる。つまり、各ダイヤルパルスの前
縁の立上がりは急峻となり、ダイヤルパルスを正確に受
信し得ることになる。
このようにしてのダイヤルパルスの受信後の通話中にお
いては、信号ＲＢは高レベルに転じているので、リレー
ドライバ２４の出力は“ｌ”となってホトカプラ２２は
オフになっている。従って、電子化チョーク回路は従来
同様に直流分に対しては低インピーダンスを呈し、交流
骨に対しては高インピーダンスを呈する。
いては、信号ＲＢは高レベルに転じているので、リレー
ドライバ２４の出力は“ｌ”となってホトカプラ２２は
オフになっている。従って、電子化チョーク回路は従来
同様に直流分に対しては低インピーダンスを呈し、交流
骨に対しては高インピーダンスを呈する。
なお、トランジスタ１０をＰＮＰ型としてもよい。それ
に伴なう各素子の変更を要する。又、ホトカプラ２２を
他のスイッチで代替してもよい。
に伴なう各素子の変更を要する。又、ホトカプラ２２を
他のスイッチで代替してもよい。
以上説明したように本発明によれば、印加されるパルス
（列）に対する応答性が向上する。例えば、ループダイ
ヤル方式回線トランクの直流ループ回路に通用した場合
において、そのループ回路を介して送られて来るダイヤ
ルパルスの歪なしの受信を可能にする。
（列）に対する応答性が向上する。例えば、ループダイ
ヤル方式回線トランクの直流ループ回路に通用した場合
において、そのループ回路を介して送られて来るダイヤ
ルパルスの歪なしの受信を可能にする。
第１図は本発明の原理ブロック図、
第２図は本発明の一実施例を示す図、
第３図はタイムチャート、
第４図は従来電子化チョーク回路の使用例を示す図、
第５図は第４図回路の応答性図解図、
第６図は第４図回路の抵抗１６の役割を説明するための
図である。 第１図及び第２図において、 ６は容量性素子５１、（コンデンサ）、８．１６，１８
．２０は抵抗、 １０はトランジスタ、 １２は短絡手段（抵抗２０．ホトカプラ２２、リレード
ライバ２４）である。 特 許 出 願 人 富士通株式会社ン ４（蒼シｐ月のΔ狂哩）゛ロック図 第１図 番焉明の−え麦彦１１ 第２図 タイムチマート 第３図 １ｃ。 訣」Ｕ凱邦ｌｊ’ｒ３−り回路−の、（史用例第４図 次朱口み■応各性図解図 第５図 トランジスタｌｏｇ＼、／ＣＥ、ＢＥ○Ｓ先友のせ方Ｅ
祝明Ｔるｈめの団 第゛６図
図である。 第１図及び第２図において、 ６は容量性素子５１、（コンデンサ）、８．１６，１８
．２０は抵抗、 １０はトランジスタ、 １２は短絡手段（抵抗２０．ホトカプラ２２、リレード
ライバ２４）である。 特 許 出 願 人 富士通株式会社ン ４（蒼シｐ月のΔ狂哩）゛ロック図 第１図 番焉明の−え麦彦１１ 第２図 タイムチマート 第３図 １ｃ。 訣」Ｕ凱邦ｌｊ’ｒ３−り回路−の、（史用例第４図 次朱口み■応各性図解図 第５図 トランジスタｌｏｇ＼、／ＣＥ、ＢＥ○Ｓ先友のせ方Ｅ
祝明Ｔるｈめの団 第゛６図
Claims (1)
- チョーク端子（２、４）間に直列接続された容量性素子
（６）及び抵抗（８）と、直列接続の素子（６）及び抵
抗（８）の端子間に並列接続された抵抗（１６）と、チ
ョーク端子（２、４）間に介在され、所定電位により駆
動されるトランジスタ（１０）とを含む電子化チョーク
回路において、前記抵抗（８）を短絡する短絡手段（１
２）を設けたことを特徴とする電子化チョーク回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61293284A JPH0728435B2 (ja) | 1986-12-09 | 1986-12-09 | ダイヤルパルス通電回路系 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61293284A JPH0728435B2 (ja) | 1986-12-09 | 1986-12-09 | ダイヤルパルス通電回路系 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63146594A true JPS63146594A (ja) | 1988-06-18 |
| JPH0728435B2 JPH0728435B2 (ja) | 1995-03-29 |
Family
ID=17792838
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61293284A Expired - Lifetime JPH0728435B2 (ja) | 1986-12-09 | 1986-12-09 | ダイヤルパルス通電回路系 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0728435B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02100593A (ja) * | 1988-10-07 | 1990-04-12 | Fujitsu Denso Ltd | ダイヤルパルス受信回路 |
| JPH0344290A (ja) * | 1989-07-12 | 1991-02-26 | Fujitsu Ltd | チップパーティ接地送出方法 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54133013A (en) * | 1978-04-07 | 1979-10-16 | Nec Corp | Dial pulse delivery circuit |
| JPS6040178U (ja) * | 1983-08-26 | 1985-03-20 | 株式会社日立製作所 | 過渡特性のスピ−ドアップ回路 |
| JPS60107995A (ja) * | 1983-11-16 | 1985-06-13 | Oki Electric Ind Co Ltd | 通話路直流ル−プ回路 |
| JPS60182898A (ja) * | 1984-02-29 | 1985-09-18 | Toshiba Corp | 局線トランク回路 |
-
1986
- 1986-12-09 JP JP61293284A patent/JPH0728435B2/ja not_active Expired - Lifetime
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54133013A (en) * | 1978-04-07 | 1979-10-16 | Nec Corp | Dial pulse delivery circuit |
| JPS6040178U (ja) * | 1983-08-26 | 1985-03-20 | 株式会社日立製作所 | 過渡特性のスピ−ドアップ回路 |
| JPS60107995A (ja) * | 1983-11-16 | 1985-06-13 | Oki Electric Ind Co Ltd | 通話路直流ル−プ回路 |
| JPS60182898A (ja) * | 1984-02-29 | 1985-09-18 | Toshiba Corp | 局線トランク回路 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02100593A (ja) * | 1988-10-07 | 1990-04-12 | Fujitsu Denso Ltd | ダイヤルパルス受信回路 |
| JPH0344290A (ja) * | 1989-07-12 | 1991-02-26 | Fujitsu Ltd | チップパーティ接地送出方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0728435B2 (ja) | 1995-03-29 |
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