JPS63290464A - ファクシミリ装置の中間調2値化回路 - Google Patents

ファクシミリ装置の中間調2値化回路

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Publication number
JPS63290464A
JPS63290464A JP62126340A JP12634087A JPS63290464A JP S63290464 A JPS63290464 A JP S63290464A JP 62126340 A JP62126340 A JP 62126340A JP 12634087 A JP12634087 A JP 12634087A JP S63290464 A JPS63290464 A JP S63290464A
Authority
JP
Japan
Prior art keywords
circuit
signal
threshold value
threshold
recording system
Prior art date
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Pending
Application number
JP62126340A
Other languages
English (en)
Inventor
Toshiro Koshimizu
越水 敏郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、ファクシミリ装置に関し、特に、中間調二値
化時のディザマトリクスの選択機能に関する。
従来の技術 ファクシミリ装置の中間調二値化回路の従来技術として
は、組織的ディザ法がある。ディザ法とは、各画素の輝
度を画素毎に変化するスレッショルドレベルで二値化す
る方法であり、原画の7画素と表示のlドツトがl対l
に対する。このディザ法においてディザ信号が画素位置
のみによって定まるものを組織的ディザという(テレビ
ジョン学会誌第3j巻@/(7号191/中間調ファク
シミリ)。
発明が解決しようとする問題点 上述した従来の中間調二値化回路である組織的ディザ法
を用いた場合には、ディザ信号をどのように与えるかに
よって得られる画質も異なってくる為に、記録の方式に
よりディザ信号もそれに適したものに変える必要がある
。しかしながら、記録方式は受信装置により異なる為に
特定の記録方式に適したディザ信号を用い、他の記録方
式はある程度犠性にしなければならないという問題があ
る。
本発明は従来の上記実情に鑑みてなされたものであり、
従って本発明の目的は、従来の技術に内在する上記欠点
を解消することを可能としたファクシミリ装置の新規な
中間調λ値化回路を提供することにある。
問題点を解決するための手段 上記目的を達成する為に、本発明のファクシミリ装置の
中間調λ値化回路は、通信手順時に受信側装置の記録方
式を送信側装置に伝達する機能識別手段を有するファク
シミリ装置において適用され中間調を含む画信号を記録
方式に応じた複数のディザマトリクスを用いてa値化す
るλ値化回路と、前記λ値化回路の複数のディザマトリ
クスを前記機能識別手段により識別された記録方式によ
り選択する閾値選択回路とを具備して構成され、受信側
装置の記録方式によりそれに適した中間調を含む画信号
のλ値化を行うことを特徴とする。
実施例 次に、本発明をその好ましい一実施例について図面を参
照して具体的に説明する。
第1図は本発明に係るファクシミリ装置の中間調λ値化
回路の一実施例を示すブロック構成図である。
第1図を参照するに、原稿読み取り回路/により読み取
られた中間調を含む画信号の画信号7は。
■変換回路−により連続的な濃度値が二値信号による濃
度値に変換され、画信号10として比較回路6に出力さ
れる。また、これと同時に、原稿読み取り回路/より読
み取りクロックざと副走査同期信号tが出力され、これ
が閾値発生回路3と閾値発生回路ダに入力される。閾値
発生回・洛3と閾値発生回路ダはそれぞれ異った記録方
式に適したλ値化閾値を発生するようにあらかじめセッ
トして2き、それぞれの発生した閾値を閾値信号//と
閾値信号/:1として閾値選択回路3に出力する。閾値
選択回路5は、閾値信号/lと閾値信号/コとを本回路
を適用するファクシミリ装置の制御部からの受信側記録
方式及び自装置記録方式に見合った選択信号15に従っ
て選択し、閾値信号13として比較回路乙に出力する。
比較回路6は1画信号10と閾値信号/3とを比較し、
その大小関係からλ値化を行って二値化画信号/弘を出
力する。本実施例においてはa種類の記録方式に適応す
る為の例を示したが、閾値発生回路を増ヤし且つ選択回
路の規模を増大することにより更に他種の記録方式に適
したλ値化を行うことも可能である。
第二図は本発明の閾値発生回路の一実施例を示すブロッ
ク構成図である。
第一図において、読み取りクロックjにより主走査カウ
ンタ/6は、ディザマトリクスの主走査方向のカウント
を行い、アドレス信号/デをROM (読み出し専用メ
モリ) /1の下位アドレスに出力する。
また副走査同期信号9により副走査カウンタ/7はディ
ザマトリクスの副走査方向のカウントを行い。
アドレス信号J、 ROM/ffの上位アドレスに出力
する。ROM 7gは記録方式に応じたディザマトリク
スの閾値をあらかじめ記憶しておき、アドレス信号/9
を下位アドレスとし、またアドレス信号Jを上位アドレ
スとして閾値信号//又は閾値信号/ユを出力する。
第3図は第7図に示す閾値発生回路J、4(と閾値選択
回路3を7つにまとめた場合の閾値発生回路の一実施例
を示すブロック構成図である。
第3図を参照するに、ROM ttは、第二図の実施例
の場合よりも更に上位アドレスを有し、選択信号/jを
そこに割り当て、且つROM nの中に複数のディザマ
トリクスの閾値を記憶させて2〈ことにより1選択信号
15の指示に従った閾値信号を発生する。前記以外の動
作は第一図の実施例と同様となる。
発明の詳細 な説明したように、本発明によれば、受信側ファクシミ
リ9e置の記録方式に応じて用意された複数のティザマ
トリクスを用いて、2値化することにより、記録方式圧
適した中間調λ値化信号を発生できる効果が得られる。
【図面の簡単な説明】
第7図は本発明に係る中間g+、iコ値化回路の一実施
例を示すブロック構成図、第一図は第1図の閾値発生回
路のブロック構成図、第3図は第1図の閾値発生回路と
閾値選択回路を7つにまとめた場合の閾値発生回路のブ
ロック構成図である。 /・・・原稿読み取り回路、コ・・・欽変換回路、3、
・・閾値発生回路、グ・・・閾値発生回路、5・・・閾
値選択回路、6・・・比較回路、7・・・画信号1g・
・・読み取りクロック、?・・副走査同期信”pEq、
10・・・画信号。 /ハ・閾値信号、7.2・・・閾値信号、/3・・・閾
値信号、/≠・・・ユ値化画信号、/S・・・選択信号
、/6・・主走査カウンタ、/7・・・副走査カウンタ
、 7g・・・ROM (読み出し専用メモリ)、/9
・・・アドレス信号、20・・・アドレス信号 誉許出願人   日本電気株式会社 代 理 人   弁理士 熊谷雄太部 1、]2  図 簗3 図

Claims (1)

    【特許請求の範囲】
  1. 通信手順時に受信側装置の記録方式を送信側装置に伝達
    する機能識別手段を有するファクシミリ装置において、
    中間調を含む画信号を記録方式に応じた複数のディザマ
    トリクスを用いて2値化する2値化回路と、前記2値化
    回路の複数のディザマトリクスを前記機能識別手段によ
    り識別された記録方式により選択する閾値選択回路とを
    具備し、受信側記録方式によりそれに適した中間調2値
    化を行うことを特徴とするファクシミリ装置の中間調2
    値化回路。
JP62126340A 1987-05-23 1987-05-23 ファクシミリ装置の中間調2値化回路 Pending JPS63290464A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP62126340A JPS63290464A (ja) 1987-05-23 1987-05-23 ファクシミリ装置の中間調2値化回路

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Application Number Priority Date Filing Date Title
JP62126340A JPS63290464A (ja) 1987-05-23 1987-05-23 ファクシミリ装置の中間調2値化回路

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Publication Number Publication Date
JPS63290464A true JPS63290464A (ja) 1988-11-28

Family

ID=14932748

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Application Number Title Priority Date Filing Date
JP62126340A Pending JPS63290464A (ja) 1987-05-23 1987-05-23 ファクシミリ装置の中間調2値化回路

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