JPS6329445B2 - - Google Patents

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JPS6329445B2
JPS6329445B2 JP59003402A JP340284A JPS6329445B2 JP S6329445 B2 JPS6329445 B2 JP S6329445B2 JP 59003402 A JP59003402 A JP 59003402A JP 340284 A JP340284 A JP 340284A JP S6329445 B2 JPS6329445 B2 JP S6329445B2
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JP
Japan
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coefficient
sample
groups
tap
signal
Prior art date
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Expired
Application number
JP59003402A
Other languages
English (en)
Other versions
JPS59139717A (ja
Inventor
Masahiro Furuya
Shigemichi Maeda
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Publication of JPS59139717A publication Critical patent/JPS59139717A/ja
Publication of JPS6329445B2 publication Critical patent/JPS6329445B2/ja
Granted legal-status Critical Current

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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00—Baseband systems
    • H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
    • H04L25/03—Shaping networks in transmitter or receiver, e.g. adaptive shaping networks
    • H04L25/03006—Arrangements for removing intersymbol interference
    • H04L25/03012—Arrangements for removing intersymbol interference operating in the time domain
    • H04L25/03019—Arrangements for removing intersymbol interference operating in the time domain adaptive, i.e. capable of adjustment during data reception
    • H04L25/03038—Arrangements for removing intersymbol interference operating in the time domain adaptive, i.e. capable of adjustment during data reception with a non-recursive structure

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Filters That Use Time-Delay Elements (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)

Description

【発明の詳細な説明】 本発明は自動等化器、特に、連続するサンプル
信号に係数を乗じて加算し、その出力信号の状態
によつて上記各サンプルの係数を制御して所定の
等化特性を得る自動等化器に係る。
電話線等を用いてデータを伝送する場合、電話
線の特性によつて、信号の振幅ひずみ、遅延ひず
み等が生じる。この否を補償するため、中継器あ
るいは受信器の入力部に等化器が用いられる。特
に伝送信号がパルス信号や、サンプル信号で、か
つ伝送線路の特性が外的条件(例えば温度や回線
の切換)によつて変動する場合、この変動を迅速
に検出し、等化器の特性を伝送線路に適応する自
動等化器が必要となる。
このような自動等化器として第1図に示す構成
のものが知られている。同図において、xi(i=
n−N〜n+N)は電話回線のひずみを受けたサ
ンプル値、2は1サンプル周期の遅延時間を持つ
遅延素子、3のci(i=−N〜+N)は調整可能
なタツプ係数、4は加算器でyo=N 〓j=N cixo-i……(1)
の出力を発生する。6は識別器でyDは識別結果を
示す。8はタツプ調整係数gを乗ずる回路であ
る。各タツプ係数の調整は9の乗算器および10
の減算器を用いて以下の式(2)に従つて実行され
る。
c(m+1) i=c(m) i−g・xo-i・(yo−yD)……(2
) ここで、mはm回目の調整を意味している。
一方、近年通信機器の処理を高速のマイクロプ
ロセツサで実現しようという動きが活発となつて
きており、自動等化器もそのひとつにあげられ
る。しかし式(1)、(2)をマイクロプロセツサで実現
するためには、サンプル時間毎に乗算回数が3×
(2N+1)回必要となる。CCITT勧告V.29の場
合を例にとると、サンプル時間416μs、乗算回数
はV.29では2次元の自動等化器、(第1図の1の
データ3のタツプ係数がそれぞれ2つずつ存在す
ることとなる)で6×(2N+1)回必要となる。
またNの値は約30であり、1回の乗算を約1μs以
内で行なわねばならない。この演算時間は現在市
販されているマイクロプロセツサのほぼ限界値で
あり、他機能を並行して実行することは不可能で
ある。
したがつて、本発明は上述の従来技術の欠点を
解消し、演算量を少なくし、実質的に従来の等化
器と同等の等化特性を実現する自動等化器を提供
することである。
本発明は上記目的を達成するため、各サンプル
値のタツプ係数を調整する回路を複数サンプル周
期毎に行なうように構成したことを特徴とするも
のである。複数サンプル周期毎に調整を行う形態
としては、以下実施例で説明するように、偶数番
目のタツプと奇数番目のタツプを各サンプル周期
毎に交互に行なう場合、すなわち、特定の番目の
タツプは2サンプル周期毎にタツプの調整が行な
われることになる。すなわち、本発明では各サン
プル値のタツプ係数を調整する複数個のタツプ係
数調整回路が、複数グループ(上記例では偶数番
目と奇数番目の2つのグループ)に分割され、こ
れらの複数のグループはサンプル周期で巡回的に
順次選択され(上記2つのグループの場合はサン
プル周期で、交互に選択されることになる。)、選
択されたグループのタツプ係数の演算は1サンプ
ル周期で行なわれ選択されたグループにおおける
タツプ係数は複数サンプル周期(上記2グループ
の場合、2サンプル周期)毎に更新されるように
制御される。
したがつて演算の回数が著しく低減せられ、又
実験によれば、各サンプル周期毎に係数を制御す
る従来の自動等化器と実質的に同程度の等化特性
を特ることができた。
以下本発明を実施例によつて詳細に説明する。
第2図は本発明による自動等化器の一実施例の
構成を示す回路図において、タツプ係数の調整回
路を除いては原理的には第1図に示したものと同
じである。入力端子1より、サンプル値xiを持つ
サンプル信号が、サンプル周期の遅延時間を有す
る縦続された複数個の遅延素子2+N、2+N−
1、……、2−N+1に加えられる。各遅延素子
の入出力部(タツプ)には、乗算器3+N、3+
N−1、……、3−N;9+N、9+N−1、…
…、9−N;減算器10+N、10+N−1、……、
10−Nからなるタツプ係数調整回路が設けられ、
各タツプ係数調整回路の出力は加算器4で加算さ
れ、自動等化された出力信号yoを出力する。
この出力信号yoの一部は識別回路6で、標本信
号が前もつて定められた信号のいずれであるかを
判別し、その判別された識別回路yDを出力する。
引算器7は上記出力信号yoと識別信号yDの差を求
め、その出力は乗算器8で係数g(1より小さい
値)を乗ぜられる。乗算器8の出力はスイツチ回
路5でサンプル周期毎に2つの線路5−1および
5−2に交互に分配され、線路5−1に分配され
た信号g・(yo−yD)は上記タツプ係数調整回路
のうちの偶数番目のものの乗算器9でサンプル信
号(xo-2l)と乗算される。又線路5−2に分配
された信号g・(yo−yD)は奇数番目のタツプ係
数調整回路の乗算器9でサンプル信号(xo-2l-1)
と乗算される。これらの乗算回路9の各出力は引
算器10で前回の乗算器3での係数(すなわち偶
数番目の係数c2m-2 2l、奇数番目の係数c2m-1 2l+1)との
差を得て、これを新しい係数として乗算器3に加
える。したがつて、偶数番目(2l)乗算器3の第
2m回目の係数c2m 2l及び、奇数番目( 2l+1)の乗
算器3の第2m+1回目の係数 c2m+1 2l+1はそれぞれ c2m 2l=c2m-2 2l−g・xo-2l(yo−yD)……(3) c2m+1 2l+1=c2m-1 2l+1−g・xo-2l-1(yo−yD)……(4) となる。又、偶数番目の乗算器3の奇数回目の係
数は前回の係数c2m 2lを使用し、奇数番目の乗算器
3の偶数回目の係数は前回の係数c2m+1 2l+1を使用す
ることになる。このようにすれば自動等化器のサ
ンプリング時間毎に必要な乗算回数は2×(2N+
1)と従来の2/3に減少する。したがつて構成回
路の速度として高速のものを使用しなくてよい。
第3図は従来の自動等化器と第2図に示す実施
例における効果を比較する図で、横軸はトレイニ
ング期間におけるタツプ係数の更新回数、縦軸は
誤差の2乗和(相対値)を示し、図中、□印は本
発明の実施例によるもの、×印は従来の自動等化
によるものである。なお、自動等化器のタツプ数
は32で乗数g(タツプ更新ゲイン)は0.0005とし
たものである。
同図から明らかなごとく約10000回のタツプ更
新の後には誤差の自乗和の相対値は、従来のもの
とほとんど等しくなることが分る。
以上本発明を実施例によつて説明したが本発明
は上記実施例に限定されるものではない。例え
ば、第4図に示すように、タツプ係数Ciとサンプ
リング間隔毎の歪を有するデータ(Xn−i)を
格納する書き込み可能メモリ(RAM)11と、
識別、判定用しきい値(yD)を格納する読み出し
専用メモリ(ROM)12と、加減算回路14、
毎サンプル周期毎に一部のタツプ係数の更新を行
う乗算器13とを用意し、これらを、前述の(3)、
(4)式で表わされる自動等化アルゴリズムによつて
制御する制御回路15とを設け、前述の実施例と
実質的に同一の動作をするように構成することが
できる。
【図面の簡単な説明】
第1図は従来の自動等化器の構成図、第2図及
び第4図は本発明による自動等化器の実施例の構
成を示す図、第3図は第1図と第2図の実施例の
自動等化器の効果を比較するためのタツプ更新回
数と誤差の関係を示す図である。 1……入力端子、2……遅延素子、3,8,9
……乗算器、4……加算器、5,11……スイツ
チ回路、6……識別回路、7,10……減算器。

Claims (1)

    【特許請求の範囲】
  1. 1 連続する複数個の入力サンプル信号のそれぞ
    れに係数を乗じ、上記係数を乗じられた各サンプ
    ル信号を加算して出力とすると共に、上記加算し
    た出力を利用して上記係数を得る演算回路を持つ
    自動化器において、上記演算手段及び上記係数を
    乗じる手段が、上記複数個の入力サンプル信号を
    複数のグループに分け、上記復数のグループに分
    けられた複数個のサンプル信号群をサンプリング
    周期で巡回的に選択し、上記選択された群のサン
    プリング信号に係数を乗する演算を上記サンプリ
    ング周期間に行うと共に、上記係数がサンプリン
    グ周期の上記グループの数の倍数の周期毎に更新
    されるように構成されたことを特徴とする自動等
    化器。
JP340284A 1984-01-13 1984-01-13 自動等化器 Granted JPS59139717A (ja)

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JP340284A JPS59139717A (ja) 1984-01-13 1984-01-13 自動等化器

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JP340284A JPS59139717A (ja) 1984-01-13 1984-01-13 自動等化器

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JPS59139717A JPS59139717A (ja) 1984-08-10
JPS6329445B2 true JPS6329445B2 (ja) 1988-06-14

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3135902B2 (ja) * 1990-05-11 2001-02-19 株式会社日立製作所 自動等化器及び半導体集積回路
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US7339990B2 (en) * 2003-02-07 2008-03-04 Fujitsu Limited Processing a received signal at a detection circuit

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