JPS633023Y2 - - Google Patents
Info
- Publication number
- JPS633023Y2 JPS633023Y2 JP2464381U JP2464381U JPS633023Y2 JP S633023 Y2 JPS633023 Y2 JP S633023Y2 JP 2464381 U JP2464381 U JP 2464381U JP 2464381 U JP2464381 U JP 2464381U JP S633023 Y2 JPS633023 Y2 JP S633023Y2
- Authority
- JP
- Japan
- Prior art keywords
- phototransistor
- delay circuit
- index
- adjustment
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 6
- 238000000034 method Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
Description
【考案の詳細な説明】
本考案はフレキシブルデイスクドライブに関す
る。
る。
従来のインデツクスホール検出は、ヘツド信号
とインデツクスホール信号の時間ズレを合わすた
め、ネジ長穴等で機械的な調整を行なつていた。
この方法では、ネジの締めつけ力等で位置が微妙
に変わり、調整工程でのネツクになつていた。
とインデツクスホール信号の時間ズレを合わすた
め、ネジ長穴等で機械的な調整を行なつていた。
この方法では、ネジの締めつけ力等で位置が微妙
に変わり、調整工程でのネツクになつていた。
本考案はかかる欠点を除去したもので、その目
的は、インデツクスホール検出素子の位置合わせ
を、短時間に簡単に行なえる方法を提供するもの
である。
的は、インデツクスホール検出素子の位置合わせ
を、短時間に簡単に行なえる方法を提供するもの
である。
以下実施例に基づき本考案を詳しく説明する。
第１図は本考案の一実施例であり、１がインデツ
クスホールを通過してきた光を受けるフオトトラ
ンジスタ、２が負荷抵抗、３が遅延回路、４が遅
延回路３の可変抵抗、５がフオトトランジスタ１
の出力電圧であり、６が遅延回路３を通過した後
の信号であり、７がその遅れ時間である。
第１図は本考案の一実施例であり、１がインデツ
クスホールを通過してきた光を受けるフオトトラ
ンジスタ、２が負荷抵抗、３が遅延回路、４が遅
延回路３の可変抵抗、５がフオトトランジスタ１
の出力電圧であり、６が遅延回路３を通過した後
の信号であり、７がその遅れ時間である。
第２図はインデツクスホール位置合わせ時、シ
ンクロに現われる信号で、８がインデツクス信
号、９がヘツドより出るバースト信号であり、１
０が規格で決められている時間で200μsecである。
この構成において、フオトトランジスタ１の取付
位置を、遅延回路３の時間遅れt1を０にした時
に、インデツクス信号８が８′になるような位置
に設定する。この後、遅延回路３の可変抵抗４に
より、遅延回路３の時間遅れt1を調整し、インデ
ツクスバースト時間t2に合わせ込む。
ンクロに現われる信号で、８がインデツクス信
号、９がヘツドより出るバースト信号であり、１
０が規格で決められている時間で200μsecである。
この構成において、フオトトランジスタ１の取付
位置を、遅延回路３の時間遅れt1を０にした時
に、インデツクス信号８が８′になるような位置
に設定する。この後、遅延回路３の可変抵抗４に
より、遅延回路３の時間遅れt1を調整し、インデ
ツクスバースト時間t2に合わせ込む。
以上の例にみられるように、インデツクスホー
ル検出用のフオトトランジスタ出力回路に遅延回
路を設け、かつ正規位置より先行し取付けること
により、調整が可変抵抗器のみで可能となり調整
工数の低減につながる。また機械的な固定部分の
調整ではなく、電気的調整に置き換えたため、調
整工程の自動化が容易となる。
ル検出用のフオトトランジスタ出力回路に遅延回
路を設け、かつ正規位置より先行し取付けること
により、調整が可変抵抗器のみで可能となり調整
工数の低減につながる。また機械的な固定部分の
調整ではなく、電気的調整に置き換えたため、調
整工程の自動化が容易となる。
第１図は本考案のインデツクホール検出部の回
路図、第２図はインデツクス信号のタイミング図
である。
路図、第２図はインデツクス信号のタイミング図
である。
Claims (1)
- インデツクスホールの検出回路に遅延回路を持
ち、かつ検出用のフオトトランジスタを正規位置
より先行させフオトトランジスタを正規位置より
先行させ取付けられることを特徴とするフレキシ
ブルデイスクドライブ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2464381U JPS633023Y2 (ja) | 1981-02-24 | 1981-02-24 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2464381U JPS633023Y2 (ja) | 1981-02-24 | 1981-02-24 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57138173U JPS57138173U (ja) | 1982-08-28 |
| JPS633023Y2 true JPS633023Y2 (ja) | 1988-01-25 |
Family
ID=29822356
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2464381U Expired JPS633023Y2 (ja) | 1981-02-24 | 1981-02-24 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS633023Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63187462A (ja) * | 1987-01-29 | 1988-08-03 | Fujitsu Ltd | 磁気ディスク装置の回転同期制御方式 |
-
1981
- 1981-02-24 JP JP2464381U patent/JPS633023Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57138173U (ja) | 1982-08-28 |
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