JPS6335146U - - Google Patents

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JPS6335146U
JPS6335146U JP12858286U JP12858286U JPS6335146U JP S6335146 U JPS6335146 U JP S6335146U JP 12858286 U JP12858286 U JP 12858286U JP 12858286 U JP12858286 U JP 12858286U JP S6335146 U JPS6335146 U JP S6335146U
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JP
Japan
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image memory
address
word data
microprocessor
word
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JP12858286U
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【図面の簡単な説明】
第１図は本考案に係る画像メモリアクセス回路
の基本構成図、第２図は画像メモリアクセス回路
の実施例、第３図はワードアドレスデータと必要
データとの関係を示す説明図、第４図はリード時
のタイミングチヤート、第５図はリード時のバレ
ルシフタの入力出力の関係を示す説明図、第６図
はライト時のタイミングチヤート、第７図はライ
ト時のバレルシフタの入出力の関係を示す説明図
、第８図はワード領域を越えてアクセスしない場
合のタイミングチヤート、第９図はワードアドレ
スデータとワードアドレスを越えてアクセスする
データとの関係を示した説明図、第１０図は従来
技術によるメモリアクセスを示した説明図である
。 １：マイクロプロセツサ、２，１２〜１５：画
像メモリ、３：アドレス加算器、４：メモリセレ
クト回路、５，２８，２９：バレルシフタ。

Claims (1)

  1. 【実用新案登録請求の範囲】 マイクロプロセツサにより画像メモリをメモリ
    アドレスのワード境界を越えてアクセスする画像
    メモリアクセス回路において、 前記画像メモリのワードデータを任意ビツト位
    置で分割して独立にリードライトを可能とするメ
    モリセレクト回路を設けると共に、前記マイクロ
    プロセツサからのアドレスを本来のアドレスとこ
    れに隣接するアドレスとに切り換えて前記画像メ
    モリを時分割的に連続してアクセスするアドレス
    変更回路を設け、且つ前記画像メモリに入出力す
    る前記ワードデータを一旦格納しその後に前記分
    割したビツト位置を境界として前記ワードデータ
    を入れ換えるシフタとを設けたことを特徴とする
    画像メモリアクセス回路。
JP12858286U 1986-08-22 1986-08-22 Pending JPS6335146U (ja)

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JP12858286U JPS6335146U (ja) 1986-08-22 1986-08-22

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JPS6335146U true JPS6335146U (ja) 1988-03-07

Family

ID=31024385

Family Applications (1)

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JP12858286U Pending JPS6335146U (ja) 1986-08-22 1986-08-22

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6097454A (ja) * 1983-11-01 1985-05-31 Nec Corp デ−タ処理装置
JPS6115245A (ja) * 1984-06-29 1986-01-23 Nec Corp 記憶装置
JPS61120260A (ja) * 1984-11-16 1986-06-07 Matsushita Electric Ind Co Ltd 順次デ−タ記憶回路のアクセス装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6097454A (ja) * 1983-11-01 1985-05-31 Nec Corp デ−タ処理装置
JPS6115245A (ja) * 1984-06-29 1986-01-23 Nec Corp 記憶装置
JPS61120260A (ja) * 1984-11-16 1986-06-07 Matsushita Electric Ind Co Ltd 順次デ−タ記憶回路のアクセス装置

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