JPS6355254B2 - - Google Patents
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- Publication number
- JPS6355254B2 JPS6355254B2 JP59125961A JP12596184A JPS6355254B2 JP S6355254 B2 JPS6355254 B2 JP S6355254B2 JP 59125961 A JP59125961 A JP 59125961A JP 12596184 A JP12596184 A JP 12596184A JP S6355254 B2 JPS6355254 B2 JP S6355254B2
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- day
- tuning
- transistor
- pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
- Noise Elimination (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、電子選局回路を備えたテレビジヨン
受像機やビデオテープレコーダーに用いられるデ
イフイート回路に関するものである。
受像機やビデオテープレコーダーに用いられるデ
イフイート回路に関するものである。
従来例の構成とその問題点
一般のソフトタツチ形の電子選局回路の一部分
を第１図に示す。集積回路化された電子選局回路
（IC）３９とチユーニング電圧（BT）を得るボ
リユーム２９、選局スイツチ２０、選局チヤンネ
ル表示用発光ダイオード（LED）２６、等で構
成されている。
を第１図に示す。集積回路化された電子選局回路
（IC）３９とチユーニング電圧（BT）を得るボ
リユーム２９、選局スイツチ２０、選局チヤンネ
ル表示用発光ダイオード（LED）２６、等で構
成されている。
第１図においては、ボリユーム、発光ダイオー
ド、スイツチ等は数局分設けられている中の１つ
だけを示しており、他の局分についても同じよう
に選局回路３９に接続されている。
ド、スイツチ等は数局分設けられている中の１つ
だけを示しており、他の局分についても同じよう
に選局回路３９に接続されている。
今、選局スイツチ２０で選局操作した場合、ス
イツチ２０の片側ラインは抵抗４０及び抵抗５を
介してキーイン量端子７に接続される。それま
で、スイツチ２０の局が選されていなかつた時
は、スイツチ２０の端子１側は32Vの電圧を有
し、したがつて、スイツチ２０が押されると端子
７は高レベルとなる。この端子７が高レベルにな
つた時に選局回路３９はクロツク発振を始め、選
局出力をシフトさせる。すなわち、操作されたス
イツチ２０の局になるまで選局チヤンネルがシフ
トされる。操作された局の選局状態になつた時は
端子１は32Vから0Vとならり、端子７は低レベ
ルになつて発振が止まり、操作されたスイツチ２
０の局が選局される。
イツチ２０の片側ラインは抵抗４０及び抵抗５を
介してキーイン量端子７に接続される。それま
で、スイツチ２０の局が選されていなかつた時
は、スイツチ２０の端子１側は32Vの電圧を有
し、したがつて、スイツチ２０が押されると端子
７は高レベルとなる。この端子７が高レベルにな
つた時に選局回路３９はクロツク発振を始め、選
局出力をシフトさせる。すなわち、操作されたス
イツチ２０の局になるまで選局チヤンネルがシフ
トされる。操作された局の選局状態になつた時は
端子１は32Vから0Vとならり、端子７は低レベ
ルになつて発振が止まり、操作されたスイツチ２
０の局が選局される。
又、リモートコントロールにも対応している時
は、リモートコントロールで選局した時のリセツ
トパルス４がトランジスタ３のベースに入力さ
れ、エミツタから抵抗５を介しキーイン端子７に
入力される。すなわち、リセツトパルス４は高レ
ベルで受け付けられ、端子７を高レベルとする。
ここで選局回路３９は発振をはじめ、トランジス
タ３のコレクタが抵抗２を介して接続されている
ポジシヨン端子１が選局されると、コレクタは低
レベルとなつて、発振が停止する。
は、リモートコントロールで選局した時のリセツ
トパルス４がトランジスタ３のベースに入力さ
れ、エミツタから抵抗５を介しキーイン端子７に
入力される。すなわち、リセツトパルス４は高レ
ベルで受け付けられ、端子７を高レベルとする。
ここで選局回路３９は発振をはじめ、トランジス
タ３のコレクタが抵抗２を介して接続されている
ポジシヨン端子１が選局されると、コレクタは低
レベルとなつて、発振が停止する。
このような動作で選局するのであるが、この選
局回路が発振を開始すると同時に選局回路３９の
デイフイート端子９から選局動作時の発振出力ま
たはチヤンネルをアツプ、ダウンさせるパルス入
力と同じ入力幅でパルスが出力される。このパル
スは選局集積回路内での時間遅れを持つことと、
又、このパルスを直流電圧にすべく積分回路によ
り、発振開始時よりデイフイートパルス１８の立
上り時間が少し遅れてしまう。そのため、デイフ
イートパルス１８を使つている音声デイフイート
動作やLEDデイフイート動作等が十分ではなく
チヤンネル切換時に雑音が入つてしまうことが発
生するし、又、LEDが一瞬点灯してしまうこと
も発生する。
局回路が発振を開始すると同時に選局回路３９の
デイフイート端子９から選局動作時の発振出力ま
たはチヤンネルをアツプ、ダウンさせるパルス入
力と同じ入力幅でパルスが出力される。このパル
スは選局集積回路内での時間遅れを持つことと、
又、このパルスを直流電圧にすべく積分回路によ
り、発振開始時よりデイフイートパルス１８の立
上り時間が少し遅れてしまう。そのため、デイフ
イートパルス１８を使つている音声デイフイート
動作やLEDデイフイート動作等が十分ではなく
チヤンネル切換時に雑音が入つてしまうことが発
生するし、又、LEDが一瞬点灯してしまうこと
も発生する。
発明の目的
本発明は、このような従来の欠点を除去するも
ので、選局が開始されると同時にデイフイートパ
ルスが出力されるようにしたデイフイート回路を
提供することを目的とする。
ので、選局が開始されると同時にデイフイートパ
ルスが出力されるようにしたデイフイート回路を
提供することを目的とする。
発明の構成
本発明においては、選局手段の選局開始を示す
電位が変化するのと同期して、デイフイートパル
スを作成し、音声デイフイート動作や、LEDデ
イフイート動作を完全なものにするものである。
電位が変化するのと同期して、デイフイートパル
スを作成し、音声デイフイート動作や、LEDデ
イフイート動作を完全なものにするものである。
実施例の説明
以下、本発明の一実施例について図面を参照し
て説明する。第２図において、３９はソフトタツ
チ電子選局集積回路（IC）である。このIC３９
は図で示した以外の端子も有するが、図では省略
する。
て説明する。第２図において、３９はソフトタツ
チ電子選局集積回路（IC）である。このIC３９
は図で示した以外の端子も有するが、図では省略
する。
１，２３，２４、は選局出力端子であり、選局
スイツチ２０，２１，２２の片側に接続されてい
る。他にもICの持つ局数だけおの端子を有する
が、ここでは端子１についてのみ説明する。端子
１はダイオード２５を介し選局表示用LED２６
に接続され、LED２６のアノード側は12Vライン
１９に抵抗３８を介して接続されている。又、端
子１はBT電圧調整用のボリユーム２９の片側に
接続されている。ボリユーム２９のもう一つの側
は32Vライン３６に接続され、センターはダイオ
ード３１を介して、BT電圧ライン３７に接続さ
れている。
スイツチ２０，２１，２２の片側に接続されてい
る。他にもICの持つ局数だけおの端子を有する
が、ここでは端子１についてのみ説明する。端子
１はダイオード２５を介し選局表示用LED２６
に接続され、LED２６のアノード側は12Vライン
１９に抵抗３８を介して接続されている。又、端
子１はBT電圧調整用のボリユーム２９の片側に
接続されている。ボリユーム２９のもう一つの側
は32Vライン３６に接続され、センターはダイオ
ード３１を介して、BT電圧ライン３７に接続さ
れている。
端子１は抵抗３０を介して、バンド切換スイツ
チ３２の共通端子に接続され、バンド切換スイツ
チ３２のその他の端子はそれぞれVHFの低バン
ド端子３３、VHFの高バンド端子３４、UHF端
子３５に接続されており、バンド切換回路につな
がる。また端子１は抵抗２を介してトランジスタ
３のコレクタに接続され、そのエミツタは選局ス
イツチ２０の共通ライン側及び抵抗５を介してキ
ーイン端子７に接続され、またアース間にコンデ
ンサ６が挿入されている。トランジスタ３のエミ
ツタは抵抗４１を介してトランジスタ４３のベー
スに接続され、ベースとアース間には抵抗４２が
入つている。トランジスタ４３のコレクタは、抵
抗４４を介してデイフイートパルス用トランジス
タ１５のベースに接続されている。
チ３２の共通端子に接続され、バンド切換スイツ
チ３２のその他の端子はそれぞれVHFの低バン
ド端子３３、VHFの高バンド端子３４、UHF端
子３５に接続されており、バンド切換回路につな
がる。また端子１は抵抗２を介してトランジスタ
３のコレクタに接続され、そのエミツタは選局ス
イツチ２０の共通ライン側及び抵抗５を介してキ
ーイン端子７に接続され、またアース間にコンデ
ンサ６が挿入されている。トランジスタ３のエミ
ツタは抵抗４１を介してトランジスタ４３のベー
スに接続され、ベースとアース間には抵抗４２が
入つている。トランジスタ４３のコレクタは、抵
抗４４を介してデイフイートパルス用トランジス
タ１５のベースに接続されている。
端子９はデイフイートパルス用の発振出力端子
であり、抵抗１０，１２を介してトランジスタ１
５のベースに接続されている。又、端子９より抵
抗１０を通つた後からは12Vライン１９間に電解
コンデンサ１１が接続されており、発振出力を積
分している。トランジスタ１５のベースと12Vラ
イン１９間には抵抗１３が入り、エミツタは12V
ライン１９間にダイオード１４が入つおり、又ア
ース間に電解コンデンサ１７が挿入されている。
コレクタはアース間に抵抗１６が設けられ、この
コレクターラインを各デイフイートパルス信号出
力端として使用されている。
であり、抵抗１０，１２を介してトランジスタ１
５のベースに接続されている。又、端子９より抵
抗１０を通つた後からは12Vライン１９間に電解
コンデンサ１１が接続されており、発振出力を積
分している。トランジスタ１５のベースと12Vラ
イン１９間には抵抗１３が入り、エミツタは12V
ライン１９間にダイオード１４が入つおり、又ア
ース間に電解コンデンサ１７が挿入されている。
コレクタはアース間に抵抗１６が設けられ、この
コレクターラインを各デイフイートパルス信号出
力端として使用されている。
次に、この回路の動作を説明する。端子１が選
局されていない時は、32Vが端子１に印加されて
おり、選局されている時は0Vとなる。すなわち、
選局スイツチ２０を操作した時に端子１に32Vが
印加されているとすれば、キーイン端子７は高レ
ベルとなる。この時、IC３９はクロツク発振を
開始し、デイフイート出力端子９からパルスが出
力される。このパルスはIC回路内での時間遅れ
及び積分回路による波形のなまりによる時間遅れ
を持つために、このデイフイートパルスは、すで
に働き始めている選局回路の選局電圧BTの変動
により出力される異常音等を消去することが出来
ない。
局されていない時は、32Vが端子１に印加されて
おり、選局されている時は0Vとなる。すなわち、
選局スイツチ２０を操作した時に端子１に32Vが
印加されているとすれば、キーイン端子７は高レ
ベルとなる。この時、IC３９はクロツク発振を
開始し、デイフイート出力端子９からパルスが出
力される。このパルスはIC回路内での時間遅れ
及び積分回路による波形のなまりによる時間遅れ
を持つために、このデイフイートパルスは、すで
に働き始めている選局回路の選局電圧BTの変動
により出力される異常音等を消去することが出来
ない。
そこで、本回路では、スイツチ２０で端子１の
ポジシヨンを選局した時に発生される高レベルの
電圧でトランジスタ４３をオンさせるようにして
いる。従つてトランジスタ１５もオンになり、デ
イフイートパルス１８は高レベルとなる。これを
それ以降のデイフイートトランジスタに接続する
ことによつて、音声、LED、AFC回路等のデイ
フイート回路を構成することが出来る。
ポジシヨンを選局した時に発生される高レベルの
電圧でトランジスタ４３をオンさせるようにして
いる。従つてトランジスタ１５もオンになり、デ
イフイートパルス１８は高レベルとなる。これを
それ以降のデイフイートトランジスタに接続する
ことによつて、音声、LED、AFC回路等のデイ
フイート回路を構成することが出来る。
すなわち、キーイン端子７への入力パルスと同
期したデイフイートパルスを作成することが可能
である。
期したデイフイートパルスを作成することが可能
である。
次にリモートコントロールの時においては、リ
モートコントロールで直接選局する時、リセツト
パルスがまず出力され、これで選局ポジシヨンを
ある指定の位置に戻す。次に別ラインよりチヤン
ネルを何ステツプ移動させるかのパルスが、その
数だけ出力される。それによつて希望のチヤンネ
ルを選局することができる。
モートコントロールで直接選局する時、リセツト
パルスがまず出力され、これで選局ポジシヨンを
ある指定の位置に戻す。次に別ラインよりチヤン
ネルを何ステツプ移動させるかのパルスが、その
数だけ出力される。それによつて希望のチヤンネ
ルを選局することができる。
この後から出力されるパルスが入力される端子
をチヤンネルアツプ端子８とする。すなわち、リ
セツトパルスはトランジスタ３のベースに入力さ
れ、チヤンネルアツプ端子８には何ポジシヨンシ
フトさせるかのパルスが入力される。IC３９は
リセツトパルスが入力されている時と、チヤンネ
ルアツプパルスが入力されている間はデイフイー
トパルスを出力するようになされているのである
が、このようにリモートコントロールで選局した
時でも最初のリセツトパルスが出力される時、キ
ーイン端子７は同様に高レベルとなり、デイフイ
ートパルスは同様に遅れてしまうが本回路によれ
ば、リセツトパルスに対してもトランジスタ３が
ONすることにより、トランジスタ１５のコレク
タにリセツトパルスに同期したデイフイートパル
スを得ることが可能である。
をチヤンネルアツプ端子８とする。すなわち、リ
セツトパルスはトランジスタ３のベースに入力さ
れ、チヤンネルアツプ端子８には何ポジシヨンシ
フトさせるかのパルスが入力される。IC３９は
リセツトパルスが入力されている時と、チヤンネ
ルアツプパルスが入力されている間はデイフイー
トパルスを出力するようになされているのである
が、このようにリモートコントロールで選局した
時でも最初のリセツトパルスが出力される時、キ
ーイン端子７は同様に高レベルとなり、デイフイ
ートパルスは同様に遅れてしまうが本回路によれ
ば、リセツトパルスに対してもトランジスタ３が
ONすることにより、トランジスタ１５のコレク
タにリセツトパルスに同期したデイフイートパル
スを得ることが可能である。
発明の効果
以上のように、本発明によれば、選局スイツチ
で選局したとしおよびリモートコントロールで選
局されたときに変化する電位を検出して選局動作
を開始するとともに、選局動作が開始されて終了
するまでの間、発振出力端子よりパルスを出力す
る選局手段を備え、かつ上記発振出力端子に積分
回路を介してベースが接続されたデイフイート用
トランジスタを備えて、選局時のデイフイートパ
ルスを発生する装置において、上記電位の変化検
出点にベースを接続したトランジスタを設け、こ
のトランジスタのコレクタ出力端子を上記デイフ
イート用トランジスタのベースに接続することに
より、選局開始と同期させて遅延するなくデイフ
イートパルスを発生することができ、選局時の音
声の雑音や表示素子の余分な点灯を防止すること
のできるデイフイート回路を提供することができ
るものである。
で選局したとしおよびリモートコントロールで選
局されたときに変化する電位を検出して選局動作
を開始するとともに、選局動作が開始されて終了
するまでの間、発振出力端子よりパルスを出力す
る選局手段を備え、かつ上記発振出力端子に積分
回路を介してベースが接続されたデイフイート用
トランジスタを備えて、選局時のデイフイートパ
ルスを発生する装置において、上記電位の変化検
出点にベースを接続したトランジスタを設け、こ
のトランジスタのコレクタ出力端子を上記デイフ
イート用トランジスタのベースに接続することに
より、選局開始と同期させて遅延するなくデイフ
イートパルスを発生することができ、選局時の音
声の雑音や表示素子の余分な点灯を防止すること
のできるデイフイート回路を提供することができ
るものである。
第１図は、従来例の電子選局回路を含むデイフ
イート回路の回路図、第２図は本発明の一実施例
におけるデイフイート回路の回路図である。 １，２３，２４……選局出力端子、７……キー
イン端子、３９……選局回路、９……デイフイー
ト出力端子、２０，２１，２２……選局スイツ
チ、３，１５，４３……トランジスタ、４……リ
セツトパルス信号、１８……デイフイートパルス
信号。
イート回路の回路図、第２図は本発明の一実施例
におけるデイフイート回路の回路図である。 １，２３，２４……選局出力端子、７……キー
イン端子、３９……選局回路、９……デイフイー
ト出力端子、２０，２１，２２……選局スイツ
チ、３，１５，４３……トランジスタ、４……リ
セツトパルス信号、１８……デイフイートパルス
信号。
Claims (1)
- １ 選局スイツチによつて選局動作がなされたと
きおよびリモートコントロールで選局がなされた
ときに変化する電位の変化を検出して選局動作を
開始するとともに、選局動作が開始されて終了す
るまでの間、発振出力端子よりパルスを出力する
集積回路化された選局手段と、上記発振出力端子
に積分回路を介してベースが接続されたデイフイ
ート用トランジスタと、上記電位の変化を検出し
た出力がベースに加えられる第１のトランジスタ
を設け、この第１のトランジスタのコレクタ出力
端子を上記デイフイート用トランジスタのベース
に接続し、上記選局スイツチあるいはリモートコ
ントロールによつて選局操作がなされたときに上
記デイフイート用トランジスタの出力端子よりデ
イフイート用パルスを得るようにしたことを特徴
とするデイフイート回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59125961A JPS614328A (ja) | 1984-06-19 | 1984-06-19 | デイフイ−ト回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59125961A JPS614328A (ja) | 1984-06-19 | 1984-06-19 | デイフイ−ト回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS614328A JPS614328A (ja) | 1986-01-10 |
| JPS6355254B2 true JPS6355254B2 (ja) | 1988-11-01 |
Family
ID=14923258
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59125961A Granted JPS614328A (ja) | 1984-06-19 | 1984-06-19 | デイフイ−ト回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS614328A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0647746A (ja) * | 1992-07-14 | 1994-02-22 | Kyowa Kogyo Kk | パレットの製造法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5816941U (ja) * | 1981-07-21 | 1983-02-02 | 三洋電機株式会社 | 電子同調受信機のミュ−ティング回路 |
-
1984
- 1984-06-19 JP JP59125961A patent/JPS614328A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS614328A (ja) | 1986-01-10 |
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