JPS6356454U - - Google Patents
Info
- Publication number
- JPS6356454U JPS6356454U JP15041886U JP15041886U JPS6356454U JP S6356454 U JPS6356454 U JP S6356454U JP 15041886 U JP15041886 U JP 15041886U JP 15041886 U JP15041886 U JP 15041886U JP S6356454 U JPS6356454 U JP S6356454U
- Authority
- JP
- Japan
- Prior art keywords
- bus
- address
- data
- interface circuit
- values
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Retry When Errors Occur (AREA)
- Information Transfer Systems (AREA)
Description
第１図は本考案の一実施例を示すバスインタフ
エース回路の構成図、第２図は第１図の動作タイ
ムチヤート、第３図は従来のバスインタフエース
回路の動作タイムチヤート、第４図は本考案の作
用の説明図である。 １：アドレスレジスタ、２：アドレス一致検出
比較器、３：データレジスタ、４：データ一致検
出比較器。
エース回路の構成図、第２図は第１図の動作タイ
ムチヤート、第３図は従来のバスインタフエース
回路の動作タイムチヤート、第４図は本考案の作
用の説明図である。 １：アドレスレジスタ、２：アドレス一致検出
比較器、３：データレジスタ、４：データ一致検
出比較器。
Claims (1)
- アドレスバスとデータバスに接続されるバスイ
ンタフエース回路において、該アドレスバスおよ
びデータバスの値をそれぞれバスクロツクに同期
して２回ずつサンプリングし、各々が一致するか
否かを比較する手段と、両比較手段がともに一致
したときアドレスおよびデータを内部に取り込む
手段とを有することを特徴とするバスインタフエ
ース回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15041886U JPS6356454U (ja) | 1986-09-30 | 1986-09-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15041886U JPS6356454U (ja) | 1986-09-30 | 1986-09-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6356454U true JPS6356454U (ja) | 1988-04-15 |
Family
ID=31066547
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15041886U Pending JPS6356454U (ja) | 1986-09-30 | 1986-09-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6356454U (ja) |
-
1986
- 1986-09-30 JP JP15041886U patent/JPS6356454U/ja active Pending
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