JPS6364131U - - Google Patents
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- Publication number
- JPS6364131U JPS6364131U JP15771586U JP15771586U JPS6364131U JP S6364131 U JPS6364131 U JP S6364131U JP 15771586 U JP15771586 U JP 15771586U JP 15771586 U JP15771586 U JP 15771586U JP S6364131 U JPS6364131 U JP S6364131U
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- JP
- Japan
- Prior art keywords
- output
- operational amplifier
- loop filter
- oscillation
- voltage
- Prior art date
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- Pending
Links
- 230000010355 oscillation Effects 0.000 claims 4
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
第１図は本考案の一実施例の回路図である。
１……位相比較器、２……基準周波数発振器、
３……可変分周器、４……オペアンプ、５１，５
２，５３……電圧制御発振器、１１Ａ，１１Ｂ…
…スイツチ、７……ＦＥＴ、９……可変電圧源、
１０……可変電圧源、８……抵抗。
３……可変分周器、４……オペアンプ、５１，５
２，５３……電圧制御発振器、１１Ａ，１１Ｂ…
…スイツチ、７……ＦＥＴ、９……可変電圧源、
１０……可変電圧源、８……抵抗。
Claims (1)
- オペアンプで構成されるループ・フイルタと、
複数の電圧制御発振器の一つを撰選択してその入
力端を前記ループ・フイルタの出力端に接続する
発振手段と、この発振手段の発振出力を分周する
可変分周器と、この可変分周器の出力を基準周波
数発振器の発振出力と比較する位相比較器とを具
備するＰＬＬ回路において、さらに前記位相比較
器の出力をＦＥＴと抵抗の直列回路により分圧し
て前記ループ・フイルタの入力とする分圧回路と
、前記オペアンプの比較電位を可変する電圧源と
を具備することを特徴とするＰＬＬ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15771586U JPS6364131U (ja) | 1986-10-14 | 1986-10-14 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15771586U JPS6364131U (ja) | 1986-10-14 | 1986-10-14 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6364131U true JPS6364131U (ja) | 1988-04-27 |
Family
ID=31080521
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15771586U Pending JPS6364131U (ja) | 1986-10-14 | 1986-10-14 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6364131U (ja) |
-
1986
- 1986-10-14 JP JP15771586U patent/JPS6364131U/ja active Pending