JPS6387877A - デジタル映像合成回路 - Google Patents
デジタル映像合成回路Info
- Publication number
- JPS6387877A JPS6387877A JP61233547A JP23354786A JPS6387877A JP S6387877 A JPS6387877 A JP S6387877A JP 61233547 A JP61233547 A JP 61233547A JP 23354786 A JP23354786 A JP 23354786A JP S6387877 A JPS6387877 A JP S6387877A
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- JP
- Japan
- Prior art keywords
- signal
- circuit
- converter
- signals
- digital
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- Analogue/Digital Conversion (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、デジタル化された映像信号と文字信号を合成
するデジタル映像合成回路に関するものである。
するデジタル映像合成回路に関するものである。
従来の技術
近年、デジタル技術の発達と共にデジタルＴＶも発表さ
れ、また付加機能の充実のため、映像と文字を重ね合わ
せるスーパーインポーズが出てきた。以下、従来のデジ
タル映像信号合成回路について図面を参照しながら説明
する。
れ、また付加機能の充実のため、映像と文字を重ね合わ
せるスーパーインポーズが出てきた。以下、従来のデジ
タル映像信号合成回路について図面を参照しながら説明
する。
第２図は、従来のデジタル映像信号合成回路のブロック
図を示すものである。第２図において、１〜５はＡ ／
Ｄ変換器、６はデジタル映像信号復調回路、７は倍速
変換回路、９〜１１ばＤ／Ａ変換器、１６はＲＧＢ変換
回路、１８はＣＲ７表示装置である。また、２０はＹＵ
Ｖマトリクス回路、２１〜２３は減算器、２３〜２６は
加算器、２７はＡ ／ Ｄ変換器、２８は倍速変換回路
、２９はＤ ／ Ａ変換器である。
図を示すものである。第２図において、１〜５はＡ ／
Ｄ変換器、６はデジタル映像信号復調回路、７は倍速
変換回路、９〜１１ばＤ／Ａ変換器、１６はＲＧＢ変換
回路、１８はＣＲ７表示装置である。また、２０はＹＵ
Ｖマトリクス回路、２１〜２３は減算器、２３〜２６は
加算器、２７はＡ ／ Ｄ変換器、２８は倍速変換回路
、２９はＤ ／ Ａ変換器である。
以上のように構成されたデジタル映像信号合成回路につ
いて、以下その動作について第３図の信号波形とともに
説明する。第２図において、まず、複合映像信号人（第
３図（ａ）参照）は、Ａ／Ｄ変換器１でデジタル化され
、デジタル映像信号復調回路６によって、第３図（ｂ）
、 （Ｃ） 、 （ｄ）で示されるようにデジタル輝
度・色差信号Ｙ１ 、Ｕｌ 、Ｖｌにそれぞれ復調され
る。ここで、第３図の波形は、説明のためアナログ波形
を示し、数値は振幅を表わす。一方、第３図（ｅ） 、
（ｆ） 、 （ｇ）に示されるような文字信号等０Ｒ
ＧＢ信号Ｃ＊ Ｄ ＊ ”は、Ｙ Ｕ Ｖ マ）リクス
回路２０によって、第３図Φ）、（ｉ）、ｌｊ）で示さ
れるように輝度・色差信号Ｙ２．Ｕ２．Ｖ２にそれぞれ
変換され、Ａ ／ Ｄ変換器３，４．５でデジタル化さ
れる。
いて、以下その動作について第３図の信号波形とともに
説明する。第２図において、まず、複合映像信号人（第
３図（ａ）参照）は、Ａ／Ｄ変換器１でデジタル化され
、デジタル映像信号復調回路６によって、第３図（ｂ）
、 （Ｃ） 、 （ｄ）で示されるようにデジタル輝
度・色差信号Ｙ１ 、Ｕｌ 、Ｖｌにそれぞれ復調され
る。ここで、第３図の波形は、説明のためアナログ波形
を示し、数値は振幅を表わす。一方、第３図（ｅ） 、
（ｆ） 、 （ｇ）に示されるような文字信号等０Ｒ
ＧＢ信号Ｃ＊ Ｄ ＊ ”は、Ｙ Ｕ Ｖ マ）リクス
回路２０によって、第３図Φ）、（ｉ）、ｌｊ）で示さ
れるように輝度・色差信号Ｙ２．Ｕ２．Ｖ２にそれぞれ
変換され、Ａ ／ Ｄ変換器３，４．５でデジタル化さ
れる。
このとき、ＹＵＶマトリクス回路２ｏは、ＲＧＢ信号よ
りつくられるが、その関係は、一般に以下の式を満足す
る。
りつくられるが、その関係は、一般に以下の式を満足す
る。
Ｙ２：０．３Ｒ＋０．６９Ｇ−）−０，１１ＢＵ２＝Ｂ
−Ｙ２ Ｖ２＝Ｒ−Ｙ２ さらに、第４図（ｋ）に示される画面合成のための切換
信号（Ｙｓ）Ｂは、Ａ／Ｄ変換器２でデジタル化され、
Ｙｓｌ 信号として、減算器２３に加えられる。Ｙｓ
ｌ 信号は、第４図例）に示されるように、信号レベ
ルが高いとき、文字信号を出力し、信号レベルが低いと
き、映像信号を出力する。本来、切換信号Ｙ、は、スイ
ッチング信号であるが、１ビツトの信号で処理してしま
うと、サンプリングクロックの周期でジッタを発生する
ため、ｎビットの信号として処理する。したがって、切
換えは、段階的に行われる。
−Ｙ２ Ｖ２＝Ｒ−Ｙ２ さらに、第４図（ｋ）に示される画面合成のための切換
信号（Ｙｓ）Ｂは、Ａ／Ｄ変換器２でデジタル化され、
Ｙｓｌ 信号として、減算器２３に加えられる。Ｙｓ
ｌ 信号は、第４図例）に示されるように、信号レベ
ルが高いとき、文字信号を出力し、信号レベルが低いと
き、映像信号を出力する。本来、切換信号Ｙ、は、スイ
ッチング信号であるが、１ビツトの信号で処理してしま
うと、サンプリングクロックの周期でジッタを発生する
ため、ｎビットの信号として処理する。したがって、切
換えは、段階的に行われる。
つぎに、Ｙ、信号を中心とした、画面合成の方法全説明
する。この場合、輝度信号を代表として説明する。
する。この場合、輝度信号を代表として説明する。
第２図の減算器２１によって、第４図（１）に示される
映像の輝度信号Ｙ１から、第４図（ｋ）で示される切換
信号Ｙ、１ ｉ減算することによって、第４図（ｎ）
に示されるような信号Ｙ′を得る。すなわち、Ｙ５１
の信号が大きいとき、映像の輝度信号Ｙ１の成分が小
さくなる。また、減算を行っているために、切換えは段
階的にスムーズに行われる。さらに、加算器２４によっ
て、第４図（ｍ）で示される文字系の輝度信号Ｙ３が、
前記信号Ｙ′に加算されることによって、第４図（０）
に示されるように、映像と文字信号が合成された輝度信
号Ｙ″を得る。
映像の輝度信号Ｙ１から、第４図（ｋ）で示される切換
信号Ｙ、１ ｉ減算することによって、第４図（ｎ）
に示されるような信号Ｙ′を得る。すなわち、Ｙ５１
の信号が大きいとき、映像の輝度信号Ｙ１の成分が小
さくなる。また、減算を行っているために、切換えは段
階的にスムーズに行われる。さらに、加算器２４によっ
て、第４図（ｍ）で示される文字系の輝度信号Ｙ３が、
前記信号Ｙ′に加算されることによって、第４図（０）
に示されるように、映像と文字信号が合成された輝度信
号Ｙ″を得る。
このとき、第４図（０）のハツチング部分が合成された
文字信号の部分となる。
文字信号の部分となる。
さらに、合成された輝度信号Ｙ／ｌは、倍速変換回路７
によって倍速変換され、第４図午）に示される波形Ｙ４
ｉ得る。その後、信号Ｙ４はＤ／Ａ変換器９によってア
ナログ信号に変換される。同様にして、色差信号も処理
され、信号Ｕｓ、Ｖ５’ｉｉ得る。そして、ＲＧＢ変換
回路１ｅにおいて、Ｙ５ 、ＵＳ 、Ｖ６信号はＣＲＴ
表示装置１８全駆動するために、ＲＧＢ信号Ｒ５、Ｇｓ
、Ｂ５に変換され、表示される。
によって倍速変換され、第４図午）に示される波形Ｙ４
ｉ得る。その後、信号Ｙ４はＤ／Ａ変換器９によってア
ナログ信号に変換される。同様にして、色差信号も処理
され、信号Ｕｓ、Ｖ５’ｉｉ得る。そして、ＲＧＢ変換
回路１ｅにおいて、Ｙ５ 、ＵＳ 、Ｖ６信号はＣＲＴ
表示装置１８全駆動するために、ＲＧＢ信号Ｒ５、Ｇｓ
、Ｂ５に変換され、表示される。
一方、ＹＭは、Ａ ／ Ｄ変換器２７でデジタル化され
（波形（（１＞ ） 、倍速変換回路２８で倍速にされ
（波形（ｒ））、Ｄ／Ａ変換器２９でアナログにもどさ
れ、ＲＧＢ変換回路１６において、ＹＭ倍信号ハイレベ
ルのときは、コントラストをあるレベルだけ落とすこと
となる。
（波形（（１＞ ） 、倍速変換回路２８で倍速にされ
（波形（ｒ））、Ｄ／Ａ変換器２９でアナログにもどさ
れ、ＲＧＢ変換回路１６において、ＹＭ倍信号ハイレベ
ルのときは、コントラストをあるレベルだけ落とすこと
となる。
発明が解決しようとする問題点
しかしながら第２図の回路構成では、倍速変換するため
に、Ａ ／ Ｄ変換器ｔ”／大変換器１恰速変換回路な
どが必要となっており、回路規模が大きくなるという問
題点を有していた。
に、Ａ ／ Ｄ変換器ｔ”／大変換器１恰速変換回路な
どが必要となっており、回路規模が大きくなるという問
題点を有していた。
本発明は、上記問題点に鑑み、Ａ ／ Ｄ変換器入力前
すなわちアナログ領域でＹＭ動作をさせることのできる
安価で実用的な回路を提供するものである。
すなわちアナログ領域でＹＭ動作をさせることのできる
安価で実用的な回路を提供するものである。
問題点を解決するための手段
上記問題点を解決するために本発明のデジタル映像合成
回路は、ビデオ信号をデジタル化するＡ ／ Ｄ変換器
と、デジタル化された信号からデジタル輝度９色差信号
を作シ出すデジタル信号り調回路と、Ｙ、にＹＭを加え
る加算回路と、それをデジタル化するＡ／Ｄ変換器と、
デジタル輝度。
回路は、ビデオ信号をデジタル化するＡ ／ Ｄ変換器
と、デジタル化された信号からデジタル輝度９色差信号
を作シ出すデジタル信号り調回路と、Ｙ、にＹＭを加え
る加算回路と、それをデジタル化するＡ／Ｄ変換器と、
デジタル輝度。
色差信号からデジタル化された（Ｙ、＋Ｙ、）を引く引
算回路と、そこに文字デジタル輝度９色差信号全加える
加算回路と、合成された信号を倍密にする倍速変換回路
と、合成されたデジタル輝度。
算回路と、そこに文字デジタル輝度９色差信号全加える
加算回路と、合成された信号を倍密にする倍速変換回路
と、合成されたデジタル輝度。
色差信号をアナログに変換するＤ／Ａ変換器と、アナロ
グに変換された輝度１色差信号からＲ，Ｃ，、Ｂ信号に
直すＲＧＢ変換回路と、ＲＧＢ信号により映像を映し出
すＣＲＴ表示装置という構成金儲えたものである。
グに変換された輝度１色差信号からＲ，Ｃ，、Ｂ信号に
直すＲＧＢ変換回路と、ＲＧＢ信号により映像を映し出
すＣＲＴ表示装置という構成金儲えたものである。
作用
本発明は、上記した構成によって、アナログ部分におい
てＹＭ倍信号Ｙ８信号の内へ組みこむことで、映像信号
よりある定数を引くことでＹＭ動作をさせることとなり
、ＹＭのための人／Ｄ。
てＹＭ倍信号Ｙ８信号の内へ組みこむことで、映像信号
よりある定数を引くことでＹＭ動作をさせることとなり
、ＹＭのための人／Ｄ。
Ｄ／Ａ変換器、倍速変換回路が不要となり、回路規模を
小さくすることができる。
小さくすることができる。
実施例
以下本発明の一実施例について図面を参照しながら説明
する。第１図は、本発明の一実施例におけるデジタル映
像信号合成回路のブロック図を示すものである。第１図
において、１〜６は人／Ｄ変換器、６はデジタル信号復
調回路、アは倍速変換回路、９〜１１はＤ／Ａ変換器、
１６はＲＧＢ変換回路、２１〜２３は減算回路、２４〜
２６は加算回路、２ｏはＹ、Ｕ、Ｖマトリ２２回路で、
以上は第２図と同じものである。また３０は加算回路で
ある。
する。第１図は、本発明の一実施例におけるデジタル映
像信号合成回路のブロック図を示すものである。第１図
において、１〜６は人／Ｄ変換器、６はデジタル信号復
調回路、アは倍速変換回路、９〜１１はＤ／Ａ変換器、
１６はＲＧＢ変換回路、２１〜２３は減算回路、２４〜
２６は加算回路、２ｏはＹ、Ｕ、Ｖマトリ２２回路で、
以上は第２図と同じものである。また３０は加算回路で
ある。
以上のように構成されたデジタル映像信号合成回路につ
いて、以下その動作について第６図を用いて説明する。
いて、以下その動作について第６図を用いて説明する。
入力信号Ｙ、、Ｙ、が第６図（Ｓ） Ｉ （ｔ）の様に
与えられた場合、加算回路３０（第５図参照）において
加算され、Ａ／Ｄ変換器２でデジタル化されＹｓｌ
（第６図（Ｕ））となる。
与えられた場合、加算回路３０（第５図参照）において
加算され、Ａ／Ｄ変換器２でデジタル化されＹｓｌ
（第６図（Ｕ））となる。
また、デジタル信号復調回路６の出力輝度信号Ｙ１．色
差信号Ｕ１．Ｖ１から引算回路２１〜２３によってＹｓ
ｌ ｆ引くことによって、Ｙ８の ・部分は完全
に０になり、ＹＭの部分はある定数＆だけ引かれて（＆
は第６図の抵抗３１によって決まる）第６図ｆｆ）の様
になる。次に加算回路２４〜２６で前述のＹｓｌ に
よって抜き取られた部分に文字の信号Ｙ３ 、Ｕ３ 、
Ｖ３が加算される（第６図（Ｗ）。その後、従来例で述
べたのと同様に各加算回路２４．２５．２６（７）出力
Ｙ″ 、Ｕ′／、ｖ′がそれぞれ倍速変換回路７によっ
て倍速変換され、Ｄ ／ Ａ変換器９〜１１でアナログ
に直され、Ｒ，Ｇ、Ｂ変換回路１６でＲ，Ｇ、Ｂ信号に
され、ＣＲＴ表示装置１８を、駆動する。
差信号Ｕ１．Ｖ１から引算回路２１〜２３によってＹｓ
ｌ ｆ引くことによって、Ｙ８の ・部分は完全
に０になり、ＹＭの部分はある定数＆だけ引かれて（＆
は第６図の抵抗３１によって決まる）第６図ｆｆ）の様
になる。次に加算回路２４〜２６で前述のＹｓｌ に
よって抜き取られた部分に文字の信号Ｙ３ 、Ｕ３ 、
Ｖ３が加算される（第６図（Ｗ）。その後、従来例で述
べたのと同様に各加算回路２４．２５．２６（７）出力
Ｙ″ 、Ｕ′／、ｖ′がそれぞれ倍速変換回路７によっ
て倍速変換され、Ｄ ／ Ａ変換器９〜１１でアナログ
に直され、Ｒ，Ｇ、Ｂ変換回路１６でＲ，Ｇ、Ｂ信号に
され、ＣＲＴ表示装置１８を、駆動する。
第５図は上記加算回路３０の具体例を示す。抵抗３１の
一端？ダイオード３２のアノードに接続し、また抵抗３
１の他端をＹＭ入力端に、ダイオード３２のカソードを
Ｙｓ入力端におのおの接続している。ダイオード３２０
カソードは出力端子ともなる。
一端？ダイオード３２のアノードに接続し、また抵抗３
１の他端をＹＭ入力端に、ダイオード３２のカソードを
Ｙｓ入力端におのおの接続している。ダイオード３２０
カソードは出力端子ともなる。
発明の効果
以上のように、本発明によれば、ＹＭの動作がＡ ／
Ｄ変換器１倚速変換回路、Ｄ／Ａ変換器を用いずに簡単
な加算回路で実現でき１１回路規模を小さくすることで
実用化に効果大なるものがある。
Ｄ変換器１倚速変換回路、Ｄ／Ａ変換器を用いずに簡単
な加算回路で実現でき１１回路規模を小さくすることで
実用化に効果大なるものがある。
第１図は本発明の一実施例におけるデジタル映像合成回
路の回路図、第２図は従来例の映像合成回路の回路図、
第３図、第４図、第６図、第６図はおのおの第１図、第
２図の回路の動作説明のための波形図および回路図であ
る。 １〜５・・・・・・Ａ ／ Ｄ変換器、６・・・・・・
信号復調回路、７・・・・・・倍速変換回路、９〜１１
・・・・・・Ｄ／Ａ変換器、１６・・・・・・ＲＧＢ変
換回路、１８・・・・・・ＣＲＴ表示装置、２０・・・
・・・ＹＵＶマトリクス回路、２１〜２３・・・・・・
引算回路、２４〜２６．３０・・・・・・加算回路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名禎
３ 図 （ｊ２−ｔｙ、７６−− −６，３ｆ□第４図
路の回路図、第２図は従来例の映像合成回路の回路図、
第３図、第４図、第６図、第６図はおのおの第１図、第
２図の回路の動作説明のための波形図および回路図であ
る。 １〜５・・・・・・Ａ ／ Ｄ変換器、６・・・・・・
信号復調回路、７・・・・・・倍速変換回路、９〜１１
・・・・・・Ｄ／Ａ変換器、１６・・・・・・ＲＧＢ変
換回路、１８・・・・・・ＣＲＴ表示装置、２０・・・
・・・ＹＵＶマトリクス回路、２１〜２３・・・・・・
引算回路、２４〜２６．３０・・・・・・加算回路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名禎
３ 図 （ｊ２−ｔｙ、７６−− −６，３ｆ□第４図
Claims (2)
- （１）複数個の第１のデジタル信号と、複数個の第２の
デジタル信号と、第３の信号と、第３の信号に第４の信
号を加算する加算回路と、前記第３の信号と第４の信号
を加算した第５の信号をデジタル化するＡ／Ｄ変換器と
、前記第１のデジタル信号から、デジタル化された第５
の信号を引算する減算器と、その引算された信号と前記
第２のデジタル信号を加算する加算回路とを備えたこと
を特徴とするデジタル映像合成回路。 - （２）第３の信号と第４の信号を加算する加算回路が、
第４の信号に直列に接続される抵抗と、その抵抗の一端
がアノードに接続されるダイオードとよりなり、そのダ
イオードのカソード側が、前記第３の信号に接続される
ことを特徴とした特許請求の範囲第１項記載のデジタル
映像合成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61233547A JP2625684B2 (ja) | 1986-10-01 | 1986-10-01 | デジタル映像合成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61233547A JP2625684B2 (ja) | 1986-10-01 | 1986-10-01 | デジタル映像合成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6387877A true JPS6387877A (ja) | 1988-04-19 |
| JP2625684B2 JP2625684B2 (ja) | 1997-07-02 |
Family
ID=16956768
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61233547A Expired - Lifetime JP2625684B2 (ja) | 1986-10-01 | 1986-10-01 | デジタル映像合成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2625684B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58222673A (ja) * | 1982-06-18 | 1983-12-24 | Matsushita Electric Ind Co Ltd | テレビジヨン受像機の信号切換え制御装置 |
-
1986
- 1986-10-01 JP JP61233547A patent/JP2625684B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58222673A (ja) * | 1982-06-18 | 1983-12-24 | Matsushita Electric Ind Co Ltd | テレビジヨン受像機の信号切換え制御装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2625684B2 (ja) | 1997-07-02 |
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