JPS6399654A - ロ−カルエリアネツトワ−クアナライザ - Google Patents

ロ−カルエリアネツトワ−クアナライザ

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JPS6399654A
JPS6399654A JP62035670A JP3567087A JPS6399654A JP S6399654 A JPS6399654 A JP S6399654A JP 62035670 A JP62035670 A JP 62035670A JP 3567087 A JP3567087 A JP 3567087A JP S6399654 A JPS6399654 A JP S6399654A
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  • Small-Scale Networks (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明は、ローカルエリアネットワーク（以下Ｌ　Ａ　
Ｎという）内のパケソＩ・（１単位の信号列、フレーム
ともいう）の流通状態を解析するＬＡＮアナライザに関
するものである。
〔従来技術とその問題点〕
従来、いわゆるプロトコルアナライザは公知であるが、
従来のアナライザはＲ３２３２Ｃ手順を利用したＩＭｂ
ｐｓ以下の比較的低速のものであり、最近のイーサネソ
１−またはＭ　Ａ　Ｒ（ＭａｎｕｆｕｃｔｕｒｉｎｇＡ
ｕｔｏｍａｔｉｏｎ　Ｐｒｏｔｃｏｌ）のような５−１
０５−１Ｏ稈度の高速ＬＡＮには適用できない。
また最近、米国でイーサネット対応のＬＡＮアナライザ
が発表されているが、これは、受信データバッファが１
２８にハイドと小さいこと、バケット間隔（時間）やパ
ケット長（時間）を連続的に記録できないこと、などか
ら種々のデータ解析に不十分であった。またＩ、ΔＮ内
を走行するあらゆる信号例えばプリアンプルを取り込む
機能がないため、限定された用途にしか使えなかった。
さらに最近ではＩ７八Ｎのユーザから、回線の使用効率
ないしは負荷率（どの程度の頻度で回線が使われている
かということ）を把握したいという要望もある。それは
、ユーザが使用しているＬＡＮシステムにまだ余裕があ
るのか（つまりサーバまたは端末をもっとつなげるのか
）、あるいは回線がすでに飽和しているのかを知りたい
ためである。しかしながら従来、このような回線の使用
効率ないしは負荷率を解析できる１、、　Ａ　Ｎアナラ
イザはなかった。
〔問題点の解決手段とその作用〕
本発明は、上記のような従来技術の問題点を解決すべく
なされたもので、本発明に係るＬＡＮアナライザは、 ローカルエリアネットワーク上を走行するパケットを入
力してクロック信号とシリアルデータ信号に分離するデ
コード部と、 上記クロック信号およびシリアルデータ信号を入力して
、シリアルデータからパラレルデータへの変換と、その
パラレルデータを記憶させるためのアドレス制御を行う
と共に、パケット長の計測を行う受信信号処理部と、 上記クロック信号およびシリアルデータ信号を入力して
、パケット数の計測を行うパケット数カウンタと、 上記クロック信号およびシリアルデータ信号を入力して
、パケット間隔の計測を行うバケット間隔計測部と、 上記パラレルデータを記憶する受信データ記憶部と、そ
のパラレルデータのアドレスポインタ、上記パケット長
、パケット数およびバケット間隔などの管理データを記
憶する管理データ記憶部とからなるデータ記憶部と、 上記データ記憶部に各種データを記憶させる処理を行う
受信制御部と、 上記データ記憶部に記憶されている各種データを用いて
、ローカルエリアネットワークの負荷率、パケット間隔
とパケット数の関係、パケット長とパケット数との関係
などを解析する主制御部と、その解析結果を表示するデ
ィスプレイ、とを具備することを特徴とするものである
。
上記デコード部には、イーサネット方式の場合はマンチ
ェスタコードデコーダが、１・−クンリンク方式の場合
はデファレンシャルマンチェスタコードデコーダが、Ｍ
ＡＰ方式の場合はブ「１−ドバンドモデムおよびり１１
ツクコードデコーダが使用される。このアナライザでは
、デコード部と受信信号処理部が別個に設けられている
ため、Ｌ　Ａ　Ｎの方式に応じてデコード部を交換する
（具体的にはデコーダを組み込んだボードを交換可能に
する）と共に、主制御部のＲＡＭに記憶させである制御
プログラムを書き換えることにより、各種方式のＬＡＮ
に対応できるようになっている。
またデータ記憶部では、受信データと各種の管理データ
とを分けて記憶することにより、受信後における各種の
データ解析を容易にしている。
また受信制御部はマイクロコンピュータより構成される
が、これを設けるのは、受信データおよび各種管理デー
タを高速でデータ記憶部に記憶させるためである。
また受信制御部は受信専用とし、データの解析は別に設
けた主制御部で行うことにより、多様なデータ解析を可
能にしている。
〔実施例〕
以下、本発明の実施例を図面を参照して詳細に説明する
。
第１図は本発明の一実施例に係るＴ−Ａ　Ｎアナライザ
の全体構成を示す。この例ではＬ　Ａ　Ｎがイーサネッ
ト方式の場合について説明する。
図において、１１はＬ　Ａ　Ｎを構成する同軸ケーブル
、１２は同軸ケーブル１１に取り付けた１−ランシーバ
である。トランシーバ１２は同軸ケーブル１１内を走行
する信号を取り込み、マンチェスタコードデコーダ１３
へ送る。
イーサネットの場合、同軸ケーブル内を走行するパケッ
トはマンチェスダニ１−ドがエンコードされている。マ
ンチェスタコードでは第２図に示すように、信号の電圧
レベルがロウ（低）からハイ（高）へ変化したときが「
１」、ハイからロウへ変化したときが「０」という決ま
りで符号化されている。
マンチェスタコードデコーダ１３では、このように符号
化された信号を第３図に示すようにシリアルデータ信号
とクロック信号に分離する。分離された信号は、ＣＲＣ
チェック部１４で誤り検出が行われ、さらにフィルタ１
５を通して受信信号処理部１６に送られる。なおＣＲＣ
チェックの結果はバスＢ、バスコントローラ２２を通し
て後述する管理データ記憶部１９に記憶される。またフ
ィルタ１５は後述する主制御部２４の指示により解析に
必要なパケットだけを選択的に通過させるものである。
受信信号処理部１６では、上記シリアルデータ信号およ
びクロック信号を入力して、シリアルデータからパラレ
ルデータへ変換し、さらにそのパラレルデータを記憶さ
せるためのアドレス制御を行うと共に、上記クロック信
号から各パケットの長さく時間）の計測を行う。この受
信信号処理部１６はＬＳＩで構成することができる。
受信信号処理部１６から出力されたパラレルデータはデ
ータ記憶部１７の受信データ記憶部１８に記憶され、ま
たパラレルデータのアドレスポインタとパケット長は管
理データ記憶部１９に記憶される。
データ記憶部１７は例えば容量１２ＭＢのメモリからな
り、そのうちＩＯＭＢが受信データメモリに、２ＭＢが
管理データメモリに当てられる。
一方、マンチェスタコードデコーダ１３からの信号はパ
ケット間隔計測部２０にも入力され、そこでパケットと
パケットの間の時間間隔の測定が行われる。この測定は
第４図に示すように、先行パケットｌの後端り、から１
＆続パケノ１−２の先端ｔ２までの時間ｔをカラン１−
することにより行う。測定されたパケット間隔は受信制
御部２１の制御のもとにバスＡ、バスコントローラ２２
を通して管理データ記憶部１９に記憶される。管理デー
タ記憶部１９への記憶は前述のアドレスポインタおよび
パケット長の記憶も含め、すべて受信制御部２１の制御
のもとに行われる。受信制御部２１はＣＰ　Ｕ６８００
０　、ＲＯＭ、ＲＡＭからなるマイクロコンピュータで
構成することができる。
また、マンチェスタコードデコーダ１３からの信号はパ
ケット数カウンタ２３にも入力され、そこで受信したパ
ケットの数がカウントされる。この計数結果はバスＢ、
バスコントローラ２２を通して管理データ記憶部１９に
送られ、そこに時間のファクタ　（いわゆるタイムスタ
ンプ）と共に記憶される。
以上は信号受信から記憶までの処理であるが、記憶した
データの解析は主制御部２４により行われる。
主制御部２４は例えばＣＰ　Ｕ３０２８６　、ＲＯＭ、
　ＲＡＭからなるマイクロコンピュータで構成され、そ
れが接続されたバスＢには次のような各種装置が接続さ
れている。すなわち、ハードディスク２５を制御するハ
ードディスクコントローラ２６、フロンビイディスク２
７を制御するフロンビイディスクコントローラ２８、キ
ーボード２９用のキーボードコントローラ３０、プラズ
マディスプレイ３１を制御するプラズマディスプレイコ
ントローラ３２、プリンタ３３を制御するセントロニク
ス準拠のパラレルインターフェース３４、外部コンピュ
ータ３５または他のシリアルボートを接続するＲ３２３
２Ｃ準拠のシリアルインターフェース３６などである。
主制御部２４はキーボード２９からの指示により受信デ
ータ記憶部１８および管理データ記憶部１９に記憶され
ている各種データを参照して所要の解析を行う。例えば
管理データ記憶部１９からパケット間隔とパケット数を
読み出して、第５図に示すようなパケット間隔とパケッ
ト数のグラフを作成し、プラズマディスプレイ３１に表
示する（またはプリンタ３３に打ち出す）。このグラフ
からは１．　Ａ　Ｎのトラヒック特性（伝送１０度）を
読み取ることができる。
以下にイーサネットの場合のトラヒック特性について説
明する。いま、ある時間Ｔ秒間にｍメガバイトのデータ
を伝送したとする。チャネル容量は１０Ｍｂｐｓである
から入力トラヒックをチャネル容量で正規化すると、ｍ
／（ＩＯＴ）が負荷率となる。
ｍ／Ｔ　＝　ｎ　　Ｍｂｐｓとすると、負荷率−ｎ／１
０となる。
第６図は最高負荷を記録したときの６分間の１秒間サン
プリング結果をグラフ化したものである。
この場合は、１秒間サンプリングの最高でも高々Ｉ　Ｍ
ｂｐｓ程度であり、これは１０Ｍｂｐｓの伝送能力を持
つイー号ネノＩ□の高々１０％以下の負荷でしかなく、
十分余裕のあるシステＪ、状態であることが分かる。
このように本発明に係るアナライザは、バケット間隔が
すべて記憶されているため、受信したデ冊 −タを時間のファクタを考慮して解析することができ、
ＬＡＮの回線使用効率、負荷状態などを知ることができ
る。
また本発明では、各バケツ１−が受信データ記憶部１８
のどこに記ｔ９されているのかを示すアドレスポインタ
が、」二記パケット間隔と共に管理データ記憶部１９に
記憶されているため、データ解析にあたっては、まず管
理データ記憶部のアドレスポインタを読み出し、それに
基づいて受信データ記憶部１８のデータ内容を順次読み
出すことができるので、データ解析処理速度の向上を図
ることができる。
さらに前述のように管理データ記憶部にＣＲＣチェック
の結果が記憶されているから、バケットのエラー発生状
況を知ることができる。つまりエラーバケットを特定で
き、回線の自己診断機能を有することになる。
なおＣＲＣチェックは上記とは別な方法で行うことも可
能である。すなわち、一般にバケットは第７図のように
バケット終端の数ビットがエラーチェックコードとなっ
ており、これの照合を行うには、どこからバケットが始
まり、その長さＮがどれほどかが分かっていればよい。
いまエラーチェックの一例をあげると、第７図に示すよ
うにイーサネットのフレーム（イーサネット仕様書では
データリンク層でのバケットをフレームという）フォー
マットは、五つのフィールドに分かれているが、伝送誤
りを検出するためのＣＲＣ（巡回冗長検査）値を入れた
フレーム検査シーゲンスは４オクテツト（１オクテツト
−８ビツト）すなわち３２ビット分である。フレーム検
査シーケンスフィールドのＣＲＣ値は、宛先アドレス、
発信元アドレス、タイプ、データの各フィールド（つま
りフレーム検査シーケンスフィールドを除くすべてのフ
ィールド）の内容の関数として次の生成多項式で定義さ
れる。
Ｇ（Ｘ）＝Ｘ”＋Ｘ２６＋Ｘ”＋Ｘ２２＋Ｘ”＋Ｘ１２
＋ＸＩｌ＋Ｘ嘗０→−Ｘ”＋Ｘマ→−Ｘ’　＋Ｘ’　＋
Ｘ”　＋Ｘ＋１ この式を用いてフレー１、の伝送誤りをチェックするこ
とができる。
つまり管理データ記憶部１９には上述のようにフレーム
長に相当するアドレスポインタが個々のフレーム毎に記
憶されているから、それと共に受信データ記憶部１８に
記憶したデータを順次読み出していけば、ＣＲＣチェッ
クを行うことができるわけである。
ところで本実施例のＬＡＮアナライザは、同軸ケーブル
１１上にデータを送信する機能も備えている。送信すべ
きデータは主制御部２４で作成、編集され、データ送信
部３７を通してマンチェスタコードエンコーダ３８に送
られ、そこでマンチェスタコードがエンコードされる。
エンコードされた送信データは二つのトランシーバ１２
と３９を通して同軸ケーブル１１に送り出せるようにな
っている。これはコリジヨン（衝突）テストを行えるよ
うにするためである。
以上の実施例では、イーサネット用のＬ　Ａ　Ｎアナラ
イザについて説明したが、このＬＡＮアナライザは他の
方式つまりＭ　Ａ　Ｐ　（ＴＥＥＨ８０２，３の規格）
や１・−クンリング（ＩｎＩＥＦ８０２．５の規格）に
も対応することができる。ぞれにはデ：１−ド部と、主
制御部のＲＡＭに記憶さ・［！である制御プロゲラ１、
を他の方式のものに交換すればよい。
ＭＡＰ方式の場合は、データ伝送をブロードバンド（広
帯域）で行っている。ブロードバンドはデータをアナロ
グ信号に変換して伝送するもので、同時に複数のチャネ
ル（伝送路）を設定できる特徴をもつ。なおイーザネソ
１一方式はヘースバンド伝送でありデータをデジタル信
号のまま伝送するものである。ＭＡＰで使用するブロー
ドハンドは、データ転送速度が５〜ｌＯＭｂｐｓで、信
号を伝送するための線路はイーサネットと同様、同軸ケ
ーブルが用いられる。ＭＡＰの場合は、第１図のマンチ
ェスタコードデコーダ１３の代わりに第８図に示すよう
にブロードバンドモデム４０とデコーダ４１を設け、受
信信号をブロードバンドモデム４０でアナログからデジ
タルに変換してから、デコーダ４１でクロック信号とデ
ータ信号に分離する。以後の処理はイーサネットの場合
と同しである。なお主制御５ 篩部のＲＡＭに記憶させである制御プログラムをＭＡＰ
用のものに書き換えるには、第１図のフロッピィディス
ク２７からＭＡＰ用の制御プログラムを読み込めばよい
。
またトークンリング方式の場合は、第９図に示すように
対撚りケーブル４２を用いてデータ伝送が行われ、使用
コードはいわゆるディファレンシャルマンチェスタコー
ドである。したがってこの場合ハ、デコード部にディフ
ァレンシャルマンチェスタコードデコーダ４３を使用す
れば、以後の処理はイーサネットの場合と同じでよい。
もちろん制御プログラムの書き換えが必要である。
以上は受信側についてであるが、送信側についてはエン
コード部を同様に交換すればよい。
なお上記実施例においてプラズマディスプレイを使用し
ているのは、小型軽量化を図るためであり、その必要性
が低い場合は通常のＣＲＴを使用すればよい。
〔発明の効果〕
以上説明したように本発明によれば、次のような効果が
ある。すなわち、Ｌ　Ａ　Ｎ内を走行するバケットを連
続的に受信し、それを受信データ記憶部に記憶させると
共に、各バケットのアドレスポインタ、パケット長、バ
ケット間隔、パケット数などを管理データ記憶部に記憶
させるようにしているので、受信後における各種のデー
タ解析が容易になると共に、時間のファクタを考慮した
データ解析を行うことができ、システムの使用効率、負
荷率を把握できる。また受信制御部と、主にデータ解析
を行う主制御部とを別に設けているので、受信データお
よび各種管理データを高速でデータ記４を部に記憶さ−
Ｕることができると共に、多様なデータ解析を行うこと
ができる。さらにデコード部と受信信号処理部を分離す
ることにより、デコード部を交換可能にしであるので、
異なる方式のＬＡＮにも対応することができる。
【図面の簡単な説明】
第１図は本発明の一実施例に係るＬ　Ａ　Ｎアナライザ
のブし１ツク図、第２図はマン千ニスタコ−Ｉ′と一般
のコードの関係を示す説明図、第３図はマンチェスタコ
ードデコーダで分離されたデータ信号とクロック信号を
示す波形図、第４図はバケット間隔の説明図、第５図は
本発明のアナライザで得られるバケット間隔とパケット
数の関係を示すグラフ、第６図は同じ＜　ＬＡＮシステ
ムの負荷率を示すグラフ、第７図はイーサネノｔ・のフ
レームフォーマットを示す説明図、第８図はＭＡＰ方式
の場合のデコード部のブロック図、第９図はトークンリ
ング方式の場合のデコード部のブロック図である。

Claims (1)

  1. 【特許請求の範囲】 ローカルエリアネットワーク上を走行するパケットを入
    力してクロック信号とシリアルデータ信号に分離するデ
    コード部と、 上記クロック信号およびシリアルデータ信号を入力して
    、シリアルデータからパラレルデータへの変換と、その
    パラレルデータを記憶させるためのアドレス制御を行う
    と共に、パケット長の計測を行う受信信号処理部と、 上記クロック信号およびシリアルデータ信号を入力して
    、パケット数の計測を行うパケット数カウンタと、 上記クロック信号およびシリアルデータ信号を入力して
    、パケット間隔の計測を行うパケット間隔計測部と、 上記パラレルデータを記憶する受信データ記憶部と、そ
    のパラレルデータのアドレスポインタ、上記パケット長
    、パケット数およびパケット間隔などの管理データを記
    憶する管理データ記憶部とからなるデータ記憶部と、 上記データ記憶部に各種データを記憶させる処理を行う
    受信制御部と、 上記データ記憶部に記憶されている各種データを用いて
    、ローカルエリアネットワークの負荷率、パケット間隔
    とパケット数の関係、パケット長とパケット数との関係
    などを解析する主制御部と、その解析結果を表示するデ
    ィスプレイ、 とを具備することを特徴とするローカルエリアネットワ
    ークアナライザ。
JP62035670A 1986-02-21 1987-02-20 ロ−カルエリアネツトワ−クアナライザ Granted JPS6399654A (ja)

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JP61-36797 1986-02-21
JP3679786 1986-02-21

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JPS6399654A true JPS6399654A (ja) 1988-04-30
JPH059980B2 JPH059980B2 (ja) 1993-02-08

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