JPS643330U - - Google Patents

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JPS643330U
JPS643330U JP9632687U JP9632687U JPS643330U JP S643330 U JPS643330 U JP S643330U JP 9632687 U JP9632687 U JP 9632687U JP 9632687 U JP9632687 U JP 9632687U JP S643330 U JPS643330 U JP S643330U
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binarization circuit
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Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す回路図。第２
図および第３図ａ，ｂ，ｃは本考案の一実施例に
おける動作を示す波形図。第４図は従来の２値化
回路を示す回路図。第５図ａ，ｂは従来の２値化
回路における波形図。 符号の説明、１……演算増幅器、２……アナロ
グ信号入力端子、３……ダイオード、４，５……
コンパレータ、５，７……出力端子、６……ＯＲ
回路、１０……原稿読取信号発生回路、１１……
原稿、１２……発光ダイオード、１３……ホトト
ランジスタ、１４，１５，１７……演算増幅器、
１６……ダイオード、１８……読取信号出力端子
、２０……２値化回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) アナログ信号を基準値と比較して２値化す
    る２値化回路において、 前記アナログ信号の微細な変化を無視してその
    レベルに追従して変化する浮動スレツシユホール
    ド信号を前記基準値とする第１の比較手段と、 予め定めた固定基準値を前記基準値とする第２
    の比較手段を備えたことを特徴とするアナログ信
    号の２値化回路。 (2) 前記第２の比較手段が、前記浮動スレツシ
    ユホールド信号が前記微細な変化を無視して追従
    するアナログ信号のレベルと、レベル低下によつ
    て信号変化に忠実に追従するアナログ信号のレベ
    ルとの間に前記固定基準値のレベルを設定する構
    成の実用新案登録請求の範囲第１項記載のアナロ
    グ信号の２値化回路。
JP1987096326U 1987-06-23 1987-06-23 原稿読取信号の２値化回路 Expired - Lifetime JPH0731623Y2 (ja)

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JPS643330U true JPS643330U (ja) 1989-01-10
JPH0731623Y2 JPH0731623Y2 (ja) 1995-07-19

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5582535A (en) * 1978-12-19 1980-06-21 Toshiba Corp Automatic threshold value control circuit
JPS5689125A (en) * 1979-12-21 1981-07-20 Fuji Electric Co Ltd Binary circuit

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5582535A (en) * 1978-12-19 1980-06-21 Toshiba Corp Automatic threshold value control circuit
JPS5689125A (en) * 1979-12-21 1981-07-20 Fuji Electric Co Ltd Binary circuit

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JPH0731623Y2 (ja) 1995-07-19

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