JPS647372U - - Google Patents

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JPS647372U
JPS647372U JP9984887U JP9984887U JPS647372U JP S647372 U JPS647372 U JP S647372U JP 9984887 U JP9984887 U JP 9984887U JP 9984887 U JP9984887 U JP 9984887U JP S647372 U JPS647372 U JP S647372U
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【図面の簡単な説明】
第１図は本考案回路の一実施例のブロツク図、
第２図は本考案回路で伝送に用いる情報信号を説
明するための図、第３図は本考案回路を適用した
メモリカードの一実施例のブロツク図、第４図は
従来のメモリカードの一例のブロツク図、第５図
は従来のシリアル通信の情報信号を説明するため
の図である。 ２２……イニシヤルフレーム検出器、２３……
タイミング発生器、２４……リフオーマツタ、２
８……シリアル／パラレル変換器、２９……アド
レスカウンタ、３０，３３……データレジスタ、
３４……パラレル／シリアル変換器、３５……フ
オーマツタ、３６……スタートビツト発生器、４
１……インターフエース回路、４２……メモリ。

Claims (1)

  1. 【実用新案登録請求の範囲】 ブロツク毎に同期用のイニシヤルフレームがＮ
    ＲＺ変調された信号の後に、所定バイト数のアド
    レス又はアドレス及びデータのデータフレームが
    ビツト中央で反転するようＮＲＺ変調とは異なる
    第２の変調された信号が連続するシリアルの情報
    信号を供給されて、該データフレームの第２の変
    調信号をＮＲＺ変調信号に変換する第１の変換回
    路と、 該第１の変換回路の出力するＮＲＺ変調信号を
    パラレルのアドレス又はアドレス及び所定ビツト
    単位のデータに変換して出力する第２の変換回路
    と、 該所定ビツト単位のデータを供給されて、該デ
    ータを所定バイト数のデータフレームのＮＲＺ変
    調された信号に変換する第３の変換回路と、 該第３の変換回路の出力するＮＲＺ変調信号を
    該第２の変調信号に変換し、その前に該イニシヤ
    ルフレームのＮＲＺ変調信号を付加してシリアル
    に出力する第４の変換回路とよりなるインターフ
    エース回路。
JP1987099848U 1987-06-29 1987-06-29 インタ−フェ−ス回路 Expired - Lifetime JPH067385Y2 (ja)

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JPS647372U true JPS647372U (ja) 1989-01-17
JPH067385Y2 JPH067385Y2 (ja) 1994-02-23

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5263655A (en) * 1975-11-20 1977-05-26 Canon Inc Data converting device

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5263655A (en) * 1975-11-20 1977-05-26 Canon Inc Data converting device

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JPH067385Y2 (ja) 1994-02-23

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