KR20200057076A - 반도체 상에 배치된 구조에 의해 흡수될 미리 결정된 파장을 갖는 방사의 양을 제어하기 위한 방법 - Google Patents
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Abstract
Description
도 2는 종래 기술에 따른 반도체 구조를 위해 사용되는 구성(arrangement)의 도식적인 스케치이다.
도 3은 본 개시에 따른 반도체 구조의 단면도의 도식적인 스케치이다.
도 4는 도 3의 반도체 구조를 형성하는데 사용되는 공정의 흐름도이다.
도 4A 내지 도 4F는 본 개시에 따른 도 3의 반도체 구조를 형성하기 위한 공정에서 사용되는 다양한 단계들에서의 반도체 구조의 단면도의 도식적인 스케치이다.
도 5는 도 5에 도시된 본 개시에 따른 최대 방사를 갖는 특정 파장에서 피크 방사 레벨(peak radiation level)로 정규화된(normalized) 도 3의 반도체 구조를 형성하는 공정에 사용되는 급속 열 어닐링 장비(Rapid Thermal Anneal equipment)의 방사 방출(emitting) 스펙트럼이다.
도 6은 도 3의 반도체 구조에 사용되는 티타늄을 포함하는 다양한 금속에 대한 반사율 및 파장 사이의 관계를 나타내는 그래프이다.
Claims (12)
- 오믹 컨택에 있어서,
오믹 컨택에 반도체를 제공하는 금속층들의 스택(stack)
을 포함하고,
상기 스택은,
상기 반도체와 직접 접촉하도록 배치된 하부층(lower layer); 및
상기 오믹 컨택을 형성하기 위한 상기 반도체를 가지는 상기 스택을 어닐링(anneal)하기 위해 사용되는 공정 중 방사(radiation)에 대한 상기 스택의 노출 도중에 방사 흡수 제어층(radiation absorption control layer)에 흡수되는 방사(radiant) 에너지의 양을 제어하기 위해 상기 하부층 위에 배치된 상기 방사 흡수 제어층
을 포함하는,
오믹 컨택.
- 반도체를 위한 오믹 컨택(ohmic contact)에 있어서,
오믹 컨택에 상기 반도체를 제공하는 층들(layers)의 스택(stack)
을 포함하고,
상기 스택은,
상기 반도체와 직접 접촉하도록 배치된 하부 금속층(lower metal layer);
상기 하부 층 위에 배치된 중간층(intermediate layer) - 상기 중간층은 미리 결정된 파장을 갖는 방사 에너지에 대해 미리 결정된 에너지 흡수 계수(coefficient)를 가짐 - ; 및
상기 중간층 위에 배치된 방사 흡수층(radiation absorbing layer) - 상기 방사 흡수층은 상기 방사 에너지에 대해 상기 중간층의 상기 미리 결정된 에너지 흡수 계수보다 적어도 자릿수(order of magnitude)가 더 큰, 상기 방사 에너지에 대해 미리 결정된 에너지 흡수 계수를 가짐 -
을 포함하는,
오믹 컨택.
- 제2항에 있어서,
상기 방사 에너지는 적외선 방사 에너지인,
오믹 컨택.
- 제2항에 있어서,
상기 방사 에너지는 미리 결정된 대역의 파장을 포함하는,
오믹 컨택.
- 제2항에 있어서,
상기 중간층은 미리 결정된 전기 저항률(electrical resistivity)을 가지고,
상기 상부층은 상기 중간층의 상기 미리 결정된 전기 저항률보다 적어도 자릿수가 더 작은 미리 결정된 전기 저항률을 가지는,
오믹 컨택.
- 미리 결정된 파장을 갖는 방사(radiation)를 이용하는 반도체층을 가지는 오믹 컨택을 형성하기 위한 방법에 있어서,
(A) 오믹 컨택 스택(ohmic contact stack)을 제공하는 단계 - 상기 오믹 컨택 스택은, 상기 미리 결정된 파장을 갖는 방사 에너지에 대해 미리 결정된 에너지 흡수 계수를 갖는 층을 포함하는 상부층(top layer); 및 상기 상부층 아래에 있고 상기 반도체층과 접촉하는 전기 전도층(electrically conductive layer)을 포함하고, 상기 상부층의 상기 미리 결정된 에너지 흡수 계수는, 상기 오믹 컨택을 형성하기 위해 상기 오믹 컨택 스택에 의해 흡수될 상기 방사 에너지의 양에 따라 선택됨 - ; 및
(B) 상기 오믹 컨택을 형성하기 위해 상기 반도체층을 가지는 상기 오믹 컨택 스택을 어닐링하는(annealing) 단계 - 상기 미리 결정된 파장을 갖는 상기 방사 에너지에 상기 스택의 상기 상부층을 노출시키는 것을 포함함 -
를 포함하는 방법.
- 제6항에 있어서,
상기 방사 에너지는 미리 결정된 대역의 파장을 포함하는,
방법.
- 반도체층에 대한 오믹 컨택을 형성하기 위한 방법에 있어서,
(A) 오믹 컨택 스택(ohmic contact stack)을 제공하는 단계 - 상기 오믹 컨택 스택은, 미리 결정된 파장을 가지는 방사 에너지에 대한 미리 결정된 에너지 흡수 계수를 가지고, 미리 결정된 전기 저항률(electrical resistivity)을 가지는 금속층을 포함하는 상부층(top layer); 및 상기 상부층 아래의 전기 전도층(electrically conductive layer)을 포함하고, 상기 전기 전도층은, 상기 상부층의 상기 미리 결정된 에너지 흡수 계수보다 적어도 자릿수(order of magnitude)가 더 작은 상기 방사 에너지에 대해 미리 결정된 에너지 흡수 계수를 가지고, 상기 상부층의 상기 미리 결정된 전기 저항률보다 적어도 자릿수가 더 큰 미리 결정된 전기 저항률을 가짐 - ; 및
(B) 상기 오믹 컨택을 형성하기 위해 상기 반도체층을 갖는 상기 오믹 컨택 스택을 합금하는(alloying) 단계 - 상기 상부층에 의해 흡수되는 상기 방사 에너지의 일부를 가지는 상기 미리 결정된 파장을 가지는 상기 방사 에너지에 상기 스택의 상기 상부층을 노출시키는 것을 포함함 -
를 포함하는,
방법.
- 제8항에 있어서,
상기 방사 에너지는 미리 결정된 대역의 파장을 포함하는,
방법.
- 반도체층에 오믹 컨택(ohmic contact)을 형성하기 위한 방법에 있어서,
상기 오믹 컨택을 위한 상기 반도체층의 표면의 일부를 노출시키기 위한 윈도우(window)를 구비하는 반도체층 위에 포토레지스트 마스크(photoresist mask)를 리소그래피적으로(lithographically) 형성하는 단계;
100 옹스트롬(angstroms) 내지 400 옹스트롬 범위의 두께를 갖는 티타늄층으로 상기 반도체의 노출된 부분 위와 마스크 위에 금속을 증착하도록(deposit) 상기 마스크를 노출시키는 단계;
800 옹스트롬 내지 2000 옹스트롬 범위의 두께를 갖는 알루미늄층으로 마스크 위에 금속을 증착하도록 상기 마스크를 노출시키는 단계;
50 옹스트롬 내지 150 옹스트롬 범위의 두께를 갖는 백금층으로 알루미늄층 위와 마스크 위에 금속을 증착하도록 상기 마스크를 노출시키는 단계;
200 옹스트롬 내지 100000 옹스트롬 범위의 두께를 갖는 금(gold)층으로 백금층 위와 마스크 위에 금속을 증착하도록 증발 플럭스(evaporant flux)에 상기 마스크를 노출시키는 단계;
50 옹스트롬 내지 150 옹스트롬 범위의 두께를 갖는 티타늄과 같은 방사 흡수 물질의 층으로 금층 위와 마스크 위에 금속을 증착하도록 상기 마스크를 노출시키는 단계;
프리-합금(pre-alloy) 오믹 컨택 스택(ohmic contact stack)을 남기도록 포토레지스트 마스크와, 티타늄층, 알루미늄층, 백금층, 금층 및 티타늄층을 리프트 오프(lifting off)하는 단계; 및
상기 오믹 컨택 스택을 합금하는(alloying) 단계 - 상기 방사 흡수층에 의해 흡수되는 상기 방사의 일부를 갖는 방사에 대해 상기 스택의 상기 방사 흡수 물질을 노출시키는 것을 포함함 -
를 포함하는,
방법.
- 반도체 상에 배치된 구조에 의해 흡수될 미리 결정된 파장을 갖는 방사의 양을 제어하기 위한 방법에 있어서,
(A) 상기 구조에 의해 흡수될 상기 방사의 양에 따라 선택된 반사율(reflectance)을 갖는 물질과 같은 상기 구조 위의 물질의 층을 제공하는 단계; 및
(B) 표면에(thereon) 상기 금속층을 갖는 상기 구조를 상기 미리 결정된 파장을 갖는 방사에 대해 서브젝팅(subjecting) 하는 단계
를 포함하는,
방법.
- 반도체 상에 배치된 구조에 의해 흡수될 미리 결정된 대역의 파장을 갖는 방사의 양을 제어하기 위한 방법에 있어서,
(A) 상기 구조에 의해 흡수될 상기 방사의 양에 따라 선택된 반사율(reflectance)을 갖는 물질과 같은 상기 구조 위의 물질의 층을 제공하는 단계; 및
(B) 표면에(thereon) 상기 금속층을 갖는 상기 구조를 상기 미리 결정된 파장을 갖는 방사에 대해 서브젝팅(subjecting) 하는 단계
를 포함하는,
방법.
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