WO2006123769A1 - 異常検出装置 - Google Patents
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Definitions
- the present invention relates to an abnormality detection device for detecting an abnormality in an input path of a video signal.
- an abnormality detection device for detecting an abnormality in an input path of a video signal
- a determination value in which a logical value represented by a parallel signal having a predetermined number of bits representing a video signal is set to be equal to or less than a dark output value
- a dark output value There is one that can be diagnosed as a failure even if at least one of the parallel signal input paths is disconnected or shorted without increasing the circuit configuration by determining a failure when the time is below a certain time.
- the conventional abnormality detection device can diagnose the disconnection or short of the input path of the video signal as a failure, there is a problem that the cause of the abnormality of the input path of the video signal cannot be grasped. .
- the present invention has been made to solve the conventional problems, and an object of the present invention is to provide an abnormality detection device capable of grasping the cause of an abnormality in an input path of a video signal. Means for solving the problem
- the abnormality detection device of the present invention includes a synchronization detection circuit that detects a synchronization signal from a video signal output by a video output device, and a first DC signal level obtained from an input path of the video signal. Whether the second DC signal level obtained is lower than a predetermined second threshold and the synchronization detection circuit Route state determination means for determining whether the input path of the video signal is in a normal state, an open state, a power fault state, or a ground fault state based on whether or not a synchronization signal is detected. It has a configuration.
- the abnormality detection device of the present invention determines whether the first DC signal level is higher than the first threshold, whether the second DC signal level is lower than the second threshold, And the video signal input path is in a normal state, an open state, a power fault state, or a ground fault state based on whether or not the synchronization signal is detected by the synchronization detection circuit. It is possible to grasp the cause of the abnormality in the input path.
- the path state determination means may determine that the input path is in a normal state when the synchronization signal is detected by the synchronization detection circuit.
- the path state determination means may determine that the input path is in a power fault state when the first DC signal level is higher than the first threshold.
- the route state determination means may determine that the input route is in a ground fault state when the second DC signal level is lower than the second threshold.
- the path state determination unit may be configured such that the first DC signal level is lower than the first threshold and the second DC signal level is higher than the second threshold, and the synchronization If the synchronization signal is not detected by the detection circuit, it may be determined that the input path is open.
- the path state determination means may divide the voltage of the input path of the video signal to obtain the first DC signal level and the second DC signal level, respectively.
- the path state determination means whether or not the first DC signal level is higher than the first threshold, whether the second DC signal level is lower than the second threshold, And each signal of the video signal by two signals composed of the logical sum of any one signal and the other two signals among the signals respectively representing the force and the force detected by the synchronization detection circuit. Even if it shows the state ⁇ .
- the present invention can provide an abnormality detection device having the effect of being able to grasp the cause of an abnormality in a video signal input path.
- FIG. 1 is a block diagram of a video signal processing device according to an embodiment of the present invention.
- FIG. 2 is a block diagram showing an example of an abnormality detection circuit constituting the video signal processing device according to one embodiment of the present invention.
- a video output device such as a camera or a video receiver is provided in the vehicle.
- An example in which the abnormality detection device of the present invention is applied to a video signal processing device that displays an output video signal on a display will be described.
- FIG. 1 shows a video signal processing apparatus to which an abnormality detection apparatus according to an embodiment of the present invention is applied.
- the video signal processing device 1 includes a camera 2 that captures the rear of the vehicle, an external video output device 3 such as a navigation device, a television broadcast receiver, and a DVD (Digital Versatile Disc) player, and video signal processing.
- a display device 4 that outputs a video signal processed by the device 1 is connected.
- the camera 2 has a lens for capturing an image and a CCD (Charged Coupled Device) sensor, and generates an image signal from a detection signal of the CCD sensor.
- the video signal is a composite signal, RGB signal, YUV signal, or any other format.
- the display device 4 includes a display unit such as a cathode ray tube or a liquid crystal display, and outputs a video signal to the display unit.
- a display unit such as a cathode ray tube or a liquid crystal display
- the video signal processing device 1 includes a CPU (Central Processing Unit) 10, an abnormality detection circuit 11 that detects an abnormality in the input path of the video signal input from the camera 2, and a video input from the camera 2.
- a first video signal buffer 12 for buffering a signal for buffering a signal
- an image processing device 14 for performing image processing and an external video output device
- One video signal is obtained from the second video signal buffer 15 for buffering the video signal input from 3, the video signal processed by the image processing device 14, and the video signal input from the external video output device 3.
- Video selection switch 16 to be selected video amplifier 17 that amplifies the video signal selected by the video selection switch 16, DRAM (Dynamic Random Access Memory) 18, flash memory 19, and fault diagnosis connection
- a diagnostic memory 20 for storing results and a power supply unit (not shown) for supplying power to each unit of the video signal processing device 1 and the camera 2 are provided.
- the state in which the video signal input path is normally connected to the camera 2 is "normal state”, and the video signal input path is connected anywhere, and the situation is The state is called “open state”, and the state where the power supply voltage is applied to the video signal input path is This is referred to as a “ground fault state”, and the state in which the video signal input path is short-circuited to the ground is called a “ground fault state”.
- the CPU 10 reads the program stored in a storage medium such as a ROM (Read Only Memory) into the DRAM 18 and executes the program loaded into the DRAM 18 to execute the program read into the DRAM 18, The operation of each part such as the video selection switch 16 and the power supply part is controlled! /.
- a storage medium such as a ROM (Read Only Memory)
- ROM Read Only Memory
- the abnormality detection circuit 11 constitutes path state determination means in the present invention.
- resistors R1 to R5 a capacitor C1, a comparator 30, a synchronization detection circuit 31, It has a Zener diode ZD and diodes D1 to D4.
- resistor Rl The resistor Rl, Zener diode ZD, resistor R2, and resistor R3 are connected in series, and a DC voltage VCC is applied to one end of the resistor R1, and one end of the resistor R3 is connected to the ground.
- Capacitor C1 has one end connected to the force sword of Zener diode ZD connected to resistor R2, and the other end connected to ground. As a result, since the AC component is grounded, the input impedance of the video signal processing device 1 becomes equal to the resistance value when the resistors R2 and R3 are connected in parallel. In this embodiment, the resistance values of the resistors R2 and R3 are set so that the input impedance of the video signal processing device 1 is 75 ⁇ so that the impedance of the camera 2 can be matched. .
- the comparator 30 is connected to the anode of the Zener diode ZD, and compares the voltage value at the anode of the Zener diode ZD with the reference voltage value.
- the output voltage value of the comparator 30 is, for example, a high level of 2. IV or higher (hereinafter simply referred to as “H”).
- H a high level of 2. IV or higher
- L a low level of 0.7 V or less
- the reference voltage value of the comparator 30 is the output voltage value of the comparator 30 when the input path of the video signal is in the ground fault state and the output voltage value of the comparator 30 is in the other state.
- the voltage value is set to L. Note that the input voltage value of the comparator 30 corresponds to the second DC signal level in the present invention, and the reference voltage value of the comparator 30 corresponds to the second threshold value in the present invention.
- the Zener diode ZD is configured so that the voltage value on the input side of the comparator 30 does not exceed a predetermined value so that the comparator 30 does not cause latch-up when the input path of the video signal has a power fault. Come to protect.
- each resistance value of the resistor R4 and the resistor R5 is in the other state because the voltage value between the resistor R4 and the resistor R5 becomes H when the input path of the video signal is in the power supply state. In this case, the voltage value between the resistor R4 and the resistor R5 is determined to be L.
- the voltage value between the resistor R4 and the resistor R5 corresponds to the first DC signal level in the present invention
- the arbitrary voltage value between H and L corresponds to the first threshold value in the present invention.
- the synchronization detection circuit 31 is connected on the input side between the resistor R2 and the resistor R3, and detects the synchronization signal from the video signal. For example, the synchronization detection circuit 31 extracts the synchronization signal portion of the video signal, and smoothes the extracted synchronization signal portion to detect the synchronization signal from the video signal. As long as the sync signal can be detected from the video signal! /, The output voltage value becomes L while there is no sync signal.
- the anode of the diode D1 is connected to the output side of the comparator 30, the anodes of the diode D2 and the diode D4 are connected between the resistor R4 and the resistor R5, and the anode of the diode D3 is the synchronization detection circuit. Connected to 31 outputs.
- the power sword of the diode D1 and the power sword of the diode D2 are ORed (logical sum), and the first abnormality detection signal (hereinafter referred to as “CAMIND1”) is output to the CPU 10. Yes.
- the force sword of the diode D3 and the force sword of the diode D4 are OR-connected to output a second abnormality detection signal (hereinafter referred to as “CAMIND2”) to the CPU 10.
- the first video signal buffer 12 buffers the video signal input from the camera 2 and fixes the pedestal (luminance reference value).
- the sync separation circuit 13 is a video signal buffered in the first video signal buffer 12.
- the synchronization signal is extracted.
- the CPU 10 monitors the period of the synchronization signal taken out by the synchronization separation circuit 13, and determines that the video signal is abnormal when the period of the synchronization signal is different from the specified period. It has become.
- the image processing device 14 is configured by a digital signal processing device such as an image processing processor, and based on control by the CPU 10, the video signal buffered in the first video signal buffer 12 is subjected to overhead processing and guideline processing. Now comes with a drawing process!
- the overhead view process is a process of creating a pseudo image taken from above the position of the camera 2 by performing a straight line process on an image of a curved portion near the vehicle such as a bumper.
- the guideline drawing process refers to the process of overwriting information indicating the direction of travel of the vehicle and the distance from the vehicle on the video!
- the second video signal buffer 15 buffers the video signal input from the external video output device 3 and fixes the pedestal.
- the video selection switch 16 selects one video signal from the video signal image-processed by the image processing device 14 and the video signal input from the external video output device 3 based on control by the CPU 10. It is supposed to be.
- the video amplifier 17 amplifies the video signal selected by the video selection switch 16, thereby adjusting the signal level of the video signal to a signal level defined on the display device 4 side.
- the DRAM 18 In addition to a program to be executed by the CPU 10, the DRAM 18 temporarily stores data used during arithmetic processing by the CPU 10 and the image processing device 14 that execute this program.
- the flash memory 19 stores parameters and the like used by the image processing device 14.
- the diagnostic memory 20 is configured by a non-volatile storage medium such as EEPROM (Electrically Erasable Programmable Read-only Memory), and the diagnostic memory 20 includes an abnormal state detected by the abnormal detection circuit 11 and the detection time. History depends on CPU10
- the CPU 10 is configured to transmit information stored in the diagnostic memory 20 to an interface circuit (not shown) that communicates with an external device or a removable storage medium.
- the power supply unit adjusts the voltage of the power supplied from the power source of the vehicle by, for example, stepping down the voltage based on the control by the CPU 10, and adjusts the adjusted voltage to each part of the video signal processing device 1 and the camera. To supply to 2. Also, the power supply unit prevents the CPU10 and camera 2 from latching up, so that the power supplied to the CPU10 and camera 2 is cut off when the CPU10 is not operating! / Speak.
- the video signal input from the external video output device 3 is input to the video selection switch 16. Therefore, it is selected.
- the video signal input from the external video output device 3 is input to the video amplifier 17 via the second video signal notch 15 and the video selection switch 16.
- the video signal input by the camera 2 is input to the image processing device 14 via the first video signal buffer 12, and the image processing device 14 performs image processing.
- the video signal that has been subjected to image processing by the image processing device 14 is input to the video amplifier 17 via the video selection switch 16.
- the video signal input to the video amplifier 17 is amplified by the video amplifier 17, output to the display device 4, and output to the display device 4.
- the voltage value of the DC voltage VCC is 5 V
- the resistance value of the resistor R1 is 1.5 kQ
- the resistance value of the resistor R2 is 82 ⁇
- the resistance value of the resistor R3 is lk ⁇
- the resistance value of resistor R4 is 4.7 kQ
- the resistance value of resistor R5 is 10 k ⁇
- the quasi-voltage value is 1.8V.
- the output voltage value of the synchronization detection circuit 31 becomes H because the synchronization detection circuit 31 can detect the synchronization signal as well as the video signal power, and the voltage value at the anode of the diode D3 becomes H.
- CAMIND 1 becomes L and CAMIND 2 becomes H.
- the voltage value at the anode of the diode D1 is the same as in the normal state.
- the voltage values at the diode D2 and diode D4 nodes are the same as in the normal state.
- the output voltage value of the synchronization detection circuit 31 becomes L because the synchronization detection circuit 31 cannot detect the synchronization signal even with the video signal power, and the voltage value at the anode of the diode D3 becomes
- CAMIND1 becomes L and CAMIND2 becomes L.
- CAMIND1 becomes H when the input path of the video signal is in a power fault state.
- CAMIND2 becomes H.
- the voltage value between the resistor R2 and the resistor R3 is OV
- the voltage value between the resistor R4 and the resistor R5 is also OV
- the voltage at each anode of the diode D2 and the diode D4 The value is
- the output voltage value of the synchronization detection circuit 31 is L because the synchronization detection circuit 31 cannot detect the synchronization signal even for the video signal power, and the voltage value at the diode D3 is
- CAMIND1 becomes H and CAMIND2 becomes L.
- the video signal processing apparatus 1 has the (CAMI) when the video signal input path is in a normal state, an open state, a power fault state, or a ground fault state.
- ND1, CAMIND2) Forces are (L, H) (L, L) (H, H) (H, L), so the cause of the video signal input path error can be identified.
- the video signal input to the abnormality detection circuit 11 is replaced with the power camera 2 described as the input of the camera 2 force.
- a navigation device, a television broadcast receiver, and a DVD It may be input from another video output device such as a player.
- the abnormality detection circuit 11 connects the anode of the diode D2 to the resistor R4 and the resistor
- the abnormality detection circuit 11 connects the anode of the diode D4 to the output side of the synchronization detection circuit 31 instead of connecting the anode of the diode D4 between the resistance R4 and the resistance R5. May be.
- the abnormality detection device is a source of abnormality in the input path of a video signal.
- it is useful as an anomaly detection device that detects an anomaly in the video signal input path.
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Abstract
映像信号の入力経路の異常の原因を把握することができる異常検出装置を提供する。
カメラ2によって出力された映像信号から同期信号を検出する同期検出回路31を有し、映像信号の入力経路から得られる第1の直流信号レベルが予め定められた第1の閾値より高いか否か、映像信号の入力経路から得られる第2の直流信号レベルが予め定められた第2の閾値より低いか否か、および同期検出回路31によって同期信号が検出されたか否かに基づいて、映像信号の入力経路が正常状態、開放状態、天絡状態および地絡状態のうち何れの状態にあるかを判断する異常検出回路11を備える。
Description
明 細 書
異常検出装置
技術分野
[0001] 本発明は、映像信号の入力経路の異常を検出する異常検出装置に関するもので ある。
背景技術
[0002] 従来、映像信号の入力経路の異常を検出する異常検出装置としては、映像信号を 表す所定ビット数のパラレル信号によって表される論理値が暗時出力値以下に設定 された判定値を一定時間下回っているとき故障と判定することによって、回路構成を 増大させることなくパラレル信号の入力経路のうち少なくとも一本が断線またはショー トしてもこれを故障と診断できるようにしたものがある (例えば、特許文献 1参照)。 特許文献 1:特開平 8 - 19007号公報
発明の開示
発明が解決しょうとする課題
[0003] し力しながら、従来の異常検出装置は、映像信号の入力経路の断線やショートを故 障として診断できるものの、映像信号の入力経路の異常の原因が把握できないとい つた問題があった。
[0004] 本発明は、従来の問題を解決するためになされたもので、映像信号の入力経路の 異常の原因を把握することができる異常検出装置を提供することを目的とする。 課題を解決するための手段
[0005] 本発明の異常検出装置は、映像出力機器によって出力された映像信号カゝら同期 信号を検出する同期検出回路を有し、前記映像信号の入力経路から得られる第 1の 直流信号レベルが予め定められた第 1の閾値より高いか否力 前記映像信号の入力 経路力 得られる第 2の直流信号レベルが予め定められた第 2の閾値より低いか否 力 および前記同期検出回路によって前記同期信号が検出されたか否かに基づい て、前記映像信号の入力経路が正常状態、開放状態、天絡状態および地絡状態の うち何れの状態にあるかを判断する経路状態判断手段を備えた構成を有している。
[0006] この構成により、本発明の異常検出装置は、第 1の直流信号レベルが第 1の閾値よ り高いか否か、第 2の直流信号レベルが第 2の閾値より低いか否か、および同期検出 回路によって同期信号が検出された力否かに基づいて映像信号の入力経路が正常 状態、開放状態、天絡状態および地絡状態の何れの状態にあるかを判断するため、 映像信号の入力経路の異常の原因を把握することができる。
[0007] なお、前記経路状態判断手段は、前記同期検出回路によって前記同期信号が検 出された場合に、前記入力経路が正常状態にあると判断するようにしてもよい。
[0008] また、前記経路状態判断手段は、前記第 1の直流信号レベルが前記第 1の閾値よ り高い場合に、前記入力経路が天絡状態にあると判断するようにしてもよい。
[0009] また、前記経路状態判断手段は、前記第 2の直流信号レベルが前記第 2の閾値よ り低い場合に、前記入力経路が地絡状態にあると判断するようにしてもよい。
[0010] また、前記経路状態判断手段は、前記第 1の直流信号レベルが前記第 1の閾値よ り低ぐ前記第 2の直流信号レベルが前記第 2の閾値より高い場合、かつ、前記同期 検出回路によって前記同期信号が検出されな力つた場合に、前記入力経路が開放 状態にあると判断するようにしてもよい。
[0011] また、前記経路状態判断手段は、前記映像信号の入力経路の電圧を分圧して前 記第 1の直流信号レベルおよび前記第 2の直流信号レベルをそれぞれ得るようにし てもよい。
[0012] また、前記経路状態判断手段は、前記第 1の直流信号レベルが前記第 1の閾値よ り高いか否力 前記第 2の直流信号レベルが前記第 2の閾値より低いか否か、および 前記同期検出回路によって前記同期信号が検出された力否力をそれぞれ表す信号 のうち、何れか 1つの信号と他の 2つの信号との各論理和よりなる 2つの信号によって 前記映像信号の各状態を表すようにしてもょ ヽ。
発明の効果
[0013] 本発明は、映像信号の入力経路の異常の原因を把握することができるといった効 果を有する異常検出装置を提供することができる。
図面の簡単な説明
[0014] [図 1]図 1は、本発明の一実施の形態における映像信号処理装置のブロック図である
[図 2]図 2は、本発明の一実施の形態における映像信号処理装置を構成する異常検 出回路の例を示すブロック図である。
符号の説明
1 映像信号処理装置
2 カメラ
3 外部映像出力装置
4 ィスプレイ装置
10 CPU
11 異常検出回路
12 第 1の映像信号バッファ
13 同期分離回路
14 画像処理装置
15 第 2の映像信号バッファ
16 映像選択スィッチ
17 ビデオアンプ
18 DRAM
19 フラッシュメモリ
20 ダイァグメモリ
30 コンノ レータ
31 同期検出回路
Rl , R2、R3、R4、R5 抵抗
C1 コンデンサ
Dl、 , D2、D3、D4 ダイオード
ZD ツエナーダイオード
発明を実施するための最良の形態
以下、本発明の実施の形態について、図面を参照して説明する。なお、本実施の 形態においては、車両に設けられ、カメラや映像受信機等の映像出力機器によって
出力された映像信号をディスプレイに表示させる映像信号処理装置に、本発明の異 常検出装置を適用した例について説明する。
[0017] 本発明の一実施の形態の異常検出装置を適用した映像信号処理装置を図 1に示 す。
[0018] 映像信号処理装置 1には、車両後方を撮影するカメラ 2と、ナビゲーシヨン装置、テ レビ放送受信機および DVD (Digital Versatile Disc)プレーヤ等の外部映像出力装 置 3と、映像信号処理装置 1によって処理された映像信号を映像出力するディスプレ ィ装置 4とが接続されている。
[0019] カメラ 2は、映像を取り込むためのレンズおよび CCD (Charged Coupled Device)セ ンサを有し、 CCDセンサの検知信号から映像信号を生成するようになっている。ここ で、映像信号は、コンポジット信号、 RGB信号、 YUV信号、またはその他のフォーマ ッ卜のちのでちょい。
[0020] ディスプレイ装置 4は、ブラウン管や液晶ディスプレイ等の表示部を有し、映像信号 を表示部に映像出力するようになっている。
[0021] 映像信号処理装置 1は、 CPU (Central Processing Unit) 10と、カメラ 2から入力さ れた映像信号の入力経路の異常を検出する異常検出回路 11と、カメラ 2から入力さ れた映像信号をバッファリングする第 1の映像信号バッファ 12と、カメラ 2から入力さ れた映像信号から同期信号を分離する同期分離回路 13と、画像処理を行う画像処 理装置 14と、外部映像出力装置 3から入力された映像信号をバッファリングする第 2 の映像信号バッファ 15と、画像処理装置 14によって画像処理された映像信号と外部 映像出力装置 3から入力された映像信号とから 1つの映像信号を選択する映像選択 スィッチ 16と、映像選択スィッチ 16によって選択された映像信号を増幅するビデオア ンプ 17と、 DRAM (Dynamic Random Access Memory) 18と、フラッシュメモリ 19と、 故障診断結果を記憶するためのダイァグメモリ 20と、映像信号処理装置 1の各部お よびカメラ 2に電力を供給する図示しない電力供給部とを備えている。
[0022] なお、以下の説明において、映像信号の入力経路がカメラ 2と正常に接続されてい る状態を「正常状態」 、 、、映像信号の入力経路が何処にも接続されて 、な ヽ状 態を「開放状態」といい、映像信号の入力経路に電源電圧が印加されている状態を「
天絡状態」といい、映像信号の入力経路がグランドに短絡して 、る状態を「地絡状態 」という。
[0023] CPU10は、図示しな!、ROM (Read Only Memory)等の記憶媒体に記憶されたプ ログラムを DRAM 18に読み込み、 DRAM 18に読み込まれたプログラムを実行する ことによって画像処理装置 14、映像選択スィッチ 16および電力供給部等の各部の 動作を制御するようになって!/、る。
[0024] 異常検出回路 11は、本発明における経路状態判断手段を構成し、例えば、図 2に 示すように、抵抗 R1乃至 R5と、コンデンサ C1と、コンパレータ 30と、同期検出回路 3 1と、ツエナーダイオード ZDと、ダイオード D1乃至 D4とを有している。
[0025] 抵抗 Rl、ツエナーダイオード ZD、抵抗 R2および抵抗 R3は、順に直列に接続され 、抵抗 R1の一端に直流電圧 VCCが印加され、抵抗 R3の一端がグランドに接続され ている。
[0026] コンデンサ C1は、一端が抵抗 R2に接続されたツエナーダイオード ZDの力ソードに 接続され、他端がグランドに接続されている。これにより、交流成分が地絡されるため 、映像信号処理装置 1の入力インピーダンスは、抵抗 R2と抵抗 R3とが並列接続され たときの抵抗値と等しくなる。本実施の形態においては、カメラ 2のインピーダンスと整 合が取れるよう、抵抗 R2および抵抗 R3の各抵抗値は、映像信号処理装置 1の入力 インピーダンスが 75 Ωになるように設定されて!、る。
[0027] コンパレータ 30は、ツエナーダイオード ZDのアノードに接続され、ツエナーダイォ ード ZDのアノードにおける電圧値と、基準電圧値とを比較するようになっている。ここ で、コンパレータ 30の出力電圧値は、ツエナーダイオード ZDのアノードにおける電 圧値が基準電圧値より低い場合には、例えば 2. IV以上のハイレベル (以下単に「H 」と記載する。 )になり、ツエナーダイオード ZDのアノードにおける電圧値が基準電圧 値より高い場合には、例えば 0. 7V以下のローレベル (以下単に「L」と記載する。)に なる。
[0028] ここで、コンパレータ 30の基準電圧値は、映像信号の入力経路が地絡状態にある 場合にコンパレータ 30の出力電圧値が Hになり、他の状態にある場合にコンパレー タ 30の出力電圧値が Lになるように定められている。
[0029] なお、コンパレータ 30の入力電圧値は、本発明における第 2の直流信号レベルに あたり、コンパレータ 30の基準電圧値は、本発明における第 2の閾値にあたる。
[0030] ツエナーダイオード ZDは、映像信号の入力経路が天絡した場合に、コンパレータ 3 0がラッチアップを起こさないよう、コンパレータ 30の入力側等における電圧値が所定 値以上にならな 、ように保護するようになって 、る。
[0031] 抵抗 R4および抵抗 R5は、直列に接続され、抵抗 R4の一端が抵抗 R2と抵抗 R3と の間に接続され、抵抗 R5の一端がグランドに接続されている。ここで、抵抗 R4およ び抵抗 R5の各抵抗値は、映像信号の入力経路が天絡状態にある場合に抵抗 R4と 抵抗 R5との間における電圧値が Hになり、他の状態にある場合に抵抗 R4と抵抗 R5 との間における電圧値が Lになるように定められている。
[0032] なお、抵抗 R4と抵抗 R5との間における電圧値は、本発明における第 1の直流信号 レベルにあたり、 Hと Lとの間の任意の電圧値は、本発明における第 1の閾値にあた る。
[0033] 同期検出回路 31は、抵抗 R2と抵抗 R3との間に入力側が接続され、映像信号から 同期信号を検出するようになっている。例えば、同期検出回路 31は、映像信号の同 期信号部分を抽出し、抽出した同期信号部分を平滑ィ匕することにより、映像信号から 同期信号を検出できている間は、出力電圧値が Hになり、映像信号から同期信号を 検出できて!/、ない間は、出力電圧値が Lになるようになって 、る。
[0034] ダイオード D1のアノードは、コンパレータ 30の出力側に接続され、ダイオード D2お よびダイオード D4の各アノードは、抵抗 R4と抵抗 R5との間に接続され、ダイオード D3のアノードは、同期検出回路 31の出力側に接続されている。また、ダイオード D1 の力ソードとダイオード D2の力ソードは、 OR (論理和)接続され、第 1の異常検出信 号(以下、「CAMIND1」と記載する。)を CPU10に出力するようになっている。一方 、ダイオード D3の力ソードとダイオード D4の力ソードは、 OR接続され、第 2の異常検 出信号 (以下、「CAMIND2」と記載する。)を CPU10に出力するようになっている。
[0035] 図 1において、第 1の映像信号バッファ 12は、カメラ 2から入力された映像信号をバ ッファリングすると共に、ペデスタル (輝度の基準値)を固定するようになっている。
[0036] 同期分離回路 13は、第 1の映像信号バッファ 12にバッファリングされた映像信号か
ら同期信号を取り出すようになつている。なお、 CPU10は、同期分離回路 13によつ て取り出された同期信号の周期を監視し、同期信号の周期が規定の周期と異なる場 合には、映像信号が異常であると判断するようになっている。
[0037] 画像処理装置 14は、画像処理プロセッサ等のディジタル信号処理装置によって構 成され、 CPU10による制御に基づいて、第 1の映像信号バッファ 12にバッファリング された映像信号に俯瞰処理やガイドラインの描画処理等を施すようになって!/ヽる。
[0038] ここで、俯瞰処理は、バンパー等の車両に近い位置の湾曲した部分の映像に直線 処理を施す等して、カメラ 2の位置よりも上方から撮影された擬似映像を作成する処 理のことをいう。また、ガイドラインの描画処理は、映像に車両の進行方向や車両から の距離を示す情報を重ね書きする処理のことを!、う。
[0039] 第 2の映像信号バッファ 15は、外部映像出力装置 3から入力された映像信号をバッ ファリングすると共に、ペデスタルを固定するようになっている。
[0040] 映像選択スィッチ 16は、 CPU10による制御に基づいて、画像処理装置 14によつ て画像処理された映像信号と外部映像出力装置 3から入力された映像信号とから 1 つの映像信号を選択するようになっている。
[0041] ビデオアンプ 17は、映像選択スィッチ 16によって選択された映像信号を増幅する ことにより、映像信号の信号レベルをディスプレイ装置 4側で規定された信号レベル に調整するようになって 、る。
[0042] DRAM18には、 CPU10に実行させるプログラムに加えて、このプログラムを実行 する CPU10や画像処理装置 14によって演算処理時に利用されるデータが一時記 憶される。また、フラッシュメモリ 19には、画像処理装置 14によって使用されるパラメ ータ等が記憶される。
[0043] ダイァグメモリ 20は、 EEPROM (Electrically Erasable Programmable Read-only M emory)等の不揮発の記憶媒体によって構成され、ダイァグメモリ 20には、異常検出 回路 11等によって検出された異常の状態や検出時間等の履歴が CPU10によって
SC fedれる。
[0044] なお、 CPU10は、外部の機器と通信する図示しないインターフェイス回路や着脱 可能な記憶媒体に、ダイァグメモリ 20に記憶された情報を送信するようになって 、る
[0045] 電力供給部は、 CPU10による制御に基づいて、車両の電源から供給された電力 の電圧を降圧するなどして調整し、電圧を調整した電力を映像信号処理装置 1の各 部やカメラ 2に供給するようになっている。また、電力供給部は、 CPU10やカメラ 2の ラッチアップを防ぐため、 CPU10を作動させない時には、 CPU10やカメラ 2に供給 する電力を遮断するようになって!/ヽる。
[0046] 以上のように構成された映像信号処理装置 1につ 、て、その動作を説明する。
[0047] まず、車両のイダ-ッシヨン電源やアクセサリー電源が投入されると、電力供給部に よって映像信号処理装置 1の各部に電力が供給され、映像信号処理装置 1の各部が 作動する。
[0048] 車両のバックギアが入って 、な 、状態等のように運転手が後方の映像を必要としな い場合には、外部映像出力装置 3から入力された映像信号が映像選択スィッチ 16に よって選択される。外部映像出力装置 3から入力された映像信号は、第 2の映像信号 ノッファ 15および映像選択スィッチ 16を介してビデオアンプ 17に入力される。
[0049] 一方、車両のバックギアが入っている状態等のように運転手が後方の映像を必要と する場合には、電力供給部によってカメラ 2に電力が供給され、カメラ 2が作動すると 共に、画像処理装置 14によって画像処理された映像信号が映像選択スィッチ 16に よって選択される。
[0050] カメラ 2によって入力された映像信号は、第 1の映像信号バッファ 12を介して画像 処理装置 14に入力され、画像処理装置 14によって画像処理が施される。画像処理 装置 14によって画像処理が施された映像信号は、映像選択スィッチ 16を介してビデ ォアンプ 17に入力される。
[0051] このようにビデオアンプ 17に入力された映像信号は、ビデオアンプ 17によって増幅 され、ディスプレイ装置 4に出力され、ディスプレイ装置 4によって映像出力される。
[0052] 次に、異常検出回路 11の動作について図 2を参照して詳細に説明する。なお、以 下の説明においては、一例として、直流電圧 VCCの電圧値を 5Vとし、抵抗 R1の抵 抗値を 1. 5kQとし、抵抗 R2の抵抗値を 82 Ωとし、抵抗 R3の抵抗値を lk Ωとし、抵 抗 R4の抵抗値を 4. 7k Qとし、抵抗 R5の抵抗値を 10k Ωとし、コンパレータ 30の基
準電圧値を 1. 8Vとする。
[0053] 映像信号の入力経路が正常状態の場合には、映像信号は、直流成分が分離され ているため、コンパレータ 30に入力される信号は、電圧値が VCC X (R2+R3) ÷ (R 1 +R2+R3) = 2. IVとなる。このため、コンパレータ 30の出力電圧値は、入力信号 の電圧値が基準電圧値より高いため Lになり、ダイオード D1のアノードにおける電圧 値は、 になる。
[0054] また、抵抗 R2と抵抗 R3との間の電圧は、 VCC XR3+ (R1 +R2+R3) = 2. OV になるため、抵抗 R4と抵抗 R5との間の電圧は、 2. 0VXR4+ (R4+R5) =0. 6V になる。したがって、ダイオード D2およびダイオード D4の各アノードにおける電圧値 は、 になる。
[0055] また、同期検出回路 31の出力電圧値は、同期検出回路 31が映像信号力も同期信 号を検出できるため Hになり、ダイオード D3のアノードにおける電圧値は、 Hになる。
[0056] したがって、映像信号の入力経路が正常状態の場合には、 CAMIND1が Lになり 、 CAMIND2が Hになる。
[0057] 映像信号の入力経路が開放状態の場合には、ダイオード D1のアノードにおける電 圧値は、正常状態と同様に になる。また、ダイオード D2およびダイオード D4の各ァ ノードにおける電圧値は、正常状態と同様に になる。また、同期検出回路 31の出力 電圧値は、同期検出回路 31が映像信号力も同期信号を検出できないため Lになり、 ダイオード D3のアノードにおける電圧値は、 になる。
[0058] したがって、映像信号の入力経路が開放状態の場合には、 CAMIND1が Lになり 、 CAMIND2が Lになる。
[0059] 映像信号の入力経路が天絡状態の場合には、ダイオード D1のアノードにおける電 圧値は、正常状態と同様に になる。また、天絡状態時に映像信号の入力経路に印 加される電圧を 9Vとすると、 9VXR4÷ (R4+R5) = 2. 9Vになるためダイオード D 2およびダイオード D4の各アノードにおける電圧値は、 Hになる。また、同期検出回 路 31の出力電圧値は、同期検出回路 31が映像信号力も同期信号を検出できない ため Lになり、ダイオード D3のアノードにおける電圧値は、 になる。
[0060] したがって、映像信号の入力経路が天絡状態の場合には、 CAMIND1が Hになり
、 CAMIND2が Hになる。
[0061] 映像信号の入力経路が地絡状態の場合には、コンパレータ 30に入力される信号 の電圧値は、 VCC XR2+ (R1 +R2) =0. 3Vとなる。このため、コンパレータ 30の 出力電圧値は、入力信号の電圧値が基準電圧値より低いため Hになり、ダイオード D 1のアノードにおける電圧値は、 Hになる。
[0062] また、抵抗 R2と抵抗 R3との間における電圧値は、 OVになるため、抵抗 R4と抵抗 R 5との間における電圧値も OVになり、ダイオード D2およびダイオード D4の各アノード における電圧値は、 になる。また、同期検出回路 31の出力電圧値は、同期検出回 路 31が映像信号力も同期信号を検出できないため Lになり、ダイオード D3のァノー ドにおける電圧値は、 になる。
[0063] したがって、映像信号の入力経路が地絡状態の場合には、 CAMIND1が Hになり 、 CAMIND2が Lになる。
[0064] このような本発明の一実施の形態の映像信号処理装置 1は、映像信号の入力経路 が正常状態、開放状態、天絡状態および地絡状態の各状態にある場合に、(CAMI ND1、 CAMIND2)力 それぞれ (L、 H) (L、 L) (H、 H) (H、 L)になるため、映像 信号の入力経路の異常の原因を把握することができる。
[0065] なお、本実施の形態において、異常検出回路 11に入力される映像信号は、カメラ 2 力も入力されるものとして説明した力 カメラ 2に代えて、ナビゲーシヨン装置、テレビ 放送受信機および DVDプレーヤ等の他の映像出力機器カゝら入力されるものでもよ い。
[0066] また、図 2において、異常検出回路 11は、ダイオード D2のアノードを抵抗 R4と抵抗
R5との間に接続するのに代えて、ダイオード D2のアノードをコンパレータ 30の出力 側に接続するようにしてもょ 、。
[0067] また、異常検出回路 11は、ダイオード D4のアノードを抵抗 R4と抵抗 R5との間に接 続するのに代えて、ダイオード D4のアノードを同期検出回路 31の出力側に接続する ようにしてもよい。
産業上の利用可能性
[0068] 以上のように、本発明にかかる異常検出装置は、映像信号の入力経路の異常の原
因を把握することができるという効果を有し、例えば、映像信号の入力経路の異常を 検出する異常検出装置等として有用である。
Claims
[1] 映像出力機器によって出力された映像信号力も同期信号を検出する同期検出回 路を有し、前記映像信号の入力経路から得られる第 1の直流信号レベルが予め定め られた第 1の閾値より高いか否か、前記映像信号の入力経路から得られる第 2の直流 信号レベルが予め定められた第 2の閾値より低いか否力、および前記同期検出回路 によって前記同期信号が検出された力否かに基づいて、前記映像信号の入力経路 が正常状態、開放状態、天絡状態および地絡状態のうち何れの状態にあるかを判断 する経路状態判断手段を備えたことを特徴とする異常検出装置。
[2] 前記経路状態判断手段は、前記同期検出回路によって前記同期信号が検出され た場合に、前記入力経路が正常状態にあると判断することを特徴とする請求項 1に 記載の異常検出装置。
[3] 前記経路状態判断手段は、前記第 1の直流信号レベルが前記第 1の閾値より高い 場合に、前記入力経路が天絡状態にあると判断することを特徴とする請求項 1に記 載の異常検出装置。
[4] 前記経路状態判断手段は、前記第 2の直流信号レベルが前記第 2の閾値より低 ヽ 場合に、前記入力経路が地絡状態にあると判断することを特徴とする請求項 1に記 載の異常検出装置。
[5] 前記経路状態判断手段は、前記第 1の直流信号レベルが前記第 1の閾値より低ぐ 前記第 2の直流信号レベルが前記第 2の閾値より高い場合、かつ、前記同期検出回 路によって前記同期信号が検出されな力つた場合に、前記入力経路が開放状態に あると判断することを特徴とする請求項 1に記載の異常検出装置。
[6] 前記経路状態判断手段は、前記映像信号の入力経路の電圧を分圧して前記第 1 の直流信号レベルおよび前記第 2の直流信号レベルをそれぞれ得ることを特徴とす る請求項 1に記載の異常検出装置。
[7] 前記経路状態判断手段は、前記第 1の直流信号レベルが前記第 1の閾値より高い か否か、前記第 2の直流信号レベルが前記第 2の閾値より低いか否か、および前記 同期検出回路によって前記同期信号が検出された力否力をそれぞれ表す信号のう ち、何れか 1つの信号と他の 2つの信号との各論理和よりなる 2つの信号によって前
記映像信号の各状態を表すことを特徴とする請求項 1に記載の異常検出装置。 映像信号を出力する映像出力機器と、
映像信号を映像出力するディスプレイ装置と、
前記映像出力機器によって出力された映像信号を前記ディスプレイ装置に映像出 力させる映像信号処理装置とを備えた映像システムにおいて、
前記映像信号処理装置は、前記映像出力機器によって出力された映像信号から 同期信号を検出する同期検出回路を含み、前記映像信号の入力経路から得られる 第 1の直流信号レベルが予め定められた第 1の閾値より高いか否か、前記映像信号 の入力経路力 得られる第 2の直流信号レベルが予め定められた第 2の閾値より低 いか否力 および前記同期検出回路によって前記同期信号が検出されたか否かに 基づいて、前記映像信号の入力経路が正常状態、開放状態、天絡状態および地絡 状態のうち何れの状態にあるかを判断する経路状態判断手段を有することを特徴と する映像システム。
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