CH676397A5 - - Google Patents

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La présente invention concerne un dispositif selon le préambule de la revendication 1. Un tel dispositif est par exemple utilisé dans une installation d'impression de valeurs qui présente une forme modulaire et, plus particulièrement, dans un système dans lequel le module du dispositif d'affranchissement de sécurité, qui contient des registres de taxation pour enregistrer les valeurs de signes imprimés, comporte également une représentation des signes stockés sous forme électronique. Par exemple, dans un système modulaire d'impression d'affranchissement, dans lequel le module d'affranchissement de sécurité peut être séparé du module d'impression, on obtient un degré encore plus grand de sécurité en stockant dans le module une représentation des signes devant être imprimés. Ainsi, non seulement le module d'affranchissement doit fournir au module d'impression la permission d'imprimer les signes, mais encore le module d'affranchissement doit fournir une représentation des signes eux-mêmes.

Un appareil d'affranchissement comprend typiquement une imprimante pour imprimer une information postale sur un pli de courrier. Des appareils d'affranchissement de ce type sont décrits dans le brevet des Etats-Unis n° 4 097 923

Un autre exemple d'appareil qui utilise une imprimante est décrit dans le brevet des États-Unis n° 4422148.

Les appareils d'affranchissement du type cité ci-dessus peuvent présenter plusieurs modifications. Par exemple, dans une modification, une caractéristique de chargement à distance est disponible dans laquelle une clef est fournie pour le fonctionnement d'un commutateur de chargement à trois positions placé sur le clavier. L'opérateur de l'ensemble peut ainsi être muni des combinaisons appropriées pour entrée dans le clavier afin de permettre le chargement à distance. Dans une autre modification, le commutateur de chargement à trois positions du clavier peut être commandé par une simple bouton sans qu'il soit nécessaire d'avoir recours à la clef. Dans ce type de système, l'appareil peut être rechargé manuellement au bureau de poste, mais la fonction service peut être effectuée localement d'une manière similaire à celle des unités du type de système à rechargement à distance.

Les appareils d'affranchissement précédents contiennent des imprimantes qui font partie de l'appareil lui-même. Bien que ces appareils exécutent leur fonction de façon exemplaire, il est toujours important de mettre au point des dispositifs d'affranchissement nouveaux et perfectionnés dans le but de diminuer les coûts et d'améliorer la vitesse et le rendement.

Comme cela est bien connu, dans un système typique l'appareil d'affranchissement contiendra le dispositif d'impression de manière à faciliter l'application d'un affranchissement à un pli de courrier ou analogue. Le dispositif d'impression placé à l'intérieur de l'appareil d'affranchissement augmente le coût et la complexité de l'appareil.

Un dispositif d'affranchissement de ce type ne contenant pas une imprimante intégrale fournit un signal de validation à un ensemble central comportant une imprimante. Ensuite, l'imprimante procède à l'impression d'une information qui comprend l'information provenant du signal de validation.

Généralement, dans un système électronique d'affranchissement du courrier, il est important que les fonds postaux se trouvant à l'intérieur de l'appareil soient en sécurité. On entend par là que, lorsque l'imprimante imprime des signes postaux sur un pli de courrier, le registre comptable situé à l'intérieur de l'appareil d'affranchissement doit toujours refléter le fait que l'impression s'est produite. Dans un des systèmes typiques d'expédition du courrier, étant donné que l'appareil d'affranchissement et l'imprimante sont des unités solidaires, ceux-ci sont verrouillés de façon à assurer que l'impression d'un signe postal ne peut se produire sans comptabilisation. Les autorités postales imposent généralement que l'information comptable soit stockée dans un appareil d'affranchissement et soit maintenue de façon sûre; un système perfectionné d'expédition du courrier doit donc comporter des caractéristiques de sécurité permettant d'éviter des changements non autorisés et non comptabilisés du montant des fonds postaux qui sont conservés dans l'appareil. Les autorités postales imposent aussi que les appareils soient mis en service et retirés du service en suivant strictement leurs règles sur l'enregistrement et l'inspection périodique (par exemple, tous les six mois). Cela permet au bureau de poste de conserver des enregistrements sur l'usage d'un appareil et de détecter les fraudes. Ainsi, il y a également des coûts administratifs associés au maintien des enregistrements, à l'inspection et à l'entretien des appareils.

Il reste un besoin pour des appareils d'affranchissement moins chers et fonctionnant à une vitesse plus élevée. Comme on l'a indiqué précédemment, à un appareil d'affranchissement typique sont associés diverses périphériques qui en augmentent le coût. Il est important de mettre au point des appareils d'affranchissement pouvant être adaptés aux systèmes d'expédition du courrier qui soient moins chers et plus efficaces, tout en maintenant le haut niveau de sécurité associé aux appareils d'affranchissement indiqués ci-dessus. Il est également important que tout nouveau système d'expédition du courrier soit tel que la sécurité puisse être maintenue en conservant les systèmes d'expédition cités précédemment.

La présente invention réalise les objets précédents avec un dispositif du type mentionné ci-dessus qui comporte en outre les particularités décrites dans la partie caractérisante de la revendication 1. Elle crée un système d'impression de valeurs qui comporte un moyen de stockage qui peut stocker une représentation des signes à imprimer, ce moyen de stockage étant disposé dans un module de sécurité d'appareil d'affranchissement. Le module permet également de conserver en sécurité les données de comptabilisation du système. Au module est couplé un module d'ensemble central, lequel est à son tour couplé à un module d'imprimante, d'où il résulte l'impression des signes. Le module de l'appa5

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reil d'affranchissement et le module de l'ensemble central sont couplés de manière à communiquer entre eux par un bus de communication à haute vitesse qui emploie une technique de changement de mémoires, ou de permutation, pour transférer des blocs de données bi-directionnellement entre l'appareil et l'ensemble central.

Dans un mode de réalisation donné à titre d'illustration, un système électronique d'expédition du courrier à haute vitesse est décrit qui comprend un appareil électronique d'affranchissement comportant une unité de comptabilisation. L'unité de comptabilisation comprend une unité de traitement, dans le présent mode de réalisation un micro-ordinateur, une mémoire rémanente MR et une unité de protection des données MR connectée au micro-ordina-teur. De plus, est également connectée au micro-or-dinateur une mémoire de signes, dans laquelle une représentation de la configuration fixe des signes postaux est stockée sous forme numérique.

L'appareil d'affranchissement permet la génération d'un numéro de validation crypté et de la configuration fixe des signes pour impression sur un document. Ce numéro de validation fournit un procédé permettant de détecter une impression non comptabilisée et donne aux autorités postales une information sur les registres de comptabilisation de l'appareil. L'imprimante à haute vitesse de ce mode de réalisation sera située à l'intérieur de la machine d'expédition du courrier ou tout autre ensemble central faisant partie du système d'expédition.

La machine centrale ou d'expédition du présent mode de réalisation comprend principalement un second microordinateur et une imprimante à haute vitesse. L'appareil peut communiquer par un bus de données de sécurité, à haute vitesse, avec la machine d'expédition ou machine centrale afin d'exécuter toutes les fonctions de comptabilisation, d'accepter des fonds, de procéder à une remise à zéro pour la sortie du service et pour effectuer toutes [es autres actions qu'exécutent généralement les systèmes électroniques d'expédition du courrier. L'appareil peut également communiquer avec l'ensemble central pour fournir une représentation numérique de la configuration fixe des signes postaux mêmes. De plus, il est avantageux d'utiliser dans cet appareil les techniques de sécurité qu'on emploie dans les appareils existants, par exemple une enceinte mécaniquement de sécurité et un bouclier électromagnétique, une alimentation isolée et des liaisons de communication isolées.

L'appareil électronique d'affranchissement, comme on l'a indiqué ci-dessus, n'imprime pas un affranchissement mais fournit un signal électrique qui représentera un numéro de validation crypté pour le montant de l'affranchissement dont il a tenu compte et, de plus, une représentation numérique de la partie fixe des signes postaux. Dans ce mode de réalisation, le numéro de validation crypté doit être imprimé en même temps qu'un montant en dollars, que le numéro de série de l'appareil et que la date d'émission. Le numéro de validation est imprimé typiquement dans un format de système approuvé qui sera approprié à une détection automatique, le cas échéant. Le numéro crypté de validation est utilisé pour détecter une impression illégale d'un montant en dollars dont il n'a pas été tenu compte.

Dans ce mode de réalisation, donné à titre d'illustration, l'unité de traitement de la machine d'expédition recevra un montant en dollars à partir d'un clavier ou analogue et enverra cette information à l'unité de traitement de l'appareil. L'appareil produira ensuite un numéro crypté de validation en utilisant une clef et un texte en clair fournis par l'unité de traitement de l'appareil. Le texte en clair sera l'information postale et les registres de comptabilisation de l'appareil. On doit noter que d'autres informations, telles que la date, l'origine du document, la destination, etc... peuvent être également utilisées en fonction des besoins et des désirs de l'usager. La clef sera stockée à l'intérieur de la mémoire MR.

L'appareil enverra alors le numéro de validation en même temps que son numéro de série et une représentation de la configuration fixe des signes postaux à l'unité de traitement de la machine d'expédition ou ensemble central. L'unité de traitement située dans l'ensemble central envoie ensuite les signes postaux, le numéro de série de l'appareil, le montant en dollars et le numéro de validation à une imprimante. L'imprimante, à son tour, imprime les signes postaux, la date, le numéro de série de l'appareil, le montant en dollars et le numéro de validation sur un pli de courrier ou un document.

Ainsi, dans ce mode de réalisation donné à titre d'illustration, un micro-ordinateur situé dans l'appareil communiquera avec un micro-ordinateur placé dans une machine d'expédition ou tout autre type d'ensemble central. Dans ce système, l'appareil d'affranchissement fournira un signal électronique qui représente un numéro crypté de validation et la partie fixe des signes postaux à la machine d'expédition. Après réception du signal approprié en provenance de l'appareil d'affranchissement, la machine d'expédition demandera à son imprimante d'imprimer les signes postaux comprenant le montant désiré pour l'affranchissement.

L'appareil d'affranchissement ne contient aucune imprimante, ce qui permet de le rendre moins complexe et moins cher. De plus, un appareil d'affranchissement de ce type pourrait être adapté à une vaste variété de machines d'expédition du courrier ou autres unités périphériques. Le schéma de cryptage utilisé pour protéger la validité des signes postaux peut être du type quelconque que connaît le technicien, dont, par exemple, ceux qu'on a utilisés généralement pour protéger l'information de comptabilisation contenue dans l'appareil.

Par conséquent, ce système fournit un appareil d'affranchissement moins cher et plus simple qui pourra être adapté à une vaste variété de machine d'expédition. Ce système permet également de disposer d'un appareil d'affranchissement qui est complètement séparé de la fonction d'impression, dans lequel seul un signal électrique représentant la configuration fixe du numéro de série de l'appareil et des signes postaux et le numéro de validation est fourni à un dispositif périphérique, c'est-à-dire à une machine d'expédition comportant une imprimante. Ce système rend aussi plus facile la détec-

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tion par le bureau de poste ou tout autre organisme des fraudes en rendant possible le maintien d'enregistrements plus précis et mis à jour de l'usage de chaque appareil.

Le système de la présente invention permet également l'impression rapide de signes postaux en utilisant un bus de communications de sécurité, à haute vitesse, entre l'appareil et l'ensemble central et, de plus, grâce à l'emploi d'une imprimante à haute vitesse, telle qu'une imprimante à jet d'encre.

La présente invention sera bien comprise à la lecture de la description suivante faite en relation avec tes dessins ci-joints, dans lesquels:

- la figure 1 est un schéma sous forme de blocs du système électronique d'expédition du courrier;

- la figure 2 représente tes signes postaux imprimés par le système d'expédition du courrier de la figure 1;

- la figure 3 est un organigramme du fonctionnement de l'ensemble central du système d'expédition du courrier de la figure 1 ;

- la figure 4 est un organigramme du fonctionnement de l'appareil d'affranchissement du système d'expédition du courrier de la figure 1;

- la figure 5 est un schéma sous forme de blocs d'un mode de réalisation du système d'expédition du courrier;

- la figure 6 est un schéma sous forme de blocs de l'interface inter-UC de la figure 5;

- les figures 7A, 7B, 7G et 7D sont chacune un schéma sous forme de blocs de l'interaction de l'appareil d'affranchissement, de l'ensemble central et de l'interface inter-UC de la figure 5;

- ta figure 8 est une représentation schématique d'une partie de l'interface inter-UC de la figure 6;

- les figures 9A et 9B, appelées ici figure 9, sont une représentation schématique d'une autre partie de l'interface inter-UC de la figure 6;

- les figures 10A et 10B, appelées ici figure 10, sont un schéma d'encore une autre partie de l'interface inter-UC de la figure 6; et

- la figure 11 est un schéma sous forme de blocs d'un autre mode de réalisation du système d'expédition du courrier.

La présente invention est décrite dans le contexte d'un appareil d'affranchissement; cependant, on peut appliquer la présente invention à d'autres types d'appareils avec le même succès. De tels types comprennent tes appareils dès services d'expédition des colis, les appareils d'apposition de taxes, tes appareils d'écriture de chèques, les imprimantes de tickets et autres appareils similaires.

La figure 1 est un schéma sous forme de blocs d'un système d'expédition du courrier selon la présente invention. Le système d'expédition comprend un appareil d'affranchissement 1, désigné également ici par appareil électronique, qui communique avec un ensemble central 2. L'ensemble centrai 2 est, typiquement, une machine d'expédition du courrier et peut être également n'importe quel autre dispositif pouvant communiquer avec l'appareil. L'ensemble 2 imprime, à son tour, des repères postaux 18 comprenant un montant d'affranchissement ainsi que d'autres informations sur un document 3 au moyen d'une imprimante 17.

L'appareil 1 comprend une unité de traitement ou micro-ordinateur 10 qui est couplé à une mémoire rémanente (MR) 11 par l'intermédiaire d'une logique de sécurité 12, L'unité de traitement, par exemple, peut être un micro-ordinateur, un micro-contrôleur, un micro processeur ou un autre dispositif intelligent ayant une possibilité de traitement, qu'on désigne ci-après soit par processeur, micro-ordinateur ou mi-cro-procésseur. L'appareil 1 du présent mode de réalisation n'a pas d'imprimante associée et à sa place fournit à l'ensemble central 2 des signaux électroniques qui représentent, typiquement, le numéro de validation et la configuration des signes postaux.

Comme on peut le voir également, l'ensemble central 2 comprend une seconde unité de traitement ou micro-ordinateur 16 et peut comporter l'imprimante 17. L'imprimante peut être également un ensemblesé-paré. Le micro-ordinateur 16 est un dispositif intelligent qui permet une communication aller et retour avec le micro-ordinateur 10 de l'appareil et avec l'Imprimante 17 de manière à provoquer l'impression lorsqu'une information correcte lui est donnée.

Typiquement, un clavier ou analogue (non représenté) envoie au micro-ordinateur 16 l'information représentant le montant de l'affranchissement. Ensuite, le micro-ordinateur 16 envoie un signal au micro-ordinateur 10 constitué du montant de l'affranchissement de manière à obtenir un numéro de validation pour impression.

Le micro-ordinateur 10, après réception d'un signal en provenance du micro-ordinateur 16, calculera un numéro de validation crypté basé en partie sur une clef stockée dans la mémoire (MR) 11. On obtient l'accès à la mémoire 11 par l'intermédiaire de la logique de sécurité 12 qui assuré l'intégrité de la comptabilisation, du crypatge et des autres données stockées dans la mémoire 11. Le numéro de validation, à titre d'exemple, peut être calculé en combinant le numéro de série de l'appareil d'affranchissement et un code secret stocké dans la mémoire 11.

Le numéro de validation sera ensuite transmis au micro-ordinateur 16 de l'ensemble central 2 en même temps qu'une représentation cryptée de la configuration fixe des signes postaux 18 stockés dans une mémoire morte 13 de signes afin de provoquer le processus d'impression. L'imprimante, comme on l'a indiqué ci-dessus, imprimera à son tour sur le doc-ment 3 l'information communiquée par le micro-ordinateur 16. Ainsi, l'appareil fournit à l'ensemble central 2 la configuration fixe des signes postaux, le numéro de série de l'appareil et le numéro de validation devant être imprimés sur le document 3, L'ensemble central 2 fournit le montant de l'affranchissement. Dans ce mode de réalisation, soit l'ensemble central 2, soit l'appareil 1 peuvent fournir l'information relative à la ville, à l'état et à la date.

En liaison maintenant avec la figure 2, on voit que les signes 18 comprennent une configuration graphique fixe 19, un montant en dollars 22, une date et une ville d'origine 23 et un numéro de série d'appareil 21. De plus, les signes 18 comprendront un numéro de validation 24. La configuration 19 est dite fixe

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dans la mesure où il n'est pas nécessaire de déterminer pour chaque signe imprimé, contrairement au montant 22. Comme on peut le remarquer, bien que la configuration 19 soit représentée en figure 2, sous forme de la représentation graphique d'un aigle, on pourrait utiliser diverses configurations prédéterminées, en fonction de l'application particulière du système d'impression de valeurs selon la présente invention.

Les figures 3 et 4 sont des organigrammes décrivant le fonctionnement du système d'expédition du courrier. A l'origine, l'ensemble central 2 (figure 1) reçoit à partir d'une source le montant nécessaire de l'affranchissement en dollars, que la source soit un opérateur ou d'un autre type, celle-ci étant représentée par le bloc 40. Ensuite, lé montant en dollars est transmis à l'appareil 1 (figure 1), bloc 41. En liaison avec la figure 4, l'appareil recevra alors ce montant en dollars en provenance de l'ensemble central 2, bloc 42, puis produira un numéro de validation, bloc 43. Après production du numéro de validation, l'appareil 1 transmettra ensuite son numéro de série, le numéro de validation, qui comprend l'information sur l'affranchissement et la partie fixe des signes pour les renvoyer à l'ensemble central 2, bloc 44. Revenant à la figure 3, l'ensemble central 2 recevra alors le numéro de série de l'appareil, le numéro de validation et la partie fixe des signes provenant de l'appareil d'affranchissement, bloc 45. Ensuite, l'imprimante 17 (figure 1) imprimera sur le document 3 ta partie fixe des signes postaux 19, le montant 22 en dollars, la date 23, le numéro 21 de série de l'appareil et le numéro de validation 24 provenant de l'appareil 1.

Dans la mesure où l'objet de l'appareil d'affranchissement de l'invention est de permettre l'impression à haute vitesse des signes postaux sur des documents, le transfert des données entre l'appareil 1 et l'ensemble 2 doit s'effectuer à vitesse élevée et d'une façon efficace. Cette nécessité peut être encore plus évidente si l'on considère la représentation de la configuration fixe 19 des signes 18 stockés dans la mémoire morte 13 de la figure 1.

Typiquement, un signe postal représenté dans un format permettant son impression par un dispositif d'impression du type à matrice à points a des dimensions standard de 25,4 mm/50,8 mm et est constitué de 240 colonnes comportant chacune 120 points, chaque point ayant éventuellement l'une de trois valeurs d'intensité. Le nombre total des éléments binaires nécessaires pour représenter un tel type de signes peut être de 68 400, soit environ 10 800 mùlti-plets. Comme on peut le remarquer, si le signe postal est fourni à l'ensemble central 2 pour chaque document imprimé, une quantité considérable de données doit être transférée rapidement entre l'appareil 1 et l'ensemble 2, en particulier si l'on considère que dans un système d'affranchissement à haute vitesse trois documents ou plus peuvent être ainsi imprimés par seconde.

En plus de la nécessité d'un bus de communications de données à haute vitesse reliant l'appareil 1 et l'ensemble 2, une telle impression à haute vitesse par matrice à points impose l'emploi d'une imprimante appropriée à haute vitesse. Une telle imprimante doit, en plus de sa possibilité de fonctionnement à haute vitesse, être capable de fournir une qualité d'impression et d'autres caractéristiques d'impression en permettant l'emploi pour l'impression d'affranchissements et autres signes précieux. Une imprimante de cette nature est une imprimante à jet d'encre, dans laquelle des gouttelettes d'encre sont déviées électrostatiquement à des vitesses élevées par des plaques commandées électroniquement, comme cela est bien connu dans la technique.

En liaison maintenant avec la figure 5, on a représenté dans un schéma sous forme de blocs d'un mode de réalisation d'un système 50 d'affranchissement modularisé, à haute vitesse. Le système 50, comme cela est représenté, comprend trois modules principaux, à savoir, un module d'affranchissement de sécurité ou appareil 52, un module de commande d'impression ou ensemble central 54 et un module d'imprimante à jet d'encre 56.

Le module 52 comporte en outre une unité centrale de comptabilisation 58, qui peut être un micro-procésseur tel que le modèle Z-80 fabriqué par la société dite Zilog Corporation ainsi que par d'autres constructeurs.

Comme cela est bien connu, un tel micro-proces-seur a une structure de bus caractérisée par un bus de commande 60, un bus de données 62 et un bus d'adresses 64. La fonction des bus et de commander, identifier et transférer les instructions du programme et les données vers la mémoire ainsi qu'à partir de celle-ci et vers des dispositifs d'entrée/sortie (E/S) et à partir de ceux-ci, lesquels sont connectés aux bus.

Aux bus 60, 62 et 64 est connecté un circuit logique de sécurité 66 qui surveille les adresses produites par l'unité 58 de manière à commander les accès à deux mémoires à accès direct dans lesquelles la donnée de comptabilisation de l'appareil est stockée; ces mémoires étant la mémoire rémanente à accès direct 68 et la mémoire à accès direct sauvegardée par batterie 70. Couplée à la mémoire 70, une batterie 72 a une tension permettant de maintenir la donnée stockée dans cette mémoire lorsque Je système 50 n'est plus alimenté. Comme cela est bien connu dans la technique, une mémoire rémanente à accès direct telle que la mémoire 68 a la caractéristique de maintenir la donnée qui y est stockée après la coupure de l'énergie provenant de la mémoire à accès direct.

Un circuit logique de sécurité pouvant être utilisé pour la logique 66 est décrit dans la demande de brevet des Etats-Unis n° 710 802 intitulée «A Postage Meter With A Non-Volatile Memory Security Circuit» (Appareil d'affranchissement avec circuit de sécurité à mémoire rémanente), la demande équivalente de brevet européen ayant été publiée le 17 septembre 1986 sous le n° 0 194 663. Le circuit décrit dans cette demande fournit un moyen pour limiter la durée pendant laquelle les mémoires de comptabilisation peuvent être continuellement validées et prévoit également d'autres mécanismes de protection de sorte que l'information précieuse de comptabilisation qui y est stockée ne peut être modifiée ou détruite par inadvertance.

L'utilisation de deux mémoires séparées pour la

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conservation de l'information de comptabilisation est décrite dans le brevet des États-Unis n° 4 481 604, dans lequel une telle redondance des mémoires est utilisée pour minimiser la possibilité de situation d'erreurs se produisant dans un appareil électronique d'affranchissement.

A l'unité centrale 58 est également connectée par les bus 60,62 et 64 une mémoire morte de stockage de programmes 74 dans laquelle sont stockées les instructions de fonctionnement et les constantes dont a besoin l'unité 58. Une mémoire à accès direct 76 est également prévue pour stocker les données temporaires et autres informations dont l'unité 58 a besoin pendant l'exécution de son programme normal de fonctionnement. Comme cela est bien connu, un tel dispositif est généralement appelé «mémoire de travail».

A l'unité centrale 58 est également connecté un dispositif 78 à horloge/calendrier qui permet la conservation d'une information sur l'heure et la date. Une telle information est nécessaire, typiquement, pour impression à titre d'une partie des signes postaux. Dans le présent mode de réalisation, l'appareil 52 fournira l'heure et la date à l'unité centrale 54 pour impression. Gomme on peut le remarquer, le dispositif 78 pourrait, en variante, être placé dans l'unité 54, d'où la réduction de la quantité des données devant être fournies par l'appareil 52 à l'unité 54 pour chaque signe postal imprimé. Dans encore un autre mode de réalisation de la présente invention, l'appareil 52 et l'unité 54 contiendraient Ghacun un tel dispositif à horloge/calendrier. Les programmes appropriés de logiciel pour l'appareil 52 et l'unité centrale 54 pourraient être alors utilisées, avant l'impression d'un signe postal, afin de vérifier que l'heure et la date dans chaque module concordent, ce qui conférerait un degré supplémentaire de sécurité.

En plus, des dispositifs venant d'être décrits et qui sont connectés aux bus 60r 62 et 64, il y a une mémoire morte 80 de signes. Selon l'invention, dans la mémoire 80 est constamment stockée une représentation, ou copie, de la configuration fixe 19 (illustrée en figure 2) des signes postaux 18.

Comme on l'a décrit ci-dessus, dans le présent mode de réalisation la configuration 19 est stockée sous forme d'une série de multiplets représentatifs de la configuration de la matrice à points nécessaire pour l'impression de la configuration 19. Les multiplets représentatifs de cette configuration 19 peuvent être fournis à l'unité 54 par l'appareil 52 pour chaque signe imprimé. Ainsi, on obtient un degré élevé de sécurité dans l'utilisation du système 50, en ce sens que le format graphique des signes postaux ne peut être reproduit volontairement ou par inadvertance par l'unité 54 à moins que l'appareil 52 soit fixé à celle-ci et, de plus, à moins que la communication nécessaire entre les deux modules soit effectuée d'une manière prédéfinie et spécifique. Ainsi, la comptabilisation par l'appareil 52 de chaque signe postal imprimé est assurée.

Comme on peut le remarquer, la mise en œuvre de cet aspect de la présente invention peut s'effectuer de différentes manières. Par exemple, la configuration fixe 19 peut être stockée dans une mémoire morte 80 de manière cryptée dans le but de conférer un degré de sécurité encore plus grand. A titre d'autre exemple, la configuration fixe 19 pourrait être stokée dans la mémoire morte 80 sous forme de donnée prédéterminée d'une séquence permettant de produire la configuration graphique des signes lorsqu'on agit sur la donnée par une formule mathématique stockée dans l'appareil 52 ou l'ensemble 54.

A titre d'autre exemple de l'utilisation de cet aspect de la présente invention, la représentation des signes dans la mémoire morte 80 peut être fournie par l'appareil 52 à l'ensemble 54 pour stockage. La représentation des signes serait fournie dès que le système 50 est d'abord excité et préparé pour utilisation. Ainsi, comme l'ensemble central 54 conservera une copie des signes pendant l'utilisation du système 50, la quantité des données, devant être transférée lors de chaque opération d'Impression des signes, sera sensiblement réduite.

Dans le but de fournir un moyen efficace à haute vitesse pour te transfert entre l'appareil 52 et l'unité 54 du montant éventuellement important des données, il faut un moyen de communication de données à haute vitesse. Ce moyen de communication est fourni par une interface 82 inter-unités centrales qui couple l'unité centrale 58 à une unité centrale de commande 84 située dans l'appareil 54. Le fonctionnement de l'interface 82 sera décrit ultérieurement.

La fonction de l'unité centrale 84 est de commander l'impression de signes postaux sur un document (non représenté en figure 5) par le module 56 de l'imprimante en réponse à la position du document et aux entrées de synchronisation du système qui sont fournies par une machine d'expédition (non représentée) couplée à l'unité 54. De telles machines d'expédition comprennent généralement des dispositifs d'introduction de documents et des convoyeurs et fonctionnent pour recueillir les documents afin de les insérer dans une enveloppe, l'enveloppe étant alors imprimée avec l'affranchissement correct dont la valeur a été prédéterminée. Dans une machine d'expédition à haute vitesse, il peut y avoir trois enveloppes ou plus par seconde sur lesquelles on doit procéder à l'impression de l'affranchissement. Un tel fonctionnement à haute vitesse nécessite un fonctionnement de l'unité centrale 84 dans un environnement en «temps réel» et, par conséquent, cette unité doit permettre ce fonctionnement. Un type approprié de miGro-processeur pour une felle application fait partie de la famille 68 000 des micro-processeurs, tels que ceux fabriqués par ta société dite Motorola Corporation ainsi que par d'autres constructeurs.

A l'unité centrale 84 sont connectés une multitude de bus, c'est-à-dire un bus de commande 86, un bus de données 88 et un bus d'adresses 90 pour coupler l'unité 84 à une multitude de mémoires et de dispositifs E/S.

Un bloc 92 contenant une logique de décodage permet de décoder les bus d'adresses 90 et de commande 86, d'une manière bien connue, de façon à produire un signal d'une multitude de signaux (non représentés) de sélection de dispositifs pour activer le dispositif correct qui est connecté aux bus 86,88 et 90.

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Une mémoire morte d'instructions 94 contient les instructions et les constantes de fonctionnement dont a besoin l'unité centrale 84 pour exécuter sa fonction de commande de l'impression des signes postaux. Une mémoire de travail 96 est utilisée par l'unité 84 pour contenir des données variables temporaires nécessaires au fonctionnement.

De manière à fournir à l'unité 84 un moyen pour communiquer avec la machine d'expédition et d'autres dispositifs extérieurs, un bloc 98 «logique de synchronisation et de vérification» et un bloc 102 «logique d'entrée d'affranchissement» sont prévus. Le but de la logique 98 est de fournir à l'unité centrale 84 des entrées en provenance de la machine d'expédition (non représentée), de telles entrées étant représentatives d'informations temporelles et de position relatives aux documents traités par la machine d'expédition. De plus, la logique 98 sert à sortir les signaux de commande entre l'unité centrale 84 et la machine d'expédition (non représentée).

La logique 102 d'entrée d'affranchissement permet l'entrée de la donnée représentative du montant en dollars de l'affranchissement nécessaire à chaque document. Cette entrée peut être fournie, par exemple, par un clavier d'opérateur ou par la sortie d'une machine pesant les documents. La valeur de l'affranchissement nécessaire pour chaque document est fournie par l'unité centrale 84 à l'unité centrale 58, comme on l'a décrit précédemment, de façon que l'appareil 52 puisse tenir compte du montant.

En plus des blocs logiques venant d'être décrits, une liaison de communication 100, ou bloc logique de communication, est fournie pour interconnecter l'unité centrale 84 aux autres dispositifs au moyen d'une liaison standard de communication, telle que la liaison RS-232-C ou IEEE-488 ou quelque autre voie de communication en série ou en parallèle d'utilisation générale. A titre d'exemples de dispositifs qui peuvent être connectés à la liaison 100, on peut citer une imprimante pour l'impression de l'état du système et d'une information comptable ou un modem permettant des communications téléphoniques avec un ordinateur central, tel qu'un ordinateur de comptabilisation de dispositif postal.

De façon à fournir à l'unité centrale 84 l'aptitude à exercer l'une de ses fonctions de base, c'est-à-dire, l'impression de signes postaux, un dispositif 104 d'accès direct en mémoire à haute vitesse est prévu pour coupler les bus 86, 88 et 90 au module 56 de l'imprimante à jets d'encre. Comme cela est bien connu, un tel dispositif fonctionne généralement pour transférer des données sans l'intervention du micro-processeur du système, entre un dispositif E/S, tel que le module 56 et la mémoire du mi-cro-processeur.

En fonctionnement, l'unité centrale 84 peut stocker temporairement dans la mémoire à accès direct 96 les multiplets des données représentatifs de la configuration fixe des signes postaux fournis par l'appareil 52 et, de plus, les données représentatives des parties variables telles que le montant de l'affranchissement 22 et la date 23 (comme cela est représenté en figure 2). Les signes complets seraient ainsi représentés par une pluralité de multiplets décrivant, par exemple, la configuration de la matrice à points nécessaire pour former les signes 18. Le dispositif 104, après activation par l'unité centrale 84, fonctionne pour fournir automatiquement au module 56 la donnée sur la matrice de signes en provenance de la mémoire 96 pour impression sur un document.

Comme on l'a décrit précédemment, un aspect du présent mode de réalisation de l'invention est la possibilité de transférer rapidement de grands blocs de données, tels que la représentation de la matrice de la partie fixe 19 des signes 18, entre l'appareil 52 et l'unité 54. Comme cela est décrit ici, la présente invention comporte un moyen de transfert de blocs de données qui fait appel à une technique d'échange de mémoires à accès direct, ou de permutation.

En figure 6, on a représenté un schéma sous forme de blocs de l'interface 82 inter-UC de la figure 5. L'interface 82 comprend un multiplexeur 110 de bus d'adresses et de bus de commande pour connecter de façon contrôlable le bus 60 de commande de l'appareil 52 soit à un premier bus 114 de commande d'une mémoire à accès direct 112 de communication, soit à un second bus 118 de commande d'une mémoire à accès direct de communication 116 et, de plus, pour connecter simultanément le bus 64 d'adresses de l'appareil 52 soit au bus 120 d'adresses de la mémoire 112, soit au bus 122 d'adresses de la mémoire 116.

Le multiplexeur 110 peut en outre fonctionner pour connecter simultanément le bus 86 de commande de l'appareil 54 soit au bus 114 de commande de la mémoire 112, soitau bus 118 de commande de la mémoire 116 et, de plus, pour connecter simultanément le bus d'adresses 90 de l'appareil 54 soit au bus d'adresses 120 de la mémoire 112, soit au bus d'adresses 122 de la mémoire 116. Comme on peut le remarquer, le multiplexeur 110 fonctionne de façon que, lorsque l'appareil 52 est connecté à la mémoire 112, l'appareil 54 est connecté à la mémoire 116 et, en variante, lorsque l'appareil 52 est connecté à la mémoire 116, l'appareil 54 est connecté à la mémoire 112. Un multiplexeur de données 124 fonctionne d'une façon similaire pour connecter le bus de données 62 de l'appareil 52 à un bus de données 126 de la mémoire 112 ou à une bus de données 128 de la mémoire 116. Le bus de données 88 de l'appareil 54 est connecté d'une façon similaire soit à la mémoire 112, soit à la mémoire 116. Les multiplexeurs 110 et 124 sont commandés par un signal 130 MUXCTRL qui est produit par un bloc logique 132 de commande de multiplexeur. La commande 132 répond aux entrées VRW134 (lecture/ écriture d'appareil), HRW136 (lecture/écriture d'unité centrale), VCRSEL138 (sélection de registre de communication d'appareil) et HCRSEL140 (sélection de registre de communication d'unité centrale), les entrées activant la commande 132 pour permuter les mémoires 112 et 116 entre l'appareil 52 et l'unité centrale 54. Pour faciliter cette permutation des mémoires 112 et 116, on a prévu un registre 142 de communication d'appareil à un multiplet et un registre 144 de communication d'unité centrale à un multiplet. Le registre 142 peut être mis en œuvre pour être écrit par l'unité centrale 54 et lu par l'appareil 52. Le refi

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gìstre 144 peut être mis en œuvre pour être écrit par l'appareil 52 et lu par l'unité centrale 54.

Généralement, l'appareil 52 et l'unité 54 lisent leurs registres respectifs de communication afin de déterminer si un code d'état à sept bits y a été écrit par l'autre. Le huitième bit de chaque registre de communication indique l'état courant de la commande 132 par rapport à un cycle de permutation de mémoires, comme cela sera décrit en détail ci-après. Le code d'état, par exemple, peut être la description du type de donnée qui a été stockée dans l'une des mémoires 112 ou 116. Si, par exemple, un code d'état est détecté par l'unité 54 qui indique que l'appareil 52 a stocké un bloc de données dans l'une dès mémoires 112 ou 116, l'appareil 54 répondra en écrivant dans le registre 142. L'écriture est effectuée par la commande 132 qui active une ligne 146. Si l'on suppose que l'appareil 52 a déjà écrit dans le registre 144, une permutation de mémoires à accès direct sera effectuée automatiquement par la commande 132. Si l'appareil 52 n'a pas encore écrit dans le registre 144, la permutation restera en attente jusqu'à ce qu'il y ait écriture dans le registre 144 par l'appareil 52. L'écriture dans le registre 144 est effectuée par la commande 132 qui active une ligne 148. Après exécution de la permutation par la commande 132, la mémoire qui a été précédemment chargée avec une donnée par l'appareil 52 sera connectée à l'unité centrale 54, ce qui permet à cette unité de lire la donnée qu'elle contient.

Selon un procédé de transfert d'un bloc de données entre deux moyens de traitement, procédé qui est une caractéristique de la présente invention, on présentera maintenant un résumé de l'opération venant d'être décrite de l'interface 82 inter-UC. En liaison avec la figure 7, et plus particulièrement avec la figure 7A, l'appareil 52 charge d'abord un bloc de donnée 107, donnée qui peut être la représentation par matrice à points de la configuration fixe des signes postaux dans, par exemple, la mémoire à accès direct 112. Un bloc de donnée peut comprendre un multiplet jusqu'à un certain nombre de multiplets qui peuvent être stockés dans la mémoire 112, soit dans le présent mode de réalisation 2047 multiplets. La donnée 107 est chargée via les bus 60, 64 et 62 (appelés collectivement bus 109), le bus 109 étant couplé par l'intermédiaire du multiplexeur 110 et du multiplexeur 124, représentés sché-matiquement figure 7A par des commutateurs 111, aux bus d'adresses 120, de commande 114 et de données 126 de la mémoire 112, représentés collectivement par un bus 113.

En liaison maintenant avec la figure 7B, après écriture de la donnée 107 dans la mémoire 112, l'appareil 52 écrit un code de communication approprié, comme indiqué par la ligne 115, dans le registre 144. L'écriture du code de communication 115 est détectée par la commande 132, comme indiqué par une ligne 117, armant la commande 132 pour qu'il y ait réponse à une écriture ultérieure par l'unité 54 dans le registre 142. De plus, le code de communication écrit par l'appareil 52 dans le registre 144 peut être lu ensuite par l'appareil 54, comme indiqué par une ligne 119.

En liaison maintenant avec la figure 7C, après lecture du code de communication écrit dans le registre 144, l'unité 54 répond en écrivant un code approprié de communication dans le registre 142, comme indiqué par la ligne 121, L'écriture de ce code de communication 121 est détectée par la commande 132, comme indiqué par la ligne 132. Dans la mesure où la commande 132 a été précédemment armée par la ligne 117, la comme 132 est activée pour inverser les connexions du multiplexeur 111 à l'issue du cycle d'écriture du code 121. De plus, le-code 121 écrit dans le registre 142 par l'unité 54 peut ensuite être lu par l'appareil 52, comme indiqué par une ligne 125.

En liaison maintenant avec la figure 7D, on peut voir qu'à l'issue du cycle d'écriture du code 121 (représenté en figure 7G), tes connexions effectuées par les commutateurs 111 ont été inversées par la commande 132 de sorte que la mémoire 112 est connectée à l'unité 54 et la mémoire 116 l'est à l'appareil 52, L'unité 54 est validée ce qui permet de lire le bloc de données 107 précédemment stocké dans la mémoire 112 par l'appareil 52, la donnée 107 étant lue via les bus 86, 90 et 88 (représentés collectivement par le bus 129), le bus 129 étant couplé par l'intermédiaire des commutateurs 111 à partir de la ligne 113 de la mémoire 112.

Comme on peut le remarquer, alors que l'unité 54 lit la donnée 107, l'appareil 52 peut charger simultanément un autre bloc de données (non représenté) dans la mémoire 116, cet autre bloc pouvant être ensuite lu par l'unité 54 après la donnée 107. D'une façon similaire, et en liaison avec la figure 7A. L'unité 54 peut charger un bloc de données (non représenté) dans la mémoire 116 simultanément au chargement de la mémoire 112 par l'appareil 52.

Le fonctionnement de l'interface 82, qui constitue l'un des aspects de la présente invention, présente plusieurs avantages par rapport aux autres lignes de communication UC.

L'un des avantages est que chaque UC, à savoir l'unité centrale 58 et l'unité centrale 84, peut écrire et lire à partir d'une mémoire à accès direct de communication qui est connectée à elle sans interférence de la part de l'autre unité centrale. Ainsi aucun arbitrage des accès en mémoire n'est nécessaire et, par conséquent, il n'y a aucun temps supplémentaire d'accès en mémoire dû à un tel arbitrage.

Un autre avantage est de chaque unité centrale a accès à la totalité du contenu de la mémoire de communication connectée à cette unité, ce qui simplifie la nature du programme de logiciel qui commande de tels accès.

Un autre avantage de l'interface 82 de la présente invention est que son utilisation assure une sécurité supplémentaire entre l'unité 54 et l'appareil 52 dans la mesure où l'accès à l'appareil 52 ne peut être obtenu sauf si l'appareil 52 accorde un tel accès en écrivant dans le registre 144. Les codes de communication cités ci-dessus, qui sont écrits par l'unité 54 pour avoir accès à la donnée de l'appareil qui est stockée dans ta mémoire à accès direct de communication peuvent en outre être de nature cryptée, renforçant encore la sécurité de cette donnée. On remarquera également que l'unité 54 n'a qu'un accès limité à la donnée dans l'appareil 52, cet

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accès étant limité à la donnée fournie par l'appareil 52 dans une mémoire à accès direct de communication. Ainsi, la possibilité que l'unité 52 puisse modifier volontairement ou par inadvertance ou effacer ia valeur de comptabilisation précieuse qui est stockée dans la mémoire 68 ou dans la mémoire 70 se trouve évitée.

En liaison maintenant avec les figures 8, 9 et 10, on a représenté schématiquement l'interface 82 inter-UC. De manière à faciliter la description du fonctionnement du circuit logique illustré, un signal logique 1 sera appelé signal «haut» et un signal logique 0 signal «bas». De plus, si on dit d'un signal qu'il est affirmé, on suppose qu'il est bas. D'une façon similaire, si on dit d'un signal qu'il n'est pas affirmé, on suppose qu'il est haut.

En liaison tout d'abord avec la figure 8, on a représenté la mémoire à accès direct de communication 112 et la mémoire à accès direct de communication 116. Grâce aux 11 lignes d'adresses connectées à chaque mémoire, VMAO à VMA10 et HMAO à HMA10, respectivement, les mémoires 112 et 116 sont chacune capables de stocker 2048 multiplets de données, dont 2047 seulement sont utilisés, comme on le décrira ci-dessous. En plus des bus d'adresses 120 et 122, chaque mémoire 112 et 116 comporte en outre un bus de commande 114 et 118, respectivement, un bus de données 126 et 128, respectivement.

Le bus de commande 114 est constitué de signaux VMCE150 (validation puce), VMRW152 (lecture/ écriture), et VMOE154 (validation sortie). Le signal 150 étant affirmé, choisit la mémoire 112 pour fonctionnement. Le signal 152 étant affirmé en conjonction avec le signal 150, lors d'un cycle d'écriture en mémoire à accès direct, active la mémoire 112 pour stocker la donnée présente sur le bus 126 dans l'emplacement choisi par le bus d'adresses 120. Le signal 154 étant affirmé en conjonction avec le signal 150, lors d'un cycle de lecture de mémoire à accès direct, active une multitude de circuits d'attaque (non représentés) de bus de données dans la mémoire 112, ce qui a pour effet qu'ils sortent sur le bus 126 la donnée située dans l'emplacement choisi par le bus 120. Le fonctionnement du bus d'adresses 122, du bus de commande 118 et du bus de données 128 de la mémoire 116 est identique à celui décrit ci-dessus en liaison avec la mémoire 112.

En figure 9, on a représenté le multiplexeur 110 d'adresses et de commande qui comprend une multitude de multiplexeurs 162 à 176 à deux entrées et une sortie. En fonctionnement, un tel multiplexeur (par exemple, multiplexeur 162) sortira de la sortie 1Y soit la donnée apparaissant à l'entrée 1A ou 1B, selon que l'entrée de commande S (sélecteur) est au niveau haut ou au niveau bas. Typiquement, lorsque l'entrée S est au niveau bas, la donnée appliquée à l'entrée 1A apparaîtra à la sortie 1Y. Lorsque l'entrée S est au niveau haut, la donnée apparaissant à l'entrée 1B apparaîtra à la sortie 1Y. D'une façon correspondante, la donnée apparaîsant aux entrées 2A ou 2B apparaîtra à la sortie 2Y, etc...

Comme on l'a représente, les multiplexeurs 162 à 168 ont leurs entrées A connectées aux bus 64 et 60, alors que les entrées B le sont aux bus 90 et 86.

Les sorties Y des multiplexeurs 162 à 168 sont connectées au bus 120 et au bus 114 de la mémoire à accès direct 112.

On peut voir que les multiplexeurs 170 à 176 ont leurs entrées A connectées au bus 90 et au bus 86 et leurs entrées B aux bus 64 et 60. Les sorties Y des multiplexeurs 170 à 176 sont connectées aux bus 122 et 118 de la mémoire à accès direct 116. Ainsi, on peut voir que lorsque le signal 130, qui est appliqué en commun aux entrées de commande S des multiplexeurs 162 à 176, est au niveau bas que le bus d'adresses 120 et le bus de commande 114 de la mémoire 112 seront entraînés par les bus 64 et 60, respectivement, par l'intermédiaire des multiplexeurs 162 à 168. D'une façon similaire, le bus d'adresses 122 et le bus de commande 118 de ta mémoire à accès direct 116 seront entraînés par les bus 90 et 86, respectivement, par l'intermédiaire des multiplexeurs 170 et 176. Lorsque le signal 130 est haut, la situation opposée se produit, c'est-à-dire que la mémoire 112 sera entraînée par le bus 90 et le bus 86 alors que la mémoire 116 le sera par le bus 64 et le bus 60. De manière à permettre aux multiplexeurs 162 à 176 d'entraîner leurs sorties respectives, une broche de validation de sortie de niveau bas de chaque multiplexeur est connectée en commun à la masse du circuit via une ligne 178.

Le multiplexeur 110 comprend en outre une porte NON ET 180 ayant onze entrées, chaque entrée étant connectée à une ligne d'adresses VA0 à VA10 du bus 64. La sortie de la porte 180 passera au niveau bas lorsque le bus 64 est égal à l'hexadécimal d'adresses 7FF, ce qui affirme te signal 138. D'une façon similaire, une porte NON ET 182 est connectée aux lignes individuelles d'adresses HAO à HA10 du bus 90, ce qui affirme le signal 140 lorsque le bus 90 est égal à l'hexadécimal 7FF. Ainsi, on peut voir que l'adresse des registres de communication, à savoir le registre 142 et le registre 144, chevauchent celle des mémoires 112 et 116. Plus spécifiquement, l'emplacement adressable le plus haut de chaque mémoire à accès direct est réellement l'adresse d'un registre de communication 142 ou 144. Le but d'un tel chevauchement d'adresses apparaîtra lors de la description de la commande 132 des multiplexeurs.

En liaison maintenant avec la figure 10, on a représenté le multiplexeur de données 124 et la commande de multiplexeur 132. Le multiplexeur 124 est constitué de quatre émetteurs-récepteurs de bus 184,186,188 et 190 pour coupler sélectivement les bus de données 126 et 128 des mémoires à accès direct 112 et 116 à chacun des bus de données 62 ou 88. Le sens du train de données dans les émetteurs-récepteurs 184 et 190 est choisi par l'état de la ligne 152, le sens du train allant du bus 62 à la mémoire 112 ou 116 alors qu'il y a un cycle d'écriture de la mémoire à accès direct de l'appareil 52. Le train de données dans les émetteurs-récepteurs 184 et 190 a lieu entre la mémoire 112 ou 116 et le bus 62 lors d'un cycle de lecture de la mémoire de l'appareil 52. Les émetteurs-récepteurs 186 et 188 sont commandés de façon similaire par l'état du bus 158 afin de coupler le bus 88 soit à la mémoire 112, soit à la mémoire 116.

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La sélection des émetteurs-récepteurs qui sont activés, c'est-à-dîre, ceux qui ont une entrée de validation (EN) basse, est faite par l'état du signal 130 en conjonction avec l'inverseur 198 et des portes NON ET 204n, 204o, 204p et 204g.

Comme on peut le voir, lorsque le signal 130 est bas, l'entrée de validation de Pémetteur-récepteur 184 est rendue basse par la sortie 254 de la porte 204nr en conjonction avec la sortie 256 de l'inverseur 198 et avec la non affirmation du signal 138. D'une façon similaire, l'émetteur-récepteur 188 est validé par la sortie 258 de la porte 204p en conjonction avec la sortie 256 et la non affirmation du signal 140. Ainsi, le bus 62 est couplé à la mémoire 112 et le bus 88 l'est à la mémoire 116. Le signal 130, étant au niveau bas, provoque un niveau haut sur les sorties 260 et 262 des portes 204o et 204g, respectivement, ce qui invalide les émetteurs-récepteurs 186 et 190.

Lorsque le signal 130 est haut, la sortie 256 de l'inverseur 198 est basse, ce qui invalide les émetteurs-récepteurs 184 et 188 par l'intermédiaire 204n et 204p, tout en validant simultanément rémetteur-récepteur 186 par l'intermédiaire de la porte 204n et l'émetteur-récepteur 190 par l'intermédiaire de la porte 204q. Ainsi, on peut voir que lorsque le signal 130 est haut, le bus 62 est connecté à la mémoire 116 par l'intermédiaire de l'émetteur-récepteur 190 et le bus 88 l'est à la mémoire 112 par l'intermédiaire de l'émetteur-récepteur 186.

Comme on l'a indiqué précédemment, les adresses du registre 142 et du registre 144 chevauchent celles des mémoires 112 et 116. De manière à éviter une situation d'encombrement des bus lorsque l'appareil 52 ou l'ensemble 54 lisent leurs registres respectifs de communication, il est nécessaire d'invalider l'émetteur-récepteur 184 par l'intermédiaire de 190 à ce moment là. Cela est effectué par les signaux 138 et 140 inclus comme entrées aux portes 204n à 204g.

Par exemple, le signal 138 est affirmé pendant une lecture du registre 142 par l'appareil 52. Le signal 138 est appliqué à la commande de sortie du registre 142 afin de valider les circuits d'attaque de bus pour entraîner le bus 62, d'où la sortie de la donnée précédemment stockée dans le registre 142 par l'ensemble 54, Les deux émetteurs-récepteurs de l'appareil, c'est-à-dire 184 et 190, sont invalidés lorsque le signal 138 est affirmé par le passage à l'état haut des sorties 254 et 262. Ainsi, seul le registre 142 sera validé pour entraîner le bus 62. Lors de la lecture du registre 144 par l'ensemble central 54, le signal 140 qui est affirmé invalide de manière similaire les émetteurs-récepteurs 186 et 188 via les portes 204o et 204b, ce qui permet au signal 140 de valider seulement le registre 144 pour attaquer le bus 88.

En liaison maintenant avec la commande de multiplexeurs 132 illustrée dans la partie inférieure de la figure 9, on peut voir que la commande 132 est constituée d'un bloc logique pour combinaison ayant une variété de types d'éléments logiques interconnectés de manière à exécuter la fonction souhaitée. Fondamentalement, cette fonction consiste à commander l'état du signal 130 de manière à coupler sélectivement les mémoires 112 et 116 soit à l'appareil 52, soit à l'ensemble central 54. Une autre fonction assurée par la commandé 132 est de contrôler le fonctionnement des registres de communication 142 et 144 et, de plus, d'exécuter une permutation des mémoires 112 et 116 lorsque chacun des registres de communication 142 et 144 a été écrit par l'ensemble 54 et l'appareil 52, respectivement.

Comme on peut le voir en figure 10, la commande 132 est en outre constituée d'une première et d'une seconde bascule de charge-remise à zéro 221 et

223 qui sont constituées de portes NON ET croisées 204c, 204d, 204e et 204f. La bascule 221 a une sortie 222 et la bascule 223 a une sortie 224. De plus, la commande 132 a une bascule 225 constituée de portes NON ET 204g à 2041 et d'inverseurs 202c, 202d et 202e. Une sortie 226 de la bascule 225 est fournie par une porte XOU 208 et une porte NON ET 204m.

De manière à faciliter la description du fonctionnement de la commande 132, on supposera que la signal 130 est bas, ce qui a pour effet de coupler l'appareil 52 à la mémoire à accès direct 112 et l'ensemble central 54 à la mémoire à accès direct 166, comme on l'a décrit précédemment. On supposera aussi que les sorties 222 et 224 sont au niveau bas et que la sortie 226 est au niveau haut.

Supposons maintenant que l'ensemble 54 désire initialiser une permutation des mémoires, l'ensemble 54 écrira un code approprié pour le registre 142. Cela est effectué lorsque l'ensemble central 54 place une donnée sur le bus 88 et affirme le signal 140 en conjonction avec le signal 136, étant rappelé que ces deux signaux sont affirmés lorsque l'ensemble 54 adresse l'adresse 7FF de la mémoire à accès direct lors d'un cycle d'écriture. Le signal 136 et le signal 140 étant affirmés ont pour effet que la sortie 212 de la porte OU 200b passe au niveau bas, cette sortie de niveau bas étant inversée par l'inverseur 202b pour apparaître à l'état haut à la sortie 228 de l'inverseur 202b,

La sortie 228 est connectée à une entrée de la porte OU 200d, l'autre entrée de la porte 200d étant connectée à la sortie 224 de la bascule 223, sortie

224 qui est au niveau bas à ce moment là. L'application de la sortie haute 228 a pour effet que la sortie 230 de la porte 200d passe au niveau haut, sortie 230 qui est appliquée à une entrée de la porte NON ET 204b. L'autre entrée de la porte 204b est connectée à la sortie 226 de la bascule 225, sortie 226 qui est à l'état haut à ce moment là. Les deux entrées de la porte 204b étant au niveau haut auront pour effet que la sortie 232 passera au niveau bas, ce qui à son tour provoque le changement d'état de la sortie 224 de la bascule 223 et son passage au niveau haut. Ce niveau haut est renvoyé à ia porte OU 200d de sorte qu'à l'issue d'un cycle d'écriture de l'ensemble 54, la sortie 224 restera au niveau haut. L'achèvement du cycle d'écriture de l'ensemble 54 provoquera le retour de la sortie 212 au niveau haut. Le front de montée de ce signal à la sortie 212 active l'entrée d'horloge du registre 142, ce qui provoque le stockage par le registre 142 du code de donnée cité ci-dessus, présent sur le bus 88.

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A l'achèvement du cycle d'écriture de l'ensemble central venant d'être décrit, la commande 132 peut être dite «armée», c'est-à-dire qu'une écriture ultérieure dans le registre 144 provoquera le changement d'état du signal 130, d'où l'activation des multiplexeurs 110 et 124 pour permuter les mémoires 112 et 116 entre l'appareil 52 et l'ensemble central 54.

De manière à procéder à une écriture dans le registre 144, l'appareil 52 affirme le signal 138 en conjonction avec le signal 134, l'affirmation de ces deux signaux provoquant le passage à l'état bas de la sortie 216 de la porte OU 200a. Le niveau bas sur la sortie 216 est inversé par l'inverseur 202a et appliqué comme étant haut à une entrée 234 de la porte OU 200c. La sortie 236 de la porte OU 200c est appliquée à une entrée de la porte NON ET 204a, l'autre entrée de la porte NON ET 204 étant déjà au niveau haut par suite de la sortie 226 de la bascule 225. La sortie 238 de la porte NON ET 204 passe ensuite à l'état bas, sortie 238 qui provoque le passage à l'état haut de la sortie 222 de la bascule 221. Cet état haut est renvoyé à la porte OU 200c de sorte qu'à la fin du cycle d'écriture de l'appareil 52, la sortie 222 restera au niveau haut.

Une porte NON ET 206 à quatre entrées a comme entrées la sortie 222 de la bascule 221, la sortie 224 de la bascule 223, la sortie 212 de la porte OU 200b et la sortie 216 de la porte OU 200a. Ainsi, on peut voir qu'aussitôt après les cycles d'écriture de l'ensemble 54 et de l'appareil 52 décrits ci-dessus, la sortie 220 de la porte NON ET 206 passe au niveau haut. La sortie 220 est appliquée comme seule entrée à la bacule 225 et, de plus, est une entrée à la mémoire 240 d'état de la permutation de l'appareil, constituée des portes NON OU 196a et 196b et, aussi à une bascule 242 d'état de permutation de l'ensemble central, constituée des portes NON OU 196c et 196d,

Le but de la mémoire d'état 240 est de fournir un bit indicateur, ou d'état, à l'appareil 52. L'état du bit d'état est représentatif du fait que l'ensemble central 54 a écrit un mot d'état dans le registre 142 et, de plus, du fait qu'une permutation de mémoire s'est produite.

En marche, une sortie 254 de la mémoire d'état 240 est normalement à l'état haut par suite de l'état normal des entrées aux portes NON OU 196a et 196b. Comme on peut le voir, une entrée à la porte NON OU 196b est la sortie 228 de l'inverseur 202b, sortie qui passe à l'état haut seulement lors d'un cycle d'écriture par l'ensemble 54 dans le registre 142. La sortie 254 de la porte NON OU 196b est normalement à l'état haut, sortie qui est appliquée comme entrée à un tampon de bus 192 et, de plus, comme entrée à la porte NON OU 196a. L'autre entrée à la porte NON OU 196, comme on l'a indiqué précédemment, est la sortie normalement basse 220 de la porte ET 206. Lors d'un cycle d'écriture de l'ensemble 54 dans le registre 142, la sortie 228 passera au niveau haut, sortie 228 qui provoquera le passage à l'état bas de la sortie 254. Cet état bas étant renvoyé à la porte NON OU 196a, aura pour effet que la sortie 254 restera au niveau bas après le cycle d'écriture de l'ensemble 54 cité ci-dessus. La sortie 258 du tampon 192 est connectée à VD7 du bus 62. Une entrée de validation du tampon 192 est connectée à la sortie 138, sortie qui est au niveau bas lors d'une lecture du registre 142 par l'appareil 52. Ainsi, le mot d'état lu à partir du registre 142 est constitué de sept bits d'une donnée strockée dans le registre 142 par l'ensemble 54 et, de plus, d'un huitième bit de donnée qui est l'état de ia mémoire d'état 142. En surveillant l'état de la sortie 258, l'appareil 52 peut déterminer si l'ensemble 54 a procédé à une écriture dans le registre 142, armant ainsi, ou initialisant, une permutation des mémoires. La mémoire d'état 240 est remise à son état de sortie normalement haut lorsque la sortie 220 de la porte ET 206 passe au niveau haut, la sortie étant à l'état haut lors d'une permutation des mémoires, comme le décrira plus pleinement ci-dessous. Ainsi, l'appareil 52 peut également déterminer, en surveillant la sortie 258, le moment ou une permutation des mémoires s'est produite.

Le fonctionnement de la mémoire d'état 242 est semblable à celui de la mémoire 240. Comme on peut le voir, la sortie 234 est connectée comme entrée à la porte NON OU 196d pour changer la sortie 256 de la mémoire 242, l'état de la sortie 256 étant rendu disponible pour l'ensemble 54 par l'intermédiaire de la sortie 260 du tampon 194.

De manière à faciliter la description du fonctionnement de la bascule 225, on se reportera aux quatre tableaux suivants, à savoir les tableaux 1 à 4 dans lesquels les états de sortie de certains dispositifs logiques sont indiqués. On supposera les conditions initiales suivantes, celles-ci étant indiquées dans le tableau 1: Le signal 130 de sortie de la bascule 225 est bas, la sortie 226 est haute et la sortie 220 de la porte NON ET 206 est basse.

En liaison maintenant avec le tableau 2, on peut voir que, lorsque la sortie 220 passe au niveau haut, ce qui indique que l'appareil 52 et l'ensemble 54 ont écrit dans les registres de communication 144 et 142, respectivement, la bascule 225 a pour effet que le signal 130 passse de l'état bas à l'état haut. Ainsi, les multiplexeurs 110 et 124 sont amenés à connecter l'appareil 52 à la mémoire 112, comme on l'a décrit ci-dessus. On peut voir en outre que la sortie 226 est amenée à passer à l'état bas. La sortie 226 devenant basse provoque à son tour la remise à zéro des deux bascules 221 et 223, ce qui a pour effet que les sorties 222 et 224 passent également à l'état bas. Dans la mesure ou les sorties 221 et 223 sont des entrées à la porte NON ET 206, la sortie 220 revient également à l'état bas. Ainsi, aussitôt après le passage à l'état haut de la sortie 220, celle-ci revient à un état bas par suite de l'action de la bascule 225. L'intervalle de temps pendant lequel la sortie 220 reste à l'état haut est déterminé par les temps de propagation des éléments logiques constituant la bascule 225 et les bascules 221 et 223, un temps typique étant de 50 nanosecondes.

En liaison maintenant avec le tableau 3, on a illustré les états des diverses sorties constituant la bascule 225 aussitôt après le retour à l'état bas de la sortie 220. Comme on peut le voir, le signal 130 reste à l'état haut, ce qui est le résultat souhaité. On peut voir également que la sortie 226 est revenue à l'état haut, ce qui a pour effet de permettre de

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nouveau la charge des bascules 221 et 223 par l'appareil 52 et l'ensemble central 54.

En liaison maintenant avec le tableau 4, on a représenté un autre cycle de permutation des mémoires, dans lequel l'appareil 52 et l'ensemble 54 ont de nouveau écrit dans tes registres de communication 144 et 142, respectivement Comme on peut le voir, le signal 130 passe de nouveau au niveau bas, ce qui a pour effet d'activer les multiplexeurs 110 et 124 comme on l'a déjà décrit. Comme on peut le voir, la sortie 226 est de nouveau à l'état bas, état bas qui remet à zéro tes bascules 221 et 223, comme on t'a décrit ci-dessus en liaison avec la tableau 2.

Tableau 1

Sortie

Etat

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Tableau 2

Sortie

Etat

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Tableau 3

Sortie

Etat

130

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BAS

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Tableau 4

Sortie

Etat

130

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Bien que l'interface 82 inter-UC ait été décrite ci-dessus comme constituée d'éléments logiques discrets, on doit remarquer que le circuit ainsi contenu convient à une fabrication comme circuit intégré dans laquelle les dispositifs logiques individuels telles que les portes NON ET et les Inverseurs sont fabriqués sur un substrat commun contenu dans un boîtier unique. On peut également remarquer que le circuit qui comprend l'appareil 52 peut aussi être fabriqué comme étant un ou plusieurs dispositifs à circuits intégrés, ce qui permet d'obtenir une réduction des dimensions, de la consommation d'énergie et des coûts de fabrication. De plus, un tel ou de tels dispositifs à circuits intégrés peuvent être conditionnés dans diverses enceintes de faible dimension, bon marché.

Une enceinte 300 pour appareil est illustrée en figure 11, dans laquelle les circuits de l'appareil 52 sont intégrés dans un seul circuit 302 à intégration à grande échelle ayant les mêmes fonctions que l'appareil 52 de la figure 5. Comme on peut le voir, le circuit 302 est constitué d'un mircro-processeur 304, d'une logique de sécurité 306, d'une mémoire réma5

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nente 308, d'une mémoire à accès direct 310, d'une mémoire morte de programme 312, d'une mémoire de travail 314, d'une horloge/calendrier 316 et d'une mémoire morte de signes 318. De plus, le circuit 302 comprend une interface 320 inter-UC pour communication avec un système centrai 322, système qui peut être une machine d'expédition du courrier ayant un module d'imprimante à jet d'encre de haute vitesse (non représenté) pour appliquer des signes postaux à un document (non représenté).

L'enceinte 300 peut avoir les dimensions physiques d'une carte de crédit typique et être constituée de feuilletés d'un matériau isolant rigide ou semi-rigide pour protéger le dispositif 302 contre la contamination de l'environnement ainsi que pour fournir une isolation électrique. L'enceinte 300 peut comporter également une multitude de conducteurs 324 exposés sur la surface extérieure de manière à coupler l'interface 320 à l'unité centrale 322.

En fonctionnement, le module 300 peut être inséré dans une enceinte appariée 326 comportant l'unité centrale 322, les conducteurs réalisant le contact avec une multitude de conducteurs similaires 328 pour coupler l'unité centrale 330 au circuit 302 à intégration à grande échelle de l'appareil.

Les avantages d'enfermer les circuits électroniques de l'appareil dans une enceinte ressemblant à une carte de crédit sont multiples. Tout d'abord, les petites dimensions de l'appareil résultant en permettront la fabrication en série avec de faibles coûts. En second lieu, un tel appareil pourra être facilement transporté ou même expédié par la poste jusqu'à une installation postale appropriée de manière que les données de comptabilisation qu'il contient y soient lues et validées.

La présente invention n'est pas limitée aux exemples de réalisation qui viennent d'être décrits, elle est au contraire susceptible de variantes et de modifications qui apparaîtront à l'homme de l'art.

Claims (5)

Revendications

1. Dispositif de transfert d'un bloc de données entre un premier moyen de traitement et un second moyen de traitement, caractérisé en ce qu'il comprend:

- un premier et un second moyen de traitement (58, 84);

- un premier et un second moyen de stockage (112, 116) de données de lecture/écriture pour stocker le bloc de données pendant le transfert;

- un moyen (110) répondant à un premier état d'un signal de commande pour coupler fonctionnellement le premier moyen de traitement (58) au premier moyen de stockage (112) de données et le second moyen de traitement (84) au second moyen de stockage de données (116), le moyen (110) répondant en outre à un second état du signal de commande pour coupler le premier moyen de traitement au second moyen de stockage de données et le second moyen de traitement au premier moyen de stockage de données;

- un premier et un second registre (142,144) de lecture/écriture, le premier registre de lecture/écriture (142) répondant à une actîvatîon d'un premier signal d'écriture produit par le second moyen de traitement (84) afin de stocker un ordre ou donnée d'état provenant du second moyen de traitement, le premier registre de lecture/écriture (142) pouvant en outre être mis en œuvre pour que l'ordre ou la donnée d'état stocké dedans soit lu par le premier moyen de traitement (58), le second registre de lecture/écriture (144) répondant à une activation d'un second signal d'écriture produit par le premier moyen de traitement (58) pour stocker un ordre ou donnée d'état en provenance du premier moyen de traitement, le second registre de lecture/écriture pouvant en outre être mis en œuvre pour que l'ordre ou la donnée d'état stocké dedans soit lu par le second moyen de traitement, d'où il résulte que chacun des premier et second moyens de traitement peut communiquer l'un à l'autre l'ordre ou donnée d'état; et

- un circuit de commande (132) répondant à l'activa-tion du premier signal d'écriture et à l'activation du second signal d'écriture pour ainsi faire passer le signal de commande du premier état au second état ou du second état au premier état.

2. Dispositif selon la revendication 1, caractérisé en ce que les premier et second moyens de traitement (58, 84) sont chacun un micro-ordinateur, ayant un bus d'adresses (120,122), un bus de données (126,128), et un bus de commande (114,118), chacun des bus pouvant être mis en œuvre pour être couplé à l'un des moyens de stockage de données de lecture/écriture (112, 116) par ledit moyen afin d'y stocker le bloc de données ou de lire le bloc de données dans le moyen de stockage de données de lecture/écriture.

3. Dispositif selon la revendication 2, caractérisé en ce que le bus de commande (114) du premier micro-ordinateur (58) est apte à être mis en œuvre pour fournir le premier signal d'écriture et en ce que le bus de commande (118) du second micro-ordina-teur (84) est apte à être mis en œuvre pour fournir le second signal d'écriture, d'où il résulte que l'état du signal d'écriture peut être changé par le circuit de commande (132), le signal de commande (130) étant ainsi modifié pour passer du premier état au second état ou du second état au premier état.

4. Utilisation d'un dispositif selon la revendication 1 dans un procédé de transfert d'un bloc de données entre un premier moyen de traitement (58) et un second moyen de traitement (84), caractérisée en ce qu'elle comprend les étapes consistant à:

- fournir un signal de commande ayant un premier état tel que ledit moyen répondant à ce premier état est initié pour coupler fonctionnellement le premier moyen de traitement (58) au premier moyen de stockage de données (112) et le second moyen de traitement (84) au second moyen de stockage de données (116), ledit signal de commande ayant un second état tel que ledit moyen répondant est initié pour coupler le premier moyen de traitement au second moyen de stockage de données et le second moyen de traitement au premier moyen de stockage de données;

- fournir un premier signal d'écriture produit par le second moyen de traitement et activant le premier registre de lecture/écriture (142) afin de stocker un order ou donnée d'état provenant du second moyen

5. Utilisation selon la revendication 4, caractérisée en ce qu'elle comprend en outre les étapes consistant à:

- stocker le bloc de données à transférer soit dans le premier (112) soit dans le second moyen de stockage (116) de données de lecture/écriture, ce moyen de stockage étant déterminé par un état courant du signal de commande (130), le bloc de données stocké étant fourni par l'un des premier ou second moyens de traitement;

- produire l'un des premier ou second signaux d'écriture;

- produire l'autre des premier ou second signaux d'écriture; et

- lire le bloc de données précédemment stocké soit par le premier soit par le second moyen de traitement (58, 84), la donnée étant lue par l'autre des premier ou second moyens de traitement.

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dé traitement (84), le premier registre de lecture/écriture (142) en outre étant mis en œuvre pour que l'ordre ou la donnée d'état stocké dedans soit lu par le premier moyen de traitement (58), et fournir un second signal d'écriture produit par le premier moyen de traitement et activant le second registre de lecture/écriture pour stocker un ordre ou donnée d'état en provenance du premier moyen de traitement, le second moyen de registre de lecture/écriture en outre étant mis en œuvre pour que l'ordre ou la donnée d'état stocké dedans soit lu par le second moyen de traitement, d'où il résulte que chacun des premier et second moyens de traitement communique l'un à l'autre l'ordre ou donnée d'état; et

- faire passer le signal de commande (130) du premier état au second état ou du second état au premier état en réponse à l'activation par ledit premier ou second signal d'écriture.