DE2215519A1 - Verfahren zur aufzeichnung von informationen und schaltungsanordnung zur durchfuehrung des verfahrens - Google Patents

Description

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15.3.^972

Anlage zur

Pat ent anireldung

ROBERT BOSCH GKBH, 7 Stuttgart ". Postfach 50

Verfahren zur Aufzeichnung von Informationen und Schaltungsanordnung zur Durchführung: des Verfahrens ·__

Die Erfindung betrifft ein Verfahren zi;r Aufzeichnung von Informationen auf elektrosensitives Papier, insbesondere auf Begistriermetallpapler, unter Verwendung einer' Gruppe von ei nebeneinander abgeordneten Schreibelektrocen, die elektrisch gegen einander isoliert sind und je einzeln über einen steuerbaren Schalter angesteuert werden.

Es sind bereits Verfahren dieser Art bekannt, bei denen eine oder mehrere Gruppen von Schreitelektroden als sogenannter Elektrodenkamm ausgebildet sind. Zur Ansteuerung jeder einzelnen Schreibelektrode wird hierbei ein besonderer Zeichengenerator verwendet,;

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. wobei sämtliche Zeichengeneratoren die·einzelnen Schreibelektroden gleichzeitig ansteuern. Die gleichzeitige Ansteuerung der Schreibelektroden bringt bei diesem Verfahren den Nachteil der Brücken—

.bildung zwischen den einzelnen Schreibelektroden mit.sich.

Es wurde nun gefunden, daß bei einem Verfahren der eingangs genannten Art dieser Nachteil der Brückenbildung beseitigt wird,
wenn gemäß der Erfindung die einzelnen Schreibelektroden nacheinander angesteuert werden und die Einschaltdauer jeder einzelnen
Schreibelektrode kurzer gewählt wird als die Zeit, nach der der
Ausbrennvorgang von alIeine beendet ist.

Eine bevorzugte Ausgestaltung des erfindungsgemäßen Verfahrens
besteht darin, daß der Gruppe von nebeneinander angeordneten
Schreibelektroden ein Demultiplexer zugeordnet wird, dessen Anzahl an Informationsausgängen gleich der Anzahl der Schreibelektroden
der Elektrodengruppe ist, daß die auf das elektrosensitive Papier aufzuzeichnenden Informationen an den ersten Eingang eines mit
zwei Eingängen versehenen NAND-Gatters gelegt werden und durch an den zweiten Eingang dieses NAND-Gatters gelegte, in gleichen Zeitabständen aufeinanderfolgende Taktimpulne gerastert werden\ daß
die am Ausgang dieses NAND-Gatters liegenden gerasterten Informationen an einen Freigabeeingang des Demultiplexers'gelegt werden, daß die an zweiten Eingang des NAND-Gatters liegenden Taktimpulse außerdem an den Takteingang eines Binärzählers gelegt weiden, daß die an den Informationsausgängen des Binärzählers entstehenden
Impulse an die Informationseingänge des Demultiplexers gelegt
werden und daß die an den Informationsausgängen des Demultiplexers entstehenden Schreibimpulse den Steuerelektroden der steuerbaren
Schalter zugeführt werden. Die Schreibzeit ist hierbei gleich der Dauer der an den zweiten Eingang des NAND-Gatters gelegten Takt-
impulse. Da-diese Zeit kleiner ist als die bis zum Einsetzen des
nächsten Taktimpulses verstreichende Zeit, ist gewährleistet, daß die einzelnen Schreibelektroden der Elektrodengruppe nacheinander augesteuert werden.

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In Weiterbildung der Erfindung 'ist es vorteilhaft, zwischen den' Ausgang des NAND-Gatters und den Freigabeeingang des Demultiplexers' einen Mono-Flop mit einstellbarer Dauer seiner Ausgangsimpulse zu legen. Die-Schreibzeit ist dann gleich dieser einsteilbaren Dauer tg der Ausgangsimpulse des Mono-Flops. Die hierdurch mögliche Veränderung der Schreibzeit erlaubt auch eine Veränderung der Punktgröße und damit des Schwarzungsgrades, so daß eine Grauwertaufzeichnung möglich ist. ■

Die Erfindung "betrifft ferner eine Schaltungsanordnung zur Aufzeichnung von Informationen unter Verwendung von fünf nebeneinander angeordneten Elektrodengruppen, von denen jede dieselbe Anzahl von Schreibelektroden hat. Eine derartige Schaltungsanordnung seil so ausgebildet werden, daß diese Elektrodengruppenund die einzelnen Schreibelektroden innerhalb jeder dieser Elektrodengruppen nacheinander angesteuert werden und daß gleichzeitig die ■ Einschaltdauer jeder einzelnen Schreibelektrode kürzer ist 'als die Zeit, nach der der Ausbrennvorgang von alleine beendet ist. Erfindungsgem.äß wird dies dadurch erreicht, daß jeder der fünf Elektrodengruppen einer von fünf gleichen, jeweils mit zwei Freigabeeingär.gen versehenen,Demultiplexern zugeordnet ist, wobei die Informatiorsausgange des Binärzählers au die Informationseingänge aller fünf Demultiplexer angeschloiTsen sind und wobei ferne'».· die Informaticnsausgänge der fünf' Demultiplexer mit den Schreibelektroden je einer Elektrodengruppe verbunden sind, daß jedem Cct fünf Demultiplexer eines von fünf jeweils mit drei Eingängen versehenen HAND-Gattern zugeordnet ist, wobei· die ersten Freig&beeingänge der·Demultiplexer jeweils an den Ausgang eines dieser. NAND-Gatter angeschlossen sind, daß jeweils der erste Eingang dieser fünf NAND-Gatter an den Ausgang des Mono-Flops angerchlossen ist, daß ferner drei Flip-Flops vorgesehen sind, daß der Eingang des ersten Flip-Flops an den Ausgang höchster Wertigkeit des Binärzählers angeschlossen ist, daß der Eingang des zweiten

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Flip-Flops an den nicht invertierenden Ausgang des ersten Flip-Flops angeschlossen ist, daß der Eingang des dritten Flip-Flops an den nicht invertierenden Ausgang des zweiten Flip-Flops angeschlossen ist, daß. der invertierende Ausgang des dritten Flip-Flops an den zv/eiten Freigabeeingang des fünften Demultiplexers angeschlossen ist, daß der nicht invertierende Ausgang des dritten FJip-Flops an die zweiten Freigabeeingänge der übrigen vier Demultiplexer angeschlossen ist, daß der zweite Eingang des dem ersten Demultiplexer zugeordneten NAND-Gatters an den invertierenden Ausgang des ersten Flip-Flops angeschlossen ist, daß der dritte Eingang dieses NAND-Gatters an den invertierenden Ausgang des zweiten Flip-Flops angeschlossen ist, daß der zweite Eingang des dem zweiten Demultiplexer zugeordneten NAND-Gatters an den nicht invertierenden Ausgang des ersten Flip-Flops angeschlossen ist, daß. der dritte Eingang dieses NAND-Gatters an den invertierenden Ausgang des zweiten Flip-Flops angeschlossen ist, daß der zweite Eingang des dem dritten Demultiplexer zugeordneten NAND-Gatters an den invertierenden Ausgang des ersten Flip-Flops angeschlossen ist, daß der dritte Eingang dieses NAND-Gatters an den nicht invertierenden. Ausgang des zweiten Flip-Flops angeschlossen ist, daß der zweite Eingang des dem vierten Demultiplexer zugeordneten NAND-Gatters an den nicht invertierenden Ausgang des ersten Flip-Flops angeschlossen ist, daß der dritte Eingang dieses NAJD-Gatters an den nicht invertierenden Ausgang des zweiten Flip-Flops angeschlossen ist, daß der zweite Eingang des dem fünften Demultiplexer zugeordneter NAND-Gatters an den nicht invertierenden Ausgang des dritten Flip-Flops angeschlossen ist und daß der dritte Eingang dieses NAND-Gatters durch Anlegen an die Betriebsspannung im Zustand "HIGH" gehalten ist.

Anhand der Zeichnung soll die Erfindung, näher erläutert werden.

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Es zeigen: . ■ ""

Fig. ι eine Schaltungsanordnung gemäß der Erfindung mit einer Gruppe von sechzehn nebeneinander angeordneten Schreibelektroden und einem dieser Gruppe zugeordneten Demultiplexer mit sechzehn Informationsausgängen,

Fig. 2 eine Schaltungsanordnung gemäß der Erfindung mit fünf nebeneinander angeordneten Gruppen von je sechzehn Schreibelektroden und fünf je einer Gruppe zugeordneten Demultiplexern mit je sechzehn Informationsausgängen,

Fig. 3 ein Impulsdiagramm zu den Schaltungsanordnungen nach · den Figuren ^Λ und 2. ·

In Fig. 1 ist das als Aufzeichnungsträger verwendete elektrosensitive Papier mit 20 bezeichnet. Zur Aufzeichnung der Informationen auf das elektros.ensitive Papier 20 dient eine Gruppe 21 von sechzehn nebeneinander angeordneten Schreibelektroden S₀, S^, Sp, S^c-) die elektrisch gegeneinander isoliert sind. Die Schreibelektroden Sq, S^₁, Sp, ... S^₁₁- werden über Schreibtransistoren T_Q, T,,, Tp, ... Ty₁C angesteuert. Die Kollektoren der Schreibtransistoren sind dabei an die Schreibelektroden, die Emitter der Schreibtransistoren an Rasse angeschlossen. Das elektrosensitlve Papier 20'ist über einen Widerstand 26 an die Schreib spannung vor: -35 Volt gelegt. Der Elektrodengruppe 2^ ist ein Demultiplexer.· J'¹ ·. zugeordnet. Der Demultiplexer 3^ ist mit i'6 Informationsausgängen versehen, die mit 0, % 2, ... ^5 bezeichnet sind, und hat ferner vier als Informationseingänge dienende Binäreingänge A^, B^, C^, Dy. und zwei Freigabeeingänge G^, _Λ und G_{0 Λ}. Der Demultiplexer 3*¹ kann dabei ein handelsüblicher, in integrierter Technik ausgeführter TTL-Demultiplexer sein. Die Informationsausgänge 0, ^, 2,' ... 15 des Deniiltiplexers 3^¹ sind über Schutzwiderstände Ra, P-^₁, Rp, .... R^c an die Basen der Schreibtransistoren T_Q, T,., Tp, "... T^t- angeschlossen.

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Ferner ist ein mit zwei Eingängen E. _n und E_{0 n} versehenes HAND-

¹ ,U /i,U

Gatter ITq vorgesehen. Der Ausgang P_Q dieses ITAND-Gatters Nq ist .an den Eingang 41 eines Mono-Flops 40 angeschlossen, -dessen Ausgangsimpulse eine veränderbare Impulsdauer t_c haben, wobei diese Impulsdauer an einem nicht dargestellten Potentiometer einstell-bar ist. Der Ausgang 42 des Mono-Flops 40 ist an den ersten Freigabeeingang G₇, _Λ des Demultiplexers 31 angeschlossen. Der zweite Eingang Ep _. des NAND-Gatters Nq ist an den Takteingang 5": eines 4-Bit-Binärzählers 50 angeschlossen, dessen Informationsausgänge Aq, Bq, Cq, Dq an die Informationseingänge A^, B^, C^, D^ des Demultiplexers 31 angeschlossen sind. Der zweite Freigabeeingang G_{0 Λ} des Demultiplexers 31 ist an Masse gelegt und wird so im Zustand "LOW" gehalten. Ferner ist noch ein zweiter Mono-Flop 60 vorgesehen, dessen nicht invertierender Ausgang 61 an den Reset-Eingang 52 des 4-Bit-Binärzählers 50 angeschlossen ist.

Wirkungsweise der Anordnung nach Fig. 1 ist folgende: Die auf das elektrosensitive Papier aufzuzeichnenden Informationen (VIDEO) werden an den ersten Eingang Έ_{Λ Q} des NAND-Gatters N_Q gelegt (Fig. 3» zweite Zeile). Am zweiten Eingang Ep q des NAND-Gatters Nq liegt ein von außen angelegter Schreibtakt Cp, der auch den 4-Bit-Binärzähler 50 ansteuert. Die am Ausgang Pq des NAND-Gatters N_Q liegenden Impulse werden im Μσηο-Flop 40 i*i ihrer Impulsdauer auf einen Wert verkürzt, der der Einschaltdauer tg jeder einzelnen Schreibelektrode S_Q, S^, Sp, ... S^₁- entspricht, wobei dieser Wert an dem in der Zeichnung nicht dargestellten Potentiometer einstellbar ist, Diese Dauer tg der am Ausgang 42 des Mono-Flops 40 entstehenden Impulse wird so eingestellt, deß sie kürzer·ist als die Zeit, nach der der Ausbrennvorgang von alleine beendet wäre. Diese am Ausgang 42 des Mono-Flops 40 abgenommenen Impulse werden an den er.sten Freigabeeingang G^ ^ des Demultiplexers 31 gelegt, während der zweite Freigabeeingang G_{2 Λ} im Zus^and "LOW" gehalten wird.. Der Schreibtakt Cp steuert

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gleichzeitig den 4-Bit-Binärzähler 50 so an, daß sich an seinen Ausgängen A₀, Bq, Cq, Dq alle sechzehn möglichen, in logischer Folge ablaufenden Zustände ergeben. Diese Ausgangsimpulse des 4-Bit-BinärZählers 50 werden auf die Informationseingänge A , B^, C_x,, D,, des Demultiplexers 31 gegeben. Dadurch wird erreicht, daß die Informationsausgänge 0, ", 2, ... 15 cL^es Demultiplexers 31 nacheinander im Takt der am ersten Freigabe eingang G^, _Λ liegenden Schreibimpulse jeweils für die Dauer to eines einzelnen Impulses auf "LOV/" geschaltet werden. Dabei erscheint ein Schreibimpuls nur an denjenigen Informationsausgängen, die gleichzeitig die durch das Videosignal bestimmte Information erhalten. Die an den Informationsausgängen 0, 1, 2, ... 15 des Demultiplexers 31 entstehenden Schreibimpulse werden über die Schutzwiderstände Rq, R^, Rq, ... R/in den Basen der Schreibtransistoren Tq, T^, Tp, ... T^c zugeführt, die für die Dauer tg der Impulse die Schreibspannung durchschalten. Nachdem alle Schreibelektroden Sq, S,,, Sp, ... S^c durchlaufen sind, wird durch einen Reset-Impulse, der im Mono-Flop 60 seine definierte Dauer erhält, der 4-Bit-Binärzähler 50 in den Ausgangszustand zurückgesetzt.

Fig. 2 zeigt ein zweites Ausführungsbeispiel einer Schaltungsanordnung gemäß der Erfindung. Zur Aufzeichnung der Informationen βμΐ das elektrosensitive Papier 20 sind hier fünf nebeneinander angeordnete Elektrodengruppen 21, 22, 23, 24, 25 vorgesehen, die je sechzehn nebeneinander angeordnete Schreibelektroden enthalten, die elektrisch gegeneinander isoliert sind. Die Schreibelektroden der ersten Gruppe 21 sind mit S_n ,,, S.. _Λ , S₀ ,,, ... S^t- _Λ bezeich-

U,¹ 'ι¹ *- ϊ ^{1 1}Pi'

net, die der zweiten Gruppe 22 mit S_n ->, S_x, _o, S_{0 o}, ... Sx₁₁-. _o, ... die der fünften Gruppe 25 mit Sq ,-, S^ 51 ^2 5' * * *' -^15 5* Die Schreibelektroden S_n . , S_x, ., S₀ ...... S_x,,- . jeder Givppe

U,l 1,1 C₁- IP1J-

werden über Schreibtransistoren T_n . , T_x. . , T₀ . , ... T^₁₁- ^ an-

U,l 1)1 c:,l '?) l

gesteuert, v/obei i die Werte 1, 2, 3i ^i und 5 annimmt je nachdem, ob sich die Schreibelektrode bzw. der Schreibtransistor in der

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ersten Gruppe 21, der zweiten Gruppe 22, der dritten Gruppe 23 usw. befindet. Die Kollektoren der Schreibtransistoren sind dabei an die Schreibelektroden, die Emitter der Schreibtransistoren an Masse angeschlossen. Das elektrosensitive Papier 20 ist über einen Widerstand 26 an die Schreibspannung von -35 Volt gelegt. Jeder der fünf Elektrodengruppen 2i, 22, 23, 2-4-, 25 ist einer von fünf gleichen Demultiplexern 31, 32, 33, 34-, 35 zugeordnet. Jeder Demultiplexer ist dabei mit zwei Freigabeeingängen G„ ., G₀ . und

ι , 1 d. , 1

mit vier binären Informations eingang en A·, B-, C, D- versehen, wobei i die Werte ^ , 2, 3, 4-, 5 annimmt je nachdem, ob der Demultiplexer, der ersten Elektrodengruppe 21, der zweiten Elektrodengruppe 22, der dritten Elektrodengruppe 23 usw. zugeordnet ist. Jeder der Demultiplexer hat ferner sechzehn Informationsausgänge j die jeweils mit 0, ^, 2, ... 15 bezeichnet sind. Diese Informationsausgänge sind jeweils über Schutzwiderstände R_n .,

υ, ι

1? . , E₀ . , ... E^c- . an die Basen der Schreibtransistoren T_n . , T/, _π· , T₀ ^, ... T^t- . angeschlossen.

Ferner ist ein mit zwei Eingängen E,, _n, E_{0 n} versehenes NAND-

. ,u ti,u

Gatter Nq vorgesehen. Der Ausgang P_n dieses NAND-Gatters IT_n ist an den Eingang ^L'A eines Mono-Flops 40 angeschlossen, dessen Ausgangsimpulse eir-e veränderbare Impulsdauer to haben, wobei diese Impulsdauer an einem nicht dargestellten Potentiometer einstellbar ist. Der zweite Eingang Ep q des NAND-Gatters Nq ist an den Takteingang 5'' eines 4—Bit-Binärzählers 50 angeschlossen, dessen Informationsausgänge mit Aq, Bq, Cq und Dq bezeichnet sind. Diese Informationsausgänge sind an die Informationseingange A-, B., C.., D. sämtlicher Demultiplexer 3^, 32, 33, 34-, 35 angeschlossen, wobei jeweils der Ausgang Aq mit sämtlichen Eingängen A- (i= 1 bis 5) der Ausgang B_Q mit sämtlichen Eingängen B. (i=1 bis 5), der Ausgang Cq mit sämtlichen Eingängen C. (i=1 bis 5) und der Ausgang Dq mit sämtlichen Eingängen D. (i=1 bis 5) verbunden ist.

Jedem der fünf Demultiplexer 31, 32, 33, 34·, 35 ist eines von fünf jeweils mit drei Eingängen E„ ". , E,> . , E, . versehenen NAND-

i ,1 c ,1 p, 1

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Gattern N^₁ Np, N,, K. und Np- zugeordnet, deren Ausgänge mit P^ bezeichnet sind (i=1 bis 5). Der erste Freigabeeingang G^ _Λ des ■ ersten Demultiplexers 31 ist dabei an den Ausgang-P^ des NAND-Gatters N^, der erste Freigabeeingang G^ _o des zweiten Demultiplexers 32 an den Ausgang P₂ des NAND-Gatters Np, der erste Freigabe eingang G_-1 -j. des dritten Demultiplexers 33 an den Ausgang P^ des NAND-Gatters N,, der erste Freigabe eingang G_x, ^ des vierten Demultiplexers 34 an den Ausgang P₂, des NAND-Gatters N^ und der · erste Freigabeeingang G^ c des fünften Demultiplexers 35 an. den Ausgang P_n- des NAND-Gatters N_n- angeschlossen. Jeweils der erste Eingang Έ,_{Λ i} der fünf NAND-Gatter N^₁, N₂, M.,, N^, N^ ist an den Ausgang 42 des Mono-Flops 40 angeschlossen. ■

Ferner sind drei Flip-Flops F^₁, F₂ und F, vorgesehen. Der Eingang 70 des ersten Flip-Flops F^₁ ist an den Ausgang Dq des 4-Bit-Binärzählers 50 angeschlossen. Der Eingang 80 des zweiten Flip-Flops Fp ist an den nicht invertierenden Ausgang £L des ersten Flip-Flops F. angeschlossen. Der Eingang 90 des dritten Flip-Flops F, ist an den nicht invertierenden Ausgang Qp des zweiten Flip-Flops F₂ angeschlossen. Der invertierende Ausgang £L des dritten Flip-Flops F^ ist an den zweiten Freigabeeingang Gp π des fünften Demultiplexers 35 angeschlossen. Der nicht invertierende Ausgang Q-, des dritten Flip-Flops F^ ist-· an die zweiten Freigabeeingänge G_{0 Λ} , G_{0 o},· G_{0 7}, G_{0 A} der übrigen vier Demultiplexer 3''· 32, 33j 34 angeschlossen. Der zweite Eingang Ep ^ des NAND-Gatters N₄ ist an den invertierenden Ausgang ζ^ des ersten Flip-Flops F. angeschlossen. Der dritte Eingang E^ _Λ des NAND-Gatters N^, ist an den invertierenden Ausgang £L, des zweiten Flip-Flops F₀ angeschlossen. Der zweite Eingang E_{2 2} des NAND-Gatters N₀ ist an den nicht invertierenden Ausgang Q^ des ersten Flip-Flops Έ_Λ angeschlossen. Der dritte Eingang E_{x o} des NAND-Gatters Np ist an den invertierenden Ausgang Q^ des zweiten Flip-Flops F₂ angeschlossen. Der zweite Eingang E₂ ^ des NAND-Gatters N_. ist sn den invertierenden Ausgang Q₁^ des ersten Flip-Flops F^

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angeschlossen. Der dritte Eingang E₇₂. _x des NAND-Gatters N- ist an den nicht invertierenden Ausgang Qp des zweiten Flip-Flops Fp angeschlossen. Der zweite Eingang E~ ^ des NAND-Gatters K^ ist an den nicht; invertierenden Ausgang Q,, des ersten Flip-Flops F^ angeschlossen. Der dritte Eingang E^ ^ des NAND-Gatters K. ist an den nicht invertierenden Ausgang Qp des zweiten Flip-Flops Fp angeschlossen. Der zweite Eingang E_{9 r} des NAND-Gatters N₁- ist an den nicht invertierenden Ausgang Q^ des dritten Flip-Flops F^ angeschlossen. Der dritte Eingang E-, j- des NAND-Gatters Kr ist durch Anlegen an die Betriebsspannung U im Zustand "HIGH" ge-

CC

halten.

Ferner ist ein zweiter Mono-Flop 60 vorgesehen. Der nicht invertierende Ausgang 61 des Mono-Flops' 60- ist an den Beset-Eingang des 4—Bit-Binärzählers 50 angeschlossen. Der invertierende Ausjang 62 des Mono-Flops 60 ist an die Eeset-Eingänge 7"¹» 8*¹ ,· 9^ der Flip-Flops F_-1, F2, F, angeschlossen.

Die Wirkungsweise der Anordnung nach Fig. 2 ist folgende:

Die auf das elektrosensitive Papier aufzuzeichnenden Informationen (VIDEO) werden an den ersten Eingang E„ ₀ des IJfAlTD-Gatters N₀ gelegt. Jiin solches Videosignal ist in der zweiten Zeile von Fig. 3 als Beispiel dargestellt. Ad zweiten Eingang E_{0 n} des NAND-Gatters Nq liegt ein von aaßen angelegter Schreibtakt Cp, eier auch den 4-Bit-Binärzähler 50 ansteuert. Die am Ausgang F₀ des NAND-Gatters N_Q liegenden Impulse werden im Mono-Flop AO in ihrer Impulsdauer auf einen Wert verkürzt, der der Einschaltdeuer tg jeder einzelnen Schreibelektrode Sq, S^₁, Sp, ... S^₁- entspricht, wobei dieser Wert an dem in der Zeichnung nicht dargestellten Potentiometer einstellbar ist. Diese Dauer tg der am Ausgang,42 des Mono-Flops 40 entstehenden Impulse wird so eingestellt, daß sie kürzer ist als die Zeit, nach der der Ausbrennvorgang ven

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alleine beendet wäre. Diese am Ausgang 42 des Mono-Flops 40 abgenommenen Impulse werden an die ersten Eingänge Έ_Λ . der NAND-Gatter N_. gelegt, deren Ausgänge P. an die ersten Freigaheein-

A. -X «

gänge Gy, . der Demultiplexer angeschlossen sind, -ι,χ.

Der Schreibtakt Cp steuert gleichzeitig den 4-Bit-Binärzähler so an, daß sich" an seinen Informationsausgängen Aq, Bq, Cq, Dq alle sechzehn möglichen, in logischer Folge ablaufenden Zustände ergeben. Diese Ausgangsimpulse des 4-Bit-Binärzählers 50 werden auf die jeweils parallel geschalteten Informationseingänge A-, B., C., D- der-Demultiplexer 31, 32, 33? 34, 35 gegeben. Wären die beiden Freigabeeingänge G _Λ · und G₀ . der Demultiplexer dabei gleichzeitig "LOW", so würden die Informationsausgänge O, ^, 2, ... 15 der Demultiplexer 31, 32, 33, 34, 35 nacheinander im Takt der Schreib impulse j-eweils für die Dauer tg eines einzelnen Impulses auf ¹¹LOVi" geschaltet. Es würden also gleichzeitig die Ausgänge 0 aller Demultiplexer auf "LOVi" geschaltet, danach alle Ausgänge 1, danach alle Ausgänge 2, usw., bis beim sechzehnten Schreibimpuls alle Ausgänge 15- auf "LOV/" geschaltet werden und danach wieder alle Ausgänge 0 beginnen.

Durch die Flip-Flops F^, Fp-und F-, werden nun aber die zweiten Freigabeeingänge· G₀ . der Demultiplexer so geschaltet, daß jeweils nur ein Demultiplexer freigegeben wird. Die am Ausgang 42 des Mono-Flopr, 40 liegenden Signale worden dabei in den NAlTD-¹ ~i at tern N- mit den Ausgangssignalen der Tlip-Flops F^₁, F^, F, verknüpft und auf die ersten Freigabeeingänge G^, . der Demultiplexer gegeben. Dadurch wird erreicht, daß nur der Ausgang eines Demultiplexers schreibt, der durch die Zähler 50, F_x., Fp, F^ angewählt wurde und gleichzeitig die durch das Videosignal bestimmte Information erhält. Die an den Informationsausgängen 0, 1, 2, ... der Demultiplexer 31, 32, 33, 34, 35 entstehenden Schreibimpulse werden über die Schutzwiderstande E₀ .,E. _i5 H₀ ,, ... E^₁ . den Basen der Schreibtransistoren T_n -,T- .,T₀-, ... T^,- . zugeführt, axe für die Dauer tg cer Impulse die Schreibspannung

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durchschalten. Nachdem die Schreibelektroden S_n . , S_x, . , S₀ . , ... S^c- . aller Gruppen 2% 22, 25, 24, 25 durchlaufen sind, im gewählten Ausführungsbeispiel also nach achtzig Takten, werden durch einen Reset-Impuls, der im Ποηο-Flop 60 seine definierte Dauer erhält, alle Zähler 50, P^, Fo, F^ in den Ausgangszjstand zurückgesetzt.

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Claims (1)

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   Ansprüche ■

   M J Verfahren zur Auf zeichnung von Informationen auf elektrosen-

   *S ·

   sitives Papier, insbesondere auf Begistriermetallpapier, unter Verwendung einer Gruppe von einzelnen, nebeneinander angeord-. neten Schreibelektroden, die elektrisch gegeneinander isoliert sind und je einzeln über einen steuerbaren Schalter angesteuert werden, dadurch gekennzeichnet, daß die einzelnen Schreibelektroden nacheinander angesteuert werden und daß die Einschaltdauer jeder einzelnen Schreibelektrode kürzer gewählt wird als die Zeit, nach der der Ausbrennvorgang von alleine.beendet i st.

   . Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß der Gruppe (21) von nebeneinander angeordneten Schreibelektroden (Sq, S_x,, Sp, ... Sy|c) ein Demultiplexer (J1) zugeordnet wird, j dessen Anzahl an Information sau κ gang en (θ, 1-, 2, ... 15) gleich "'. der Anzahl der Schreib elektroden (S_Q, S_x,., S₂, ... S/jc) ihr ■ Elektrodeng;ruppe (21) ist, daß die auf das elektrosensitive Papiei' aufziizeichnenden Informationen (VIDEO) an deri erste:} Eingang (Ξ> _Q) eines mit zwei Eingängen (E^ _Q, Έ^ q) versehenen ITAND-Gatters (Nq) gelegt werden und durch an den zweiten Eingang (Ep q) dieses NAND-Gatters (Nq) gelegte, in-gleichen Zeitabständen aufeinanderfolgende Taktimpulse (Cp) gerastert werden,

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   daß die am Ausgang (Pq) dieses RAITD-Gatters (Nq) liegenden gerasterten Informationen an einen Freigabeeingang (G,. *) des Demultiplexers (31) gelegt werden, daß die am zweiten Eingang (E_{2 0}) des ITAITD-Gatters (1T_Q) liegenden Taktimpulse (c_p) außerdem an den Takteingang (5^) eines Binärzählers (50) gelegt werden, daß die an den Informationsausgängen (Aq, Bq, Cq, Dq) des Binärzählers (50) entstehenden Impulse an die Informationseingänge (A^, B^, C^, D^) des Demultiplexers (31) gelegt werden und daß die an den Informationsausgängen (0, 1, 2, ... 15) des Demultiplexers (31) entstehenden Schreibimpulse den Steuerelektroden der steuerbaren Schalter (T_Q, T^, T~, ... T^r-) zugeführt v/erden.

   3. Schaltungsanordnung zur Durchführung des Verfahrens nach den Ansprüchen 1 und 2, dadurch gekennzeichnet, daß zwischen den Ausgang (Pq) des ITAND-Gatters (Nq) und den Freigabeeingang (G„ „) des Demultiplexers (31) ein Mono-Flop (40) mit einetellbarer Dauer (tg) seiner Ausgarigsimpulse gelegt ist.

   4.. Schaltungsanordnung nach Anspruch 3 zur Aufzeichnung von Informationen (VIDEO) unter Verwendung von fünf nebeneinander angeordneten Elektrodengruppei-i (2'1, 22, 23, 24, 25), vor. denen jede dieselbe Anzahl von Schreibelektroden (S_n ., S„ ., S„ ., ... S^c .) hat, dadurch gekennzeichnet, daß jeder der fünf Elektrodengruppen (21, 22, 23, 24. 25) einer von fünf gleichen, jeweils mib zwei Freigabeeingäiige.a (G^ ., G₀ .) versehenen

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   Eöbert Bosch GmbH . Fb/Lo

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   Demultiplexern (31, 32, 33, 34, 35) zugeordnet ist, wobei die Informationsausgänge (A_n, B_n, Cq, D_q) des Binärzählers (50) an die Informationseingänge (A.,B^," C., D.) aller fünf Demultiplexer (3^i 32, 33, 34, 35) angeschlossen sind und wohei ferner die Informationsausgänge (0, 1, 2, ... 15) der fünf Demultiplexer (3^, 32, 33, 3²I-, 35) mit den Schreibelektroden (S_n -,

   u,-x

   Si ς ν S₀ -, ... S-C-) je einer Elektrodengruppe (21, 22, 23,

   ι ,1 cL,± I ρ, Χ

   24, 25) verbunden sind, da'ß jedem der fünf Demultiplexer (31, 32, 33, 34, 35) eines von fünf jeweils mit drei Eingängen ■ (E₇₁ ^, E_{2 i}, E₅ ^) versehenen HMD-Gattern (H_-1, Kg, N,, H^, N₅) zugeordnet ist, wohei die ersten Ereigaheeingänge (G_x, .") der Demultiplexer (31, 32, 33, 3^, 35) G^eweil^s an den Ausgang (P^) eines dieser NAHD-Gatter (W-) angeschlossen sind, daß jeweils der ercte Eingang (E. -") dieser fünf NAND-Gatter (W-) an den

   1,1 1

   Ausgang (42) des Kono-IMops (40) angeschlossen ist, daß ferner drei ITlip-^Flops (I¹^₁, I"p, F^) vorgesehen sind, daß der Eingang (70) des ersten Flip-Flops (F^) an d.en_; Ausgang höchster Wertigkeit (Dq) des Binärzählers (50) angeschlossen ist, daß dtr Eingang (80) des zweiten Flip-Flops (Fp) an den nicht invertierenden Ausgang (Qp) des zweiten Flip-Flops (Fp) angeschlossen ist, daß der invertierende Ausgang (Q^) des dritten Flip-Flops (F,) an den zweiten Freigabeeingang (Gp ,-) des fünften Demujtiplexers (35) angeschlossen ist, daß der nicht invertierende Ausgang (Q^) des dritten Flip-Flops (F,) an die zweiten Freigabeeirgänge (G„ ^, Gp «, ^₂ ^, G₂ ^) der übrigen vier Demulti-

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   — Ib-

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   plexer (3"¹» 32, 33» 34-) angeschlossen ist, daß der zweite Eingang (E₀ -.). des dem ersten Demultiplexer (3Ό zugeordneten NAND-Gatters (N^₁) an den invertierenden Ausgang (CL) des ersten Flip-Flops (F/i) angeschlossen ist, daß der dritte Eingang (E, ^) dieses NAND-Gatters (N^) an den invertierenden Ausgang (Q₂) ^des zweiten Flip-Flops (Fp) angeschlossen ist, daß der zweite Eingang (E~ p) des dem zweiten Demultiplexer (32) zugeordneten NAND-Gatters (Np) an den nicht invertierenden Ausgang (Q,,) des ersten Flip-Flops (F^) angeschlossen ist, daß der dritte Eingang (E₇. _o) dieses NAND-Gatters (N₀) an den invertierenden Ausgang(Qp) des zweiten Flip-Flops (Fp) angeschlossen ist, daß der zweite Eingang (E_n ^) des dem dritten Demultiplexer (33) zugeordneten NAND-Gatters (N^) an den invertierenden Ausgang (Q^) cl^es ersten Flip-Flops (F^) angeschlossen ist, daß der dritte Eingang (E₇. S) dieses NAND-Gatters (N₇.) an den nicht invertierenden Ausgang (Qp) des zweiten Flip-Flops (Fp) angeschlossen ist, daß der zweite Eingang (Ep ^) des dem vierten Demultiplexer (3*0 zxxgeordneten NAND-Gattex^s <J$, ) an den nictt invertierenden Ausgang (Q.*) des ersten Flip-Flops (F^) angeschlossen ist, daß der dritte Eingang (E₇- ,.) dieses NAND-Gatters (N^) an den nicht invertierenden Ausgang (Qo) des zweiten Flip-Flops (Fp) angeschlossen ist, daß der zweite Eingang (E₀ ,-) des dem fünften Demultiplexer (35) zugeordneten NAND-Gatters (Kr) an den nicht invertierenden Ausgang (O_l7j) des dritten Flip-Flops (F₇-) angeschlossen ist und daß der

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   Robert Bosch GmbH . . £b/Lo

   Stuttgart -

   dritte Eingang (E^t-) dieses KAKD-Gatter-s- (Nr) durch Anlegen an die Betriebsspannung (TI ) im Zustand "HIGH" gehalten ist.

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   5. Schaltungsanordnung nach Anspruch 4, dadurch gekennzeichnet, daß eine oder mehrere Elektrodengruppen (21, 22, 23, 24, 25) in einem Elektrodenkamm untergebracht sind, der aus einzelnen Segmenten besteht, die sowohl die Schreibelektroden als auch die Schreibtransistoren als auch die Demultiplexer enthalten.

   6. Schaltungsanordnung nach Anspruch 5? dadurch gekennzeichnet, daß die Schreibelektroden aus Wolframdrähten bestehen»

   7. Verfahren zur Herstellung einer Schaltungsanordnung nach Anspruch 6, bei welchem die schaltungsseitigen Enden der Schreibelektroden an den KoIlektoranschlußklemmen der Schreib-

   , transistoren mittels Weichlot befestigt werden, dadurch gekennzeichnet, daß ,diese Enden vor dem Anlöten .an die ."Kollektoranschlußklemmen galvanisch verkupfert, vergoldet, versilbert ' oder verzinnt werden.

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