JPH01102952U - - Google Patents
Info
- Publication number
- JPH01102952U JPH01102952U JP20123687U JP20123687U JPH01102952U JP H01102952 U JPH01102952 U JP H01102952U JP 20123687 U JP20123687 U JP 20123687U JP 20123687 U JP20123687 U JP 20123687U JP H01102952 U JPH01102952 U JP H01102952U
- Authority
- JP
- Japan
- Prior art keywords
- clock pulse
- storage
- storage element
- pulse
- synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000015654 memory Effects 0.000 claims description 2
- 238000013500 data storage Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 8
Landscapes
- Recording Measured Values (AREA)
Description
第1図は本考案の一実施例を示したブロツク図
、第2図は第1図に示した実施例のバツクアツプ
を示した回路図、第3図は第1図に示したシフト
レジスタの内部構成図、第4図は第1図に示した
クロツクパルス発生回路から送出されるそれぞれ
のクロツクパルスを示した説明図、第5図は第1
図に示したシフトレジスタの他の構成例を示した
回路図、第6図は本考案の他の実施例を示したブ
ロツク図、第7図は従来例を示したブロツク図、
第8図は第7図に示した記憶部の内部構成図、第
9図は第7図に示した記憶部の他の構成例を示し
た回路図である。 5a,5b…記憶ブロツク、7a,7b…シフ
トレジスタ、19…クロツクパルス発生回路。
、第2図は第1図に示した実施例のバツクアツプ
を示した回路図、第3図は第1図に示したシフト
レジスタの内部構成図、第4図は第1図に示した
クロツクパルス発生回路から送出されるそれぞれ
のクロツクパルスを示した説明図、第5図は第1
図に示したシフトレジスタの他の構成例を示した
回路図、第6図は本考案の他の実施例を示したブ
ロツク図、第7図は従来例を示したブロツク図、
第8図は第7図に示した記憶部の内部構成図、第
9図は第7図に示した記憶部の他の構成例を示し
た回路図である。 5a,5b…記憶ブロツク、7a,7b…シフ
トレジスタ、19…クロツクパルス発生回路。
Claims (1)
- 【実用新案登録請求の範囲】 所定のパルス周期を有する第1のクロツクパル
スと、この第1のクロツクパルスより長いパルス
周期を有する第2のクロツクパルスとを送出する
クロツクパルス送出手段と、 配列される複数の記憶素子に記憶されるデータ
を、前記第1のクロツクパルスに同期して当該各
記憶素子に後続する記憶素子へ順次シフトする第
1の記憶手段と、 この第1の記憶手段から送出され、かつ配列さ
れる複数の記憶素子に順次記憶されるデータを、
前記第2のクロツクパルスに同期して当該各記憶
素子に後続する記憶素子へ順次シフトする第2の
記憶手段と を有することを特徴とするデータ記憶装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20123687U JPH01102952U (ja) | 1987-12-28 | 1987-12-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20123687U JPH01102952U (ja) | 1987-12-28 | 1987-12-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01102952U true JPH01102952U (ja) | 1989-07-12 |
Family
ID=31491606
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20123687U Pending JPH01102952U (ja) | 1987-12-28 | 1987-12-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01102952U (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6126182A (ja) * | 1984-07-17 | 1986-02-05 | Fujitsu Ltd | デ−タロガ− |
-
1987
- 1987-12-28 JP JP20123687U patent/JPH01102952U/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6126182A (ja) * | 1984-07-17 | 1986-02-05 | Fujitsu Ltd | デ−タロガ− |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| KR100206063B1 (ko) | 동기 낸드 디램 구조 | |
| JPH01102953U (ja) | ||
| JPS63138659U (ja) | ||
| JPH0273258U (ja) | ||
| JPS62121652U (ja) | ||
| JPH0733179Y2 (ja) | デイジタル回路の試験用リセツト回路 | |
| JPH0246261U (ja) | ||
| JPS6257468U (ja) | ||
| JPH0415072U (ja) | ||
| JPS6144974U (ja) | 画像メモリ装置 | |
| JPH0285390U (ja) | ||
| JPS6257837U (ja) | ||
| JPS62169833U (ja) | ||
| JPH02143642U (ja) | ||
| JPS5872797U (ja) | メモリ制御装置 | |
| JPS60174947U (ja) | 入出力制御装置 | |
| JPS63181200U (ja) | ||
| JPS63103151U (ja) | ||
| JPS6097864U (ja) | 符号化信号装置 | |
| JPS5984586U (ja) | 画像情報記憶装置 | |
| JPH0471174U (ja) | ||
| JPS6251600U (ja) | ||
| JPS5917096U (ja) | メモリの読み出し制御装置 | |
| JPS6324602U (ja) | ||
| JPH0360087U (ja) |