JPH01107367A - Ｖｔｒ - Google Patents
ＶｔｒInfo
- Publication number
- JPH01107367A JPH01107367A JP62264666A JP26466687A JPH01107367A JP H01107367 A JPH01107367 A JP H01107367A JP 62264666 A JP62264666 A JP 62264666A JP 26466687 A JP26466687 A JP 26466687A JP H01107367 A JPH01107367 A JP H01107367A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- supplied
- switch
- recorded
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
- Television Signal Processing For Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＰＣＭ音声系を有するいわゆる８ミリ規格等
のＶＴＲに関する。
のＶＴＲに関する。
（発明の概要）
本発明はＶＴＲに関し、各々１フィールド分のＰＣＭ音
声信号に相当するメモリを４（ＩＩ設けることによって
、従来の２倍の記憶容量を有する各トラックの延長部を
有効に利用できるようにしたものである。
声信号に相当するメモリを４（ＩＩ設けることによって
、従来の２倍の記憶容量を有する各トラックの延長部を
有効に利用できるようにしたものである。
いわゆる８ミリＶＴＲにおいて、音声をＰＣＭ信号でデ
ィジタル磁気記録再生することが行われている（特開昭
５７−１８６８７７号公報、特開昭５８−１９９４０９
号公報等参照）。
ィジタル磁気記録再生することが行われている（特開昭
５７−１８６８７７号公報、特開昭５８−１９９４０９
号公報等参照）。
ここで従来の８ミリＶＴＲのＰＣＭ音声記録においては
、音声信号を水平周波数の約２倍（ＮＴＳＣでは３１．
５ｋＨｚ ）でサンプリングし、折線８ビツト（直線ｌ
Ｏビット相当）で符号化し、２周波を用いたいわゆるバ
イフェーズ方式で記録を行うことが規格化されている。
、音声信号を水平周波数の約２倍（ＮＴＳＣでは３１．
５ｋＨｚ ）でサンプリングし、折線８ビツト（直線ｌ
Ｏビット相当）で符号化し、２周波を用いたいわゆるバ
イフェーズ方式で記録を行うことが規格化されている。
すなわち第５図において、入力端子（５１）に供給され
る入力音声信号はアナログノイズリダクシッン回路（５
２）に供給される。この回路（５２）でエンコードされ
た信号がＡＤ／ＤＡ変換回路（５３）に供給され、変換
されたディジタル信号がエラー訂正補間／１０−８ビツ
ト変換回路（５４）に供給されて、ＲＡＭ １ （５
５ａ ） 、 ２ （５５ｂ ）との共働によって１
０−８ビツトのビット圧縮及びエラー訂正補間のための
エンコードが行われる。
る入力音声信号はアナログノイズリダクシッン回路（５
２）に供給される。この回路（５２）でエンコードされ
た信号がＡＤ／ＤＡ変換回路（５３）に供給され、変換
されたディジタル信号がエラー訂正補間／１０−８ビツ
ト変換回路（５４）に供給されて、ＲＡＭ １ （５
５ａ ） 、 ２ （５５ｂ ）との共働によって１
０−８ビツトのビット圧縮及びエラー訂正補間のための
エンコードが行われる。
そしてこの回路において変換回路（５４）及びＲＡＭＩ
（５５ａ） 、 ２ （５５ｂ）の記録時の動作は
第６図に示すように行われる。図においてＡは映像信号
の各フィールドに対応するＲＦスイッチ信号であって、
この信号に対してＲＡＭＩ、２の書込が同図Ｂ、Ｃに示
すように行われる。さらに書込まれた信号が同図り、Ｅ
に示される期間にビット圧縮及びエラー訂正補間のため
のエンコード等の処理が行われ、これらの処理された信
号が同図Ｆ、 Ｇに示される期間に時間軸圧縮して読出
される。この読出された８ビットＰＣＭ信号がバイフェ
ーズ方式の変復調回路（５６）に供給されて記録用の変
調信号が形成される。
（５５ａ） 、 ２ （５５ｂ）の記録時の動作は
第６図に示すように行われる。図においてＡは映像信号
の各フィールドに対応するＲＦスイッチ信号であって、
この信号に対してＲＡＭＩ、２の書込が同図Ｂ、Ｃに示
すように行われる。さらに書込まれた信号が同図り、Ｅ
に示される期間にビット圧縮及びエラー訂正補間のため
のエンコード等の処理が行われ、これらの処理された信
号が同図Ｆ、 Ｇに示される期間に時間軸圧縮して読出
される。この読出された８ビットＰＣＭ信号がバイフェ
ーズ方式の変復調回路（５６）に供給されて記録用の変
調信号が形成される。
さらにこの変調信号が録再切換スイッチ（６１） 。
記録アンプ（６２） 、録再切換スイッチ（６３）を通
じてスイッチ回路（６４）に供給される。そしてこの回
路（６４）にて端子（６５）から録画切換スイッチ（６
６）を通じて供給される映像入力信号との間での所定の
切換及び一対の磁気ヘッドへの信号の振分等が行われる
。この振分けられた信号がヘッド（６７）に供給され、
テープ（６８）に記録される。
じてスイッチ回路（６４）に供給される。そしてこの回
路（６４）にて端子（６５）から録画切換スイッチ（６
６）を通じて供給される映像入力信号との間での所定の
切換及び一対の磁気ヘッドへの信号の振分等が行われる
。この振分けられた信号がヘッド（６７）に供給され、
テープ（６８）に記録される。
これによってテープ（６８）上には第７図に示すように
、それぞれ映像（ビデオ）信号の記録されるトラックの
始端側に、交互にＲＡＭＩ、２から読出されたＰＣＭ音
声信号の変調信号の記録が行われる。
、それぞれ映像（ビデオ）信号の記録されるトラックの
始端側に、交互にＲＡＭＩ、２から読出されたＰＣＭ音
声信号の変調信号の記録が行われる。
さらに再生時には、テープ（６８）からヘッド（６７）
で再生された信号がスイッチ回路（６４）に供給されて
映像信号と音声信号との分離が行われ、分離された映像
信号はスイッチ（６６）を通じて出力端子（６９）に取
出される。
で再生された信号がスイッチ回路（６４）に供給されて
映像信号と音声信号との分離が行われ、分離された映像
信号はスイッチ（６６）を通じて出力端子（６９）に取
出される。
またスイッチ回路（６４）で分離された音声信号はスイ
ッチ（６３）を通じて再生アンプ（７０）に供給され、
このアンプ（７０）からの信号が再生イコライザ回路（
７１）を通じて比較回路（７２）に供給され、所定レベ
ル以上の比較出力がフリップフロップ（７３）のデータ
入力端子りに供給される。また比較回路（７２）からの
信号がＰＬＬ（７４）に供給されて再生信号中のクロッ
ク信号が抽出され、この再生クロック信号がフリップフ
ロップ（７３）のクロック端子Ｃに供給される。そして
このフリップフロップ（７３）のＱ出力がスイッチ（６
１）に供給される。なお（７５）は再生クロック信号の
出力端子である。
ッチ（６３）を通じて再生アンプ（７０）に供給され、
このアンプ（７０）からの信号が再生イコライザ回路（
７１）を通じて比較回路（７２）に供給され、所定レベ
ル以上の比較出力がフリップフロップ（７３）のデータ
入力端子りに供給される。また比較回路（７２）からの
信号がＰＬＬ（７４）に供給されて再生信号中のクロッ
ク信号が抽出され、この再生クロック信号がフリップフ
ロップ（７３）のクロック端子Ｃに供給される。そして
このフリップフロップ（７３）のＱ出力がスイッチ（６
１）に供給される。なお（７５）は再生クロック信号の
出力端子である。
このスイッチ（６１）からの信号がバイフェーズ方式の
変復調回路（５６）に供給され、この回路（５６）で復
調された信号が回路（５４）に供給されて、ＲＡＭ １
（５５ａ ） 、 ２ （５５ｂ ）との共働に
よって８−１０ビツトのビット伸張及びエラー訂正補間
のデコードが行われる。この場合に変換回路（５４）及
びＲＡＭ １ （５５ａ ） 、 ２ （５５ｂ ）
の再生時の動作は第８図に示すように行われ、同図Ａに
示すようなＲＦスイッチ信号に対して、同図Ｂ。
変復調回路（５６）に供給され、この回路（５６）で復
調された信号が回路（５４）に供給されて、ＲＡＭ １
（５５ａ ） 、 ２ （５５ｂ ）との共働に
よって８−１０ビツトのビット伸張及びエラー訂正補間
のデコードが行われる。この場合に変換回路（５４）及
びＲＡＭ １ （５５ａ ） 、 ２ （５５ｂ ）
の再生時の動作は第８図に示すように行われ、同図Ａに
示すようなＲＦスイッチ信号に対して、同図Ｂ。
Ｃに示すようにＲＡＭ１．２の書込が行われ、書込まれ
た信号は同図り、Ｂに示される期間にピント伸張及びエ
ラー訂正補間のためのデコード等の処理が行われ、これ
らの処理された信号が同図Ｆ。
た信号は同図り、Ｂに示される期間にピント伸張及びエ
ラー訂正補間のためのデコード等の処理が行われ、これ
らの処理された信号が同図Ｆ。
Ｇに示される期間に時間軸伸張して読出される。
この読出された信号がＡＤ／ＤＡ変換回路（５３）に供
給され、変換されたアナログ信号がアナログノイズリダ
クション回路（５２）に供給されて、デコードされた音
声出力信号が出力端子（５７）に取出される。
給され、変換されたアナログ信号がアナログノイズリダ
クション回路（５２）に供給されて、デコードされた音
声出力信号が出力端子（５７）に取出される。
このようにして従来の例えば８ミリＶＴＲの記録再生が
行われていた。
行われていた。
これに対して８ミリＶ ’Ｉ’ Ｒの映像信号の記録再
生において、記録媒体により高保磁力の磁性体を用い、
伝送帯域を拡大してより高画質の映像を得られるように
することが検討されている。その場合にＰＣＭ音声記録
においても、伝送帯域の拡大と、いわゆるＲ−ＤＡＴに
用いられている８−１Ｏ変変換式（特開昭５９−２００
５６２号公報等参照）等の併用によって、例えばディジ
タル信号の記録密度を従来の２倍にする高密度記録を実
現することができる。
生において、記録媒体により高保磁力の磁性体を用い、
伝送帯域を拡大してより高画質の映像を得られるように
することが検討されている。その場合にＰＣＭ音声記録
においても、伝送帯域の拡大と、いわゆるＲ−ＤＡＴに
用いられている８−１Ｏ変変換式（特開昭５９−２００
５６２号公報等参照）等の併用によって、例えばディジ
タル信号の記録密度を従来の２倍にする高密度記録を実
現することができる。
しかしながら上述の装置において、ＲＡＭＩ（５５ａ
） 、 ２ （５５ｂ ）の記録容量はそれぞれ例えば
１６にバイトとされ、これはｌフィール１分の音声信号
に対応している。このためこれらのＲＡＭ１．２はフィ
ールドの交互に書込及び続出が行われており、従って上
述のように２倍の記録容量が設けられても、このままの
構成ではこれを有効に利用することができないものであ
る。
） 、 ２ （５５ｂ ）の記録容量はそれぞれ例えば
１６にバイトとされ、これはｌフィール１分の音声信号
に対応している。このためこれらのＲＡＭ１．２はフィ
ールドの交互に書込及び続出が行われており、従って上
述のように２倍の記録容量が設けられても、このままの
構成ではこれを有効に利用することができないものであ
る。
本出願はこのような点に鑑みてなされたものである。
本発明は、ｌフィール１分の映像信号が１トラックに記
録されると共にこのトラックの延長部にディジタル信号
が記録されるようにしたＶＴＲにおいて、各々１フィー
ルド分のＰＣＭ音声信号に相当するメモリが４１固（１
２ａ）〜（１２ｄ）設けられ、少なくとも２個の上記メ
モリには上記ＰＣＭ音声信号が逐時記憶され、上記メモ
リ中の２個分の情報を上記ｌトラックの延長部に記録（
エラー訂正補間回路（４））するようにしたＶＴＲであ
る。
録されると共にこのトラックの延長部にディジタル信号
が記録されるようにしたＶＴＲにおいて、各々１フィー
ルド分のＰＣＭ音声信号に相当するメモリが４１固（１
２ａ）〜（１２ｄ）設けられ、少なくとも２個の上記メ
モリには上記ＰＣＭ音声信号が逐時記憶され、上記メモ
リ中の２個分の情報を上記ｌトラックの延長部に記録（
エラー訂正補間回路（４））するようにしたＶＴＲであ
る。
これによれば、メモリが４１１８１設けられたことによ
り、種々の情報信号をＰＣＭ音声信号と共に記録するこ
とができ、これによって高密度記録を有効に利用するこ
とができる。
り、種々の情報信号をＰＣＭ音声信号と共に記録するこ
とができ、これによって高密度記録を有効に利用するこ
とができる。
第１図において、入力端子（１１に供給される音声入力
信号はアナログノイズリダクション回路（２）を通じて
Ａ Ｄ／Ｄ Ａ変換回路（３）に供給され、変換された
ディジクル信号がエラー訂正補間回路（４）に供給され
る。
信号はアナログノイズリダクション回路（２）を通じて
Ａ Ｄ／Ｄ Ａ変換回路（３）に供給され、変換された
ディジクル信号がエラー訂正補間回路（４）に供給され
る。
また音声信号が４ｃｈ音源の場合の後方音声１３号等の
他の音声入力信号が入力端子（５）からアナログノイズ
リダクション回路（６）を通じてＡＤ／ＤＡｉ換回路（
７）に供給される。さらに例えば端子（８）に供給され
る静止画映像信号がＡＤ／ＤＡ変換回路（９）に供給さ
れる。そしてこれらの変換されたディジタル信号及び入
出力端子（ｌＯ）に供給される任意のディジタルデータ
信号等がスイッチ（１１）で選択され、選ばれたディジ
タル信号がエラー訂正補間回路（４）に供給されて、Ｒ
ＡＭＡ （１２ａ ） 〜ＲＡＭＤ（１２ｄ）との共働
によってエラー訂正補間のためのエンコードが行われる
。
他の音声入力信号が入力端子（５）からアナログノイズ
リダクション回路（６）を通じてＡＤ／ＤＡｉ換回路（
７）に供給される。さらに例えば端子（８）に供給され
る静止画映像信号がＡＤ／ＤＡ変換回路（９）に供給さ
れる。そしてこれらの変換されたディジタル信号及び入
出力端子（ｌＯ）に供給される任意のディジタルデータ
信号等がスイッチ（１１）で選択され、選ばれたディジ
タル信号がエラー訂正補間回路（４）に供給されて、Ｒ
ＡＭＡ （１２ａ ） 〜ＲＡＭＤ（１２ｄ）との共働
によってエラー訂正補間のためのエンコードが行われる
。
そしてこの回路において変換回路（４）及びＲＡＭＡ
（１２ａ ） 〜ＲＡＭＤ （１２ｄ ）の記録時の動
作は第２図に示すように行われる。図においてＡは映像
信号の各フィールドに対応するＲＦスイ・ノチ信号であ
って、この信号に対してＲＡＭＡ−Ｄ（７）を込が同図
Ｂ、Ｃに示すように行われる。ここで例えばＲＡＭＡ、
Ｃには変換回路（３）からのＰＣＭ音声信号が書込まれ
、ＲＡＭＢ、Ｄにはスイッチ（１１）からの他のディジ
タル信号が書込まれる。
（１２ａ ） 〜ＲＡＭＤ （１２ｄ ）の記録時の動
作は第２図に示すように行われる。図においてＡは映像
信号の各フィールドに対応するＲＦスイ・ノチ信号であ
って、この信号に対してＲＡＭＡ−Ｄ（７）を込が同図
Ｂ、Ｃに示すように行われる。ここで例えばＲＡＭＡ、
Ｃには変換回路（３）からのＰＣＭ音声信号が書込まれ
、ＲＡＭＢ、Ｄにはスイッチ（１１）からの他のディジ
タル信号が書込まれる。
さらに書込まれた信号が同図り、 Ｅに示される期間
にビット圧縮及びエラー訂正補間のためのエンコード等
の処理が行われ、これらの処理された信号が同図Ｆ、
Ｇに示される期間に時間軸圧縮して読出される。この読
出された例えば１６ビツトＰＣＭ信号が８−１０変換方
式の変復調回路（１３）に供給され、この変調信号がス
イッチ（６１）以下の回路に供給され、従来と同様にテ
ープ（６８）に記録される。
にビット圧縮及びエラー訂正補間のためのエンコード等
の処理が行われ、これらの処理された信号が同図Ｆ、
Ｇに示される期間に時間軸圧縮して読出される。この読
出された例えば１６ビツトＰＣＭ信号が８−１０変換方
式の変復調回路（１３）に供給され、この変調信号がス
イッチ（６１）以下の回路に供給され、従来と同様にテ
ープ（６８）に記録される。
これによってテープ（６Ｂ）上には第３図に示すように
、それぞれ映像（ビデオ）信号の記録されるトランクの
始端側に交互に順次ＲＡＭＡＢ。
、それぞれ映像（ビデオ）信号の記録されるトランクの
始端側に交互に順次ＲＡＭＡＢ。
Ｃ［）から読出されたＰＣＭ音声信号及び他のディジタ
ルデータ信号等の変調信号の記録が行われる。
ルデータ信号等の変調信号の記録が行われる。
さらに再生時には、テープ（６８）から従来と同様に再
生された信号がスイッチ（６１）から変復調回路（１３
）に供給される。この回路（１３）で復調された信号が
エラー訂正補間回路（４）に供給されて、ＲＡＭＡ （
１２ａ ） 〜ＲＡＭＤ （１２ｄ ）との共働によっ
てエラー訂正補間のデコードが行われる。この場合に変
換回路（４）及びＲＡＭＡ（１２ａ）〜ＲＡＭＤ（１２
ｄ）の再生時の動作は第４図に示すように行われ、同図
Ａに示すようなＲＦスイッチ信号に対して、同図ＢＮＥ
に示すようにＲＡＭＡＮＤの書込が行われ、書込まれた
信号は同図Ｆ、Ｇに示される期間にビット伸張及びエラ
ー訂正補間のためのデコード等の処理が行われ、これら
の処理された信号が同図Ｈ，Ｉに示される期間に時間軸
伸張して読出される。
生された信号がスイッチ（６１）から変復調回路（１３
）に供給される。この回路（１３）で復調された信号が
エラー訂正補間回路（４）に供給されて、ＲＡＭＡ （
１２ａ ） 〜ＲＡＭＤ （１２ｄ ）との共働によっ
てエラー訂正補間のデコードが行われる。この場合に変
換回路（４）及びＲＡＭＡ（１２ａ）〜ＲＡＭＤ（１２
ｄ）の再生時の動作は第４図に示すように行われ、同図
Ａに示すようなＲＦスイッチ信号に対して、同図ＢＮＥ
に示すようにＲＡＭＡＮＤの書込が行われ、書込まれた
信号は同図Ｆ、Ｇに示される期間にビット伸張及びエラ
ー訂正補間のためのデコード等の処理が行われ、これら
の処理された信号が同図Ｈ，Ｉに示される期間に時間軸
伸張して読出される。
この読出された信号がＡＤ／ＤＡ変換回路（３）及びス
イッチ（１１）に供給され、変換回路（３）からのアナ
ログ信号がアナログノイズリダクシッン回路（２）に供
給されて、デコードされた音声出力信号が出力端子（１
４）に取出される。
イッチ（１１）に供給され、変換回路（３）からのアナ
ログ信号がアナログノイズリダクシッン回路（２）に供
給されて、デコードされた音声出力信号が出力端子（１
４）に取出される。
さらにスイッチ（１１）に供給された信号は記録内容に
従って選択され、まず音声信号のときはスイッチ（１１
）からＡＤ／ＤＡ変換回路（７）に供給される。そして
変換された音声出力信号がアナログノイズリダクシッン
回路（６）を通じて出力端子（１５）に取出される。
従って選択され、まず音声信号のときはスイッチ（１１
）からＡＤ／ＤＡ変換回路（７）に供給される。そして
変換された音声出力信号がアナログノイズリダクシッン
回路（６）を通じて出力端子（１５）に取出される。
また信号が映像信号のときはスイッチ（１１）からの信
号がＡＤ／ＤＡ変換回路（９）に供給されて、変換され
た映像出力信号が端子（１６）に取出される。
号がＡＤ／ＤＡ変換回路（９）に供給されて、変換され
た映像出力信号が端子（１６）に取出される。
さらにディジタルデータ信号のときはスイッチ（１１）
からの信号が入出力端子（１０）に取出される。
からの信号が入出力端子（１０）に取出される。
こうして上述の装置によれば、メモリが４（１１設けら
れたことにより、種々の情報信号をＰＣＭ音声信号と共
に記録することができ、これによって高密度記録を有効
に利用することができる。
れたことにより、種々の情報信号をＰＣＭ音声信号と共
に記録することができ、これによって高密度記録を有効
に利用することができる。
なお上述の新規なＰＣＭ記録としては、上記以外にも、
例えば回路（４）にて直線１６ビツトを折線１２ビツト
にビット圧縮し、回路（１３）にて６−７変換方式の変
調を行うようにしてもよい。
例えば回路（４）にて直線１６ビツトを折線１２ビツト
にビット圧縮し、回路（１３）にて６−７変換方式の変
調を行うようにしてもよい。
（発明の効果〕
この発明によれば、メモリが４個設けられたことにより
、種々の情報信号をＰＣＭ音声信号と共に記録すること
ができ、これによって高密度記録を有効に利用すること
ができるようになった。
、種々の情報信号をＰＣＭ音声信号と共に記録すること
ができ、これによって高密度記録を有効に利用すること
ができるようになった。
第１図は本発明の一例の構成図、第２図〜第４図はその
説明のための図、第５図〜第８図は従来の技術の説明の
ための図である。 （１） ＋５）は音声入力端子、（２） （６）はアナ
ログノイズリダクシッン回路、（３） （７） （９１
はＡＤ／ＤＡ変換回路、（４）はエラー訂正補間回路、
（８）は静止画映像入力端子、（１０）はディジタルデ
ータ信号入出力端子、（１１）はスイッチ、（１２ａ
） 〜（１２ｄ ）はＲＡＭ、（１３）は８−ＩＯ変換
変復調回路、（１４）〜（１６）は出力端子である。
説明のための図、第５図〜第８図は従来の技術の説明の
ための図である。 （１） ＋５）は音声入力端子、（２） （６）はアナ
ログノイズリダクシッン回路、（３） （７） （９１
はＡＤ／ＤＡ変換回路、（４）はエラー訂正補間回路、
（８）は静止画映像入力端子、（１０）はディジタルデ
ータ信号入出力端子、（１１）はスイッチ、（１２ａ
） 〜（１２ｄ ）はＲＡＭ、（１３）は８−ＩＯ変換
変復調回路、（１４）〜（１６）は出力端子である。
Claims (1)
- 【特許請求の範囲】 １フィールド分の映像信号が１トラックに記録されると
共にこのトラックの延長部にディジタル信号が記録され
るようにしたＶＴＲにおいて、各々１フィールド分のＰ
ＣＭ音声信号に相当するメモリが４個設けられ、 少なくとも２個の上記メモリには上記ＰＣＭ音声信号が
逐時記憶され、 上記メモリ中の２個分の情報を上記１トラックの延長部
に記録するようにしたＶＴＲ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62264666A JPH01107367A (ja) | 1987-10-20 | 1987-10-20 | Ｖｔｒ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62264666A JPH01107367A (ja) | 1987-10-20 | 1987-10-20 | Ｖｔｒ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01107367A true JPH01107367A (ja) | 1989-04-25 |
Family
ID=17406519
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62264666A Pending JPH01107367A (ja) | 1987-10-20 | 1987-10-20 | Ｖｔｒ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01107367A (ja) |
-
1987
- 1987-10-20 JP JP62264666A patent/JPH01107367A/ja active Pending
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