JPH01112442A - Cpu負荷分布測定装置 - Google Patents
Cpu負荷分布測定装置Info
- Publication number
- JPH01112442A JPH01112442A JP62272237A JP27223787A JPH01112442A JP H01112442 A JPH01112442 A JP H01112442A JP 62272237 A JP62272237 A JP 62272237A JP 27223787 A JP27223787 A JP 27223787A JP H01112442 A JPH01112442 A JP H01112442A
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- JP
- Japan
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- program
- address
- load distribution
- cpu load
- deciding
- Prior art date
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- Pending
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- 238000004364 calculation method Methods 0.000 claims abstract description 12
- 238000000605 extraction Methods 0.000 claims description 19
- 238000005070 sampling Methods 0.000 claims description 6
- 239000000284 extract Substances 0.000 claims description 3
- 238000005259 measurement Methods 0.000 abstract description 10
- 238000010586 diagram Methods 0.000 description 7
- 239000013256 coordination polymer Substances 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000007619 statistical method Methods 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はCPU負荷分布測定装置に関し、特にコンピュ
ータシステムで稼働する各プログラムに対するCPUの
負荷の分布を測定するCPU負荷分布測定装置に関する
。
ータシステムで稼働する各プログラムに対するCPUの
負荷の分布を測定するCPU負荷分布測定装置に関する
。
コンピュータシステムで稼働する各プログラムへのCP
U負荷分布を測定する従来のCPU負荷分布測定装置は
、各プログラムを実行させるファームウェアエミュレー
タなどに、CPUの実行時間測定機能やCPUの実行時
間測定区間登録機能を組込んでいる。
U負荷分布を測定する従来のCPU負荷分布測定装置は
、各プログラムを実行させるファームウェアエミュレー
タなどに、CPUの実行時間測定機能やCPUの実行時
間測定区間登録機能を組込んでいる。
これらを使用して、従来のCPU負荷分布測定装置は、
各プログラムの実行開始アドレスと実行終了アドレスと
を登録して、その二つがあられれる間の時間1m隔を測
定し、この時間間隔と全実行時間との比を求めて、CP
U負荷分布を測定している。
各プログラムの実行開始アドレスと実行終了アドレスと
を登録して、その二つがあられれる間の時間1m隔を測
定し、この時間間隔と全実行時間との比を求めて、CP
U負荷分布を測定している。
1、発明が解決しようとする問題点〕
上述した従来のCPU負荷分布測定装置は、測定するプ
ログラムについて、実行開始アドレスと実行終了アドレ
スとを測定装置に登録しなければならないが、一つのプ
ログラムが複数の実行開始アドレスと複数の実行終了ア
ドレスとを持つ場合も多く、そのプログラムの設計上の
構造を理ぞしていなければ測定することができないとい
う問題・点がある。
ログラムについて、実行開始アドレスと実行終了アドレ
スとを測定装置に登録しなければならないが、一つのプ
ログラムが複数の実行開始アドレスと複数の実行終了ア
ドレスとを持つ場合も多く、そのプログラムの設計上の
構造を理ぞしていなければ測定することができないとい
う問題・点がある。
また、コンピュータシステムは、−fiにオペレーティ
ングシステムを使用し、タスクと呼ばれるプログラムの
処理単位により、並行処理を行っており、あるタスクで
実行中のプログラムに他のタスクにあるプログラムが割
込んで実行されるので、あるタスクで実行中のプログラ
ムの実行開始アドレスと実行終了アドレスとの間の時間
間隔を単純に測定したのではそのタスクの実行時間にな
らないこととなる。
ングシステムを使用し、タスクと呼ばれるプログラムの
処理単位により、並行処理を行っており、あるタスクで
実行中のプログラムに他のタスクにあるプログラムが割
込んで実行されるので、あるタスクで実行中のプログラ
ムの実行開始アドレスと実行終了アドレスとの間の時間
間隔を単純に測定したのではそのタスクの実行時間にな
らないこととなる。
このため、割込んだ他のタスクにあるプログラムの実行
時間部分をその測定値から取除くなど複雑な測定とその
結果の処置を行わねばならないという問題点がある。
時間部分をその測定値から取除くなど複雑な測定とその
結果の処置を行わねばならないという問題点がある。
これらの二つの問題点は、そのコンピュータシステムで
使用しているプログラム数やそのときの測定対象となる
プログラム数が多いほど、顕著にあられれて難しい問題
となる。
使用しているプログラム数やそのときの測定対象となる
プログラム数が多いほど、顕著にあられれて難しい問題
となる。
本発明の目的は、実行する各プログラムの設計上の構造
や他のタスクによる割込みの影響を考慮する必要がなく
、多数のプログラムに対する同時測定が簡単に行えるC
PU負荷分布測定装置を提供することにある。
や他のタスクによる割込みの影響を考慮する必要がなく
、多数のプログラムに対する同時測定が簡単に行えるC
PU負荷分布測定装置を提供することにある。
(゛問題点を解決するための手段〕
本発明のCPU負荷分布測定装置は、
(A>あらかじめ設定した一定の時間間隔で連続してサ
ンプリングパルスを発生するパルス発生部、 (B)前記サンプリングパルスの一つ一つを受けて、そ
の都度、コンピュータシステムで実行中にある命令の格
納アドレスを抽出する実行アドレス抽出部、 (C)前記コンピュータシステムが実行する各プログラ
ムの格納領域を示す情報を記憶するプログラム格納領域
表記憶部、 (D>前記実行アドレス抽出部で抽出された実行中にあ
る命令の格納アドレスが前記プログラム格納領域表記憶
部に記憶されたどのプログラムの格納アドレス領域゛に
あるかを判定する抽出アドレス判定部、 (E)前記抽出アドレス判定部の判定回数を各プログラ
ムごとに集計し、全抽出回数に対する各プログラムの判
定回数の割合を算定するCPU負荷分布算定部、 (F)前記CPU負荷分布算定部の算定結果を各プログ
ラムへのCPU負荷分布として出力するCPU負荷分布
出力部、 を備えて構成されている。
ンプリングパルスを発生するパルス発生部、 (B)前記サンプリングパルスの一つ一つを受けて、そ
の都度、コンピュータシステムで実行中にある命令の格
納アドレスを抽出する実行アドレス抽出部、 (C)前記コンピュータシステムが実行する各プログラ
ムの格納領域を示す情報を記憶するプログラム格納領域
表記憶部、 (D>前記実行アドレス抽出部で抽出された実行中にあ
る命令の格納アドレスが前記プログラム格納領域表記憶
部に記憶されたどのプログラムの格納アドレス領域゛に
あるかを判定する抽出アドレス判定部、 (E)前記抽出アドレス判定部の判定回数を各プログラ
ムごとに集計し、全抽出回数に対する各プログラムの判
定回数の割合を算定するCPU負荷分布算定部、 (F)前記CPU負荷分布算定部の算定結果を各プログ
ラムへのCPU負荷分布として出力するCPU負荷分布
出力部、 を備えて構成されている。
次に本発明の実施例について図面を参照して説明する。
第1図は本発明のCPU負荷分布測定装置の一実施例を
示すブロック図である。
示すブロック図である。
第1図において、CPU負荷分布測定装置1は、コンピ
ュータシステム2で実行される各プログラムに対して5
、どのようにCPUの負荷が分布するかを測定する。
ュータシステム2で実行される各プログラムに対して5
、どのようにCPUの負荷が分布するかを測定する。
まず、CPU負荷分布測定装置1のパルス発生部1−1
は、あらかじめ設定した一定の時間間隔で連続してサン
プリングパルスを発生する。
は、あらかじめ設定した一定の時間間隔で連続してサン
プリングパルスを発生する。
実行アドレス抽出部1−2は、このサンプリングパルス
の一つ一つを受けて、それを受けるごとにコンピュータ
システム2から送られて来る実行中の命令の格納アドレ
スを抽出する。
の一つ一つを受けて、それを受けるごとにコンピュータ
システム2から送られて来る実行中の命令の格納アドレ
スを抽出する。
一方、プログラム格納領域表記憶部1−3は、コンピュ
ータシステム2が実行する各プログラムの格納領域を示
す情報を記憶している。
ータシステム2が実行する各プログラムの格納領域を示
す情報を記憶している。
第2図はプログラム格納領域表記憶部1−3に記憶され
ている各プログラムの格納領域を示す情報の情報構成図
である。
ている各プログラムの格納領域を示す情報の情報構成図
である。
第2図に示すように、コンピュータシステム2が実行す
る各プログラムp、、p2. ・・・ ・・・ ・・
・P l +・・・・・・・・・PMは、それぞれ格納
領域の先頭アドレスL、、L2.・・・・・・・・・L
t、・・・・・・・・・LM、およびそれぞれ格納領域
の後尾アドレスH1。
る各プログラムp、、p2. ・・・ ・・・ ・・
・P l +・・・・・・・・・PMは、それぞれ格納
領域の先頭アドレスL、、L2.・・・・・・・・・L
t、・・・・・・・・・LM、およびそれぞれ格納領域
の後尾アドレスH1。
H2+・・・・・・・・・Ht、・・・・・・・・・H
Mを、各プログラムの格納領域を示す情報として有して
いる。
Mを、各プログラムの格納領域を示す情報として有して
いる。
実行アドレス抽出部1−2で抽出された実行中の命令の
格納アドレスをX番地とすると、抽出アドレス判定部1
−4は、このXに対して、L、≦X≦H+を満足するp
tを検索し、このXがプログラムP1の格納アドレス領
域にあると判定する。
格納アドレスをX番地とすると、抽出アドレス判定部1
−4は、このXに対して、L、≦X≦H+を満足するp
tを検索し、このXがプログラムP1の格納アドレス領
域にあると判定する。
この判定結果を受けて、CPU負荷分布算定部1−5は
、抽出アドレス判定部1−4の判定回数を各プログラム
ごとに集計し、全抽出回数に対する各プログラムの判定
回数の割合を算定する。
、抽出アドレス判定部1−4の判定回数を各プログラム
ごとに集計し、全抽出回数に対する各プログラムの判定
回数の割合を算定する。
第3図はCPU負荷分布算定部1−5に有する判定回数
情報を示す情報構成図である。
情報を示す情報構成図である。
CPU負荷分布算定部1−5は、第3図のように、各プ
ログラムp、、p2.・・・・・・・・・PI、・・・
・・・・・・PMに対して、それぞれそのプログラムI
\の判定回数N、、N2.・・・・・・・・・N1.・
・・・・・・・・N、とそれらの合計値Nとを保持して
いる。
ログラムp、、p2.・・・・・・・・・PI、・・・
・・・・・・PMに対して、それぞれそのプログラムI
\の判定回数N、、N2.・・・・・・・・・N1.・
・・・・・・・・N、とそれらの合計値Nとを保持して
いる。
判定回数N1 + N2 +・・・・・・・・・Nl、
・・・・・・・・・NMおよびNは、初期値としてはそ
れぞれOが与えられるが、抽出アドレス判定部1−4が
格納アドレスXをプログラムP、の格納アドレス領域に
あると判定するごとに、CPU負荷分布算定部1−5は
そのプログラムへの判定回数N1と判定回数の合計値N
とに1を加える。
・・・・・・・・・NMおよびNは、初期値としてはそ
れぞれOが与えられるが、抽出アドレス判定部1−4が
格納アドレスXをプログラムP、の格納アドレス領域に
あると判定するごとに、CPU負荷分布算定部1−5は
そのプログラムへの判定回数N1と判定回数の合計値N
とに1を加える。
Nの値が一定の値を越えたとき、CPLI負荷分布算定
部1−5は全抽出回数に対する各プログラムの判定回数
の割合N l/ N 、 N2 / N 、・・・・・
・・・・N、/N、・・・・・・・・・N、/Nを算定
する。
部1−5は全抽出回数に対する各プログラムの判定回数
の割合N l/ N 、 N2 / N 、・・・・・
・・・・N、/N、・・・・・・・・・N、/Nを算定
する。
CPU負荷分布出力部1−6は、CPU負荷分布算定部
1−5の算定結果である全抽出回数に対する各プログラ
ムの判定回数の割合N、/N。
1−5の算定結果である全抽出回数に対する各プログラ
ムの判定回数の割合N、/N。
N2/N、・・・・・・・・・N、/N、・・・・・・
・・・N M / Nを各プログラムへのコンピュータ
システム2のCPU負荷分布としてCR,Tデイスプレ
ィまたはプリンタに出力する。
・・・N M / Nを各プログラムへのコンピュータ
システム2のCPU負荷分布としてCR,Tデイスプレ
ィまたはプリンタに出力する。
以上説明したように、本発明のCPU負荷分布測定装置
は、コンピュータシステムの性能評価に関する重要な要
素である各プログラムへのCPU負荷分布の測定を統計
的手法を用いて実現しているので、実行アドレス抽出回
数を増加させることにより、その測定精度を制限なく向
上させることができるという利点がある。
は、コンピュータシステムの性能評価に関する重要な要
素である各プログラムへのCPU負荷分布の測定を統計
的手法を用いて実現しているので、実行アドレス抽出回
数を増加させることにより、その測定精度を制限なく向
上させることができるという利点がある。
一方、本発明のCPU負荷分布測定装置は、各プログラ
ムの実行開始アドレスと実行終了アドレスを測定に使用
するのではなく、各プログラムに割当てられた格納アド
レス領域を使用しているので、実行する各プログラムの
設計上の構造や他のタスクによる割込みの影響を考慮す
る必要がなく、多数の10グラムに対する同時測定が簡
単に行えるという効果を有している。
ムの実行開始アドレスと実行終了アドレスを測定に使用
するのではなく、各プログラムに割当てられた格納アド
レス領域を使用しているので、実行する各プログラムの
設計上の構造や他のタスクによる割込みの影響を考慮す
る必要がなく、多数の10グラムに対する同時測定が簡
単に行えるという効果を有している。
このため、本発明のCPU負荷分布測定装置を使用する
ことにより、CPU負荷分布の測定をプログラム設計に
無関係の人々に依頼して容易に行えるという効果もある
。
ことにより、CPU負荷分布の測定をプログラム設計に
無関係の人々に依頼して容易に行えるという効果もある
。
第1図は本発明のCPU負荷分布測定装置の一実施例を
示すブロック図、第2図は各プログラムの格納領域を示
す情報の情報構成図、第3図は判定回数情報を示す情報
構成図である。 l・・・・・・CPU負荷分布測定装置、1−1・・・
・・・パルス発生部、■−2・・・・・・実行アドレス
抽出部、1−3・・・・・・プログラム格納領域表記憶
部、1−4・・・・・・抽出アドレス判定部、■−5・
・・・・・CPU負荷分布算定部、1−6・・・・・・
CPU負荷分布出力部、2・・・・・・コンピュータシ
ステム。 −代理人 弁理士 白魚 音 第1図
示すブロック図、第2図は各プログラムの格納領域を示
す情報の情報構成図、第3図は判定回数情報を示す情報
構成図である。 l・・・・・・CPU負荷分布測定装置、1−1・・・
・・・パルス発生部、■−2・・・・・・実行アドレス
抽出部、1−3・・・・・・プログラム格納領域表記憶
部、1−4・・・・・・抽出アドレス判定部、■−5・
・・・・・CPU負荷分布算定部、1−6・・・・・・
CPU負荷分布出力部、2・・・・・・コンピュータシ
ステム。 −代理人 弁理士 白魚 音 第1図
Claims (1)
- 【特許請求の範囲】 (A)あらかじめ設定した一定の時間間隔で連続してサ
ンプリングパルスを発生するパルス発生部、 (B)前記サンプリングパルスの一つ一つを受けて、そ
の都度、コンピュータシステムで実行中にある命令の格
納アドレスを抽出する実行アドレス抽出部、 (C)前記コンピュータシステムが実行する各プログラ
ムの格納領域を示す情報を記憶するプログラム格納領域
表記憶部、 (D)前記実行アドレス抽出部で抽出された実行中にあ
る命令の格納アドレスが前記プログラム格納領域表記憶
部に記憶されたどのプログラムの格納アドレス領域にあ
るかを判定する抽出アドレス判定部、 (E)前記抽出アドレス判定部の判定回数を各プログラ
ムごとに集計し、全抽出回数に対する各プログラムの判
定回数の割合を算定する CPU負荷分布算定部、 (F)前記CPU負荷分布算定部の算定結果を各プログ
ラムへのCPU負荷分布として出力するCPU負荷分布
出力部、 を備えることを特徴とするCPU負荷分布測定装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62272237A JPH01112442A (ja) | 1987-10-27 | 1987-10-27 | Cpu負荷分布測定装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62272237A JPH01112442A (ja) | 1987-10-27 | 1987-10-27 | Cpu負荷分布測定装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01112442A true JPH01112442A (ja) | 1989-05-01 |
Family
ID=17511035
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62272237A Pending JPH01112442A (ja) | 1987-10-27 | 1987-10-27 | Cpu負荷分布測定装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01112442A (ja) |
-
1987
- 1987-10-27 JP JP62272237A patent/JPH01112442A/ja active Pending
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