JPH01115127A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPH01115127A JPH01115127A JP62274564A JP27456487A JPH01115127A JP H01115127 A JPH01115127 A JP H01115127A JP 62274564 A JP62274564 A JP 62274564A JP 27456487 A JP27456487 A JP 27456487A JP H01115127 A JPH01115127 A JP H01115127A
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor chip
- section
- frame
- solder
- peripheral side
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/30—Die-attach connectors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/10—Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
- H10D62/117—Shapes of semiconductor bodies
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/01—Manufacture or treatment
- H10W72/013—Manufacture or treatment of die-attach connectors
- H10W72/01308—Manufacture or treatment of die-attach connectors using permanent auxiliary members, e.g. using alignment marks
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/073—Connecting or disconnecting of die-attach connectors
- H10W72/07311—Treating the bonding area before connecting, e.g. by applying flux or cleaning
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/073—Connecting or disconnecting of die-attach connectors
- H10W72/07351—Connecting or disconnecting of die-attach connectors characterised by changes in properties of the die-attach connectors during connecting
- H10W72/07352—Connecting or disconnecting of die-attach connectors characterised by changes in properties of the die-attach connectors during connecting changes in structures or sizes
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/30—Die-attach connectors
- H10W72/321—Structures or relative sizes of die-attach connectors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/531—Shapes of wire connectors
- H10W72/5363—Shapes of wire connectors the connected ends being wedge-shaped
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/851—Dispositions of multiple connectors or interconnections
- H10W72/874—On different surfaces
- H10W72/884—Die-attach connectors and bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W74/00—Encapsulations, e.g. protective coatings
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/731—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
- H10W90/736—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked lead frame, conducting package substrate or heat sink
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Die Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は両面メサ形半導体チップがフレームに半田付け
されてなる半導体装置に関するものである。
されてなる半導体装置に関するものである。
従来、中1カデバイスのトチイアツク、サイリスタ等の
半導体装置に使用される両面メサ形半導体チップは、裏
面にメタライズ部が形成され、このメタライズ部とフレ
ームとを半田付けすることによってフレーム上に固着さ
れていた。これを図によって説明すると、第2図は従来
の半導体装置を示す側断面図で、同図において、1は半
導体チップで、この半導体チップ1は表面に表面端子1
aを有し、裏面にメタライズ部1bが形成されており、
かつ周側部にはメサ溝1Cが形成され、このメサ溝を覆
うようにガラスパッシベーション2が“汲けられている
。3はフレームで、このフレーム3は前記半導体チップ
1が固着されるダイパッド部3aと、他の装置へ接続さ
れる外部端子部3bとから構成されている。4は前記フ
レーム3のダイパッド部3a上に半導体チップ1を固着
させるための半田、5は半導体チップ1の表面電極1a
とフレーム3の外部端子部3bとを接続するためのアル
ミワイヤで、超音波ボンディングによって接合されてい
る。6は封止用樹脂としてのエポキシ樹脂である。
半導体装置に使用される両面メサ形半導体チップは、裏
面にメタライズ部が形成され、このメタライズ部とフレ
ームとを半田付けすることによってフレーム上に固着さ
れていた。これを図によって説明すると、第2図は従来
の半導体装置を示す側断面図で、同図において、1は半
導体チップで、この半導体チップ1は表面に表面端子1
aを有し、裏面にメタライズ部1bが形成されており、
かつ周側部にはメサ溝1Cが形成され、このメサ溝を覆
うようにガラスパッシベーション2が“汲けられている
。3はフレームで、このフレーム3は前記半導体チップ
1が固着されるダイパッド部3aと、他の装置へ接続さ
れる外部端子部3bとから構成されている。4は前記フ
レーム3のダイパッド部3a上に半導体チップ1を固着
させるための半田、5は半導体チップ1の表面電極1a
とフレーム3の外部端子部3bとを接続するためのアル
ミワイヤで、超音波ボンディングによって接合されてい
る。6は封止用樹脂としてのエポキシ樹脂である。
このように構成された半導体装置を組立てるにハ、先ず
、フレーム3のダイパッド部3a上に半田片(図示せず
)を載置し、この半田片の上にメタライズ部1bが対応
するように半導体チップ1を載置させ、次いで、300
℃〜400℃に加熱された熱板上にフレーム3を移載さ
せ、半田片を溶融させることによってダイボンディング
する。しかる後、アルミワイヤ5をワイヤボンディング
し、エポキシ樹脂6により封止することによって組立て
が完了する。
、フレーム3のダイパッド部3a上に半田片(図示せず
)を載置し、この半田片の上にメタライズ部1bが対応
するように半導体チップ1を載置させ、次いで、300
℃〜400℃に加熱された熱板上にフレーム3を移載さ
せ、半田片を溶融させることによってダイボンディング
する。しかる後、アルミワイヤ5をワイヤボンディング
し、エポキシ樹脂6により封止することによって組立て
が完了する。
なお、この半導体装置においては、半導体チップ1がフ
レーム3上に固着された際に、メタライズ部1bとダイ
パッド部3aとの間の半田4の厚みが断続通電寿命サイ
クルの関係から30μm以上になるよう定められている
。
レーム3上に固着された際に、メタライズ部1bとダイ
パッド部3aとの間の半田4の厚みが断続通電寿命サイ
クルの関係から30μm以上になるよう定められている
。
また、この半導体装置に使用される半導体チップ1は、
ガラスパッシベーション2が施されたものの他ニ、ガラ
スパッシベーション2の代わりに8 i(h膜が形成さ
れたものもある。
ガラスパッシベーション2が施されたものの他ニ、ガラ
スパッシベーション2の代わりに8 i(h膜が形成さ
れたものもある。
〔発明が解決しようとする問題点〕
しかるに、このように構成された従来の半導体装置にお
いては、半田4の厚み寸法が小さくならないように半田
4の量を若干多くすると、第2図に示すように、半田4
が半導体チップ1のメサ溝1Cに泊ってはい上がるごと
く、盛シ上が14aが生じ、この盛シ上がF)4aのた
めに半導体チップ1の信頼性が低下するという問題があ
った。また、この盛シ上がシのために半田を必要以上に
要し、このため製造コストが高くなっていた。
いては、半田4の厚み寸法が小さくならないように半田
4の量を若干多くすると、第2図に示すように、半田4
が半導体チップ1のメサ溝1Cに泊ってはい上がるごと
く、盛シ上が14aが生じ、この盛シ上がF)4aのた
めに半導体チップ1の信頼性が低下するという問題があ
った。また、この盛シ上がシのために半田を必要以上に
要し、このため製造コストが高くなっていた。
本発明に係る半導体装置は、フレームにおける半導体チ
ップの裏面の周縁部より中心側であってパッシベーショ
ンおよびメタライズ部と対向する部位を、半導体チップ
の周側部と対向する部位より高く形成したものである。
ップの裏面の周縁部より中心側であってパッシベーショ
ンおよびメタライズ部と対向する部位を、半導体チップ
の周側部と対向する部位より高く形成したものである。
フレームにおける半導体チップの周側部と対向する部位
に余分な半田が流れ出し、半導体チップのメタライズ部
とフレームにおけるメタライズ部と対向する部位との間
に半田が保持される。
に余分な半田が流れ出し、半導体チップのメタライズ部
とフレームにおけるメタライズ部と対向する部位との間
に半田が保持される。
以下、その構成等を図に示す実施例により詳細に説明す
る。第1図は本発明に係る半導体装置を示す側断面図で
、同図において第2図で示した部材と同一もしくは同等
部材については同一符号を付し、ここにおいて詳細な説
明は省略する。同図において、11は本発明の半導体装
置に使用されるフレームで、このフレーム11は半導体
チップ1が固着されるダイパッド部11aと、他の装置
へ接続される外部端子部11bとからなシ、このダイパ
ッド11aには、半導体チップ1の周側部に形成された
メサ溝1Cと対向する部位に凹部11Cを形成すること
により、半導体チップの裏面の周縁部より中心側であっ
てパッシベーション2およびメタライズ部1bと対向す
る部位に凸部11dが形成されている。すなわち、この
凸部11dの上面は、半導体チップ1のメタライズ部1
bより大きく、かつ半導体チップ1の裏面全体より小さ
く形成されることになシ、凸部11dの周縁部分は、半
導体チップ1の裏面に形成されたパッシベーション2と
対向することになる。また、この凸部11dの高さ、換
言すれば凹部11Cの深さはエツチング等により約50
μm程度に形成されている。
る。第1図は本発明に係る半導体装置を示す側断面図で
、同図において第2図で示した部材と同一もしくは同等
部材については同一符号を付し、ここにおいて詳細な説
明は省略する。同図において、11は本発明の半導体装
置に使用されるフレームで、このフレーム11は半導体
チップ1が固着されるダイパッド部11aと、他の装置
へ接続される外部端子部11bとからなシ、このダイパ
ッド11aには、半導体チップ1の周側部に形成された
メサ溝1Cと対向する部位に凹部11Cを形成すること
により、半導体チップの裏面の周縁部より中心側であっ
てパッシベーション2およびメタライズ部1bと対向す
る部位に凸部11dが形成されている。すなわち、この
凸部11dの上面は、半導体チップ1のメタライズ部1
bより大きく、かつ半導体チップ1の裏面全体より小さ
く形成されることになシ、凸部11dの周縁部分は、半
導体チップ1の裏面に形成されたパッシベーション2と
対向することになる。また、この凸部11dの高さ、換
言すれば凹部11Cの深さはエツチング等により約50
μm程度に形成されている。
とのフレーム11を使用して半導体装置を組立てるには
、フレーム11の凸部11d上に半田片(図示せず)を
載置し、この半田片上に半導体チップ1を載置させる。
、フレーム11の凸部11d上に半田片(図示せず)を
載置し、この半田片上に半導体チップ1を載置させる。
次いで、半田片を溶融させてダイボンディングする。し
かる後、アルミワイヤ5をワイヤボンディングし、エポ
キシ樹脂6により封止することによって組立てが完了す
る。
かる後、アルミワイヤ5をワイヤボンディングし、エポ
キシ樹脂6により封止することによって組立てが完了す
る。
したがって、半田片が溶融した際に、余分な半田は半導
体チップ1のメサ溝1Cに付着することす<フレーム1
1の凹部11Cに流れ、かつフレーム11の凸部11d
上面は半導体チップ1のメタライズ部1dより大きく形
成されているから、凸部11dが半導体チップ1の裏面
周側部に形成されたパッシベーション2の内側に嵌入す
ることもないので、メタライズ部1bと凸部11dとの
間に半田が所定厚みをもって保持されることになる。
体チップ1のメサ溝1Cに付着することす<フレーム1
1の凹部11Cに流れ、かつフレーム11の凸部11d
上面は半導体チップ1のメタライズ部1dより大きく形
成されているから、凸部11dが半導体チップ1の裏面
周側部に形成されたパッシベーション2の内側に嵌入す
ることもないので、メタライズ部1bと凸部11dとの
間に半田が所定厚みをもって保持されることになる。
なお、本実施例ではサイリスタ、トライアック等の電力
用半導体装置について説明したが、MO5FET 、I
GBT等の半導体装置であってもよく、上記実施例と同
等の効果が得られる。
用半導体装置について説明したが、MO5FET 、I
GBT等の半導体装置であってもよく、上記実施例と同
等の効果が得られる。
以上説明したように本発明によれば、フレームにおける
半導体チップ裏面の周縁部より中心側であってパッシベ
ーションおよびメタライズ部と対向する部位を、半導体
チップの周側部と対向する部位より高く形成したため、
余分な半田が半導体チップの周側部に付着することなく
フレームにおける半導体チップの周側部と対向する部位
に流れかつ半導体チップのメタライズ部とフレームにお
けるメタライズ部と対向する部位との間に半田が保持さ
れることになる。したがって、半田が半導体チップの周
側部に沿ってはい上がるごとく盛り上がることがないの
で、この種半導体装置を多数個形成するにあたりフレー
ム毎に半田の塵υ上がシ量が異なるようなことがなく、
全ての半導体装置において半田の厚みを均等にすること
ができ、また、半田の量も半導体チップの裏面周縁部ま
で半田を付着させずに保持でき減らすことができるから
、精度および信頼性の高い半導体装置を安価に得ること
ができる。
半導体チップ裏面の周縁部より中心側であってパッシベ
ーションおよびメタライズ部と対向する部位を、半導体
チップの周側部と対向する部位より高く形成したため、
余分な半田が半導体チップの周側部に付着することなく
フレームにおける半導体チップの周側部と対向する部位
に流れかつ半導体チップのメタライズ部とフレームにお
けるメタライズ部と対向する部位との間に半田が保持さ
れることになる。したがって、半田が半導体チップの周
側部に沿ってはい上がるごとく盛り上がることがないの
で、この種半導体装置を多数個形成するにあたりフレー
ム毎に半田の塵υ上がシ量が異なるようなことがなく、
全ての半導体装置において半田の厚みを均等にすること
ができ、また、半田の量も半導体チップの裏面周縁部ま
で半田を付着させずに保持でき減らすことができるから
、精度および信頼性の高い半導体装置を安価に得ること
ができる。
第1図は本発明に係る半導体装置を示す側断面図、第2
図は従来の半導体装置を示す側断面図である。 1・・・拳半導体チップ、1b・・・・メタライズ部、
2・・・・ガラスパッシベーション、4・・争・半田、
11・・・eフレーム、11d・・・・凸部。
図は従来の半導体装置を示す側断面図である。 1・・・拳半導体チップ、1b・・・・メタライズ部、
2・・・・ガラスパッシベーション、4・・争・半田、
11・・・eフレーム、11d・・・・凸部。
Claims (1)
- 裏面にメタライズ部が形成され、周側部および裏面の
周縁部とがパッシベーションされた両面メサ形半導体チ
ップがフレーム上に半田付けされてなる半導体装置にお
いて、前記フレームにおける半導体チップ裏面の周縁部
より中心側であつてパッシベーションおよびメタライズ
部と対向する部位を、半導体チップの周側部と対向する
部位より高く形成したことを特徴とする半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62274564A JPH01115127A (ja) | 1987-10-28 | 1987-10-28 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62274564A JPH01115127A (ja) | 1987-10-28 | 1987-10-28 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01115127A true JPH01115127A (ja) | 1989-05-08 |
Family
ID=17543488
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62274564A Pending JPH01115127A (ja) | 1987-10-28 | 1987-10-28 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01115127A (ja) |
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08508614A (ja) * | 1993-03-31 | 1996-09-10 | シーメンス コンポーネンツ インコーポレイテッド | 半導体チップを支持する台座を具備したリードフレーム |
| JP2004511926A (ja) * | 2000-05-31 | 2004-04-15 | @ポス ドットコム インコーポレイテッド | セキュアな、暗号化pinパッド |
| JP2004119944A (ja) * | 2002-09-30 | 2004-04-15 | Toyota Industries Corp | 半導体モジュールおよび実装基板 |
| JP2006269751A (ja) * | 2005-03-24 | 2006-10-05 | Toshiba Corp | 半導体装置の製造方法及び半導体装置 |
| JP2007134395A (ja) * | 2005-11-08 | 2007-05-31 | Rohm Co Ltd | 半導体装置 |
| US7235876B2 (en) * | 2005-09-12 | 2007-06-26 | Denso Corporation | Semiconductor device having metallic plate with groove |
| JP2011223035A (ja) * | 2011-07-25 | 2011-11-04 | Toshiba Corp | 半導体装置 |
| EP2605278A1 (en) * | 2011-12-15 | 2013-06-19 | Nxp B.V. | Lead Frame with Die Attach Bleeding Control Features |
| JP2016105508A (ja) * | 2016-02-29 | 2016-06-09 | 株式会社三社電機製作所 | 半導体装置 |
-
1987
- 1987-10-28 JP JP62274564A patent/JPH01115127A/ja active Pending
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08508614A (ja) * | 1993-03-31 | 1996-09-10 | シーメンス コンポーネンツ インコーポレイテッド | 半導体チップを支持する台座を具備したリードフレーム |
| JP2004511926A (ja) * | 2000-05-31 | 2004-04-15 | @ポス ドットコム インコーポレイテッド | セキュアな、暗号化pinパッド |
| JP2004119944A (ja) * | 2002-09-30 | 2004-04-15 | Toyota Industries Corp | 半導体モジュールおよび実装基板 |
| JP2006269751A (ja) * | 2005-03-24 | 2006-10-05 | Toshiba Corp | 半導体装置の製造方法及び半導体装置 |
| US7235876B2 (en) * | 2005-09-12 | 2007-06-26 | Denso Corporation | Semiconductor device having metallic plate with groove |
| JP2007134395A (ja) * | 2005-11-08 | 2007-05-31 | Rohm Co Ltd | 半導体装置 |
| JP2011223035A (ja) * | 2011-07-25 | 2011-11-04 | Toshiba Corp | 半導体装置 |
| EP2605278A1 (en) * | 2011-12-15 | 2013-06-19 | Nxp B.V. | Lead Frame with Die Attach Bleeding Control Features |
| JP2016105508A (ja) * | 2016-02-29 | 2016-06-09 | 株式会社三社電機製作所 | 半導体装置 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP3007023B2 (ja) | 半導体集積回路およびその製造方法 | |
| US5218229A (en) | Inset die lead frame configuration lead frame for a semiconductor device having means for improved busing and die-lead frame attachment | |
| US5016084A (en) | Semiconductor device | |
| JPH06244360A (ja) | 半導体装置 | |
| JPH01115127A (ja) | 半導体装置 | |
| JPS62202548A (ja) | 半導体装置 | |
| JP2569400B2 (ja) | 樹脂封止型半導体装置の製造方法 | |
| US3280383A (en) | Electronic semiconductor device | |
| JPH10247701A (ja) | 半導体装置およびその製造に用いるリードフレーム | |
| US3471752A (en) | Semiconductor device with an insulating body interposed between a semiconductor element and a part of a casing | |
| JP2000077458A (ja) | フリップチップ実装方法 | |
| JP2788011B2 (ja) | 半導体集積回路装置 | |
| JPS63293963A (ja) | 樹脂封止型半導体装置 | |
| JPH06241889A (ja) | 半導体装置 | |
| JPH09223767A (ja) | リードフレーム | |
| JPH0451056B2 (ja) | ||
| JPS6218737A (ja) | 半導体装置用セラミツクパツケ−ジ | |
| JPS6155778B2 (ja) | ||
| JPH05235260A (ja) | 半導体装置 | |
| JPH1155065A (ja) | 固体素子デバイスの製造方法 | |
| JP2526534Y2 (ja) | シヨツトキバリアダイオ−ド素子 | |
| JPH05335366A (ja) | 半導体装置 | |
| JPH0553310B2 (ja) | ||
| JPH05275570A (ja) | 半導体装置 | |
| JPS60246656A (ja) | 半導体装置用パツケ−ジ |