JPH01122634U - - Google Patents
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- Publication number
- JPH01122634U JPH01122634U JP1753188U JP1753188U JPH01122634U JP H01122634 U JPH01122634 U JP H01122634U JP 1753188 U JP1753188 U JP 1753188U JP 1753188 U JP1753188 U JP 1753188U JP H01122634 U JPH01122634 U JP H01122634U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- output
- channel switching
- input
- switching transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
Description
第１図はこの考案の一実施例を示すブロツク図
、第２図は第１図の各部の信号波形を示す波形図
、第３図は第１図のスイツチ回路の接続を示す接
続図、第４図は従来のスイツチ回路を示す接続図
。 １……発振器、２１，２２，２３……それぞれ
Ｆ／Ｆ、３０，３１，３２，３３……それぞれ出
力信号、４０，４１，４２，４３……それぞれス
イツチ回路、５……出力信号線、６……デコーダ
、Ｔｒ１，Ｔｒ２……ロード回路を構成するｐチ
ヤネルのスイツチング・トランジスタ、Ｔｒ３，
Ｔｒ４……ドライバ回路を構成するｎチヤネルの
スイツチング・トランジスタ。なお、図中同一符
号は同一または相当部分を示す。
、第２図は第１図の各部の信号波形を示す波形図
、第３図は第１図のスイツチ回路の接続を示す接
続図、第４図は従来のスイツチ回路を示す接続図
。 １……発振器、２１，２２，２３……それぞれ
Ｆ／Ｆ、３０，３１，３２，３３……それぞれ出
力信号、４０，４１，４２，４３……それぞれス
イツチ回路、５……出力信号線、６……デコーダ
、Ｔｒ１，Ｔｒ２……ロード回路を構成するｐチ
ヤネルのスイツチング・トランジスタ、Ｔｒ３，
Ｔｒ４……ドライバ回路を構成するｎチヤネルの
スイツチング・トランジスタ。なお、図中同一符
号は同一または相当部分を示す。
Claims (1)
- 【実用新案登録請求の範囲】 所望の範囲のクロツク周波数の中の最高のクロ
ツク周波数を発生する発振器と、この発振器の出
力周波数を一段ごとに１／２に分周するＴ型フリ
ツプフロツプをＮ段縦続した分周回路と、上記発
振器の出力信号と上記分周回路の各段の出力信号
に対応してそれぞれ設けられ、対応する出力信号
を入力してクロツクド・インバータによつて構成
されたスイツチ素子を経て出力する各スイツチ回
路と、この各スイツチ回路を制御し全てのスイツ
チ回路内の選択した一つのスイツチ回路からの出
力だけを可能にするデコーダと、全てのスイツチ
回路の出力の論理和を出力する共通の出力信号線
とを有するクロツク周波数選択装置において、 上記各スイツチ回路は、ｐチヤネルのスイツチ
ング・トランジスタを２個直列に接続しその一端
を電源の正端子に他端を信号出力端子に接続して
構成したロード回路と、ｎチヤネルのスイツチン
グ・トランジスタを２個直列に接続しその一端を
上記信号出力端子に他端を上記電源の負端子に接
続して構成したドライバ回路とを備え、入力信号
は電源の正端子に接続されたｐチヤネルのスイツ
チング・トランジスタのゲートと電源の負端子に
接続されたｎチヤネルのスイツチング・トランジ
スタのゲートとに加えられ、上記デコーダからの
制御信号は上記信号出力端子に接続されたｐチヤ
ネルのスイツチング・トランジスタのゲートと上
記信号出力端子に接続されたｎチヤネルのスイツ
チング・トランジスタのゲートとに加えられ、 上記デコーダから各スイツチ回路に入力される
制御信号は、当該スイツチ回路に入力される入力
信号と同一入力信号が入力されるＴ型フリツプフ
ロツプのリセツト信号として入力され、上記当該
スイツチ回路からの出力を通過させるよう制御す
るとき、対応するＴ型フリツプフロツプをリセツ
ト状態に保つよう制御することを特徴とするクロ
ツク周波数選択装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1753188U JPH01122634U (ja) | 1988-02-15 | 1988-02-15 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1753188U JPH01122634U (ja) | 1988-02-15 | 1988-02-15 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01122634U true JPH01122634U (ja) | 1989-08-21 |
Family
ID=31231397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1753188U Pending JPH01122634U (ja) | 1988-02-15 | 1988-02-15 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01122634U (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5315721A (en) * | 1976-07-28 | 1978-02-14 | Toshiba Corp | Two-way shift register |
| JPS63109608A (ja) * | 1986-10-27 | 1988-05-14 | Fujitsu Ltd | 可変速形アツプ／ダウンカウンタ |
-
1988
- 1988-02-15 JP JP1753188U patent/JPH01122634U/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5315721A (en) * | 1976-07-28 | 1978-02-14 | Toshiba Corp | Two-way shift register |
| JPS63109608A (ja) * | 1986-10-27 | 1988-05-14 | Fujitsu Ltd | 可変速形アツプ／ダウンカウンタ |
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