JPH01129655A - イメージセンサ - Google Patents
イメージセンサInfo
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- JPH01129655A JPH01129655A JP62287505A JP28750587A JPH01129655A JP H01129655 A JPH01129655 A JP H01129655A JP 62287505 A JP62287505 A JP 62287505A JP 28750587 A JP28750587 A JP 28750587A JP H01129655 A JPH01129655 A JP H01129655A
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- Japan
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- light
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、例えばファクシミリ用送信原稿と同一サイ
ズに、単一または複数個のセンサを配列し原稿上の画情
報を読み取るイメージセンサに関するものである。
ズに、単一または複数個のセンサを配列し原稿上の画情
報を読み取るイメージセンサに関するものである。
近年、ファクシミリ、光学文字読取り装置（以下ＯＣＲ
という）などの光電変換装置の技術的進歩は著しく、そ
の中で、ファクシミリ、ＯＣＲなどの装置の小型化を目
ざし、原稿密着型のイメージセンサが開発され実用化さ
れている。
という）などの光電変換装置の技術的進歩は著しく、そ
の中で、ファクシミリ、ＯＣＲなどの装置の小型化を目
ざし、原稿密着型のイメージセンサが開発され実用化さ
れている。
第７図は三菱電機株式会社編「密着イメージセンサ」
（昭和６２年６月発行）に紹介された従来のイメージセ
ンサを示す断面図であり、第８図はブロック図であり、
図において１は発光素子となる発光素子アレイ、２は基
板８ａ上に配列された受光素子、３は受光素子２上に位
置し、１対１の王立等倍結像を行なうロッドレンズアレ
イ、４は発光素子アレイ１およびロッドレンズアレイ３
の上方に位置する光透過板、５は光透過板４上を移動す
る原稿で、５ａは原稿５の読取り位置となる。
（昭和６２年６月発行）に紹介された従来のイメージセ
ンサを示す断面図であり、第８図はブロック図であり、
図において１は発光素子となる発光素子アレイ、２は基
板８ａ上に配列された受光素子、３は受光素子２上に位
置し、１対１の王立等倍結像を行なうロッドレンズアレ
イ、４は発光素子アレイ１およびロッドレンズアレイ３
の上方に位置する光透過板、５は光透過板４上を移動す
る原稿で、５ａは原稿５の読取り位置となる。
又、６は原稿５を送るプラテンローラ、７は基板８ａに
実装された信号処理回路で、第８図に示すように、シフ
トレジスタおよびアナログスイッチ７ａとその出力を増
幅するアンプ７ｂとにより構成されている。第７図の８
はフレームで、上記発光素子アレイ１、受光素子２、ロ
ッドレンズアレイ３、信号処理回路７などを内包してい
る。
実装された信号処理回路で、第８図に示すように、シフ
トレジスタおよびアナログスイッチ７ａとその出力を増
幅するアンプ７ｂとにより構成されている。第７図の８
はフレームで、上記発光素子アレイ１、受光素子２、ロ
ッドレンズアレイ３、信号処理回路７などを内包してい
る。
次に動作について説明する。第９図はその動作を説明す
るためのタイミング図である。プラテンローラ６により
搬送される原稿５は光透過板４上を移動する。このとき
、発光素子アレイ１の発光により原稿５の読取り位置５
ａに反射光が生じ、その像はロッドレンズアレイ３によ
って王立等倍の像となり、受光素子２に受光されてその
出力を信号処理回路７に送り、そこで電気信号に変換さ
れ、アンプ７ｂで増幅される。そして、原稿５の搬送を
連続して行うことにより、原稿５の読み取りが行なわれ
る。
るためのタイミング図である。プラテンローラ６により
搬送される原稿５は光透過板４上を移動する。このとき
、発光素子アレイ１の発光により原稿５の読取り位置５
ａに反射光が生じ、その像はロッドレンズアレイ３によ
って王立等倍の像となり、受光素子２に受光されてその
出力を信号処理回路７に送り、そこで電気信号に変換さ
れ、アンプ７ｂで増幅される。そして、原稿５の搬送を
連続して行うことにより、原稿５の読み取りが行なわれ
る。
上記信号処理回路７としては、個々の受光素子２と接続
されたアナログスイッチの順次駆動にて受光素子２の受
光した電荷を電流又は電圧に変換して出力させればよく
、受光素子２と同ビット数のシフトレジスタをこの順次
駆動手段に用いれば容易な回路構成となる。
されたアナログスイッチの順次駆動にて受光素子２の受
光した電荷を電流又は電圧に変換して出力させればよく
、受光素子２と同ビット数のシフトレジスタをこの順次
駆動手段に用いれば容易な回路構成となる。
第８図のブロック図、第９図のタイミング図にて“ＣＬ
ＯＣＫ、、と示すのは、このシフトレジスタの動作転送
信号を示しており、“Ｓｌ、は受光素子２の１ビツト目
に接続されたアナログスイッチをシフトレジスタの先頭
ビットの出力にて“ＯＮ、させることを示しており、受
光素子２に接続されたアナログスイッチをシフトレジス
タの先頭ビットからクロック信号に同期して順次転送し
てアナログスイッチをそれぞれＯＮ、ｌ、て行くことに
より、１ラインの原稿読取り信号“５ｒＧ７が出力され
る。
ＯＣＫ、、と示すのは、このシフトレジスタの動作転送
信号を示しており、“Ｓｌ、は受光素子２の１ビツト目
に接続されたアナログスイッチをシフトレジスタの先頭
ビットの出力にて“ＯＮ、させることを示しており、受
光素子２に接続されたアナログスイッチをシフトレジス
タの先頭ビットからクロック信号に同期して順次転送し
てアナログスイッチをそれぞれＯＮ、ｌ、て行くことに
より、１ラインの原稿読取り信号“５ｒＧ７が出力され
る。
なお、図中″ＶＬＥＤ、、”ＧＬＥＤ、、は発光素子ア
レイ１への電源入力であり、“ＶＤＤ、“Ｖ５．。
レイ１への電源入力であり、“ＶＤＤ、“Ｖ５．。
＝５−
などは信号処理回路７の電源入力、“ＧＮＤ、はグラン
ド電位である。
ド電位である。
従来のイメージセンサは以上のように構成されているの
で、カラー画像読取り装置に用いようとすると、発光素
子アレイ１例の光源切換方式又は受光素子２上の光フイ
ルタ切換方式のいずれかの方式となり、数回の切換えに
よるカラー画像読取り出力信号が１ライン分ずつ出るま
で原稿５を搬送せず、固定しておくことが必要であり、
読取り速度が低下してしまう。
で、カラー画像読取り装置に用いようとすると、発光素
子アレイ１例の光源切換方式又は受光素子２上の光フイ
ルタ切換方式のいずれかの方式となり、数回の切換えに
よるカラー画像読取り出力信号が１ライン分ずつ出るま
で原稿５を搬送せず、固定しておくことが必要であり、
読取り速度が低下してしまう。
又、光フイルタ切換方式は機構的に難しく、受光素子２
を分割し、光フィルタを各色（３〜４色）配置するよう
な構成がとられたりして、カラー画像読取り装置が高価
になってしまうなどの問題点があった。
を分割し、光フィルタを各色（３〜４色）配置するよう
な構成がとられたりして、カラー画像読取り装置が高価
になってしまうなどの問題点があった。
さらに、単色読取りの高解像度化を行うには、受光素子
２の配置ピッチを高密度にしかつそれに接続されるアナ
ログスイッチ、シフトレジスタなどの信号処理回路７も
増加することになり、出力６一 信号のＳ／Ｎ比劣化を招いたり、それらの結果としてイ
メージセンサが高価格になるなどの問題点があった。
２の配置ピッチを高密度にしかつそれに接続されるアナ
ログスイッチ、シフトレジスタなどの信号処理回路７も
増加することになり、出力６一 信号のＳ／Ｎ比劣化を招いたり、それらの結果としてイ
メージセンサが高価格になるなどの問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、読取り速度を低下させることなく、光フイル
タ切換方式を用いなくて済むカラー画像読取装置用に適
用でき、かつ高解像度化が可能で、しかも安価にできる
イメージセンサを得ることを目的とする。
たもので、読取り速度を低下させることなく、光フイル
タ切換方式を用いなくて済むカラー画像読取装置用に適
用でき、かつ高解像度化が可能で、しかも安価にできる
イメージセンサを得ることを目的とする。
この発明に係るイメージセンサは、ｎ個の受光素子をｍ
個の各アナログスイッチに接続し、１クロツク転送内に
ｍ個のアナログスイッチの駆動とこの受光素子の共通電
極の切換えを同期させてｎ個の受光素子の受光出力を得
るとともに光源切換えを行うようにしたものである。
個の各アナログスイッチに接続し、１クロツク転送内に
ｍ個のアナログスイッチの駆動とこの受光素子の共通電
極の切換えを同期させてｎ個の受光素子の受光出力を得
るとともに光源切換えを行うようにしたものである。
この発明における受光素子は画像読取り１ビツトをｎ個
にて構成し、画像読取りビットをｍビットとし、ｍ個の
アナログスイッチを順次駆動して受光出力を得て、ｎ個
の受光素子の受光出力を１クロツク転送内に行ない、そ
のｎ個の受光出力切換えと受光素子の共通電極の切換え
制御により光源の切換えを同期させて行い、カラー画像
読取り出力信号を得る。
にて構成し、画像読取りビットをｍビットとし、ｍ個の
アナログスイッチを順次駆動して受光出力を得て、ｎ個
の受光素子の受光出力を１クロツク転送内に行ない、そ
のｎ個の受光出力切換えと受光素子の共通電極の切換え
制御により光源の切換えを同期させて行い、カラー画像
読取り出力信号を得る。
以下、この発明の一実施例を図について説明する。第１
図において、■は発光素子アレイ、２は受光素子で、第
７図と同様にフレーム内の基板上に配設され、画像読取
り１ビツトをｎ個の受光素子で構成し、画像読取りビッ
トをｍビットとしており、この第１図の実施例では画像
読取り１ビツトを４個の受光素子（ａ、ｂ、ｃ、ｄで示
す）で構成している場合を示している。３は第７図で示
したのと同様のロッドレンズアレイで、フレーム内にお
いて、上記受光素子２上に位置し、１対１の王立等倍結
像を行うものである。
図において、■は発光素子アレイ、２は受光素子で、第
７図と同様にフレーム内の基板上に配設され、画像読取
り１ビツトをｎ個の受光素子で構成し、画像読取りビッ
トをｍビットとしており、この第１図の実施例では画像
読取り１ビツトを４個の受光素子（ａ、ｂ、ｃ、ｄで示
す）で構成している場合を示している。３は第７図で示
したのと同様のロッドレンズアレイで、フレーム内にお
いて、上記受光素子２上に位置し、１対１の王立等倍結
像を行うものである。
７は処理回路でｍビットシフトレジスタおよびｍ個のア
ナログスイッチ７ａとアンプ７ｂとで構成されている。
ナログスイッチ７ａとアンプ７ｂとで構成されている。
＝７−
なお、図示されていないが光透過板、プラテンローラ、
原稿、読取り位置などは第７図と同様である。
原稿、読取り位置などは第７図と同様である。
９は共通電極制御回路で、４個の受光素子ａ、ｂ、ｃ、
ｄの共通電極Ｃ１〜Ｃ４の制御を行うようにしている。
ｄの共通電極Ｃ１〜Ｃ４の制御を行うようにしている。
この共通電極ｃ１〜ｃ４はｍビット（第１図では４ビツ
ト）のそれぞれの受光素子２にそれぞれ接続されている
。
ト）のそれぞれの受光素子２にそれぞれ接続されている
。
カラー画像読取り装置では、Ｃ（青色）、Ｙ（黄色）、
Ｍ（赤色）、Ｗ（白色）の４色光源の切換えにてカラー
画像読み取り出力信号が得られる。第１図、第２図（第
１図の動作を示すタイミングチャート）に示すものは上
述したようにｍビットの画像読取りにて、ｍビットのシ
フトレジスタ、およびｍ個のアナログスイッチ７ａの構
成にて、ｍ個の各アナログスイッチ７ａに４個の受光素
子２を接続した構成とし、共通電極ｃ１、Ｃ２、Ｃ３、
Ｃ４にそれぞれ４個の受光素子２が接続され、共通電極
制御回路９で制御されることを示している。
Ｍ（赤色）、Ｗ（白色）の４色光源の切換えにてカラー
画像読み取り出力信号が得られる。第１図、第２図（第
１図の動作を示すタイミングチャート）に示すものは上
述したようにｍビットの画像読取りにて、ｍビットのシ
フトレジスタ、およびｍ個のアナログスイッチ７ａの構
成にて、ｍ個の各アナログスイッチ７ａに４個の受光素
子２を接続した構成とし、共通電極ｃ１、Ｃ２、Ｃ３、
Ｃ４にそれぞれ４個の受光素子２が接続され、共通電極
制御回路９で制御されることを示している。
ＤＩ、Ｄ２、Ｄ３、Ｄ４はＣ（青色）、Ｙ（黄色）、Ｍ
（赤色）、Ｗ（白色）の４色の発光素子に対応した異色
発光素子であり、４色の光源となるものである。
（赤色）、Ｗ（白色）の４色の発光素子に対応した異色
発光素子であり、４色の光源となるものである。
なお、”ＳＩ 、”ＣＬＯＣＫヵ“ＳＩＧ、。
“ＶＩＩＤや“■３３ ｓ“ＣＬＥＤ、などの動作は従
来と同様である。
来と同様である。
次に動作について説明する。第１図において１ビツトの
画像読取りビットは４個の受光素子２にて構成されてお
り、このビットはシフトレジスタの１クロツク転送（第
２図（１））にて第２図（Ｊｌに示すように次ビットの
アナログスイッチの動作がなされる。この１クロツク転
送時間内に４色の異色発光素子ＤＩ、Ｄ２、Ｄ３、Ｄ４
を第２図（ａ）〜第２図＋ｄ）に示すように順次切り換
える（すなわち、４色の発光色の異なる光源切換えとな
る）とともに、ビット内の４個の受光素子２を共通電極
ＣＩ、Ｃ２、Ｃ３、Ｃ４にて第２図（ｅ）〜第２図（ｈ
）に示すように同期して制御することにより、１クロツ
ク転送時間内にカラー画像読取り出力信号となる第２図
（ｋｌに示すように、Ｃ（青色）、Ｙ（黄色）、Ｍ（赤
色）、Ｗ（白色）が順次出力されることになる。
画像読取りビットは４個の受光素子２にて構成されてお
り、このビットはシフトレジスタの１クロツク転送（第
２図（１））にて第２図（Ｊｌに示すように次ビットの
アナログスイッチの動作がなされる。この１クロツク転
送時間内に４色の異色発光素子ＤＩ、Ｄ２、Ｄ３、Ｄ４
を第２図（ａ）〜第２図＋ｄ）に示すように順次切り換
える（すなわち、４色の発光色の異なる光源切換えとな
る）とともに、ビット内の４個の受光素子２を共通電極
ＣＩ、Ｃ２、Ｃ３、Ｃ４にて第２図（ｅ）〜第２図（ｈ
）に示すように同期して制御することにより、１クロツ
ク転送時間内にカラー画像読取り出力信号となる第２図
（ｋｌに示すように、Ｃ（青色）、Ｙ（黄色）、Ｍ（赤
色）、Ｗ（白色）が順次出力されることになる。
共通電極ＣＩ、Ｃ２、Ｃ３、Ｃ４の切換制御は、例えば
デマルチプレクサ回路からなる共通電極制御回路９のＳ
Ｅ Ｌ １．５ＥＬ２端子への信号入力にて切換制御
される。
デマルチプレクサ回路からなる共通電極制御回路９のＳ
Ｅ Ｌ １．５ＥＬ２端子への信号入力にて切換制御
される。
なお、上記実施例では、カラー画像読取り装置用のイメ
ージセンサについて示したが、第３図のブロック図、第
４図のタイミング図（読み取り出力信号を大きくする場
合のタイミング図）に示すように、第４図（Ｃ１の１ク
ロック転送時間内に第４図ｆｄｌに示すように受光素子
２の１ビツト目に接続され、アナログスイッチをシフト
レジスタの先頭ビットの出力をオンさせて、光源を単色
とし、共通電極Ｃ１、Ｃ２（第４図（ａ））と０３、Ｃ
４（第４図山））をペアにして同期して制御して解像度
を下げることにより、第４図（ｅ）に示すように読取り
出力信号を大きくしたりできる。
ージセンサについて示したが、第３図のブロック図、第
４図のタイミング図（読み取り出力信号を大きくする場
合のタイミング図）に示すように、第４図（Ｃ１の１ク
ロック転送時間内に第４図ｆｄｌに示すように受光素子
２の１ビツト目に接続され、アナログスイッチをシフト
レジスタの先頭ビットの出力をオンさせて、光源を単色
とし、共通電極Ｃ１、Ｃ２（第４図（ａ））と０３、Ｃ
４（第４図山））をペアにして同期して制御して解像度
を下げることにより、第４図（ｅ）に示すように読取り
出力信号を大きくしたりできる。
又、第５図は高速化の場合のタイミング図であり、第５
図（Ｃ）に示す１クロック転送時間内に第５図（ｄｉに
示すように受光素子２の１ビツト目に接続され、アナロ
グスイッチをラフ１〜レジスタの先頭ビットの出力をオ
ンさせて、第５図（ａ）に示すように共通電極ＣＩとＣ
２、第５図ｆｂｌに示すように共通電極Ｃ３と０４をペ
アにして第５図（ｅｌに示すように読取り出力信号を高
速化できる。
図（Ｃ）に示す１クロック転送時間内に第５図（ｄｉに
示すように受光素子２の１ビツト目に接続され、アナロ
グスイッチをラフ１〜レジスタの先頭ビットの出力をオ
ンさせて、第５図（ａ）に示すように共通電極ＣＩとＣ
２、第５図ｆｂｌに示すように共通電極Ｃ３と０４をペ
アにして第５図（ｅｌに示すように読取り出力信号を高
速化できる。
さらに、上記実施例では、４個の受光素子２が第６図（
Ｃ）に示す主走査方向に配列されたものについて示した
が、副走査方向に配置しても、主走査、副走査方向２個
ずつ配置してもよ（、上記実施例と同様の効果を奏する
。
Ｃ）に示す主走査方向に配列されたものについて示した
が、副走査方向に配置しても、主走査、副走査方向２個
ずつ配置してもよ（、上記実施例と同様の効果を奏する
。
これらの受光素子２の配置の様子を第６図ｆａｌ〜第６
図ｆｃ）に示す。第６図（ａ）〜第６図ｆＣ１のａ、ｂ
。
図ｆｃ）に示す。第６図（ａ）〜第６図ｆＣ１のａ、ｂ
。
ｃ、ｄは４個の受光素子を示す。
さらに、上記実施例では一つの画像読取りビットを４個
の受光素子２を配置するものについて示したが、ｎ個と
すれば単色時の解像度はｎ倍になり、しかもシフトレジ
スタ、アナログスイッチはｍビット分で済み、高解像度
化に伴う回路数（シフトレジスタ、アナログスイッチ）
の増加がなく、信号処理回路７を容易に構成できる。
の受光素子２を配置するものについて示したが、ｎ個と
すれば単色時の解像度はｎ倍になり、しかもシフトレジ
スタ、アナログスイッチはｍビット分で済み、高解像度
化に伴う回路数（シフトレジスタ、アナログスイッチ）
の増加がなく、信号処理回路７を容易に構成できる。
又、共通電極制御回路９をデマルチプレクサ回路にて構
成するものについて述べたが、受光素子２を初期化状態
とするため、第１図、第３図のごとく、ＲＥＳＥＴ端子
を設けてもよく、上記実施例と同様の効果を奏し、デマ
ルチプレクサ回路に限定するものではなく、他の回路構
成であってもよい。
成するものについて述べたが、受光素子２を初期化状態
とするため、第１図、第３図のごとく、ＲＥＳＥＴ端子
を設けてもよく、上記実施例と同様の効果を奏し、デマ
ルチプレクサ回路に限定するものではなく、他の回路構
成であってもよい。
さらに、以上のような構成からなる受光素子とアナログ
スイッチと順次駆動手段とを複数個備えたチップを複数
個配列し、共通電極制御回路９などに接続することで容
易に長尺化が可能となる。
スイッチと順次駆動手段とを複数個備えたチップを複数
個配列し、共通電極制御回路９などに接続することで容
易に長尺化が可能となる。
これらの受光素子として、フォトトランジスタを用いる
ことにより受光素子ごとの受光による信号の増幅が容易
となり信号増幅回路での大増幅によるＳ／Ｎ比の悪化を
防止できる。
ことにより受光素子ごとの受光による信号の増幅が容易
となり信号増幅回路での大増幅によるＳ／Ｎ比の悪化を
防止できる。
以上のように、この発明によれば、画像読取り１ビツト
をｎ個の受光素子で構成し、画像読取りビットをｍビッ
トとし、ｎ個の受光素子をｍ個の各アナログスイッチに
接続してこのｍ個のアナログスイッチを順次駆動して１
クロツク転送内にｎ個の受光素子の受光出力を出力させ
るとともに光源の切換えを同期させるように構成したの
で、光フイルタ切換方式を用いなくて済むカラー画像読
取り装置用のイメージセンサが得られ、高解像度の受光
素子をより少ない信号処理回路にて制御でき、取り扱い
やすく、その枯果低価格のイメージセンサが得られる効
果がある。
をｎ個の受光素子で構成し、画像読取りビットをｍビッ
トとし、ｎ個の受光素子をｍ個の各アナログスイッチに
接続してこのｍ個のアナログスイッチを順次駆動して１
クロツク転送内にｎ個の受光素子の受光出力を出力させ
るとともに光源の切換えを同期させるように構成したの
で、光フイルタ切換方式を用いなくて済むカラー画像読
取り装置用のイメージセンサが得られ、高解像度の受光
素子をより少ない信号処理回路にて制御でき、取り扱い
やすく、その枯果低価格のイメージセンサが得られる効
果がある。
第１図はこの発明の一実施例によるカラー画像読取り装
置用のイメージセンサを示すプロ・ツク図、第２図は第
１図のイメージセンサの動作を説明するためのタイミン
グ図、第３図はこの発明の他の実施例によるイメージセ
ンサのブロック図、第４図および第５図はそれぞれ第３
図のイメージセンサの動作を説明するためのタイミング
図、第６図（ａｌないし第６図（Ｃ１はそれぞれこの発
明のイメージセンサにおける受光素子の配置を示す説明
図、第７図は従来のイメージセンサを示す断面図、第８
図は従来のイメージセンサのブロック図、第９図は従来
のイメージセンサの動作を説明するためのタイミング図
である。 ２は受光素子、７ａはｍビットシフトレジスタおよびア
ナログスイッチ、Ｄ１〜Ｄ４は異色発光素子、０１〜Ｃ
４は受光素子の共通電極。 なお、図中、同一符号は同一、又は相当部分を示す。 第４図 第５図 （ｄ）Ｓｌ 第６図 （ａ） （ｂ） （Ｃ） 搦′ｊ走萱方向 （厘槁域送方向） 第８図 第９図
置用のイメージセンサを示すプロ・ツク図、第２図は第
１図のイメージセンサの動作を説明するためのタイミン
グ図、第３図はこの発明の他の実施例によるイメージセ
ンサのブロック図、第４図および第５図はそれぞれ第３
図のイメージセンサの動作を説明するためのタイミング
図、第６図（ａｌないし第６図（Ｃ１はそれぞれこの発
明のイメージセンサにおける受光素子の配置を示す説明
図、第７図は従来のイメージセンサを示す断面図、第８
図は従来のイメージセンサのブロック図、第９図は従来
のイメージセンサの動作を説明するためのタイミング図
である。 ２は受光素子、７ａはｍビットシフトレジスタおよびア
ナログスイッチ、Ｄ１〜Ｄ４は異色発光素子、０１〜Ｃ
４は受光素子の共通電極。 なお、図中、同一符号は同一、又は相当部分を示す。 第４図 第５図 （ｄ）Ｓｌ 第６図 （ａ） （ｂ） （Ｃ） 搦′ｊ走萱方向 （厘槁域送方向） 第８図 第９図
Claims (8)
- （１）基板上に配列された複数個の受光素子と、この受
光素子の各々に接続されたアナログスイッチを順次駆動
させることにより上記受光素子から受光出力を得て画像
を読み取るイメージセンサにおいて、ｍ個の上記アナロ
グスイッチにｎ個（ｎは２以上の整数）の上記受光素子
を接続するとともに上記ｎ以下の正の整数の上記受光素
子の共通電極への信号の切換を行って光源を切り換えか
つ少なくともｍ個ずつの上記受光素子を駆動制御して受
光出力を得ることを特徴とするイメージセンサ。 - （２）上記ｎ個の受光素子は主走査方向に配列され一列
の受光素子列であることを特徴とする特許請求の範囲第
１項記載のイメージセンサ。 - （３）上記ｎ個の受光素子は副走査方向に配列され複数
列の受光素子列であることを特徴とする特許請求の範囲
第１項記載のイメージセンサ。 - （４）上記アナログスイッチの順次駆動はシフトレジス
タにより行うことを特徴とする特許請求の範囲第１項な
いし第３項のいずれか１項記載のイメージセンサ。 - （５）上記ｎ個の受光素子は順次駆動制御するとともに
複数色からなる発光を順次点灯駆動制御することを特徴
とする特許請求の範囲第１項ないし第４項のいずれか１
項記載のイメージセンサ。 - （６）上記アナログスイッチの１ビット駆動動作内にｎ
個の受光素子の順次駆動がなされることを特徴とする特
許請求の範囲第１項ないし第５項のいずれか１項記載の
イメージセンサ。 - （７）上記受光素子と上記アナログスイッチとこれらを
順次駆動する手段とを複数個備えたチップを複数個配列
して受光素子を駆動することを特徴とする特許請求の範
囲第１項ないし第６項のいずれか１項記載のイメージセ
ンサ。 - （８）受光素子がフォトトランジスタにて構成されるこ
とを特徴とする特許請求の範囲第１項ないし第７項のい
ずれか１項記載のイメージセンサ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62287505A JPH0710087B2 (ja) | 1987-11-16 | 1987-11-16 | イメージセンサ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62287505A JPH0710087B2 (ja) | 1987-11-16 | 1987-11-16 | イメージセンサ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01129655A true JPH01129655A (ja) | 1989-05-22 |
| JPH0710087B2 JPH0710087B2 (ja) | 1995-02-01 |
Family
ID=17718208
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62287505A Expired - Fee Related JPH0710087B2 (ja) | 1987-11-16 | 1987-11-16 | イメージセンサ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0710087B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59212071A (ja) * | 1983-05-18 | 1984-11-30 | Canon Inc | 光源の点灯装置 |
-
1987
- 1987-11-16 JP JP62287505A patent/JPH0710087B2/ja not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59212071A (ja) * | 1983-05-18 | 1984-11-30 | Canon Inc | 光源の点灯装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0710087B2 (ja) | 1995-02-01 |
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