JPH01151630U - - Google Patents
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- Publication number
- JPH01151630U JPH01151630U JP4901588U JP4901588U JPH01151630U JP H01151630 U JPH01151630 U JP H01151630U JP 4901588 U JP4901588 U JP 4901588U JP 4901588 U JP4901588 U JP 4901588U JP H01151630 U JPH01151630 U JP H01151630U
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- Japan
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Information Transfer Systems (AREA)
- Dc Digital Transmission (AREA)
- Communication Control (AREA)
Description
第１図は本考案の一実施例を示す構成図である
。 １……マイクロコンピユータ部、２，３，４，
５……データ入力部、６……シリアルデータライ
ン、７……タイミングライン、８……クロツクラ
イン、９……マイクロコンピユータ、１０……シ
リアル・パラレル変換回路、１１……コンパレー
タ回路、１２，１７……タイミングジエネレータ
回路、１３，１９……平衡・不平衡変換回路、１
４，１８……不平衡・平衡変換回路、１５……入
力バツフア回路、１６……パラレル・シリアル変
換回路。
。 １……マイクロコンピユータ部、２，３，４，
５……データ入力部、６……シリアルデータライ
ン、７……タイミングライン、８……クロツクラ
イン、９……マイクロコンピユータ、１０……シ
リアル・パラレル変換回路、１１……コンパレー
タ回路、１２，１７……タイミングジエネレータ
回路、１３，１９……平衡・不平衡変換回路、１
４，１８……不平衡・平衡変換回路、１５……入
力バツフア回路、１６……パラレル・シリアル変
換回路。
Claims (1)
- 【実用新案登録請求の範囲】 外部から入力されたパラレルデータをシリアル
データに変換する少なくとも一つのデータ入力部
と、 該データ入力部からのシリアルデータ出力を順
次に入力するマイクロコンピユータ部とから構成
され、 前記各データ入力部のシリアルデータ出力と前
記マイクロコンピユータ部のシリアルデータ入力
を平衡シリアルラインにてインターフエイスする
ことを特徴とする多入力読込回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4901588U JPH01151630U (ja) | 1988-04-11 | 1988-04-11 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4901588U JPH01151630U (ja) | 1988-04-11 | 1988-04-11 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01151630U true JPH01151630U (ja) | 1989-10-19 |
Family
ID=31275136
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4901588U Pending JPH01151630U (ja) | 1988-04-11 | 1988-04-11 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01151630U (ja) |
-
1988
- 1988-04-11 JP JP4901588U patent/JPH01151630U/ja active Pending