JPH01155542U - - Google Patents

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JPH01155542U
JPH01155542U JP5323888U JP5323888U JPH01155542U JP H01155542 U JPH01155542 U JP H01155542U JP 5323888 U JP5323888 U JP 5323888U JP 5323888 U JP5323888 U JP 5323888U JP H01155542 U JPH01155542 U JP H01155542U
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JP
Japan
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circuit emulator
target microprocessor
memory
main body
port
Prior art date
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Pending
Application number
JP5323888U
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English (en)
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Publication date
Application filed filed Critical
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Pending legal-status Critical Current

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  • Debugging And Monitoring (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)

Description

【図面の簡単な説明】
第1図は本考案に係るインサーキツト・エミユ
レータの一実施例を示す要部構成図、第2図は第
1図の主要部を更に詳細に示す構成図である。 10……インサーキツト・エミユレータ本体、
20……ターゲツト・マイクロプロセツサ、11
……インサーキツト・エミユレータ本体側のマイ
クロプロセツサ、12a,12b,12c……ア
ドレスバス、13a,13b,16a,16b…
…バツフア、14……データ用RAM、15a,
15b,15c……データバス、17……調停回
路。

Claims (1)

  1. 【実用新案登録請求の範囲】 インサーキツト・エミユレータにおいて、 メモリのアドレス幅がターゲツト・マイクロプ
    ロセツサのアドレス空間より大きく、ターゲツト
    ・マイクロプロセツサの書き込むデータを記憶し
    その内容をインサーキツト・エミユレータ本体側
    から任意の時刻に読み出すことが可能に構成され
    た2ポートのメモリと、 前記ターゲツト・マイクロプロセツサの前記2
    ポートのメモリへの書き込み動作中はインサーキ
    ツト・エミユレータ本体側からの読み出し動作を
    中止すると共に読み出し動作が完了しなかつたこ
    とを表すステータス信号を出力する調停回路 を具備し、ターゲツト・マイクロプロセツサの
    動作を妨害することなくターゲツト・マイクロプ
    ロセツサの書き込んだメモリの内容をインサーキ
    ツト・エミユレータ本体側から任意の時刻に読み
    出すことができるようにしたことを特徴とするリ
    アルタイム・インサーキツト・エミユレータ。
JP5323888U 1988-04-20 1988-04-20 Pending JPH01155542U (ja)

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JP5323888U JPH01155542U (ja) 1988-04-20 1988-04-20

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JP5323888U JPH01155542U (ja) 1988-04-20 1988-04-20

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JPH01155542U true JPH01155542U (ja) 1989-10-25

Family

ID=31279228

Family Applications (1)

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JP5323888U Pending JPH01155542U (ja) 1988-04-20 1988-04-20

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