JPH01167731U - - Google Patents

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JPH01167731U
JPH01167731U JP6426888U JP6426888U JPH01167731U JP H01167731 U JPH01167731 U JP H01167731U JP 6426888 U JP6426888 U JP 6426888U JP 6426888 U JP6426888 U JP 6426888U JP H01167731 U JPH01167731 U JP H01167731U
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【図面の簡単な説明】
第１図は本考案に係る信号発生回路の一実施例
を示した図、第２図は第１図装置の動作を示すタ
イムチヤート、第３図はＰＬＬ方式の従来の信号
発生回路を示した図である。 １１……ＶＣＯ、１３……位相検出器、１４…
…ループフイルタ、２３……比較器、２５……累
算器、２６……ランプ波発生器、ｓｒ……基準信
号、ｓｆ……周波数設定入力。

Claims (1)

  1. 【実用新案登録請求の範囲】 電圧制御発振器と、 この電圧制御発振器の出力信号に同期して値が
    周波数設定入力に対応した一定ステツプで順次増
    加する累算器と、 基準信号により一定周期でリセツトされるラン
    プ波発生器と、 このランプ波発生器の出力と前記累算部の出力
    とを比較する比較器と、 この比較器出力と前記電圧制御発振器出力との
    位相差を検出する位相検出器と、 この位相検出器の出力を積分して前記電圧制御
    発振器に出力するループフイルタとを備え、 周波数設定入力に対応して基準信号の周波数を
    逓倍した周波数信号を出力するように構成した事
    を特徴とする信号発生回路。
JP6426888U 1988-05-16 1988-05-16 信号発生回路 Expired - Lifetime JPH075703Y2 (ja)

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Publication Number Publication Date
JPH01167731U true JPH01167731U (ja) 1989-11-27
JPH075703Y2 JPH075703Y2 (ja) 1995-02-08

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ID=31289742

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02226913A (ja) * 1989-02-28 1990-09-10 Fujitsu Ltd ディジタルミキサを含むｐｌｌのデッドロック現象防止回路
JP2006174303A (ja) * 2004-12-17 2006-06-29 Seiko Npc Corp 周波数シンセサイザ及びその基準信号位相設定方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02226913A (ja) * 1989-02-28 1990-09-10 Fujitsu Ltd ディジタルミキサを含むｐｌｌのデッドロック現象防止回路
JP2006174303A (ja) * 2004-12-17 2006-06-29 Seiko Npc Corp 周波数シンセサイザ及びその基準信号位相設定方法

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JPH075703Y2 (ja) 1995-02-08

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