JPS584271Y2 - サ−チ回路装置 - Google Patents
サ−チ回路装置Info
- Publication number
- JPS584271Y2 JPS584271Y2 JP6053978U JP6053978U JPS584271Y2 JP S584271 Y2 JPS584271 Y2 JP S584271Y2 JP 6053978 U JP6053978 U JP 6053978U JP 6053978 U JP6053978 U JP 6053978U JP S584271 Y2 JPS584271 Y2 JP S584271Y2
- Authority
- JP
- Japan
- Prior art keywords
- search
- circuit device
- integrating
- output
- reset pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Description
【考案の詳細な説明】
本考案はＰＬＬ（Ｐｈａｓｅ Ｌｏｏｋｅｄ Ｌｏｏｐ
）を用いた電子同調ラジオ等において、段階的に同調周
波数が変化し、受信可能な局をサーチするサーチ回路装
置に関するもので、サーチストップを精度よく行なえる
ようにしたものである。
）を用いた電子同調ラジオ等において、段階的に同調周
波数が変化し、受信可能な局をサーチするサーチ回路装
置に関するもので、サーチストップを精度よく行なえる
ようにしたものである。
たとえばＡ局を受信している時にサーチをかけてカウン
タの数を１ずつ増加してローカルオツシレータの周波数
を第２図のイのように変更して行き、その状態でＩＦ出
力があった際サーチストップをかけることによりたとえ
ば第２図のイに示すＢ局を受信することができる。
タの数を１ずつ増加してローカルオツシレータの周波数
を第２図のイのように変更して行き、その状態でＩＦ出
力があった際サーチストップをかけることによりたとえ
ば第２図のイに示すＢ局を受信することができる。
この場合サーチストップにあたってはローカル周波数が
変更時点ではその安定性に欠け、良好な受信が行なえな
い。
変更時点ではその安定性に欠け、良好な受信が行なえな
い。
本考案はこの点を考慮したもので以下図面の一実施例に
より説明する。
より説明する。
第１図において１はＩＦ（中間周波）アンプ、２は検波
器、３は積分器、４はコンパレータ、５はＰＬＬ回路側
（図示せず）から同期信号Ｓ（第２図イのＳ）が加わる
端子、６は同期信号Ｓをもとに第２図のハのようなリセ
ットパルスを発生し、積分器３の積分値をリセットする
リセットパルス発生器である。
器、３は積分器、４はコンパレータ、５はＰＬＬ回路側
（図示せず）から同期信号Ｓ（第２図イのＳ）が加わる
端子、６は同期信号Ｓをもとに第２図のハのようなリセ
ットパルスを発生し、積分器３の積分値をリセットする
リセットパルス発生器である。
７は基準電圧が加わる端子、８はサーチストップ信号が
出力される端子である。
出力される端子である。
第２図は同期信号Ｓに対する各部の波形を示したもので
ある。
ある。
イは同調周波数および同期信号を示す図、口はＩＦアン
プ１の出力信号を示し、ハはリセットパルス発生器の出
力信号を示し、二は積分器３の出力信号を示すものであ
る。
プ１の出力信号を示し、ハはリセットパルス発生器の出
力信号を示し、二は積分器３の出力信号を示すものであ
る。
なお第２図二におけるａはサーチストップスレッシホー
ルドレベルである。
ルドレベルである。
上記装置において同期周波数が変化する毎（同期信号Ｓ
があるたび）にリセットパルス発生器６テモって第２図
ハのようなリセットパルス力発生する。
があるたび）にリセットパルス発生器６テモって第２図
ハのようなリセットパルス力発生する。
このリセットパルスにより積分器３の積分値をリセット
する。
する。
その過程でＩＰアンプ１より第２図口のようなＩＦ出力
があった場合、リセットパルスによるリセットが解除さ
れた後に第２図二のような積分をおこなわせ、その値が
一定値（サーチストップスレッシホールドレベル）に達
した際コンパレータ４よりサーチストップ信号を得られ
るようにしている。
があった場合、リセットパルスによるリセットが解除さ
れた後に第２図二のような積分をおこなわせ、その値が
一定値（サーチストップスレッシホールドレベル）に達
した際コンパレータ４よりサーチストップ信号を得られ
るようにしている。
したがって積分器３の積分はＩＰ出力が安定した状態で
開始することになるので積分精度（サーチストップ信号
精度）の向上がはかれる一方、その積分が容易におこな
える。
開始することになるので積分精度（サーチストップ信号
精度）の向上がはかれる一方、その積分が容易におこな
える。
上記実施例より明らかなように本考案によればローカル
周波数が安定後に積分手段に積分動作を行なわせるよう
に構成しているためにサーチ動作を安定に行なわせるこ
とができ、良好な受信が行なえる。
周波数が安定後に積分手段に積分動作を行なわせるよう
に構成しているためにサーチ動作を安定に行なわせるこ
とができ、良好な受信が行なえる。
第１図は本考案の一実施例によるサーチ回路装置のブロ
ック図、第２図はその動作波形図である。 ２・・・・・・検波器、３・・・・・・積分器、４・・
・・・・コンパレータ、６・・・・・・リセットパルス
発生器。
ック図、第２図はその動作波形図である。 ２・・・・・・検波器、３・・・・・・積分器、４・・
・・・・コンパレータ、６・・・・・・リセットパルス
発生器。
Claims (1)
- ＰＬＬ（Ｐｈａｓｅ Ｌｏｏｋｅｄ Ｌｏｏｐ）を用い
、段階的に同調周波数を変化させて受信局をサーチする
回路装置において、中間周波信号を検波する手段、その
検波された信号を積分する積分手段、同調周波数が変化
する毎にリセットパルスを発生させ、上記積分手段の積
分開始を遅らせる手段、および上記積分手段の出力から
サーチストップ信号を得る手段を設けたサーチ回路装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6053978U JPS584271Y2 (ja) | 1978-05-04 | 1978-05-04 | サ−チ回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6053978U JPS584271Y2 (ja) | 1978-05-04 | 1978-05-04 | サ−チ回路装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54162724U JPS54162724U (ja) | 1979-11-14 |
| JPS584271Y2 true JPS584271Y2 (ja) | 1983-01-25 |
Family
ID=28961133
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6053978U Expired JPS584271Y2 (ja) | 1978-05-04 | 1978-05-04 | サ−チ回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS584271Y2 (ja) |
-
1978
- 1978-05-04 JP JP6053978U patent/JPS584271Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54162724U (ja) | 1979-11-14 |
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