JPH01211055A - 記憶内容リセット制御方式 - Google Patents
記憶内容リセット制御方式Info
- Publication number
- JPH01211055A JPH01211055A JP63036012A JP3601288A JPH01211055A JP H01211055 A JPH01211055 A JP H01211055A JP 63036012 A JP63036012 A JP 63036012A JP 3601288 A JP3601288 A JP 3601288A JP H01211055 A JPH01211055 A JP H01211055A
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- JP
- Japan
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- storage
- signal
- reset
- unit
- storage unit
- Prior art date
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- Pending
Links
- 238000000034 method Methods 0.000 title claims description 8
- 238000012544 monitoring process Methods 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
本発明は、記憶部に格納された記憶内容をクリアする記
憶内容リセット制御方式に関し、補助電源でバックアッ
プされた記憶部のリセット信号の送出を制御する方式を
提供することを目的とし、− 記憶部に記憶された記憶内容が読み出されたのを示す読
了信号と、該記憶部に記憶内容を有することを示す格納
信号とを出力する手段を有する記憶部と、該記憶部の記
憶内容をクリアするリセット信号を出力するリセット処
理部と、前記読了、格納両信号を監視する記憶監視部と
を備え、該記憶監視部の出力によって前記リセット処理
部が出力するリセット信号を制御するよう構成する。
憶内容リセット制御方式に関し、補助電源でバックアッ
プされた記憶部のリセット信号の送出を制御する方式を
提供することを目的とし、− 記憶部に記憶された記憶内容が読み出されたのを示す読
了信号と、該記憶部に記憶内容を有することを示す格納
信号とを出力する手段を有する記憶部と、該記憶部の記
憶内容をクリアするリセット信号を出力するリセット処
理部と、前記読了、格納両信号を監視する記憶監視部と
を備え、該記憶監視部の出力によって前記リセット処理
部が出力するリセット信号を制御するよう構成する。
本発明は、記憶部に格納された記憶内容をクリアする記
憶内容リセット制御方式に関するものである。
憶内容リセット制御方式に関するものである。
記憶内容が電源投入時に自動的にクリアされる記憶部は
、操作上便利ではあるが、主電源が停電した時、記憶部
が補助電源によって電源供給を代替されている場合、主
電源の復旧時にクリアされてしまう。
、操作上便利ではあるが、主電源が停電した時、記憶部
が補助電源によって電源供給を代替されている場合、主
電源の復旧時にクリアされてしまう。
第2図は従来の記憶部の自動リセットを説明する図であ
る。
る。
第2図において、記憶部lはアラーム(警報)データを
格納するものとし、記憶されたデータが読み出された時
には、その記憶内容をクリアして次に書き込まれるデー
タの格納に備える。
格納するものとし、記憶されたデータが読み出された時
には、その記憶内容をクリアして次に書き込まれるデー
タの格納に備える。
即ち、例えば、アラーム処理のために記憶部1の記憶内
容が図示しない他の記憶部に出力された場合は、リセッ
ト処理部3からリセット信号Rが送出されて記憶部1の
記憶内容がクリアされる。
容が図示しない他の記憶部に出力された場合は、リセッ
ト処理部3からリセット信号Rが送出されて記憶部1の
記憶内容がクリアされる。
また、電源2の投入時には自動的にリセット信号Rが出
力され、記憶部1をクリア状態にする。
力され、記憶部1をクリア状態にする。
この従来の方式では起動時に記憶部がクリア状態となり
、それまでに格納された記憶内容に新データが重畳する
ことなく、正確な入力データの記憶ができる。
、それまでに格納された記憶内容に新データが重畳する
ことなく、正確な入力データの記憶ができる。
、しかし、記憶部が補助電源によって無停電で記憶保護
がされていても、リセット処理部等の記憶部以外の部分
が主電源が停電して、電源供給が断たれた場合、主電源
の復旧は起動の際の電源投入と同じ状態であるため、リ
セット処理部はリセット信号を送出し、記憶部の記憶内
容をクリアしてしまう。
がされていても、リセット処理部等の記憶部以外の部分
が主電源が停電して、電源供給が断たれた場合、主電源
の復旧は起動の際の電源投入と同じ状態であるため、リ
セット処理部はリセット信号を送出し、記憶部の記憶内
容をクリアしてしまう。
この場合、装置としての稼動は継続しているので、記憶
内容の消滅は重大な問題となる。
内容の消滅は重大な問題となる。
本発明はこのような点に鑑みて創作されたものであって
、補助電源でバックアップされた記憶部のリセット信号
を制御する方式を提供することを目的としている。
、補助電源でバックアップされた記憶部のリセット信号
を制御する方式を提供することを目的としている。
上記した目的を達成するために、読了信号と、格納信号
とを出力する手段を有する記憶部と、リセット信号を送
出するリセット処理部と、前記読了、格納両信号を監視
する記憶監視部とを備えて構成する。
とを出力する手段を有する記憶部と、リセット信号を送
出するリセット処理部と、前記読了、格納両信号を監視
する記憶監視部とを備えて構成する。
記憶監視部は記憶部が送出する読了信号と、格納信号と
を監視して、記憶部に記憶された記憶内容の状態を認識
し、リセット処理部は記憶監視部の出力信号によって送
出するリセット信号の送出を制御する。
を監視して、記憶部に記憶された記憶内容の状態を認識
し、リセット処理部は記憶監視部の出力信号によって送
出するリセット信号の送出を制御する。
第1図は本発明の記憶内容リセット制御方式の一実施例
の構成を示すブロック図である。
の構成を示すブロック図である。
第1図において、記憶部1Aは読了信号A、即ち記憶部
1Aの記憶内容が読み出されると出力される信号と、格
納信号B1即ち記憶部1Aにデータが格納されていると
出力する信号をそれぞれの状態に応じて出力する手段を
有している。
1Aの記憶内容が読み出されると出力される信号と、格
納信号B1即ち記憶部1Aにデータが格納されていると
出力する信号をそれぞれの状態に応じて出力する手段を
有している。
記憶監視部4は、読了信号Aと格納信号Bとが次の関係
にあるのを監視して制御信号Cを出力する。
にあるのを監視して制御信号Cを出力する。
即ち、(1)格納信号Bが出力されていて、読了信号A
が出力されていない時は、制御信号Cを送出しない。
が出力されていない時は、制御信号Cを送出しない。
(2)格納信号Bが出力されていても、読了信号Aが出
力されている時は、制御信号Cを送出する。
力されている時は、制御信号Cを送出する。
リセット処理部3Aにおいて、電源が投入された場合、
リセット信号発生器31は自動的にリセット信号Rを発
生する。
リセット信号発生器31は自動的にリセット信号Rを発
生する。
そして、リセット処理部3Aは記憶監視部4の制御信号
Cとの論理積によってリセット信号Rを送出する。
Cとの論理積によってリセット信号Rを送出する。
即ち、前記(1)の状態の場合記憶部1にリセット信号
Rを送出し、(2)の状態の場合送出しない。
Rを送出し、(2)の状態の場合送出しない。
そこで、主電源2Aは全装置の電源供給を行い、補助電
源2Bは主電源2Aが障害で停電した場合、記憶部1A
に対して主電源2Aに代替して電源供給を行う。
源2Bは主電源2Aが障害で停電した場合、記憶部1A
に対して主電源2Aに代替して電源供給を行う。
従って、記憶部1Aは主電源2Aが停電しても、補助電
源2Bから電源供給され、その記憶内容は保護され、記
憶部1Aを除くその他の部分は主電源2Aの停電ととも
に電源供給が断たれる。
源2Bから電源供給され、その記憶内容は保護され、記
憶部1Aを除くその他の部分は主電源2Aの停電ととも
に電源供給が断たれる。
そして、主電源2Aが復旧して電源供給を再開すると、
記憶部1Aを除く部分は恰も起動に際して電源投入され
たのと同じ状態となるが、上記したように記憶部1Aの
状態を認識してリセット信号が制御される。
記憶部1Aを除く部分は恰も起動に際して電源投入され
たのと同じ状態となるが、上記したように記憶部1Aの
状態を認識してリセット信号が制御される。
以上の説明から明らかなように本発明によれば記憶部の
記憶内容のクリアが記憶部の状態を認識して行われ、自
動リセットが問題な〈実施することができ、工業的に極
めて有用である。
記憶内容のクリアが記憶部の状態を認識して行われ、自
動リセットが問題な〈実施することができ、工業的に極
めて有用である。
第1図は本発明の記憶内容リセット制御方式の一実施例
の構成を示すブロック図、 第2図は従来の記憶部の自動リセットを説明する図であ
る。 図において、
の構成を示すブロック図、 第2図は従来の記憶部の自動リセットを説明する図であ
る。 図において、
Claims (1)
- 記憶部(1A)に記憶された記憶内容が読み出されたの
を示す読了信号(A)と、該記憶部(1A)に記憶内容
を有するのを示す格納信号(B)とを出力する手段を有
する記憶部(1A)と、該記憶部(1A)の記憶内容を
クリアするリセット信号(R)を出力するリセット処理
部(3A)と、前記読了、格納両信号(A、B)を監視
する記憶監視部(4)とを備え、該記憶監視部(4)が
出力する制御信号(C)によって前記リセット処理部(
3A)が出力するリセット信号(R)を制御することを
特徴とする記憶内容リセット制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63036012A JPH01211055A (ja) | 1988-02-18 | 1988-02-18 | 記憶内容リセット制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63036012A JPH01211055A (ja) | 1988-02-18 | 1988-02-18 | 記憶内容リセット制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01211055A true JPH01211055A (ja) | 1989-08-24 |
Family
ID=12457839
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63036012A Pending JPH01211055A (ja) | 1988-02-18 | 1988-02-18 | 記憶内容リセット制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01211055A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2023080559A1 (ko) | 2021-11-02 | 2023-05-11 | 주식회사 엘지에너지솔루션 | 배터리 팩 전압 측정 회로와 그의 동작 방법 |
-
1988
- 1988-02-18 JP JP63036012A patent/JPH01211055A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2023080559A1 (ko) | 2021-11-02 | 2023-05-11 | 주식회사 엘지에너지솔루션 | 배터리 팩 전압 측정 회로와 그의 동작 방법 |
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