JPH01220515A - キーマトリクス装置 - Google Patents
キーマトリクス装置Info
- Publication number
- JPH01220515A JPH01220515A JP63045031A JP4503188A JPH01220515A JP H01220515 A JPH01220515 A JP H01220515A JP 63045031 A JP63045031 A JP 63045031A JP 4503188 A JP4503188 A JP 4503188A JP H01220515 A JPH01220515 A JP H01220515A
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- JP
- Japan
- Prior art keywords
- key
- key matrix
- signal line
- terminal
- row signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は電子機器の操作スイッチの読み取りに用いられ
るキーマトリクス装置に関するものである。
るキーマトリクス装置に関するものである。
従来の技術
この種のキーマトリクス装置は第２図のように構成され
ている。列信号線Ｙｌ−Ｙ４と行信号線Ｘｔ〜Ｘ４カラ
なるキーマトリクスの各交差点にはキースイッチ１〜１
６が介装されており、それぞれキーが操作されることに
よって導通する。列信号線ｙｔ〜Ｙ４の端子ＰＩ−Ｐ４
には下記第１表に示すように４つの信号線のうちの１つ
が“Ｌ”レベルになるように繰り返しスキャンされてお
り、例えばキースイッチ１０のキーが操作された場合に
は列信号線Ｙ２がＬ”レベルのタイミングに行信号線Ｘ
３が“Ｌ″になって、行信号線Ｘｔ〜Ｘ４の端子Ｐ５〜
Ｐ８のうちの端子Ｐ７が“Ｌ”レベルになる。
ている。列信号線Ｙｌ−Ｙ４と行信号線Ｘｔ〜Ｘ４カラ
なるキーマトリクスの各交差点にはキースイッチ１〜１
６が介装されており、それぞれキーが操作されることに
よって導通する。列信号線ｙｔ〜Ｙ４の端子ＰＩ−Ｐ４
には下記第１表に示すように４つの信号線のうちの１つ
が“Ｌ”レベルになるように繰り返しスキャンされてお
り、例えばキースイッチ１０のキーが操作された場合に
は列信号線Ｙ２がＬ”レベルのタイミングに行信号線Ｘ
３が“Ｌ″になって、行信号線Ｘｔ〜Ｘ４の端子Ｐ５〜
Ｐ８のうちの端子Ｐ７が“Ｌ”レベルになる。
〔第１表〕
発明が解決しようとする課題
このような従来の構成では、キーの数を列信号線Ｙｌ−
Ｙ４の数と行信号線Ｘ１−Ｘ４の数との積、ここでは４
Ｘ４＝１６１１ｉ９以上にすることができず、キーの数
をさらに増設するためには列信号線あるいは行信号線を
増設し、入出力端子ＰＩ−Ｐ８の数を増設することが必
要となる。
Ｙ４の数と行信号線Ｘ１−Ｘ４の数との積、ここでは４
Ｘ４＝１６１１ｉ９以上にすることができず、キーの数
をさらに増設するためには列信号線あるいは行信号線を
増設し、入出力端子ＰＩ−Ｐ８の数を増設することが必
要となる。
本発明は入出力端子の数を増設させることなく、従来よ
りも多くのキースイッチを設けることかできるキーマト
リクス装置を提供することを目的とする。
りも多くのキースイッチを設けることかできるキーマト
リクス装置を提供することを目的とする。
課題ｔＬＩＡｑ漁する讐めの手延
本発明のキーマトリクス装置は、第１のキーマトリクス
の列信号線と第２のキーマトリクスの列信号線をシリア
ルに接続し、第１のキーマトリクスの行信号線と第２の
キー７） ＩＪクスの行信号線を、ダイオードにより逆
バイアスになるようにパラレルに接続１−たことを特徴
とする。
の列信号線と第２のキーマトリクスの列信号線をシリア
ルに接続し、第１のキーマトリクスの行信号線と第２の
キー７） ＩＪクスの行信号線を、ダイオードにより逆
バイアスになるようにパラレルに接続１−たことを特徴
とする。
作 用
この構成によると、列信号線の側の端子群とダイオード
が介装されている行信号線の側の端子群のうち、一方の
端子群を順次′Ｌ”レベルにスキャンさせると、他方の
端子群には第１１第２のキーマトリクスのうちの一方の
検出情報が発生し、前記他方の端子群を順次Ｌレベルに
スキャンさせると、前記一方の端子群には他方のキーマ
トリクスの検出情報が発生する。
が介装されている行信号線の側の端子群のうち、一方の
端子群を順次′Ｌ”レベルにスキャンさせると、他方の
端子群には第１１第２のキーマトリクスのうちの一方の
検出情報が発生し、前記他方の端子群を順次Ｌレベルに
スキャンさせると、前記一方の端子群には他方のキーマ
トリクスの検出情報が発生する。
夾施例
以下、本発明の一実施例を第１図に基づいて説明する。
第１のキーマトリクスＡと第２のキーマトリクスＢは、
列信号線をシリアル接続してＹｌ−Ｙ４を共用しており
、第１のキーマトリクスＡでは列信号線Ｙｌ−Ｙ４と行
信号線Ｘｉ〜ｘ４の交差点にキースイッチ１〜１６が設
けられている。第２のキーマトリクスＢでは列信号＃Ｉ
Ｙｌ−Ｙ４と行信号線Ｘ５〜Ｘ８の交差点にキースイ
ッチ１７〜３２が設けられている。列信号線Ｙｌ〜Ｙ４
は端子Ｐ Ｌ−Ｐ４に接続され、行信号線ＸＩ〜Ｘ４は
、ダイオードＤＩ−Ｄ４を介して端子Ｐ５〜Ｐ８に接続
されており、行信号ｆｉｊ！Ｘ５〜Ｘ８はダイオードＤ
５〜Ｄ８を介して端子Ｐ５〜Ｐ８に接続されている。こ
こではダイオードＤＩ−Ｄ４とＤ５〜Ｄ８の行信号線Ｘ
ｌ−Ｘ４゜ｘ５〜Ｘ８に対する極性が逆方向となるよう
に構成されておシ、ダイオードＤ１〜Ｄ４のカソードは
行信号線ｘ１〜ｘ４に接続され、ダイオードＤ５〜Ｄ８
のカソードは端子Ｐ５〜Ｐ８に接続されている。Ｒ１−
Ｒ４，Ｒ５−Ｒ８はプルアップ抵抗である。
列信号線をシリアル接続してＹｌ−Ｙ４を共用しており
、第１のキーマトリクスＡでは列信号線Ｙｌ−Ｙ４と行
信号線Ｘｉ〜ｘ４の交差点にキースイッチ１〜１６が設
けられている。第２のキーマトリクスＢでは列信号＃Ｉ
Ｙｌ−Ｙ４と行信号線Ｘ５〜Ｘ８の交差点にキースイ
ッチ１７〜３２が設けられている。列信号線Ｙｌ〜Ｙ４
は端子Ｐ Ｌ−Ｐ４に接続され、行信号線ＸＩ〜Ｘ４は
、ダイオードＤＩ−Ｄ４を介して端子Ｐ５〜Ｐ８に接続
されており、行信号ｆｉｊ！Ｘ５〜Ｘ８はダイオードＤ
５〜Ｄ８を介して端子Ｐ５〜Ｐ８に接続されている。こ
こではダイオードＤＩ−Ｄ４とＤ５〜Ｄ８の行信号線Ｘ
ｌ−Ｘ４゜ｘ５〜Ｘ８に対する極性が逆方向となるよう
に構成されておシ、ダイオードＤ１〜Ｄ４のカソードは
行信号線ｘ１〜ｘ４に接続され、ダイオードＤ５〜Ｄ８
のカソードは端子Ｐ５〜Ｐ８に接続されている。Ｒ１−
Ｒ４，Ｒ５−Ｒ８はプルアップ抵抗である。
このように構成したため、キースイッチ１〜１６が設け
られている第１のキーマトリクスＡの読ミＰＩ−Ｐ４の
うちの“Ｌ″レベルなるよう繰り返しス＾ キャンされ、端子Ｐ５〜Ｐ８に検出情報が発生する。
られている第１のキーマトリクスＡの読ミＰＩ−Ｐ４の
うちの“Ｌ″レベルなるよう繰り返しス＾ キャンされ、端子Ｐ５〜Ｐ８に検出情報が発生する。
なお、第２表において「−」はハイインピーダンスを表
している。
している。
〔第２表〕
例えば、キースイッチｌが操作された場合には、端子Ｐ
ＩがＬ”レベルのタイミングに、端子Ｐ５→ダイオード
Ｄ１→キースイッチｌ→端子ｐｔと閉回路が形成されて
端子Ｐ５が“Ｌルベルに反転する。この際には、端子ｐ
ｔと端子Ｐ５の間に介装されている。
ＩがＬ”レベルのタイミングに、端子Ｐ５→ダイオード
Ｄ１→キースイッチｌ→端子ｐｔと閉回路が形成されて
端子Ｐ５が“Ｌルベルに反転する。この際には、端子ｐ
ｔと端子Ｐ５の間に介装されている。
もう一方のキースイッチであるキースイッチ１７はダイ
オードＤ５で逆バイアスされており、端子Ｐ５のレベル
に関与していない。
オードＤ５で逆バイアスされており、端子Ｐ５のレベル
に関与していない。
キースイッチ１７〜３２が設けられている第２のキーマ
トリクスＢの読み取り実行時には、下記の第３表に示す
ように端子Ｐ５〜Ｐ８のうちの１つが“Ｌ”レベルにな
るよう繰り返しスキャンされ、端子ＰＩ〜Ｐ４に検出情
報が発生する。
トリクスＢの読み取り実行時には、下記の第３表に示す
ように端子Ｐ５〜Ｐ８のうちの１つが“Ｌ”レベルにな
るよう繰り返しスキャンされ、端子ＰＩ〜Ｐ４に検出情
報が発生する。
なお、第３表において「−」は第２表と同様にハイイン
ピーダンスを表している。
ピーダンスを表している。
以 下 空 白
〔第３表〕
例えば、キースイッチ１７が操作された場合には、端子
Ｐ５が″Ｌルベルのタイミングに、端子Ｐｉ→キースイ
ッチ１７→ダイオードＤ５→端子Ｐ５と閉回路が形成さ
れて端子ＰＬが“Ｌルベルに反転する。この際には、端
子Ｐｉと端子Ｐ５の間に介装されているもう一方のキー
スイッチであるキースイッチ１はダイオードＤＩで逆バ
イアスされており、端子Ｐ１のレベルに関与していない
。
Ｐ５が″Ｌルベルのタイミングに、端子Ｐｉ→キースイ
ッチ１７→ダイオードＤ５→端子Ｐ５と閉回路が形成さ
れて端子ＰＬが“Ｌルベルに反転する。この際には、端
子Ｐｉと端子Ｐ５の間に介装されているもう一方のキー
スイッチであるキースイッチ１はダイオードＤＩで逆バ
イアスされており、端子Ｐ１のレベルに関与していない
。
キースイッチ２〜１６ 、 ｔｓ〜３２の場合も同様で
あって、端子Ｐ１〜Ｐ８の８個の端子数であるにもかか
わらず、従来の倍のキースイッチの状態を検出すること
かできる。
あって、端子Ｐ１〜Ｐ８の８個の端子数であるにもかか
わらず、従来の倍のキースイッチの状態を検出すること
かできる。
発明の効果
以上のように本発明によると、第１のキーマトリクスの
列信号線と第２のキーマトリクスの列信号線をシリアル
に接続し、第１のキーマトリクスの行信号線と第２のキ
ーマトリクスの行信号線を、ダイオードにより逆バイア
スになるようにパラレルに接続したため、列信号線の側
の端子群と行信号線の側の端子群のうちの一方を順次“
Ｌルベルにスキャンさせると、他方の端子群には第１、
第２のキーマトリクスのうちの一方の検出情報が発生し
、スキャンする端子群と読み取りの端子群を入れ換える
ことによって他方のキーマトリクスの検出情報を読み取
ることができ、端子数が従来と同じであっても操作を検
出できるキースイッチの数を２倍Ｋまで増設することが
できるものである。
列信号線と第２のキーマトリクスの列信号線をシリアル
に接続し、第１のキーマトリクスの行信号線と第２のキ
ーマトリクスの行信号線を、ダイオードにより逆バイア
スになるようにパラレルに接続したため、列信号線の側
の端子群と行信号線の側の端子群のうちの一方を順次“
Ｌルベルにスキャンさせると、他方の端子群には第１、
第２のキーマトリクスのうちの一方の検出情報が発生し
、スキャンする端子群と読み取りの端子群を入れ換える
ことによって他方のキーマトリクスの検出情報を読み取
ることができ、端子数が従来と同じであっても操作を検
出できるキースイッチの数を２倍Ｋまで増設することが
できるものである。
第１図は本発明のキーマトリクス装置の構成図、第２図
は従来のキーマトリクス装置の構成図である。 Ａ・・・第１のキーマトリクス、Ｂ・・・第２のキーマ
トリクス、Ｙｌ−Ｙ４・・・列信号線、Ｘｌ−Ｘｌ・・
・第１のキーマトリクスの行信号線、ｘ５〜ｘ８・・・
第２ （Ｄ キー マトリクスの行信号線、Ｄ１〜Ｄ８
・・・ダイオード。 代理人 森 本 義 弘 第１図 Ａ・・−窮ｌＩＪキー７トリクス Ｂ・・・γ２の訃マトリクス Ｘ／−Ｘｌ、Ｘｊ〜Ｘδ・−行１３号線’（１−Ｙ４・
−列１３ｇ線 ０ｆ−ＤＢ−・・夕゛イ才一ド
は従来のキーマトリクス装置の構成図である。 Ａ・・・第１のキーマトリクス、Ｂ・・・第２のキーマ
トリクス、Ｙｌ−Ｙ４・・・列信号線、Ｘｌ−Ｘｌ・・
・第１のキーマトリクスの行信号線、ｘ５〜ｘ８・・・
第２ （Ｄ キー マトリクスの行信号線、Ｄ１〜Ｄ８
・・・ダイオード。 代理人 森 本 義 弘 第１図 Ａ・・−窮ｌＩＪキー７トリクス Ｂ・・・γ２の訃マトリクス Ｘ／−Ｘｌ、Ｘｊ〜Ｘδ・−行１３号線’（１−Ｙ４・
−列１３ｇ線 ０ｆ−ＤＢ−・・夕゛イ才一ド
Claims (1)
- １、第１のキーマトリクスの列信号線と第２のキーマト
リクスの列信号線をシリアルに接続し、第１のキーマト
リクスの行信号線と第２のキーマトリクスの行信号線を
、ダイオードにより逆バイアスになるようにパラレルに
接続したキーマトリクス装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63045031A JPH01220515A (ja) | 1988-02-26 | 1988-02-26 | キーマトリクス装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63045031A JPH01220515A (ja) | 1988-02-26 | 1988-02-26 | キーマトリクス装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01220515A true JPH01220515A (ja) | 1989-09-04 |
Family
ID=12707970
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63045031A Pending JPH01220515A (ja) | 1988-02-26 | 1988-02-26 | キーマトリクス装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01220515A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008311836A (ja) * | 2007-06-13 | 2008-12-25 | Funai Electric Co Ltd | 入力装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56108130A (en) * | 1980-01-31 | 1981-08-27 | Fujitsu General Ltd | Switch circuit |
| JPS63224412A (ja) * | 1987-03-13 | 1988-09-19 | Nec Corp | キ−・マトリツクス・スイツチ |
-
1988
- 1988-02-26 JP JP63045031A patent/JPH01220515A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56108130A (en) * | 1980-01-31 | 1981-08-27 | Fujitsu General Ltd | Switch circuit |
| JPS63224412A (ja) * | 1987-03-13 | 1988-09-19 | Nec Corp | キ−・マトリツクス・スイツチ |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008311836A (ja) * | 2007-06-13 | 2008-12-25 | Funai Electric Co Ltd | 入力装置 |
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