JPH01221677A - 停電検出装置 - Google Patents
停電検出装置Info
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- JPH01221677A JPH01221677A JP4823488A JP4823488A JPH01221677A JP H01221677 A JPH01221677 A JP H01221677A JP 4823488 A JP4823488 A JP 4823488A JP 4823488 A JP4823488 A JP 4823488A JP H01221677 A JPH01221677 A JP H01221677A
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- input voltage
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は交流ＷＩ源の停電を検出する停電検出装置に
関するものである。
関するものである。
ｇ１４４図は例えば実用言子回路（４） Ｐ２２８〜２
３１（ＣＱ出版株式会社昭和５５年１１月３０日発行）
に示された従来の停電検出袋Ｍ（１）をホす回路図であ
り、図において、（ｌａ）（ｌｂ）は検出する交流電圧
信号を入力する入力端子％（２）ａ ）〜（２）ｄ）は
その交流電圧信号を整流するダイオード、（至）は抵抗
器、（ハ）は定電圧ダイオード、（ハ）はコンデンサ、
（至）は抵抗器、（２）ハｗ 圧比較器（コンパレータ
）、（至）は可変抵抗で電源（７）と共通電位とに接続
され、中間端子はコンパレータ翰のもう１つの入力端子
に接続されており、（２）はコンパレータ（財）の出力
端子である。
３１（ＣＱ出版株式会社昭和５５年１１月３０日発行）
に示された従来の停電検出袋Ｍ（１）をホす回路図であ
り、図において、（ｌａ）（ｌｂ）は検出する交流電圧
信号を入力する入力端子％（２）ａ ）〜（２）ｄ）は
その交流電圧信号を整流するダイオード、（至）は抵抗
器、（ハ）は定電圧ダイオード、（ハ）はコンデンサ、
（至）は抵抗器、（２）ハｗ 圧比較器（コンパレータ
）、（至）は可変抵抗で電源（７）と共通電位とに接続
され、中間端子はコンパレータ翰のもう１つの入力端子
に接続されており、（２）はコンパレータ（財）の出力
端子である。
次に動作について説明する。入力端子（ｌａ ） （ｌ
ｂ ）より入力された交流電圧信号（第５図（ａ）に波
形を示す）はブリッジ接続されたダイオード（２）ａ
）〜（２）ｄ）によって整流され、（第５図（ｂ））、
抵抗器−を通して定電圧ダイオード（財）、コンデンサ
（ハ）抵抗器（至）に印加され、コンパレータ勾のマイ
ナス側入力端子（０点）に入力される。コンパレータ（
２）のプラス側入力端子には可変抵抗器（至）により設
定これる基準電圧が入力される。０点電圧は第５図（Ｃ
）の実線に示すように、まず抵抗器（至）を通してコン
デンサ（至）が充！され電圧が上昇し、次に定電圧ダイ
オード（財）の制限電圧＝’Ｖｚに制限され、やがて交
流電圧の方がＶｚよりも低くなると、コンデンサ（２）
から抵抗（至）を通して放電するという動作を半周期ご
とに繰り返す。コンパレータ翰はマイナス側入力端子の
電圧がプラス側入力端子の電圧よりも低くなると出力端
子αのに出力信号を出すように動作する。
ｂ ）より入力された交流電圧信号（第５図（ａ）に波
形を示す）はブリッジ接続されたダイオード（２）ａ
）〜（２）ｄ）によって整流され、（第５図（ｂ））、
抵抗器−を通して定電圧ダイオード（財）、コンデンサ
（ハ）抵抗器（至）に印加され、コンパレータ勾のマイ
ナス側入力端子（０点）に入力される。コンパレータ（
２）のプラス側入力端子には可変抵抗器（至）により設
定これる基準電圧が入力される。０点電圧は第５図（Ｃ
）の実線に示すように、まず抵抗器（至）を通してコン
デンサ（至）が充！され電圧が上昇し、次に定電圧ダイ
オード（財）の制限電圧＝’Ｖｚに制限され、やがて交
流電圧の方がＶｚよりも低くなると、コンデンサ（２）
から抵抗（至）を通して放電するという動作を半周期ご
とに繰り返す。コンパレータ翰はマイナス側入力端子の
電圧がプラス側入力端子の電圧よりも低くなると出力端
子αのに出力信号を出すように動作する。
ここでＦ時点で入力の交流電圧信号が停ｗＩ（ｗ！圧低
下）することを考えると、交流電圧信号が低下しコンデ
ンサ（至）の電荷が放電して０点の電圧が可変抵抗器（
至）により設定された基準電圧よりも低くなると第５図
（ｄ）Ｇ時点でコンパレータ勾が動作して出力端子υに
停電検出信号が出力される。
下）することを考えると、交流電圧信号が低下しコンデ
ンサ（至）の電荷が放電して０点の電圧が可変抵抗器（
至）により設定された基準電圧よりも低くなると第５図
（ｄ）Ｇ時点でコンパレータ勾が動作して出力端子υに
停電検出信号が出力される。
従来の停電検出装置は以上のように構成されているので
、検出速度と検出精度はコンデンサ（至）の専ヤパシタ
ンスと抵抗器（至）の抵抗値とで定まる放で時定数と、
基準電圧の設定値とに依存する。従−で放電時定数をあ
まり小さくすると検出回路での消費電力が大きくなり、
又通常状態での０点の電圧リップルが大きくな−て検出
精度が悪くなるので、実用的な検出速度は１〜２サイク
ルよりも速くできないという課題があった。
、検出速度と検出精度はコンデンサ（至）の専ヤパシタ
ンスと抵抗器（至）の抵抗値とで定まる放で時定数と、
基準電圧の設定値とに依存する。従−で放電時定数をあ
まり小さくすると検出回路での消費電力が大きくなり、
又通常状態での０点の電圧リップルが大きくな−て検出
精度が悪くなるので、実用的な検出速度は１〜２サイク
ルよりも速くできないという課題があった。
この発明は上記のような課題を解消するためになされた
もので、停電を短時間でかつ精度良く検出できる停電検
出装置を得ることを目的とする。
もので、停電を短時間でかつ精度良く検出できる停電検
出装置を得ることを目的とする。
この発明に係る停電検出装置は交流入力電圧に同期した
所定電圧値の基準正弦波背圧を発生する手段と、上記入
力電圧と上記基準正弦波電圧の差を演算する手段と、上
記差の電圧が所望の設定値を越えると出力を発生する比
較手段とを備えたものである。
所定電圧値の基準正弦波背圧を発生する手段と、上記入
力電圧と上記基準正弦波電圧の差を演算する手段と、上
記差の電圧が所望の設定値を越えると出力を発生する比
較手段とを備えたものである。
この発明における交流入力電圧に同期した正弦波電圧の
基準信号は交流入力電圧と比較され、両者の差が所定の
値を越えた時に停電と判断される。
基準信号は交流入力電圧と比較され、両者の差が所定の
値を越えた時に停電と判断される。
以下、この発明の一実施例を図について説明する。
第１図（ａ）において、（１）は入力端子、（２）は例
えばフェーズロックドループ（ＰＬＬ）回路により構成
される同期回路、（３）は同期回路（２）の出力が入力
され、入力交流電圧に同期しかつ所定の大きさを有する
正弦波電圧を発生する正弦波発生回路、（４）は上記入
力電圧と上記正弦波電圧との差の信号を発生する減算器 （５）、（６１は電圧比較器（コンパレータ）（７）は
制御電源（正極、電圧Ｖｐ）（８）は制御電源（負極、
電圧ＶＮ） （９）、ａｎは実質的に同一の抵抗値Ｒ１を有する抵抗
器αＯは抵抗値島に設定はれた可変抵抗器（２）は電圧
比較器（６１（６１のいずれかに出力があれば出力を発
生する出力端子である。
えばフェーズロックドループ（ＰＬＬ）回路により構成
される同期回路、（３）は同期回路（２）の出力が入力
され、入力交流電圧に同期しかつ所定の大きさを有する
正弦波電圧を発生する正弦波発生回路、（４）は上記入
力電圧と上記正弦波電圧との差の信号を発生する減算器 （５）、（６１は電圧比較器（コンパレータ）（７）は
制御電源（正極、電圧Ｖｐ）（８）は制御電源（負極、
電圧ＶＮ） （９）、ａｎは実質的に同一の抵抗値Ｒ１を有する抵抗
器αＯは抵抗値島に設定はれた可変抵抗器（２）は電圧
比較器（６１（６１のいずれかに出力があれば出力を発
生する出力端子である。
次に動作について説明する。
入力端子（１）には交流入力常圧（＠３図（ａ））が印
加される。同期回路（２）は例えば第１図（ｂ）に示す
ように１ニーズロツクドループ（ＰＬＬ）回路を構成骨
との位相を比較する位相比較器（２０１）と、その出力
に接続されたフィルタ（２０２）と、そのフィルタ出力
電圧に応じた周波数の信号を発振する重圧制御発振器（
ＶＣＯ）とにより入力電圧の１，２、・・・２ｎ倍の周
波数のｎ個の同期信号を発生する（第３図ｂ）。この回
路の応答速度はフィルタ（２０２）の時定数により決定
される。正弦波発生回路（２）は例えば第１図（Ｃ）に
示すように正弦波パターンを記憶させた読出し専用メモ
リ（ＲＯＭ）（３０１）とディジタル／アナログ（Ｄ／
Ａ ）変換器、（３０２）とにより入カゴ圧に同期して
、電圧の一定な正弦波電圧を発生する（第３図（Ｃ））
。減算器（４）は上記入力電圧と上記正弦波電圧との差
を演算して求める。
加される。同期回路（２）は例えば第１図（ｂ）に示す
ように１ニーズロツクドループ（ＰＬＬ）回路を構成骨
との位相を比較する位相比較器（２０１）と、その出力
に接続されたフィルタ（２０２）と、そのフィルタ出力
電圧に応じた周波数の信号を発振する重圧制御発振器（
ＶＣＯ）とにより入力電圧の１，２、・・・２ｎ倍の周
波数のｎ個の同期信号を発生する（第３図ｂ）。この回
路の応答速度はフィルタ（２０２）の時定数により決定
される。正弦波発生回路（２）は例えば第１図（Ｃ）に
示すように正弦波パターンを記憶させた読出し専用メモ
リ（ＲＯＭ）（３０１）とディジタル／アナログ（Ｄ／
Ａ ）変換器、（３０２）とにより入カゴ圧に同期して
、電圧の一定な正弦波電圧を発生する（第３図（Ｃ））
。減算器（４）は上記入力電圧と上記正弦波電圧との差
を演算して求める。
ここで上記正弦波背圧の大きさを入力電圧の定格値に設
定しておけば上記差の背圧は入力電圧の定格電圧からの
変動分に相当する。
定しておけば上記差の背圧は入力電圧の定格電圧からの
変動分に相当する。
コンパレータ（５）及び（６）はウィンドウコンパレー
タ回路を構成しており、入力電圧Ｖが 出力を発生する。（但しＶｐ＝−ＶＮの場合）上記差の
電圧は上記ウィンドウコンパレータ回路に入力され、入
力電圧の定格電圧からの変動が上記検出レベルＭを逸脱
した場合に停電とみなして出力を発生する。
タ回路を構成しており、入力電圧Ｖが 出力を発生する。（但しＶｐ＝−ＶＮの場合）上記差の
電圧は上記ウィンドウコンパレータ回路に入力され、入
力電圧の定格電圧からの変動が上記検出レベルＭを逸脱
した場合に停電とみなして出力を発生する。
即ち、第３図ａの最初の１サイクルでは入力電圧が定格
背圧よりも小さか。たり大きかったりしているが、その
差が所定の検出レベルよりも小さいので検出出力（第３
図ｅ）は出ないが、Ｆ時点で停電が発生し入力背圧が低
下すると、上記正弦波常圧との差が上記検出レベルを越
え遅滞なく検出出力が発生する。
背圧よりも小さか。たり大きかったりしているが、その
差が所定の検出レベルよりも小さいので検出出力（第３
図ｅ）は出ないが、Ｆ時点で停電が発生し入力背圧が低
下すると、上記正弦波常圧との差が上記検出レベルを越
え遅滞なく検出出力が発生する。
この場合フィルタ（２０２）の時定数を十分長くしてお
けば、停電直後は停笥前の入力電圧の位相が保持される
。
けば、停電直後は停笥前の入力電圧の位相が保持される
。
ｍ２図はこの発明の他の実施例を示す回路図であり、図
において、（至）は従来の停電検出回路で検出レベルは
精密に設定されており（例えば−１０％）、（至）は上
記この発明の第１の実施例で説明した停電検出回路で検
出レベルは（２）よりもやや広く設定されており（例え
ば−３０％）α４は論理和（第３）ゲートで、（転）又
は（至）のいずれか一方の出力が有る場合に出力を発生
する。（２）の停電検出回路は応答速度が速いが、電圧
波形歪の影響により誤動作する可能がやや高いので、検
出レベルを広げて不要な動作をしないようにする。一方
翰の検出回路はフィルタがあ′り電圧波形歪の影響を受
けにくいので、検出レベルを精密に設定する。
において、（至）は従来の停電検出回路で検出レベルは
精密に設定されており（例えば−１０％）、（至）は上
記この発明の第１の実施例で説明した停電検出回路で検
出レベルは（２）よりもやや広く設定されており（例え
ば−３０％）α４は論理和（第３）ゲートで、（転）又
は（至）のいずれか一方の出力が有る場合に出力を発生
する。（２）の停電検出回路は応答速度が速いが、電圧
波形歪の影響により誤動作する可能がやや高いので、検
出レベルを広げて不要な動作をしないようにする。一方
翰の検出回路はフィルタがあ′り電圧波形歪の影響を受
けにくいので、検出レベルを精密に設定する。
即ち、電圧低下量の小さな停Ｗ（Ｉ！圧低下）が継続す
る場合は停電検出回路（１）で所定のフィルタ時定数後
に検出することができ、電圧低下量の大きな停電の場合
は停電検出回路で高速に検出することができるので、両
者の長所を生かした、高速で精度の高い停電検出装置を
得ることができる。
る場合は停電検出回路（１）で所定のフィルタ時定数後
に検出することができ、電圧低下量の大きな停電の場合
は停電検出回路で高速に検出することができるので、両
者の長所を生かした、高速で精度の高い停電検出装置を
得ることができる。
なお、上記実施例の構成をディジタル回路とソフトウェ
アで組んでもよく、上記実施例と同様の効果を奏する。
アで組んでもよく、上記実施例と同様の効果を奏する。
以上のように、この発明によれば入力背圧に同期した所
定の正弦波１圧を基準として停電検出をするように構成
したので、検出時間が短かく、精度の高いものが得られ
る効果がある。
定の正弦波１圧を基準として停電検出をするように構成
したので、検出時間が短かく、精度の高いものが得られ
る効果がある。
第１図ａはこの発明の一実施例による停電検出装置を示
す回路図、第１図すは第１図ａの同期回路の回路図、第
１図Ｃは第１図ａの正弦波発生回路の回路図、第２図は
この発明の他の実施例を示す停電検出装置の回路図、第
３図はこの発明の一実施例の波形図、第４図は従来の停
電検出装置を示す回路図、第５図は第４図の動作を示す
波形図である。 （１）は入力端子、（２）は同期回路、（３）は正弦波
発生回路、（４）は減算器、（５）％（６）は電圧比較
ＪＩ＠（コンパレータ”） 、（７）は制御電源（正極
）、（８）は制御電源（負極） 、（９）、０は抵抗器
、Ｑｄは可変抵抗器、（至）は出力端子、（２０１）は
位相比較器、（２０２）はフィ周器、（３０１）は読出
し専用メモリ（ＲＯＭ ”）、（３０２）はディジタル
／アナログ（Ｄ／Ａ）変換器、（至）は本発明による停
電検出回路、α４は論理和（オア）ゲート、勾は従来の
停電検出回路、（２）ａ）〜（２）ｄ）はダイオード、
（至）は抵抗器、（２）は定電圧ダイオード、（ハ）は
コンデンサ、（至）は抵抗器、（２）は電圧比較器、（
至）は可変抵抗器 なお、図中、同一符号は同一、又は相当部分を示す。
す回路図、第１図すは第１図ａの同期回路の回路図、第
１図Ｃは第１図ａの正弦波発生回路の回路図、第２図は
この発明の他の実施例を示す停電検出装置の回路図、第
３図はこの発明の一実施例の波形図、第４図は従来の停
電検出装置を示す回路図、第５図は第４図の動作を示す
波形図である。 （１）は入力端子、（２）は同期回路、（３）は正弦波
発生回路、（４）は減算器、（５）％（６）は電圧比較
ＪＩ＠（コンパレータ”） 、（７）は制御電源（正極
）、（８）は制御電源（負極） 、（９）、０は抵抗器
、Ｑｄは可変抵抗器、（至）は出力端子、（２０１）は
位相比較器、（２０２）はフィ周器、（３０１）は読出
し専用メモリ（ＲＯＭ ”）、（３０２）はディジタル
／アナログ（Ｄ／Ａ）変換器、（至）は本発明による停
電検出回路、α４は論理和（オア）ゲート、勾は従来の
停電検出回路、（２）ａ）〜（２）ｄ）はダイオード、
（至）は抵抗器、（２）は定電圧ダイオード、（ハ）は
コンデンサ、（至）は抵抗器、（２）は電圧比較器、（
至）は可変抵抗器 なお、図中、同一符号は同一、又は相当部分を示す。
Claims (2)
- （１）交流入力電圧に同期した所定電圧値の基準正弦波
電圧を発生する手段と、上記入力電圧と上記基準正弦波
電圧の差を演算する手段と、上記差の電圧が所望の設定
値を越えると出力を発生する比較手段とを備えた停電検
出装置。 - （２）交流入力電圧に同期した所定電圧値の基準正弦波
電圧を発生する手段と、上記入力電圧と上記基準正弦波
電圧の差を演算する手段と、上記差の電圧が所望の第１
の記定値を越えると第１の出力を発生する比較手段とを
備えた第１の停電検出手段、 上記入力電圧を整流しフィルタをかけた後の電圧が所望
の第２の設定値を越えると第２の出力を発生する第２の
停電検出手段、 上記第１の出力と第２の出力の論理和を出力するＯＲゲ
ートを備え、 上記第１の設定値を上記第２の設定値よりも低電圧で動
作するよう設定したことを特徴とする停電検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63048234A JP2581735B2 (ja) | 1988-02-29 | 1988-02-29 | 停電検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63048234A JP2581735B2 (ja) | 1988-02-29 | 1988-02-29 | 停電検出装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01221677A true JPH01221677A (ja) | 1989-09-05 |
| JP2581735B2 JP2581735B2 (ja) | 1997-02-12 |
Family
ID=12797751
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63048234A Expired - Lifetime JP2581735B2 (ja) | 1988-02-29 | 1988-02-29 | 停電検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2581735B2 (ja) |
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0213130A (ja) * | 1988-06-30 | 1990-01-17 | Sanyo Denki Co Ltd | デジタルｐｌｌを使用した正弦波発生回路 |
| JPH0415445A (ja) * | 1990-05-10 | 1992-01-20 | Mitsubishi Heavy Ind Ltd | 多室型空気調和機の制御方法 |
| JPH0478572U (ja) * | 1990-11-16 | 1992-07-08 | ||
| JPH09297156A (ja) * | 1996-05-07 | 1997-11-18 | Shindengen Electric Mfg Co Ltd | 商用電源の瞬時停電検出回路 |
| JP2004282585A (ja) * | 2003-03-18 | 2004-10-07 | Matsushita Electric Ind Co Ltd | 電子機器 |
| JP2005172427A (ja) * | 2003-12-05 | 2005-06-30 | Mitsubishi Electric Corp | 交流電圧低下検出装置 |
| EP1440605A4 (en) * | 2001-03-15 | 2006-06-14 | Bodine Company Inc The | DEVICE FOR MAINTAINING ARC IN HIGH INTENSITY DISCHARGE LAMPS AND ADAPTIVE CONTROL OSCILLOSCOPE |
| JP2017138313A (ja) * | 2016-02-03 | 2017-08-10 | 富士電機株式会社 | 電圧異常検出装置、プログラム、電圧異常検出方法 |
| JPWO2020022255A1 (ja) * | 2018-07-23 | 2021-08-02 | 日本電気株式会社 | 測定装置及び電圧生成方法 |
| WO2026076950A1 (zh) * | 2024-10-09 | 2026-04-16 | 深圳市华宝新能源股份有限公司 | 检测方法、控制装置、配电箱和存储介质 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54119646A (en) * | 1978-03-08 | 1979-09-17 | Fuji Electric Co Ltd | Ac voltage abnormality detector |
| JPS59206773A (ja) * | 1983-05-11 | 1984-11-22 | Tohoku Oki Denki Kk | 交流電源異常検出回路 |
-
1988
- 1988-02-29 JP JP63048234A patent/JP2581735B2/ja not_active Expired - Lifetime
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| JPWO2020022255A1 (ja) * | 2018-07-23 | 2021-08-02 | 日本電気株式会社 | 測定装置及び電圧生成方法 |
| WO2026076950A1 (zh) * | 2024-10-09 | 2026-04-16 | 深圳市华宝新能源股份有限公司 | 检测方法、控制装置、配电箱和存储介质 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2581735B2 (ja) | 1997-02-12 |
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