JPH0130341B2 - - Google Patents
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- JPH0130341B2 JPH0130341B2 JP54014972A JP1497279A JPH0130341B2 JP H0130341 B2 JPH0130341 B2 JP H0130341B2 JP 54014972 A JP54014972 A JP 54014972A JP 1497279 A JP1497279 A JP 1497279A JP H0130341 B2 JPH0130341 B2 JP H0130341B2
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Description
【発明の詳細な説明】
本発明は、フアクシミリ用光電変換装置にかか
わり、特に、光電変換部の出力信号に現われる光
電変換装置の変換歪を補償する手段を有するフア
クシミリ用光電変換装置に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a photoelectric conversion device for facsimile, and more particularly to a photoelectric conversion device for facsimile having means for compensating for conversion distortion of the photoelectric conversion device appearing in an output signal of a photoelectric conversion section.
近年、フアクシミリ送信機には、CCD(Charge
Coupled Device)やMOS(Metal Oxide
Semiconductor)技術によるイメージセンサアレ
イ(Image Sensor Array)を使つた光電変換装
置が用いられている。これは、読み取ろうとする
原稿を照明する光源、照明された原稿上の光学情
報をイメージセンサ上に結像する光学系によつて
イメージセンサ上に光情報を与えイメージセンサ
によつて光−電気変換するものである。イメージ
センサを使つたフアクシミリ用光電変換装置は、
(1)イメージセンサ自身が電気回路的な走査機能を
持つており慣性のない高速走査が可能、(2)半導体
技術で集積化されているため小型化、高信頼化が
可能、(3)感度が高く高速読取が可能、(4)制御がデ
イジタル信号でできるため信号処理がやりやすい
特徴がある。 In recent years, facsimile transmitters are equipped with CCD (Charge
Coupled Device) and MOS (Metal Oxide
A photoelectric conversion device using an image sensor array developed by Semiconductor technology is used. This involves a light source that illuminates the document to be read, an optical system that images the optical information on the illuminated document onto the image sensor, and the image sensor converts light into electricity. It is something to do. A photoelectric conversion device for facsimile using an image sensor is
(1) The image sensor itself has a scanning function similar to an electric circuit, allowing high-speed scanning without inertia; (2) Integrated using semiconductor technology, allowing for miniaturization and high reliability; (3) Sensitivity (4) Control is possible using digital signals, making signal processing easy.
しかしながら、このイメージセンサを使つたフ
アクシミリ用光電変換装置は、原稿上の各走査点
に対して、光源、光学系、センサの変換係数が変
化し、出力信号に歪を生じる問題がある。そのた
めに、照明部の反射板による補正、光学的なマス
ク、レンズやフアイバーによる補正、読み取つた
信号の積分値に応じた補正(フロテイングスライ
ス)などが用いられているが、実際上は、相当な
熟練と精密な調整が必要でかつ良い効果があがり
にくい。 However, a facsimile photoelectric conversion device using this image sensor has a problem in that the conversion coefficients of the light source, optical system, and sensor change with respect to each scanning point on the document, causing distortion in the output signal. For this purpose, corrections are made using a reflector in the illumination section, corrections using optical masks, lenses or fibers, corrections according to the integral value of the read signal (floating slice), etc. However, in practice, this is quite difficult. It requires extensive skill and precise adjustment, and is difficult to produce good results.
本発明は、上記した従来技術の欠点にかんがみ
補正の容易な補正手段を付加したフアクシミリ用
光電変換装置を提供することを目的とする。 SUMMARY OF THE INVENTION An object of the present invention is to provide a photoelectric conversion device for facsimile in which a correction means that can be easily corrected is added to the above-mentioned drawbacks of the prior art.
本発明の目的は、従来のフアクシミリ用光電変
換装置に、さらに、原稿が読み取り位置に無い時
に原稿の送りガイドを兼ねる一様白の拡散反射板
を読みとり、あらかじめ光電変換動作をさせて読
み取りの変換特性を測定して記憶し、その測定結
果に応じて光電変換信号を評価する手段を付加す
ることによつて達成できる。 An object of the present invention is to provide a conventional facsimile photoelectric conversion device that further reads a uniformly white diffuse reflection plate that also serves as a document feeding guide when the document is not in the reading position, and performs a photoelectric conversion operation in advance to convert the reading. This can be achieved by measuring and storing the characteristics and adding a means for evaluating the photoelectric conversion signal according to the measurement results.
以下実施例によつて本発明を説明する。 The present invention will be explained below with reference to Examples.
第1図は、本発明によるフアクシミリ用光電変
換装置の1実施例のブロツク構成図である。第1
図において、10は図示せぬが所定の規則に従つ
て給紙する駆動手段によつて移動される原稿、2
0は原稿10を照明する光源、集光部、遮光部
等々から成る照明手段、30は反射鏡(場合によ
り省略可)、レンズ、遮光部等々から成る光学系、
40はCCDやMOS等々のイメージセンサアレイ
およびその駆動回路を含む光−電気変換回路、5
0はインピーダンス変換および、増幅作用を有す
増幅回路、60は変換歪の補正回路、70はフア
クシミリ用光電変換装置に対して外部から与えら
れる制御信号を受けて一定の手続に従つてフアク
シミリ用光電変換装置を動作させる制御回路であ
る。 FIG. 1 is a block diagram of one embodiment of a photoelectric conversion device for facsimile according to the present invention. 1st
In the figure, reference numeral 10 denotes a document that is moved by a drive means (not shown) that feeds paper according to a predetermined rule;
0 is an illumination means consisting of a light source for illuminating the original 10, a condensing section, a light shielding section, etc.; 30 is an optical system consisting of a reflecting mirror (which can be omitted depending on the case), a lens, a light shielding section, etc.;
40 is an optical-to-electrical conversion circuit including an image sensor array such as a CCD or MOS and its driving circuit; 5
0 is an amplifier circuit that performs impedance conversion and amplification, 60 is a correction circuit for conversion distortion, and 70 is a photoelectric converter for facsimile that receives a control signal given from the outside to the photoelectric converter for facsimile according to a certain procedure. This is a control circuit that operates the conversion device.
本実施例では、光源に直管螢光灯、光学系に
F4.0f=30mmのレンズ、イメージセンサに、2048
ビツトのCCDイメージセンサを用いる。 In this example, the light source is a straight tube fluorescent lamp, and the optical system is
F4.0f = 30mm lens, image sensor, 2048
Uses BIT's CCD image sensor.
本実施例は補正手段60、制御手段70を除く
部分はいずれも公知であり、この基本部分は、第
2図のようなタイミングで動作し、第3図のよう
な特性を示す。 All parts of this embodiment except for the correction means 60 and the control means 70 are known, and these basic parts operate at the timing shown in FIG. 2 and exhibit the characteristics shown in FIG. 3.
第2図において信号CPOは、フアクシミリ用
光電変換装置全体を動作させる基準タイミングで
本実施例では100kHzのクロツクを用いる。信号
SCOは、光電変換指令信号であり、約10μsのパ
ルス幅を持ちこの信号を入力すると、イメージセ
ンサ駆動回路は、CPOに同期した光電変換指令
信号SC1を発生し、イメージセンサアレイに光
電変換指令を与える。CP1は、基準クロツクの
1/2の周波数のタイミング信号で、イメージセン
サアレイからの出力データの転送タイミングに一
致し、後に接続する補正手段あるいは光電変換信
号を利用する部分で使用する。VOは、補正前の
光電変換出力信号である。この信号には、第3図
のように照明の不均一性、光学系の不均一性、イ
メージセンサ増幅手段の不均一性を含んでいる。
すなわち、(a)は照明の不均一性で横軸が走査線上
の位置で縦軸が原稿面照度である。本実施例の場
合、補正用反射板を付けないと端部と中央部で約
50%の不均一性がある。(b)は光学系の不均一性
で、縦軸は透過率に相当し、周辺光量を補正した
非球面レンズの場合でも周辺部と中央部とでは20
〜30%の差がある。(c)はイメージセンサの変換特
性で、イメージセンサアレイ内部の各受光素子の
感度の不均一性、CCDの転送効率等が加算され
図のようにパターン誤差、半導体の不均一性等が
5〜10%現われる。したがつて出力信号は(a)(b)(c)
の相乗効果として(d)(VOに相当)のようにな
り、このままでは利用できないわけである。 In FIG. 2, the signal CPO is the reference timing for operating the entire facsimile photoelectric conversion device, and in this embodiment, a 100 kHz clock is used. signal
SCO is a photoelectric conversion command signal, which has a pulse width of approximately 10 μs. When this signal is input, the image sensor drive circuit generates a photoelectric conversion command signal SC1 synchronized with CPO, and issues a photoelectric conversion command to the image sensor array. give. CP1 is a timing signal with a frequency 1/2 that of the reference clock, which coincides with the transfer timing of the output data from the image sensor array, and is used in the correction means connected later or in the part that utilizes the photoelectric conversion signal. VO is a photoelectric conversion output signal before correction. As shown in FIG. 3, this signal includes non-uniformity of illumination, non-uniformity of the optical system, and non-uniformity of the image sensor amplification means.
That is, (a) shows the non-uniformity of illumination, with the horizontal axis representing the position on the scanning line and the vertical axis representing the illuminance on the document surface. In the case of this example, if the correction reflector is not attached, the edges and center will be approximately
There is 50% heterogeneity. (b) is the non-uniformity of the optical system, and the vertical axis corresponds to the transmittance.
There is a difference of ~30%. (c) is the conversion characteristic of the image sensor. Non-uniformity in sensitivity of each light-receiving element inside the image sensor array, transfer efficiency of CCD, etc. are added, and as shown in the figure, pattern error, non-uniformity of semiconductor, etc. 10% appear. Therefore, the output signals are (a)(b)(c)
The synergistic effect of (d) (corresponding to VO) is obtained, and it cannot be used as is.
以下各部の詳細を説明する。 The details of each part will be explained below.
第4図は、本実施例の補正回路を除く電気回路
図である。第4図において、100〜102は抵
抗、103は可変抵抗、104〜107はコンデ
ンサー、108は水晶振動子、109〜110は
インバーター、111〜113はフリツプフロツ
プ、114はナンドゲート、115〜118は
MOSドライバー、119はCCDイメージセンサ
アレイ、120はオペアンプ、121はデイジタ
ルカウンタ122はインバータであり、ブロツク
番号の名称および信号名称は第1図、第2図と同
一である。 FIG. 4 is an electrical circuit diagram excluding the correction circuit of this embodiment. In FIG. 4, 100 to 102 are resistors, 103 is a variable resistor, 104 to 107 are capacitors, 108 is a crystal oscillator, 109 to 110 are inverters, 111 to 113 are flip-flops, 114 is a NAND gate, and 115 to 118 are
MOS driver, 119 is a CCD image sensor array, 120 is an operational amplifier, 121 is a digital counter 122 is an inverter, and the names of block numbers and signal names are the same as in FIGS. 1 and 2.
フリツプフロツプ111及び112、ナンドゲ
ート114およびMOSドライバ115〜118
はCCDイメージセンサアレイ119の駆動回路
であり、また抵抗102、コンデンサ107、可
変抵抗103、オペアンプ120は、CCDイメ
ージセンサアレイ119の出力信号の増幅回路で
ある。抵抗100〜101、コンデンサ104〜
106、インバータ109からなる回路は、水晶
振動子108を用いた発振回路でCPOの256倍の
周波数で発振させる。インバータ110およびフ
リツプフロツプ113は、発振回路の出力の波形
整形および、クロツクパルスのデユーテイを50対
50にするための回路で、このクロツクを使用する
回路の動作安定にはあつた方が良いが本質的なも
のではない。カウンタ121は分周器として用い
CP2の128分の1の周波数のクロツクCPOを発生
するものである。制御回路70はこの発振、波形
整形、分周及び信号の分配をするものである。信
号としては、第2図で説明した外に、光電変換装
置が原稿を読み取る位置にある事を示す信号
SOPがあり、これはインバータ122により信
号反転して補正回路に、読み取りの変換特性測定
の指令信号として使用する。すなわち、SOPが
オフ(2値信号の0レベル)の場合は、光電変換
指令SCOによつて、この光電変換装置は、変換
特性を測定して測定値を記憶する動作をする。 Flip-flops 111 and 112, NAND gate 114 and MOS drivers 115 to 118
is a drive circuit for the CCD image sensor array 119, and a resistor 102, a capacitor 107, a variable resistor 103, and an operational amplifier 120 are an amplification circuit for the output signal of the CCD image sensor array 119. Resistor 100~101, capacitor 104~
The circuit consisting of 106 and inverter 109 is an oscillation circuit using a crystal resonator 108 and oscillates at a frequency 256 times that of CPO. The inverter 110 and flip-flop 113 shape the waveform of the output of the oscillation circuit and adjust the duty of the clock pulse to 50.
This is a circuit for setting the clock to 50. It would be good to have a stable operation for the circuit that uses this clock, but it is not essential. Counter 121 is used as a frequency divider
It generates a clock CPO with a frequency 1/128 of CP2. The control circuit 70 performs this oscillation, waveform shaping, frequency division, and signal distribution. In addition to the signals explained in Figure 2, there is also a signal indicating that the photoelectric conversion device is in the position to read the document.
There is an SOP, which is inverted as a signal by an inverter 122 and used as a command signal for the correction circuit to measure the reading conversion characteristics. That is, when the SOP is off (0 level of the binary signal), the photoelectric conversion device measures the conversion characteristics and stores the measured value according to the photoelectric conversion command SCO.
次に、第5図〜第8図によつてこの測定動作お
よび補正動作を説明する。 Next, this measurement operation and correction operation will be explained with reference to FIGS. 5 to 8.
第5図は、補正回路60であり、同図において
131〜138はインバータ、139はMOSド
ライバ、140はアンド回路、141〜142は
負論理のオア回路、143はナンド回路、144
は抵抗、145〜146はコンデンサ、147は
可変抵抗、148はアナログスイツチ、149〜
150はデイジタルのカウンタ、151はRAM
(Randam Access Memory)、152はトライ
ステートのバスバツフア、153はアナログ値の
データセレクタ、154はブログラマブル分圧
器、いわゆるラダー抵抗、155はオペアンプ、
156はコンパレータである。 FIG. 5 shows the correction circuit 60, in which 131 to 138 are inverters, 139 is a MOS driver, 140 is an AND circuit, 141 to 142 are negative logic OR circuits, 143 is a NAND circuit, and 144
is a resistor, 145 to 146 are capacitors, 147 is a variable resistor, 148 is an analog switch, 149 to 146 are capacitors, 147 is a variable resistor, 148 is an analog switch,
150 is a digital counter, 151 is RAM
(Random Access Memory), 152 is a tri-state bus buffer, 153 is an analog value data selector, 154 is a programmable voltage divider, so-called ladder resistor, 155 is an operational amplifier,
156 is a comparator.
この補正回路は、クロツク入力CP1、CP2、
走査指令SC1及び読み取り歪補正指令TRとで駆
動され、TR=“1”の時は、読み取り歪測定モ
ード、TR=“0”の時は、歪補正モードで、読
み取り信号入力VOを読み取り歪の影響を補正し
て2値化し、VO1として出力する。すなわち、
TR=“1”の時は、拡散反射板の読み取り信
号VOの中の)読み取り歪を、カウンタ、プログ
ラマブル分圧器、コンパレータから成るAD変換
器によつて測定してRAMに記憶する。 This correction circuit uses clock inputs CP1, CP2,
It is driven by the scanning command SC1 and the reading distortion correction command TR, and when TR = "1", it is in the reading distortion measurement mode, and when TR = "0", it is in the distortion correction mode, and reads the read signal input VO and calculates the distortion. Correct the influence, binarize it, and output it as VO1. That is, when TR="1", the read distortion (in the read signal VO of the diffuse reflector) is measured by an AD converter consisting of a counter, a programmable voltage divider, and a comparator, and is stored in the RAM.
TR=“0”の時は、原稿の読み取り信号に対
して、読み取り歪データを読み出してプログラマ
ブル分圧器を介してDA変換した評価基準信号を
しきい値としてコンパレータで2値化する。 When TR="0", reading distortion data is read out from the original reading signal, and the evaluation reference signal obtained by DA conversion via a programmable voltage divider is used as a threshold value to be binarized by a comparator.
コンデンサ146は第4図の増幅回路の直流レ
ベルのドリフトを遮断するもので、このために、
アナログスイツチ148によるクランプ回路で直
流再生を施している。このブロツクはいわゆる直
流再生回路である。オペアンプ155は、コンパ
レータ156に十分な電力を供給するための電圧
ホロワいわゆるインピーダンス変換回路である。
カウンタ149は、RAM151の記憶アドレス
を発生させるための回路で、SC1によつて、1
走査線毎にリセツトする。アナログスイツチ15
3は、TRがオンの時はVSt(基準値でありVOの
最大値以上の値)、オフ(原稿の読み取り中)は、
可変抵抗147で分圧された電圧を、プログラマ
ブル分圧器154に与える。プログラマブル分圧
器154の出力VREFは、コンパレータ156に入
力し、入力信号VOと比較する。比較結果がVO
1であり、TRがオンの時は、カウンタ150の
カウント動作を制御する。カウンタ150は、
SC1によつて走査線毎にリセツトされるほか、
後で説明するように、インバータ131,13
2、抵抗144、コンデンサ145、アンド回路
140から成るブロツクはいわゆる微分回路で、
CP1の立下がり点を微分して作成したリセツト
パルスPCでリセツトする。カウンタ150の出
力は、TRがオンの時のみバスバツフアが開いて
プログラマブル分周器154に与えられる。コン
パレータ156は、VREFがVOよりも小さい場合
にのみ、カウンタ150のカウント動作を許可す
る。したがつてVREFがわずかにVOを超えた値に
なるようにカウント値が増加した時点までカウン
タ150はカウント動作を続ける。TRがオンの
時は、ナンドゲート143は微分パルスを通過さ
せる。したがつてカウンタがストツプした時のカ
ウント値をRAM151に記憶させる事ができ
る。当然カウンタ150のリセツトは、インバー
タ134〜137から成るいわゆる遅延回路で書
き込みパルスよりも十分に遅延したリセツトパル
スでリセツトするから記憶動作の間、カウンタ1
50の出力は保証される。TRがオフの時は、バ
スバツフア152は出力を禁止され、RAMへの
記憶も禁止されるが、RAMの出力はCEが常にオ
ンとなり許可され、アドレスカウンタ149の出
力に応じた記憶内容を出力する。なお、CP1と
CP2のクロツクの動作タイミングは一致してい
るものとし、その周波数比は次式で与えられる。 The capacitor 146 is for blocking the DC level drift of the amplifier circuit shown in FIG.
DC regeneration is performed by a clamp circuit using an analog switch 148. This block is a so-called DC regeneration circuit. The operational amplifier 155 is a voltage follower so-called impedance conversion circuit for supplying sufficient power to the comparator 156.
The counter 149 is a circuit for generating a memory address of the RAM 151, and is a circuit for generating a memory address of the RAM 151.
Reset every scan line. analog switch 15
3, when TR is on, V St (reference value, value greater than the maximum value of VO), when off (while reading the document),
The voltage divided by the variable resistor 147 is applied to the programmable voltage divider 154. The output V REF of programmable voltage divider 154 is input to comparator 156 and compared with input signal VO. The comparison result is VO
1, and when TR is on, it controls the counting operation of the counter 150. The counter 150 is
In addition to being reset for each scanning line by SC1,
As will be explained later, inverters 131, 13
2. The block consisting of a resistor 144, a capacitor 145, and an AND circuit 140 is a so-called differential circuit.
Reset using the reset pulse PC created by differentiating the falling point of CP1. The output of the counter 150 is provided to the programmable frequency divider 154 when the bus buffer is opened only when TR is on. Comparator 156 allows counter 150 to count only if V REF is less than VO. Therefore, the counter 150 continues counting until the count value increases so that V REF slightly exceeds VO. When TR is on, NAND gate 143 passes the differential pulse. Therefore, the count value when the counter stops can be stored in the RAM 151. Naturally, the counter 150 is reset by a reset pulse that is sufficiently delayed from the write pulse by a so-called delay circuit consisting of inverters 134 to 137, so that the counter 150 is reset during the storage operation.
50 outputs are guaranteed. When TR is off, the bus buffer 152 is prohibited from outputting and storage to RAM is also prohibited, but CE is always on and RAM output is permitted, and the memory contents are output according to the output of the address counter 149. . In addition, CP1 and
It is assumed that the operating timings of the clocks of CP2 match, and the frequency ratio is given by the following equation.
CP2/CP1=2N
ただしNはプログラマブル分周器の分周比Nす
なわちカウンタ150の最大カウント可能数であ
る。 CP2/CP1=2 N , where N is the frequency division ratio N of the programmable frequency divider, that is, the maximum countable number of the counter 150.
全体的な動作を第6図によつて説明する。第6
図は、原稿が読み取り位置に有るか無いかを示す
SOPより作成したTRがオンかオフかで2つの動
作形態がある事を示しており、オンの時がVOの
波形の測定、オフの時は、VOを測定値によつて
評価(すなわち白か黒かを判別)している。フア
クシミリやOCRにおいて必要なV1は、大きい
か小さいかでなく、白か黒かの判断を要求する。
したがつて原稿が挿入されて、TRがオフし、
SOPがオンするとV0は、記憶データに基づい
た正しい判断を実施することができる。 The overall operation will be explained with reference to FIG. 6th
The figure shows whether the document is in the reading position or not.
This shows that there are two operating modes depending on whether the TR created from the SOP is on or off. (distinguish whether it is black). V1 required in facsimile and OCR requires judgment of black and white, not of large or small.
Therefore, the original is inserted, TR is turned off, and
When the SOP is turned on, V0 is able to make correct decisions based on stored data.
この動作を以下、第7図、第8図によつて説明
する。第7図は、TRがオンの時の動作である。
時間軸を引き伸ばすと、CP1に対してV0は、
図のように変化する。点線で示したVREFは、クロ
ツクパルスCP2に応じて直線的に増加し、V0
の値を越えた時点で一定値となる。この値は、
CP1の立下がりの微分パルスでRAMに記憶す
る。この値は、次の理由により読み取り系の変換
係数に比例している。 This operation will be explained below with reference to FIGS. 7 and 8. FIG. 7 shows the operation when TR is on.
If we extend the time axis, V0 for CP1 is
It changes as shown in the figure. V REF shown by the dotted line increases linearly in response to clock pulse CP2, and V0
It becomes a constant value when it exceeds the value of . This value is
Store it in RAM with the differential pulse of the falling edge of CP1. This value is proportional to the conversion factor of the reading system for the following reason.
まず、原稿のない場合に、読み取り位置に一様
白の拡散反射板(説明しなかつたが原稿の送りガ
イドを兼ねる)があるとすると、その反射板の読
み取り走査線上の照度分布は次式で表わすことが
できる。 First, if there is no document and there is a uniformly white diffuse reflection plate (not explained, but it also serves as a document feed guide) at the reading position, the illuminance distribution on the reading scanning line of the reflection plate is given by the following formula: can be expressed.
E=e(x) …(第3図aに相当)
同様に、光学系の透過率は
F=f(x) …(第3図bに相当)
イメージセンサアレイは
S=s(x) …(第3図cに相当)
で表わすことができる。但し、xは走査線上の位
置を表わす。 E=e(x)...(corresponds to Figure 3a) Similarly, the transmittance of the optical system is F=f(x)...(corresponds to Figure 3b) The image sensor array is S=s(x)... (corresponding to Fig. 3c). However, x represents the position on the scanning line.
したがつて、反射板の反射率をR=r(x)と
すれば、出力V0は
V0=E×F×S×R
=e(x)・f(x)・s(x)・γ(x)
と表わすことができ、反射板のγ(x)=k(一定)
とすれば、
V0=e(x)・f(x)・s(x)・kとなり、V
0は、読み取り系の変換係数に比例していること
になる。したがつてこの値を測定したVREF(すな
わち、カウンタの出力で示せば、分圧比N)は、
変換係数を示しており、この値は、RAMに分圧
比Nの2進数の形で記憶した事になる。 Therefore, if the reflectance of the reflector is R=r(x), the output V0 is V0=E×F×S×R = e(x)・f(x)・s(x)・γ( x), and γ(x) of the reflector = k (constant)
Then, V0=e(x)・f(x)・s(x)・k, and V
0 is proportional to the conversion coefficient of the reading system. Therefore, the measured value V REF (i.e., the partial pressure ratio N if expressed by the output of the counter) is:
It shows the conversion coefficient, and this value is stored in the RAM in the form of a binary number of the voltage division ratio N.
次に、TRがオフになり、実際に原稿が読み取
り位置にある場合を第8図によつて示す。時間軸
を引き伸ばすと、クロツクパルスCP1に対して
TRがオンの時の測定値V0は2点鎖線のように
なり、アナログスイツチがTRオフになつた事に
より可変抵抗の分圧電位を選択すると、評価基準
信号VREFは、点線のようになり、原稿を実際に読
み取つた信号V0′に対してその変換特性を補償
した比較値を与えることができ、出力V1は正し
くVSTに対する可変抵抗設定したスライス比で白
黒を判定することができる。 Next, FIG. 8 shows a case where the TR is turned off and the document is actually at the reading position. If you extend the time axis, for clock pulse CP1,
When TR is on, the measured value V0 is as shown by the two-dot chain line, and when the analog switch turns TR off and the divided potential of the variable resistor is selected, the evaluation reference signal V REF becomes as shown in the dotted line. , it is possible to provide a comparison value that compensates for the conversion characteristics of the signal V0' obtained by actually reading the original, and it is possible to accurately determine whether the output V1 is black or white based on the slice ratio set by the variable resistor with respect to VST .
以上説明したように、本発明によれば、あらか
じめ原稿が読み取り位置に無い時に一様白の拡散
反射板を読み取り、読み取り系の変換特性を測定
して記憶し、この記憶値に応じて、実際に原稿を
読み取つた光電変換信号の白黒を判断するから、
読み取り系の変換特性の歪を補償し、かつ、原稿
自体の濃度も実際に読み取ることが可能である。 As explained above, according to the present invention, a uniformly white diffuse reflection plate is read in advance when the document is not at the reading position, the conversion characteristics of the reading system are measured and stored, and the actual reading is performed according to the stored values. Because it determines whether the photoelectric conversion signal is black or white after reading the original,
It is possible to compensate for distortion in the conversion characteristics of the reading system and to actually read the density of the document itself.
また、一様白の拡散反射板を読み出るので、原
稿に特別な補償用のスペースを設ける必要もな
い。 Furthermore, since a uniformly white diffuse reflector is read out, there is no need to provide a special compensation space on the document.
なお、本発明は、実施例に限定することなく変
形が可能である。 Note that the present invention can be modified without being limited to the embodiments.
すなわち、本実施例では、記憶手段にRAMを
用いたが、ROM(Read Only Memory)を用
い、測定およびROMへの書き込みを光電変換装
置に付加する形で実施できるようにしてもよい。
すなわち、「あらかじめ」は、原稿の挿入毎であ
るとは限定しない。 That is, in this embodiment, a RAM is used as the storage means, but a ROM (Read Only Memory) may be used so that measurement and writing to the ROM can be performed by adding it to the photoelectric conversion device.
That is, "in advance" does not necessarily mean each time a document is inserted.
また、本実施例では記憶手段の記憶アドレス数
と光電変換の1走査線のビツト数とを一致させて
説明したが、読み取り系の変換歪が急激な変化を
示さない場合には、1/N′に縮少しても良い。
この場合、実施例の回路では、補正回路60に入
るクロツクCP1を光−電気変換回路の出力CP1
の1/N′にすれば良い。 In addition, in this embodiment, the number of storage addresses of the storage means and the number of bits of one scanning line of photoelectric conversion are made to match, but if the conversion distortion of the reading system does not show a sudden change, 1/N It may be reduced to '.
In this case, in the circuit of the embodiment, the clock CP1 input to the correction circuit 60 is changed to the output CP1 of the optical-to-electrical conversion circuit.
It is sufficient to set it to 1/N'.
さらに、本実施例では、SCOの間隔について、
等間隔であるとしたが、プリスキヤン、メインス
キヤンの2回動作により1回の読み取り走査をさ
せる場合にも適用できる。なおこの場合でも、常
に原稿のない場合の出力V0は一定の最大値を有
する事が条件である。 Furthermore, in this embodiment, regarding the SCO interval,
Although it is assumed that the intervals are equal, the present invention can also be applied to a case where one reading scan is performed by performing two operations of pre-scan and main scan. Even in this case, the condition is that the output V0 always has a certain maximum value when there is no document.
図面は本発明の実施例を示すもので、第1図は
全体のブロツク図、第2図は動作タイミングチヤ
ート、第3図は歪特性図、第4図は補正回路を除
く電気回路図、第5図は補正回路図、第6〜第8
図は動作タイミングチヤートである。
10……原稿、20……光源、30……光学
系、40……光−電気変換回路、50……増幅回
路、60……補正回路、70……制御回路。
The drawings show an embodiment of the present invention, and FIG. 1 is an overall block diagram, FIG. 2 is an operation timing chart, FIG. 3 is a distortion characteristic diagram, FIG. 4 is an electric circuit diagram excluding the correction circuit, and FIG. Figure 5 is a correction circuit diagram, 6th to 8th
The figure is an operation timing chart. DESCRIPTION OF SYMBOLS 10... Original document, 20... Light source, 30... Optical system, 40... Optical-electric conversion circuit, 50... Amplification circuit, 60... Correction circuit, 70... Control circuit.
Claims (1)
となる一様白の拡散反射板、原稿上の光学情報を
結像する光学手段、結像した光学像を電気信号に
変換するイメージセンサアレイおよびその駆動回
路を含む光−電気変換手段、所定の規則に従つて
原稿を移動させる機能を含む原稿駆動手段、これ
らの手段を所定の手続きに従つて動作させる制御
手段を含むフアクシミリ用光電変換装置におい
て、 原稿が読み取り位置に無い時に、前記イメージ
センサアレイによつて前記一様白の拡散反射板を
読み取り、あらかじめ光電変換動作をさせて読み
取り系全体の変換特性を測定してこの測定データ
を記憶する手段と、 実際に原稿を読み取る場合に前記記憶した測定
データに従つて光電変換信号の評価基準信号を作
成し、この基準信号に応じて実際に原稿から読み
取つた光電変換信号をスライスして白黒2値の画
像を表示する信号を得る手段と を設けたことを特徴とするフアクシミリ用光電変
換装置。[Scope of Claims] 1. Illumination means for illuminating the original, a uniformly white diffuse reflection plate that serves as a guide for feeding the original, optical means for forming an image of optical information on the original, and converting the formed optical image into an electrical signal. A facsimile machine that includes an optical-to-electric conversion means including an image sensor array and its driving circuit, an original driving means including a function of moving an original according to a predetermined rule, and a control means for operating these means according to a predetermined procedure. In the photoelectric conversion device for use in the photoelectric conversion device, when the document is not at the reading position, the uniform white diffuse reflection plate is read by the image sensor array, and the conversion characteristics of the entire reading system are measured by performing a photoelectric conversion operation in advance. A means for storing measurement data; and a means for creating an evaluation reference signal for a photoelectric conversion signal according to the stored measurement data when actually reading a document, and generating a photoelectric conversion signal actually read from the document according to the reference signal. 1. A photoelectric conversion device for facsimile, comprising means for obtaining a signal for slicing and displaying a black and white binary image.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1497279A JPS55108080A (en) | 1979-02-14 | 1979-02-14 | Photo electric conversion unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1497279A JPS55108080A (en) | 1979-02-14 | 1979-02-14 | Photo electric conversion unit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55108080A JPS55108080A (en) | 1980-08-19 |
| JPH0130341B2 true JPH0130341B2 (en) | 1989-06-19 |
Family
ID=11875883
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1497279A Granted JPS55108080A (en) | 1979-02-14 | 1979-02-14 | Photo electric conversion unit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55108080A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04127242U (en) * | 1991-05-01 | 1992-11-19 | 日康ケミカル株式会社 | Cold insulation material |
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| JPS59100666A (en) * | 1982-11-30 | 1984-06-09 | Matsushita Graphic Commun Syst Inc | Eprom writer |
| JPS59147566A (en) * | 1983-02-10 | 1984-08-23 | Agency Of Ind Science & Technol | Device for eliminating effect of external light of visual sensor |
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| JPH03219779A (en) * | 1990-08-17 | 1991-09-27 | Hitachi Ltd | facsimile machine |
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| JPS5732378B2 (en) * | 1974-03-23 | 1982-07-10 | ||
| JPS5317034A (en) * | 1976-07-30 | 1978-02-16 | Sharp Corp | Image sensor output correcting system |
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-
1979
- 1979-02-14 JP JP1497279A patent/JPS55108080A/en active Granted
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| JPH04127242U (en) * | 1991-05-01 | 1992-11-19 | 日康ケミカル株式会社 | Cold insulation material |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55108080A (en) | 1980-08-19 |
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