JPH01320681A - Magnetic disk device - Google Patents
Magnetic disk deviceInfo
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- JPH01320681A JPH01320681A JP15408388A JP15408388A JPH01320681A JP H01320681 A JPH01320681 A JP H01320681A JP 15408388 A JP15408388 A JP 15408388A JP 15408388 A JP15408388 A JP 15408388A JP H01320681 A JPH01320681 A JP H01320681A
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Abstract
Description
【発明の詳細な説明】
[産業上の利用分野コ
本発明は磁気ディスク装置に関し、特に、ディスクに書
込む符号化信号の異常検出の手段に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a magnetic disk drive, and more particularly to means for detecting abnormalities in encoded signals written on a disk.
[従来の技術]
磁気ディスク゛装置におけるデータの書込みフォーマッ
トは一般にギャップパターン(GAP)、同期バイトパ
ターン(SYNC) 、データパターン(DATA)に
より構成される。これらの各パターンの書込みタイミン
グを第4図に示す。即ち、GAP、5YNC,DATA
の各パターンは、パラレルデータをシリアル変換した後
、符号化することによって生成され、書込み信号(WR
T)に同期してGAP、、5YNC,DATAの順に順
次ディスクに書込まれる。5YNC,DATAの各パタ
ーンは、通常、上位装置から送られてくるが、GAPは
、上位装置とのインターフェースの違いにより、上位装
置から送られる場合と磁気ディスク装置の内部で生成さ
れる場合の2通りがある。[Prior Art] A data writing format in a magnetic disk device is generally composed of a gap pattern (GAP), a synchronous byte pattern (SYNC), and a data pattern (DATA). FIG. 4 shows the write timing of each of these patterns. That is, GAP, 5YNC, DATA
Each pattern is generated by serially converting parallel data and then encoding it, and the write signal (WR
GAP, 5YNC, and DATA are sequentially written to the disk in synchronization with T). Each pattern of 5YNC and DATA is normally sent from the host device, but due to the difference in the interface with the host device, GAP can be sent from the host device or generated inside the magnetic disk device. There is a street.
[発明が解決しようとする課題]
しかしながら、従来の磁気ディスク装置では、上述した
符号化信号の書込みに際し、GAP、5YNC,DAT
Aの各パターンを何ら区別していない、このため、例え
ば、符号化回路の故障や上位装置からGAP、5YNC
バイトが送られなかった場合等、何らかの異常が発生し
たとしても、書込み動作は続行され、この結果、誤った
信号の書込みを行なってしまうという問題点があった。[Problems to be Solved by the Invention] However, in the conventional magnetic disk device, when writing the above-mentioned encoded signal, GAP, 5YNC, DAT
There is no distinction between the patterns of
Even if some abnormality occurs, such as when a byte is not sent, the write operation continues, resulting in the problem of writing an erroneous signal.
本発明はかかる問題点に鑑みてなされたものであって、
符号化信号の書込みの際に異常な信号の書込みが行われ
た場合、これを検出して誤った信号の書込を防止できる
磁気ディスク装置を提供することを目的とする。The present invention has been made in view of such problems, and includes:
It is an object of the present invention to provide a magnetic disk device that can detect an abnormal signal when writing an encoded signal and prevent writing of an erroneous signal.
[課題を解決するための手段]
本発明に係る磁気ディスク装置は、ディスクへ書込む符
号化信号からギャップパターン(GAP)と同期パター
ン(SYNC)とを検出する検出回路と、この検出回路
で前記ギャップパターンと同期パターンとがこの順で検
出されたときに正常信号を出力する検出チェック回路と
、前記符号化信号のデータパターン出力期間中に出力さ
れるチェック信号に基いて前記検出チェック回路からの
正常信号の出力の有無を検査し、正常信号が出力されて
いないときにエラー信号を出力するエラー信号出力回路
とを備えている。[Means for Solving the Problems] A magnetic disk device according to the present invention includes a detection circuit that detects a gap pattern (GAP) and a synchronization pattern (SYNC) from an encoded signal written to a disk, and a detection circuit that detects a gap pattern (GAP) and a synchronization pattern (SYNC) from an encoded signal written to a disk. a detection check circuit that outputs a normal signal when a gap pattern and a synchronization pattern are detected in this order; and a detection check circuit that outputs a normal signal when a gap pattern and a synchronization pattern are detected in this order. The apparatus includes an error signal output circuit that checks whether a normal signal is output and outputs an error signal when a normal signal is not output.
[作用]
本発明によれば、ディスクに書込む符号化信号のチェッ
クが書込み動作と並行して行われる。即ち、検出回路は
符号化信号からGAPと5YNCの両パターンをこの順
で検出すれば、正常信号を出力し、そうでないときは正
常信号を出力しないので、いずれか一方のパターンが欠
落している場合には、エラー信号出力回路からエラー信
号が出力される。この結果、書込みに異常があったこと
を知らせることができる。[Operation] According to the present invention, checking of the encoded signal to be written to the disk is performed in parallel with the writing operation. That is, if the detection circuit detects both the GAP and 5YNC patterns from the encoded signal in this order, it will output a normal signal; otherwise, it will not output a normal signal, so one of the patterns is missing. In this case, an error signal is output from the error signal output circuit. As a result, it is possible to notify that there is an abnormality in writing.
[実施例]
以下、添付の図面を参照して、本発明の実施例について
具体的に説明する。[Examples] Examples of the present invention will be specifically described below with reference to the accompanying drawings.
第1図は本発明の実施例に係るデータ書込回路とその検
査回路の構成を示すブロック図である。FIG. 1 is a block diagram showing the configuration of a data write circuit and its test circuit according to an embodiment of the present invention.
図示しない上位装置から与えられる書込データaはパラ
レルシリアル変換回路1において並直変換されてシリア
ルの書込データbとなる。この書込データbは符号化回
路2にて符号化されて符号化信号Cとなり図示しない磁
気ディスク媒体に書込まれる。一方、この符号化信号C
は、シフトレジスタ3に入力され、ここでパラレル信号
dに変換される。パラレル信号dはパラレルデコーダ4
に入力されている。パラレルデコーダ4は、パラレル信
号dからGAPパターンと5YNCパターンとを検出し
、GAPの検出信号fと5YNCの検出信号gとを出力
する。GAPの検出信号fは記憶回路(MEM)5に格
納される。また、5YNCの検出信号gはANDゲート
6の一方の入力に与えられている。このANDゲート6
の他方の入力には前記記憶回路5の出力りが入力されて
いる。Write data a given from a host device (not shown) is parallel-to-serial converted in a parallel-to-serial conversion circuit 1 to become serial write data b. This write data b is encoded by the encoding circuit 2 to become an encoded signal C and written to a magnetic disk medium (not shown). On the other hand, this encoded signal C
is input to the shift register 3, where it is converted into a parallel signal d. Parallel signal d is sent to parallel decoder 4
has been entered. The parallel decoder 4 detects a GAP pattern and a 5YNC pattern from the parallel signal d, and outputs a GAP detection signal f and a 5YNC detection signal g. The GAP detection signal f is stored in a memory circuit (MEM) 5. Further, the 5YNC detection signal g is applied to one input of the AND gate 6. This AND gate 6
The output of the memory circuit 5 is input to the other input.
ANDゲート6の出力iは、記憶回路(MEM)7に格
納される。これら記憶回路5,7の出力り。The output i of the AND gate 6 is stored in a memory circuit (MEM) 7. The outputs of these memory circuits 5 and 7.
iはNANDゲート8に入力されている。従って、NA
NDゲート8の出力にはGAPと5YNCとがこの順に
検出されたときのみ“0″、その他の場合には°′1”
となる。D型フリップフロップ9はDATA書込み期間
に出力されるチェック信号1でNANDゲート8の出力
k(正常信号)をラッチし、エラー出力mを上位装置(
図示せず)に出力する。i is input to the NAND gate 8. Therefore, N.A.
The output of the ND gate 8 is "0" only when GAP and 5YNC are detected in this order, otherwise it is "°'1".
becomes. The D-type flip-flop 9 latches the output k (normal signal) of the NAND gate 8 with the check signal 1 output during the DATA write period, and sends the error output m to the host device (
(not shown).
この回路では、シフトレジスタ3及びパター4デコーダ
4が検出回路を構成し、記憶回路5,7、ANDゲート
6及びNANDゲート8が検出チェック回路を構成し、
D型フリップフロップ9がエラー信号出力回路を構成す
る。In this circuit, the shift register 3 and the pattern 4 decoder 4 constitute a detection circuit, and the memory circuits 5 and 7, the AND gate 6 and the NAND gate 8 constitute a detection check circuit,
D-type flip-flop 9 constitutes an error signal output circuit.
次に、このように構成された本実施例の回路の動作につ
いて説明する。Next, the operation of the circuit of this embodiment configured as described above will be explained.
第2図は正常時のタイムチャートを示す。WRT信号e
が′1”になり書込動作を始めると、パターンデコーダ
4は、先ず、GAPパターンを検出する。このため、検
出信号fは” 1 ”となり、これが記憶回路5に保持
される。続いてパターンデコーダ4は5YNCバイトを
検出するので検出信号gは” i ”となる。記憶回路
5の出力りも1″を維持しているので、ANDゲート6
の出力iは°゛1″′となり、これが記憶回路7に格納
される。データ部(DATA)の書込み期間にチェック
信号iが“1°′となった時、NANDゲート8の出力
には“0°′となっているため、D型フリップフロップ
9には0゛°がラッチされ、エラー出力mは“O″のま
まとなる。このため、書込動作は続けられる。FIG. 2 shows a time chart during normal operation. WRT signal e
When becomes '1' and starts the write operation, the pattern decoder 4 first detects the GAP pattern. Therefore, the detection signal f becomes '1' and this is held in the memory circuit 5. Subsequently, the pattern decoder 4 detects the GAP pattern. Since the decoder 4 detects 5YNC bytes, the detection signal g becomes "i". Since the output of the memory circuit 5 also maintains 1", the AND gate 6
The output i of the NAND gate 8 becomes "1", which is stored in the memory circuit 7. When the check signal i becomes "1" during the writing period of the data section (DATA), the output of the NAND gate 8 becomes "1". Since it is 0°', 0° is latched in the D-type flip-flop 9, and the error output m remains at "O".Therefore, the write operation continues.
次に、第3図のタイムチャートを参照して上位装置から
5YNCバイトが送られなかった場合について説明する
。WRT信号eが“1”となり書込み動作を始めると、
パターンデコーダ4はGAPパターンを検出し、上記と
同様に記憶回路5の出力りは“1′′となる。ところが
5YNCバイトは検出されないので、検出信号gは“0
”、記憶回路7の出力jも“′0″のままである。この
ため、出力には1”を維持する。従って、ディスク部(
DATA)の書込み期間においてチェック信号gが“1
”となった時、出力には“1”のままであるため、D型
フリップフロップ9は1”をラッチし、エラー出力mは
“1”となる、これにより磁気ディスク装置はエラーを
検出し、書込み動作を中止すると共に、上位装置に報告
する。Next, the case where 5YNC bytes are not sent from the host device will be explained with reference to the time chart in FIG. When the WRT signal e becomes “1” and the write operation starts,
The pattern decoder 4 detects the GAP pattern, and the output of the memory circuit 5 becomes "1'' in the same way as above. However, since the 5YNC byte is not detected, the detection signal g becomes "0".
”, the output j of the memory circuit 7 also remains at “0”. Therefore, the output remains at “1”. Therefore, the disk part (
DATA) check signal g is “1” during the write period.
”, the output remains “1”, so the D-type flip-flop 9 latches “1”, and the error output m becomes “1”, so the magnetic disk drive detects the error. , aborts the write operation and reports it to the higher-level device.
このように本装置によれば、GAP、5YNCバイトの
各パターンの欠落を検出することができるので、異常な
データのディスク媒体への書込みを防止することができ
る。As described above, according to the present device, it is possible to detect the omission of each pattern of GAP and 5YNC bytes, and therefore it is possible to prevent abnormal data from being written to the disk medium.
[発明の効果]
以上説明したように、本発明は符号化されたシリアル書
込信号のGAPパターン及び5YNCバイトパターンの
有無をチェックすることにより、書込みデータの異常を
検出できるので、誤った信号の書込みを防止することが
できるという効果を奏する。[Effects of the Invention] As explained above, the present invention can detect an abnormality in write data by checking the presence or absence of a GAP pattern and a 5YNC byte pattern in an encoded serial write signal. This has the effect of being able to prevent writing.
第1図は本発明の実施例に係るデータ書込回路及び検査
回路のブロック図、第2図は同検査回路の正常信号書込
み時の動作を示すタイミング図、第3図は同検査回路の
異常信号書込み時の動作を示すタイミング図、第4図は
書込みデータの構成示す図である。Fig. 1 is a block diagram of a data writing circuit and a test circuit according to an embodiment of the present invention, Fig. 2 is a timing diagram showing the operation of the test circuit when writing a normal signal, and Fig. 3 is an abnormality of the test circuit. FIG. 4 is a timing diagram showing the operation during signal writing, and is a diagram showing the structure of write data.
Claims (1)
ンと同期パターンとを検出する検出回路と、この検出回
路で前記ギャップパターンと同期パターンとがこの順で
検出されたときに正常信号を出力する検出チェック回路
と、前記符号化信号のデータパターン出力期間中に出力
されるチェック信号に基いて前記検出チェック回路から
正常信号の出力の有無を検査し正常信号が出力されてい
ないときにエラー信号を出力するエラー信号出力回路と
を具備したことを特徴とする磁気ディスク装置。(1) A detection circuit that detects a gap pattern and a synchronization pattern from an encoded signal written to a disk, and a detection circuit that outputs a normal signal when the gap pattern and synchronization pattern are detected in this order by this detection circuit. A check circuit and a check signal output during the data pattern output period of the encoded signal are used to check whether or not a normal signal is output from the detection check circuit, and when a normal signal is not output, an error signal is output. What is claimed is: 1. A magnetic disk drive comprising: an error signal output circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15408388A JPH01320681A (en) | 1988-06-22 | 1988-06-22 | Magnetic disk device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15408388A JPH01320681A (en) | 1988-06-22 | 1988-06-22 | Magnetic disk device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01320681A true JPH01320681A (en) | 1989-12-26 |
Family
ID=15576521
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15408388A Pending JPH01320681A (en) | 1988-06-22 | 1988-06-22 | Magnetic disk device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01320681A (en) |
-
1988
- 1988-06-22 JP JP15408388A patent/JPH01320681A/en active Pending
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