JPH0134556Y2 - - Google Patents
Info
- Publication number
- JPH0134556Y2 JPH0134556Y2 JP1980155086U JP15508680U JPH0134556Y2 JP H0134556 Y2 JPH0134556 Y2 JP H0134556Y2 JP 1980155086 U JP1980155086 U JP 1980155086U JP 15508680 U JP15508680 U JP 15508680U JP H0134556 Y2 JPH0134556 Y2 JP H0134556Y2
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- resistor
- trigger
- bidirectional
- transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Power Conversion In General (AREA)
- Thyristor Switches And Gates (AREA)
Description
【考案の詳細な説明】
本考案は、双方向３端子サイリスタトリガ回路
に係り、特に交流電力制御を行う場合、零電圧位
相近傍にて双方向３端子サイリスタ（トライアツ
ク）をトリガし、トライアツクが導通したことを
検出してトリガ信号を停止させる機能を有するト
ライアツクトリガ回路に関するものである。
に係り、特に交流電力制御を行う場合、零電圧位
相近傍にて双方向３端子サイリスタ（トライアツ
ク）をトリガし、トライアツクが導通したことを
検出してトリガ信号を停止させる機能を有するト
ライアツクトリガ回路に関するものである。
従来、この種のトリガ回路は、第１図に示すよ
うに、PNPトランジスタ４，５でトライアツク
２の端子T1と端子T2間の電圧を検出することに
より、正負両方向の零電圧位相の検出と、トライ
アツク２の導通の検出を行ない、NPNトランジ
スタ１０により信号を電流増幅し、トリガパルス
を発生させていた。
うに、PNPトランジスタ４，５でトライアツク
２の端子T1と端子T2間の電圧を検出することに
より、正負両方向の零電圧位相の検出と、トライ
アツク２の導通の検出を行ない、NPNトランジ
スタ１０により信号を電流増幅し、トリガパルス
を発生させていた。
同図において、PNPトランジスタ５は交流電
源１がライアツクク２の端子T1側が正の場合の
零電圧位相検出を行ないエミツタ接続地増幅動作
している。PNPトランジスタ４は、トライアツ
ク２の端子T2側が正の場合の検出を行ない、交
流電源１を信号源としてエミツタフオロワ動作し
ている。
源１がライアツクク２の端子T1側が正の場合の
零電圧位相検出を行ないエミツタ接続地増幅動作
している。PNPトランジスタ４は、トライアツ
ク２の端子T2側が正の場合の検出を行ない、交
流電源１を信号源としてエミツタフオロワ動作し
ている。
この種の回路では、ノイズの発生を小さくする
ため、トリガパルスは零電圧位相になるべく近い
時点で印加するよう定数設計しているが、第１図
の回路では、PNPトランジスタ４がエミツタフ
オロワ動作するため、信号の電流増幅が行なえ
ず、抵抗７を小さくして交流電源１が零電圧位相
に近い時点でのエミツタ電流を大きくすることに
より、トリガパルスの供給を零電圧位相に近づけ
るようにしている。このため、抵抗７には許容損
失の大きいものを使わなければならなかつた。ま
た、トライアツク２の導通後は、トリガ信号を停
止させるため、PNPトランジスタ４，５のオン
電圧を抵抗６と７で分圧し、トライアツク２導通
後はPNPトランジスタ４，５のベース・エミツ
タ間に加える電圧を低くしている。この定数設計
としては、トライアツク２のオン電圧のバラつ
き、PNPトランジスタ４，５のベース・エミツ
タ間電圧のバラつきを考慮し、抵抗６に対する抵
抗７の比率を大きくするため、PNPトランジス
タ４，５の導通は交流電源が零電圧位相からある
程度経過した時点とならざるを得なかつた。さら
に、本回路ではトリガパルスの極性を負とする目
的と検出信号電流を電流増幅するため、NPNト
ランジスタ１０が必要であつた。この結果、トラ
イアツク２のトリガモードとしては、やや感度の
鈍いT2 +G-及びT2 -G-モードとなり、大きなトリ
ガ電流が必要であつた。
ため、トリガパルスは零電圧位相になるべく近い
時点で印加するよう定数設計しているが、第１図
の回路では、PNPトランジスタ４がエミツタフ
オロワ動作するため、信号の電流増幅が行なえ
ず、抵抗７を小さくして交流電源１が零電圧位相
に近い時点でのエミツタ電流を大きくすることに
より、トリガパルスの供給を零電圧位相に近づけ
るようにしている。このため、抵抗７には許容損
失の大きいものを使わなければならなかつた。ま
た、トライアツク２の導通後は、トリガ信号を停
止させるため、PNPトランジスタ４，５のオン
電圧を抵抗６と７で分圧し、トライアツク２導通
後はPNPトランジスタ４，５のベース・エミツ
タ間に加える電圧を低くしている。この定数設計
としては、トライアツク２のオン電圧のバラつ
き、PNPトランジスタ４，５のベース・エミツ
タ間電圧のバラつきを考慮し、抵抗６に対する抵
抗７の比率を大きくするため、PNPトランジス
タ４，５の導通は交流電源が零電圧位相からある
程度経過した時点とならざるを得なかつた。さら
に、本回路ではトリガパルスの極性を負とする目
的と検出信号電流を電流増幅するため、NPNト
ランジスタ１０が必要であつた。この結果、トラ
イアツク２のトリガモードとしては、やや感度の
鈍いT2 +G-及びT2 -G-モードとなり、大きなトリ
ガ電流が必要であつた。
本考案は、零電圧位相検出用のトランジスタを
エミツタ接地で動作させることにより、このトラ
ンジスタが検出及び電流増幅の機能を有し、トラ
イアツクのトリガモードを感度のよいT2 +G+及び
T2 -G-モードとし、かつ零電圧位相及びトライア
ツクの導通信号を端子T2とゲート端子との間か
ら得ることにより、反転増幅用のトランジスタの
省略、高許容損失抵抗の非使用、零電圧位相近傍
でのトリガパルス印加を実現するものである。
エミツタ接地で動作させることにより、このトラ
ンジスタが検出及び電流増幅の機能を有し、トラ
イアツクのトリガモードを感度のよいT2 +G+及び
T2 -G-モードとし、かつ零電圧位相及びトライア
ツクの導通信号を端子T2とゲート端子との間か
ら得ることにより、反転増幅用のトランジスタの
省略、高許容損失抵抗の非使用、零電圧位相近傍
でのトリガパルス印加を実現するものである。
第２図は、本考案の一実施例であり、１は交流
電源、２はトライアツク、３は負荷抵抗、７，１
３，１６，１７は抵抗、１１，１８はコンデン
サ、１２，１９はダイオード、１４はNPNトラ
ンジスタ、１５はPNPトランジスタである。
電源、２はトライアツク、３は負荷抵抗、７，１
３，１６，１７は抵抗、１１，１８はコンデン
サ、１２，１９はダイオード、１４はNPNトラ
ンジスタ、１５はPNPトランジスタである。
同図において、電源１が投入されると、コンデ
ンサ１１はダイオード１２、抵抗１３を通してト
ライアツク２のT1端子側を正として充電され、
コンデンサ１８は抵抗１３ダイオード１９を通し
てコンデンサ１１と逆極性に充電される。交流電
源１がトライアツク２のT1端子側を正とするサ
イクルの場合、PNPトランジスタ１５のベース
電流は交流電源１からトライアツク２のT1端子、
PNPトランジスタ１５のエミツタ，ベース、抵
抗７負荷抵抗３を通して流れるため、PNPトラ
ンジスタ１５はエミツタ接地電流増幅動作をし
て、トライアツク２のトリガ電流としては、コン
デンサ１１から抵抗１７を介したPNPトランジ
スタ１５のエミツタ電流が与えられる。このトリ
ガモードはT2 -，G-であり、導通の容易なモード
である。トリガ電流の印加によりトライアツク２
が導通すると、端子T2とゲート端子の間の電圧
は、端子T1と端子T2の間のオン電圧より充分低
くなるため、PNPトランジスタ１５のベースバ
イアスが与えられなくなり、トリガ電流の供給が
停止する。
ンサ１１はダイオード１２、抵抗１３を通してト
ライアツク２のT1端子側を正として充電され、
コンデンサ１８は抵抗１３ダイオード１９を通し
てコンデンサ１１と逆極性に充電される。交流電
源１がトライアツク２のT1端子側を正とするサ
イクルの場合、PNPトランジスタ１５のベース
電流は交流電源１からトライアツク２のT1端子、
PNPトランジスタ１５のエミツタ，ベース、抵
抗７負荷抵抗３を通して流れるため、PNPトラ
ンジスタ１５はエミツタ接地電流増幅動作をし
て、トライアツク２のトリガ電流としては、コン
デンサ１１から抵抗１７を介したPNPトランジ
スタ１５のエミツタ電流が与えられる。このトリ
ガモードはT2 -，G-であり、導通の容易なモード
である。トリガ電流の印加によりトライアツク２
が導通すると、端子T2とゲート端子の間の電圧
は、端子T1と端子T2の間のオン電圧より充分低
くなるため、PNPトランジスタ１５のベースバ
イアスが与えられなくなり、トリガ電流の供給が
停止する。
このトリガ電流停止動作により、コンデンサ１
１の無駄な放電を抑えることができ、省電力設計
となつている。
１の無駄な放電を抑えることができ、省電力設計
となつている。
交流電源１がトライアツク２の端子T2を正と
するサイクルの場合は、極性が逆で前述と同様の
動作状態となり、NPNトランジスタ１４により
コンデンサ１８からトリガ電流が供給される。こ
の場合のトリガモードは、T2 +G+であり、トリガ
の容易なモードである。
するサイクルの場合は、極性が逆で前述と同様の
動作状態となり、NPNトランジスタ１４により
コンデンサ１８からトリガ電流が供給される。こ
の場合のトリガモードは、T2 +G+であり、トリガ
の容易なモードである。
第３図は、本考案の実施例に、電気信号により
トリガパルスの供給、停止を制御するためのトラ
ンジスタ２２を接続したものである。
トリガパルスの供給、停止を制御するためのトラ
ンジスタ２２を接続したものである。
同図において、制御端子２１に負の信号を与え
た時には、トランジスタ２２が双方向性のトラン
ジスタとして導通動作し、PNPトランジスタ１
５及びNPNトランジスタ１５及びNPNトランジ
スタ１４にベース電流が流れず、トリガパルスは
発生しない。制御端子２１に負の信号が与えられ
ていない時は第２図に示す回路と同一のトリガ動
作となる。
た時には、トランジスタ２２が双方向性のトラン
ジスタとして導通動作し、PNPトランジスタ１
５及びNPNトランジスタ１５及びNPNトランジ
スタ１４にベース電流が流れず、トリガパルスは
発生しない。制御端子２１に負の信号が与えられ
ていない時は第２図に示す回路と同一のトリガ動
作となる。
以上のように、本考案の回路図では零電圧位相
検出用トランジスタをエミツタ接地で動作させる
ことにより、このトランジスタが検出及び電流増
幅の機能を有し、トライアツクが導通の容易な
T2 +G+及びT2 -G-のトリガモードとし、かつ零電
圧位相及びトライアツクの導通の検出を端子T2
とゲート端子との間から得ることにより、増幅用
トランジスタを付加することなく、また高許容損
失抵抗を使用することなく、零電圧位相近傍でト
リガパルスを供給できるという利点がある。
検出用トランジスタをエミツタ接地で動作させる
ことにより、このトランジスタが検出及び電流増
幅の機能を有し、トライアツクが導通の容易な
T2 +G+及びT2 -G-のトリガモードとし、かつ零電
圧位相及びトライアツクの導通の検出を端子T2
とゲート端子との間から得ることにより、増幅用
トランジスタを付加することなく、また高許容損
失抵抗を使用することなく、零電圧位相近傍でト
リガパルスを供給できるという利点がある。
第１図は従来のトライアツクトリガ回路を示す
回路図、第２図は本考案の一実施例を示す回路
図、第３図は第２図の回路を電気信号で制御する
回路である。尚図において、 １……交流電源、２……トライアツク、３……
負荷抵抗、４，５，１５，２２……PNPトラン
ジスタ、６，７，８，９，１３，１６，１７，２
０……抵抗、１０，１４……NPNトランジスタ、
１１，１８……コンデンサ、１２，１９……ダイ
オード、２１……制御端子。
回路図、第２図は本考案の一実施例を示す回路
図、第３図は第２図の回路を電気信号で制御する
回路である。尚図において、 １……交流電源、２……トライアツク、３……
負荷抵抗、４，５，１５，２２……PNPトラン
ジスタ、６，７，８，９，１３，１６，１７，２
０……抵抗、１０，１４……NPNトランジスタ、
１１，１８……コンデンサ、１２，１９……ダイ
オード、２１……制御端子。
Claims (1)
- 交流電源の一端にそれぞれの一端が接続された
第１および第２のコンデンサと、前記交流電源の
他端に一端が接続された第１の抵抗と、前記第１
のコンデンサの他端にアノードが接続され前記第
１の抵抗の他端にカソードが接続された第１のダ
イオードと、前記第２のコンデンサの他端にカソ
ードが接続され前記第１の抵抗の前記他端にアノ
ードが接続された第２のダイオードと、前記交流
電源の前記一端に第１の端子が接続され前記交流
電源の前記他端に負荷を介して第２の端子が接続
された双方向３端子サイリスタと、前記双方向３
端子サイリスタのゲートにエミツタが接続され、
前記双方向３端子サイリスタの前記第２の端子に
第２の抵抗を介してベースが接続され、前記第１
のコンデンサの前記他端に第３の抵抗を介してコ
レクタが接続されたPNPトランジスタと、前記
双方向３端子サイリスタのゲートにエミツタが接
続され、前記PNPトランジスタのベースにベー
スが接続され、前記第２のコンデンサの前記他端
に第４の抵抗を介してコレクタが接続された
NPNトランジスタとを備える双方向３端子サイ
リスタトリガ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980155086U JPH0134556Y2 (ja) | 1980-10-30 | 1980-10-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980155086U JPH0134556Y2 (ja) | 1980-10-30 | 1980-10-30 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5778281U JPS5778281U (ja) | 1982-05-14 |
| JPH0134556Y2 true JPH0134556Y2 (ja) | 1989-10-20 |
Family
ID=29514295
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1980155086U Expired JPH0134556Y2 (ja) | 1980-10-30 | 1980-10-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0134556Y2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51161054U (ja) * | 1975-06-14 | 1976-12-22 |
-
1980
- 1980-10-30 JP JP1980155086U patent/JPH0134556Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5778281U (ja) | 1982-05-14 |
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