JPH0136633B2 - - Google Patents
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- Publication number
- JPH0136633B2 JPH0136633B2 JP56173395A JP17339581A JPH0136633B2 JP H0136633 B2 JPH0136633 B2 JP H0136633B2 JP 56173395 A JP56173395 A JP 56173395A JP 17339581 A JP17339581 A JP 17339581A JP H0136633 B2 JPH0136633 B2 JP H0136633B2
- Authority
- JP
- Japan
- Prior art keywords
- dot
- data
- section
- small
- dots
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/22—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of characters or indicia using display control signals derived from coded signals representing the characters or indicia, e.g. with a character-code memory
- G09G5/24—Generation of individual character patterns
- G09G5/28—Generation of individual character patterns for enhancement of character form, e.g. smoothing
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Controls And Circuits For Display Device (AREA)
- Image Generation (AREA)
- Transforming Electric Information Into Light Information (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【発明の詳細な説明】
電話回線を利用して、あるいはテレビジヨン放
送の垂直ブランキング期間を利用してニユース、
天気予報、お知らせなどの情報を伝送するシステ
ムとして、キヤプテンシステムやテレビジヨン文
字多重放送システムなどがある。
送の垂直ブランキング期間を利用してニユース、
天気予報、お知らせなどの情報を伝送するシステ
ムとして、キヤプテンシステムやテレビジヨン文
字多重放送システムなどがある。
これは、送信側では文字、数字、あるいは記号
などのキヤラクタをコード信号に変換して送信
し、受信側ではそのコード信号からもとのキヤラ
クタを復号してテレビ受像機の画面に表示するも
のである。
などのキヤラクタをコード信号に変換して送信
し、受信側ではそのコード信号からもとのキヤラ
クタを復号してテレビ受像機の画面に表示するも
のである。
例えば、文字「Ａ」の場合には、送信側から文
字「Ａ」を示すコード信号“41”（16進値）が８
ビツトのバイナリコードに変換されて送信され
る。そして、受信側では、このコード信号“41”
がキヤラクタメモリ（キヤラクタジエネレータ）
に供給されて文字「Ａ」のパターンとなる揮度信
号が形成され、従つて、受像機の画面に文字
「Ａ」が表示される。
字「Ａ」を示すコード信号“41”（16進値）が８
ビツトのバイナリコードに変換されて送信され
る。そして、受信側では、このコード信号“41”
がキヤラクタメモリ（キヤラクタジエネレータ）
に供給されて文字「Ａ」のパターンとなる揮度信
号が形成され、従つて、受像機の画面に文字
「Ａ」が表示される。
そして、この場合、実際には表示されるキヤラ
クタを見やすくするため、スムージングが行われ
ている。
クタを見やすくするため、スムージングが行われ
ている。
すなわち、第１図はキヤラクタメモリに書き込
まれている文字「Ａ」の原パターンの一例を模型
的に示すもので、この原パターンは例えば５×７
ドツトのドツトマトリツクスにより構成されてい
る。
まれている文字「Ａ」の原パターンの一例を模型
的に示すもので、この原パターンは例えば５×７
ドツトのドツトマトリツクスにより構成されてい
る。
また、第２図は受像機の画面に表示された文字
「Ａ」を示す。ただし、スムージングは行われて
いない。そして、L1〜L14は走査線を示し、破線
図示の走査線L2n+1は寄数フイールド期間に形成
され、実線図示の走査線L2nは偶数フイールド期
間に形成される。また、Duは基本となる大きさ
のドツト（揮点）を示し、キヤラクタメモリの出
力（第１図）が寄数フイールド期間及び偶数フイ
ールド期間の両方に使用されるので、図のような
表示パターンとなる。
「Ａ」を示す。ただし、スムージングは行われて
いない。そして、L1〜L14は走査線を示し、破線
図示の走査線L2n+1は寄数フイールド期間に形成
され、実線図示の走査線L2nは偶数フイールド期
間に形成される。また、Duは基本となる大きさ
のドツト（揮点）を示し、キヤラクタメモリの出
力（第１図）が寄数フイールド期間及び偶数フイ
ールド期間の両方に使用されるので、図のような
表示パターンとなる。
これに対して、スムージングが行われたときに
は、文字「Ａ」は第３図のように表示され、本来
のドツトDuの1/2の幅のハーフドツトDhが付加
される。従つて、第２図のスムージング前の文字
「Ａ」に比べて滑らかになり、見やすくなる。
は、文字「Ａ」は第３図のように表示され、本来
のドツトDuの1/2の幅のハーフドツトDhが付加
される。従つて、第２図のスムージング前の文字
「Ａ」に比べて滑らかになり、見やすくなる。
そして、このスムージングを行うとき、単位ド
ツトDuに対するハーフドツトDhの組み合わせ
は、基本的に第４図に示す２通りだけであり、全
てのキヤラクタについて第４図に示す組み合わせ
でハーフドツトDhが付加される。
ツトDuに対するハーフドツトDhの組み合わせ
は、基本的に第４図に示す２通りだけであり、全
てのキヤラクタについて第４図に示す組み合わせ
でハーフドツトDhが付加される。
ところが、このようにハーフドツトDhを付加
してスムージングを行う場合には、原パターンが
例えば第５図に示すようなキヤラクタのとき、そ
の表示パターンは第６図に示すようになり、文字
「Ｖ」のように斜線部分が急なときには、滑らか
さが必ずしも十分でなかつたり、記号「／」のよ
うに斜線部分では、視覚上、必要以上に太くなつ
たり、あるいは記号「。」のように単位ドツトDu
に対応する非ドツト部分がハーフドツトDhによ
り埋められてしまつたりする。
してスムージングを行う場合には、原パターンが
例えば第５図に示すようなキヤラクタのとき、そ
の表示パターンは第６図に示すようになり、文字
「Ｖ」のように斜線部分が急なときには、滑らか
さが必ずしも十分でなかつたり、記号「／」のよ
うに斜線部分では、視覚上、必要以上に太くなつ
たり、あるいは記号「。」のように単位ドツトDu
に対応する非ドツト部分がハーフドツトDhによ
り埋められてしまつたりする。
この発明は、このような問題点を解決しようと
するものである。
するものである。
このため、この発明においては、例えば第７図
に示すように単位ドツトDuの1/3の幅の小ドツト
の付加することによりスムージングを行うと共
に、さらに、単位ドツトDuの適当な部分を削つ
てスムージングを行う、すなわち、単位ドツト
Duに対して1/3の幅の小ドツトDsを付加あるい
は削除してスムージングを行うものである。
に示すように単位ドツトDuの1/3の幅の小ドツト
の付加することによりスムージングを行うと共
に、さらに、単位ドツトDuの適当な部分を削つ
てスムージングを行う、すなわち、単位ドツト
Duに対して1/3の幅の小ドツトDsを付加あるい
は削除してスムージングを行うものである。
以下その一例について説明しよう。
第８図は、この発明において、単位ドツトDu
に対して小ドツトDsを付加あるいは削除すると
きの基本的な組み合わせを示し、第９図は小ドツ
トDsを付加あるいは削除してはならないときの
単位ドツトDuの基本的な組み合わせを示す。
に対して小ドツトDsを付加あるいは削除すると
きの基本的な組み合わせを示し、第９図は小ドツ
トDsを付加あるいは削除してはならないときの
単位ドツトDuの基本的な組み合わせを示す。
従つて、ある点に小ドツトDsを付加あるいは
削除するか否かを判断するためには、寄数フイー
ルド期間のときには、現在表示している行のデー
タ（原パターンの行のデータ）と、１つ上の行の
データとを使用し、偶数フイールド期間のときに
は、現在表示している行のデータと、１つ下の行
のデータとを使用する（ここで言う「行」とは原
パターン（第１図）における行であり、表示され
たパターンにおける行ではない）。
削除するか否かを判断するためには、寄数フイー
ルド期間のときには、現在表示している行のデー
タ（原パターンの行のデータ）と、１つ上の行の
データとを使用し、偶数フイールド期間のときに
は、現在表示している行のデータと、１つ下の行
のデータとを使用する（ここで言う「行」とは原
パターン（第１図）における行であり、表示され
たパターンにおける行ではない）。
そして、第７図及び第８図からも明きらかなよ
うに、小ドツトDsにも単位ドツト区間の前1/3の
区間に位置する小ドツトDfと、後1/3の区間に位
置する小ドツトDbとがある。
うに、小ドツトDsにも単位ドツト区間の前1/3の
区間に位置する小ドツトDfと、後1/3の区間に位
置する小ドツトDbとがある。
そこで、ドツトDfを「前小ドツト」、ドツトDb
を「後小ドツト」と呼ぶことにして、これら前小
ドツトDf及び後小ドツトDbの付加あるいは削除
する条件を求めると、次のようになる。すなわ
ち、例えば第１０図及び第１１図に示すように、 To：前小ドツトDfまたは後小ドツトDbが付加ま
たは削除される時刻を、単位ドツトごとに換算
した時刻 Ｄ：表示データ（現在表示している行のデータ） Ｒ：参照データ（１つ上または下の行のデータ） とすると、 (1) 前小ドツトDfを付加する条件（第１０図Ａ） （o-1）・Ｒ（to）・Ｄ（to-1）＝１ (2) 後小ドツトDbを付加する条件（第１１図Ａ） Ｒ（to）・（o+1） ・Ｄ（to+1）＝１ (3) 前小ドツトDfを削除する条件（第１０図Ｂ） （o-1）・ （o）・Ｒ（to+1）・（o-1）・（o+1）
＝１ (4) 後小ドツトDbを削除する条件（第１１図Ｂ） Ｒ（to-1）・（o）・（o+1） ・（o-1）・（o+1）＝１ となる。
を「後小ドツト」と呼ぶことにして、これら前小
ドツトDf及び後小ドツトDbの付加あるいは削除
する条件を求めると、次のようになる。すなわ
ち、例えば第１０図及び第１１図に示すように、 To：前小ドツトDfまたは後小ドツトDbが付加ま
たは削除される時刻を、単位ドツトごとに換算
した時刻 Ｄ：表示データ（現在表示している行のデータ） Ｒ：参照データ（１つ上または下の行のデータ） とすると、 (1) 前小ドツトDfを付加する条件（第１０図Ａ） （o-1）・Ｒ（to）・Ｄ（to-1）＝１ (2) 後小ドツトDbを付加する条件（第１１図Ａ） Ｒ（to）・（o+1） ・Ｄ（to+1）＝１ (3) 前小ドツトDfを削除する条件（第１０図Ｂ） （o-1）・ （o）・Ｒ（to+1）・（o-1）・（o+1）
＝１ (4) 後小ドツトDbを削除する条件（第１１図Ｂ） Ｒ（to-1）・（o）・（o+1） ・（o-1）・（o+1）＝１ となる。
すなわち、この発明においては、条件(1)〜(4)の
どれかが成立したときには、その条件の成立した
前小ドツトDfまたは後小ドツトDbについてその
条件に対応して付加あるいは削除を行う。
どれかが成立したときには、その条件の成立した
前小ドツトDfまたは後小ドツトDbについてその
条件に対応して付加あるいは削除を行う。
なお、第９図に示す単位ドツトDuの組み合わ
せのときには、上述した条件(1)〜(4)は成立せず、
従つて、この組み合わせでは小ドツトDsの付加
あるいは削除は全く行われない。
せのときには、上述した条件(1)〜(4)は成立せず、
従つて、この組み合わせでは小ドツトDsの付加
あるいは削除は全く行われない。
第１２図は条件(1)〜(4)にしたがつてスムージン
グを行う回路の一例を示す。すなわち、(11)は５×
７ドツトのドツトマトリツクスによる原パターン
のデータが書き込まれているキヤラクタメモリ
で、代１２図においては、コード信号により文字
「Ａ」が指定されている場合のデータを模型的に
示し、〇印をつけたドツトが“１”レベル、つけ
ないドツトが“０”レベルである。なお、表示時
の行方向（水平方向）の字間スペースは１単位ド
ツト分であり、従つて１キヤラクタは５×７ドツ
トの大きさであるが、１キヤラクタあたりの表示
領域は６×７ドツトの大きさとする（列方向の字
間スペースは考えない）。
グを行う回路の一例を示す。すなわち、(11)は５×
７ドツトのドツトマトリツクスによる原パターン
のデータが書き込まれているキヤラクタメモリ
で、代１２図においては、コード信号により文字
「Ａ」が指定されている場合のデータを模型的に
示し、〇印をつけたドツトが“１”レベル、つけ
ないドツトが“０”レベルである。なお、表示時
の行方向（水平方向）の字間スペースは１単位ド
ツト分であり、従つて１キヤラクタは５×７ドツ
トの大きさであるが、１キヤラクタあたりの表示
領域は６×７ドツトの大きさとする（列方向の字
間スペースは考えない）。
そして、水平同期パルスがカウンタに供給され
て１水平期間ごとに変化してメモリ１１のアドレ
スを指定するアドレス信号LADRSが形成される
と共に、補助アドレス信号SADRSが形成され
る。
て１水平期間ごとに変化してメモリ１１のアドレ
スを指定するアドレス信号LADRSが形成される
と共に、補助アドレス信号SADRSが形成され
る。
この場合、補助アドレス信号SADRSは、第１
３図Ｃに示すような信号である。すなわち、第１
３図ＡはフレームクロツクFCKを示し、同図Ｂ
はドツトクロツクDCKを示し、フレームクロツ
クFCKの１サイクル期間TFが原パターンの１行
を表示する期間に対応し、ドツトクロツクDCK
の１サイクル期間TD原パターンの１ドツトを表
示する期間に対応する。そして、補助アドレス信
号SADRS（第１３図Ｃ）は、奇数フイールド期
間における期間TFの前半の期間Trには「−１」
となると共に、後半の期間Tdには「０」となり、
一方、偶数フイールド期間における期間TFの前
半の期間Trには「＋１」となると共に、後半の
期間Tdには「０」となる。
３図Ｃに示すような信号である。すなわち、第１
３図ＡはフレームクロツクFCKを示し、同図Ｂ
はドツトクロツクDCKを示し、フレームクロツ
クFCKの１サイクル期間TFが原パターンの１行
を表示する期間に対応し、ドツトクロツクDCK
の１サイクル期間TD原パターンの１ドツトを表
示する期間に対応する。そして、補助アドレス信
号SADRS（第１３図Ｃ）は、奇数フイールド期
間における期間TFの前半の期間Trには「−１」
となると共に、後半の期間Tdには「０」となり、
一方、偶数フイールド期間における期間TFの前
半の期間Trには「＋１」となると共に、後半の
期間Tdには「０」となる。
そして、これらアドレス信号LADRS、
SADRSがバスライン１２，１３を通じて加算回
路１４に供給され、その加算出力がメモリ１１に
行アドレスを指定する行アドレス信号として供給
される。
SADRSがバスライン１２，１３を通じて加算回
路１４に供給され、その加算出力がメモリ１１に
行アドレスを指定する行アドレス信号として供給
される。
従つて、メモリ１１に対して、期間TFの後半
の期間Tdには、現在表示している行のアドレス
が指定され、その前半の期間Trには、１つ上ま
たは下の行のアドレスが指定されるので、第１３
図Ｄに示すように、期間TFの前半の期間Trには
参照データＲ（５ビツトの並列データ）がその５
ビツトづつ同時に読み出され、その後半の期間
Tdには表示データＤ（５ビツトの並列データ）が
その５ビツトづつ同時に読み出される。なお、こ
の読み出されたデータＲ，Ｄは、上述のようにそ
れぞれ５ビツトの並列データであるが、字間スペ
ースとなる“０”レベルのビツトが付加され、デ
ータＲ，Ｄはそれぞれ６ビツトの並列データとさ
れる。
の期間Tdには、現在表示している行のアドレス
が指定され、その前半の期間Trには、１つ上ま
たは下の行のアドレスが指定されるので、第１３
図Ｄに示すように、期間TFの前半の期間Trには
参照データＲ（５ビツトの並列データ）がその５
ビツトづつ同時に読み出され、その後半の期間
Tdには表示データＤ（５ビツトの並列データ）が
その５ビツトづつ同時に読み出される。なお、こ
の読み出されたデータＲ，Ｄは、上述のようにそ
れぞれ５ビツトの並列データであるが、字間スペ
ースとなる“０”レベルのビツトが付加され、デ
ータＲ，Ｄはそれぞれ６ビツトの並列データとさ
れる。
そして、この６ビツトの並列データが、10ビツ
トの参照データ用シフトレジスタ２１に並列に供
給されると共に、第１３図Ｅに示すように期間
Trの終了時点にロードパルスRLDがレジスタ２
１に供給されて期間Trに得られている参照デー
タがシフトレジスタ２１に並列にロードされる。
またメモリ１１からの６ビツトの並列データが、
７ビツトの表示データ用シフトレジスタ２２に並
列に供給されると共に、第１３図Ｆに示すように
期間Tdの終了時点にロードパルスDLDがレジス
タ２２に供給されて期間Tdに得られている表示
データＤがシフトレジスタ２２に並列にロードさ
れる。
トの参照データ用シフトレジスタ２１に並列に供
給されると共に、第１３図Ｅに示すように期間
Trの終了時点にロードパルスRLDがレジスタ２
１に供給されて期間Trに得られている参照デー
タがシフトレジスタ２１に並列にロードされる。
またメモリ１１からの６ビツトの並列データが、
７ビツトの表示データ用シフトレジスタ２２に並
列に供給されると共に、第１３図Ｆに示すように
期間Tdの終了時点にロードパルスDLDがレジス
タ２２に供給されて期間Tdに得られている表示
データＤがシフトレジスタ２２に並列にロードさ
れる。
そして、シフトレジスタ２１，２２にはドツト
クロツクDCKがシフトクロツクとして供給され
てデータＲ，Ｄはシフトレジスタ２１，２２内を
矢印で示すように直列にシフトされ、従つてシフ
トレジスタ２１からは参照データＲ（to-1）、Ｒ
（to）、Ｒ（to+1）が同時に（並列に）取り出される
と共に、シフトレジスタ２２からは表示データＤ
（to-1）、Ｄ（to）、Ｄ（to+1）が同時に、かつ、参照
データＲ（to-1）〜Ｒ（to+1）とも同時に取り出さ
れる。
クロツクDCKがシフトクロツクとして供給され
てデータＲ，Ｄはシフトレジスタ２１，２２内を
矢印で示すように直列にシフトされ、従つてシフ
トレジスタ２１からは参照データＲ（to-1）、Ｒ
（to）、Ｒ（to+1）が同時に（並列に）取り出される
と共に、シフトレジスタ２２からは表示データＤ
（to-1）、Ｄ（to）、Ｄ（to+1）が同時に、かつ、参照
データＲ（to-1）〜Ｒ（to+1）とも同時に取り出さ
れる。
そして、これら取り出された参照データＲ及び
表示データＤが、論理回路３０に供給される。こ
の論理回路３０は、上記(1)〜(4)にしたがつて前小
ドツトDf及び後小ドツトDbの付加あるいは削除
を行うもので、この例においては、第１５図に示
す真理値表の論理演算を行うデコーダ３１，３２
と、第１６図に示す真理値表の論理演算を行うデ
コーダ３３，３４と、インバータ４１〜４４と、
ナンド回路４５，４７，４８と、オア回路４６と
により構成される。そして、レジスタ２１，２２
からのデータＲ，Ｄが供給されると共に、パルス
形成回路５０において第１４図に示すように、ド
ツトクロツクDCKの１サイクル期間Tdの前1/3
の期間に位置して前小ドツトDfとなるドツトパ
ルスPfと、後1/3の期間に位置して後ドツトDbと
なるドツトパルスPbとが形成され、これらパル
スPf、Pbが論理回路３０に供給される。
表示データＤが、論理回路３０に供給される。こ
の論理回路３０は、上記(1)〜(4)にしたがつて前小
ドツトDf及び後小ドツトDbの付加あるいは削除
を行うもので、この例においては、第１５図に示
す真理値表の論理演算を行うデコーダ３１，３２
と、第１６図に示す真理値表の論理演算を行うデ
コーダ３３，３４と、インバータ４１〜４４と、
ナンド回路４５，４７，４８と、オア回路４６と
により構成される。そして、レジスタ２１，２２
からのデータＲ，Ｄが供給されると共に、パルス
形成回路５０において第１４図に示すように、ド
ツトクロツクDCKの１サイクル期間Tdの前1/3
の期間に位置して前小ドツトDfとなるドツトパ
ルスPfと、後1/3の期間に位置して後ドツトDbと
なるドツトパルスPbとが形成され、これらパル
スPf、Pbが論理回路３０に供給される。
従つて、ナンド回路４６からは、上記条件(1)〜
(4)にしたがつて前小ドツトDfまたは後小ドツト
Dbが付加あるいは削除された表示パターンの揮
度信号Ｙが取り出される。そして、この信号Ｙが
アンプ６０を通じて受像管７０に供給される。
(4)にしたがつて前小ドツトDfまたは後小ドツト
Dbが付加あるいは削除された表示パターンの揮
度信号Ｙが取り出される。そして、この信号Ｙが
アンプ６０を通じて受像管７０に供給される。
こうして、この発明によれば、単位ドツトDu
の1/3の幅の小ドツトDf、Dbを条件(1)〜(4)にした
がつて付加あるいは削除しているので、キヤラク
タは例えば第７図に示すように表示され、従つ
て、斜線部分が急であつても滑らかな表示とな
り、また、斜線部分が視感上、太くなることもな
く、さらに、単位ドツトDuに対応する非ドツト
部分が埋められることもない。従つて、表示され
たキヤラクタのパターンは、きわめて見やすくな
る。
の1/3の幅の小ドツトDf、Dbを条件(1)〜(4)にした
がつて付加あるいは削除しているので、キヤラク
タは例えば第７図に示すように表示され、従つ
て、斜線部分が急であつても滑らかな表示とな
り、また、斜線部分が視感上、太くなることもな
く、さらに、単位ドツトDuに対応する非ドツト
部分が埋められることもない。従つて、表示され
たキヤラクタのパターンは、きわめて見やすくな
る。
上述の例においては、１フレームクロツク期間
TFにキヤラクタメモリ１１から参照データＲと
表示データＤとを計２回にわたつて読み出した場
合であるが、この読み出しを１回とすることもで
きる。例えば、２つのキヤラクタメモリを設け、
一方のキヤラクタメモリから表示データＤを読み
出すと共に、他方のキヤラクタメモリから参照デ
ータＲを読み出せばよい。
TFにキヤラクタメモリ１１から参照データＲと
表示データＤとを計２回にわたつて読み出した場
合であるが、この読み出しを１回とすることもで
きる。例えば、２つのキヤラクタメモリを設け、
一方のキヤラクタメモリから表示データＤを読み
出すと共に、他方のキヤラクタメモリから参照デ
ータＲを読み出せばよい。
あるいは、１水平ライン分のシフトレジスタを
設けてキヤラクタメモリからの出力データを１水
平ライン分遅延させ、この遅延出力と遅延してい
ないデータとを表示データＤ及び参照データＲに
切り換えて使用すればよい。
設けてキヤラクタメモリからの出力データを１水
平ライン分遅延させ、この遅延出力と遅延してい
ないデータとを表示データＤ及び参照データＲに
切り換えて使用すればよい。
そして、これらのスムージングの場合には、キ
ヤラクタメモリからの読み出しが１フレームクロ
ツク期間TFに１回になるので、キヤラクタメモ
リとして低速のものを使用できる。
ヤラクタメモリからの読み出しが１フレームクロ
ツク期間TFに１回になるので、キヤラクタメモ
リとして低速のものを使用できる。
また、グラフイツクパターンを表示させるとき
のように字間スペースを形成しない場合には、シ
フトレジスタ２１，２２をそれぞれ１ビツトづつ
増やせば、隣り合うキヤラクタ間の境目において
もスムージングを行うことができる。
のように字間スペースを形成しない場合には、シ
フトレジスタ２１，２２をそれぞれ１ビツトづつ
増やせば、隣り合うキヤラクタ間の境目において
もスムージングを行うことができる。
さらに、前小ドツトDf及び後小ドツトDbを付
加あるいは削除してスムージングを行う代わり
に、揮度を変化させてスムージングを行つてもよ
く、この場合には、第４図のハーフドツトDhを
単位ドツトDuとすると共に、その揮度を下げた
ものが基本的な組み合わせとなる。
加あるいは削除してスムージングを行う代わり
に、揮度を変化させてスムージングを行つてもよ
く、この場合には、第４図のハーフドツトDhを
単位ドツトDuとすると共に、その揮度を下げた
ものが基本的な組み合わせとなる。
第１図〜第１１図、第１３図〜第１６図はこの
発明を説明するための図、第１２図はこの発明の
一例の系統図である。 １１はキヤラクタメモリ、２１，２２はシフト
レジスタ、３０は論理回路、５０はパルス形成回
路、７０は受像管である。
発明を説明するための図、第１２図はこの発明の
一例の系統図である。 １１はキヤラクタメモリ、２１，２２はシフト
レジスタ、３０は論理回路、５０はパルス形成回
路、７０は受像管である。
Claims (1)
- 【特許請求の範囲】 １ 行方向及び列方向の直交マトリツクスを構成
するドツトが水平走査及び垂直走査により形成さ
れると共に、上記ドツトにより文字、数字あるい
は記号などのキヤラクタが表示されるキヤラクタ
表示装置において 小ドツト：上記ドツトの1/3の幅を有するドツト to：上記小ドツトが付加または削除される時刻
を、上記ドツトごとに換算した時刻 Ｄ：現在表示している行のデータ Ｒ：１つ上または下の行のデータ とするとき、データＲ（to-1）、Ｒ（to）、Ｒ（to+1）
、
Ｄ（to-1）、Ｄ（to）、Ｄ（to+1）を記憶する回路と、
この記憶回路の記憶内容に応答し、所定の論理式
条件にしたがつて上記小ドツトの付加あるいは削
除の論理演算を行う論理回路と、この論理回路の
出力にしたがつて上記小ドツトの付加あるいは削
除を行う回路とを有し、上記論理回路は以下の論
理式条件にしたがうようにされた表示装置のスム
ージング回路。 (1) 上記ドツトの区間の前1/3の区間に位置する
小ドツトを付加する条件 （o-1）・Ｒ（to）・Ｄ（to-1）＝１ (2) 上記ドツトの区間の後1/3の区間に位置する
小ドツトを付加する条件 Ｒ（to）・（o+1）・Ｄ（to+1）＝１ (3) 上記ドツトの区間の前1/3の区間から上記小
ドツトを削除する条件 （o-1）・（o）・Ｒ（to+1） ・（o-1）・（o+1）＝１ (4) 上記ドツトの区間の後1/3の区間から上記小
ドツトを削除する条件 Ｒ（to-1）・（o）・（o+1） ・（o-1）・（o+1）＝１
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