JPH01599A - Pitch generation circuit - Google Patents
Pitch generation circuitInfo
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- JPH01599A JPH01599A JP62-155689A JP15568987A JPH01599A JP H01599 A JPH01599 A JP H01599A JP 15568987 A JP15568987 A JP 15568987A JP H01599 A JPH01599 A JP H01599A
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- JP
- Japan
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- frequency
- pitch
- decoder
- generation circuit
- circuit
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、メロディICの音程発生回路に関する。[Detailed description of the invention] [Industrial application field] The present invention relates to a pitch generation circuit for a melody IC.
本発明は、メロディICの音程発生回路において、Cn
xBn” (n・整数)の12種の音程の周波数のに倍
(K=整数)の周波数を発振させ、その信号をプログラ
マブルカウンタに入力し、デコーダにより、プログラマ
ブルカウンタにセットまたはリセットをかけて分周比を
変化させ、さらにその信号を分周期で17にの周波数に
して、Lオクターブ(L=整数)のすべての音程を発生
させる様にしたものである。The present invention provides a pitch generation circuit for a melody IC.
oscillate at a frequency twice (K = integer) the frequency of 12 different pitches of xBn'' (n/integer), input that signal to a programmable counter, and set or reset the programmable counter using a decoder to divide the frequency. By changing the frequency ratio and further dividing the signal to a frequency of 17, all pitches of L octaves (L = integer) are generated.
従来のメロディICの音程発生回路は、第2図の様にな
っており、図中、51は発振回路、52はプログラマブ
ルカウンタ、53は分周回路、54はスケールROM、
55はメインROM 、56は出力端子である。The pitch generation circuit of a conventional melody IC is as shown in Fig. 2, in which 51 is an oscillation circuit, 52 is a programmable counter, 53 is a frequency dividing circuit, 54 is a scale ROM,
55 is a main ROM, and 56 is an output terminal.
55のメインROMのデータにより、54のスケールR
O門のマドレスが決まり、それに応じて、スケール1?
OMからのデータが出力され52のプログラマブルカウ
ンタにセットまたは、リセットをかけ、分周比を変化さ
せ、53の分周回路により、波形整形して、出力してい
た。The scale R of 54 is determined by the data in the main ROM of 55.
The madres of the O gate has been decided, and accordingly, scale 1?
The data from the OM was output, set or reset to the programmable counter 52, changed the frequency division ratio, and shaped the waveform by the frequency division circuit 53 before being output.
しかし、前述の従来技術では、プログラマブルカウンタ
によって作成される音程は、ピント数を大きくすれば、
3オクタ一ブ以上の音程を出ずことが可能だが、スケー
ルl?OMの容量の関係からスケールROMに記憶可能
な音程は限られてしまい、最大でも15〜20音程しか
出力できないという問題点を有する。そこで本発明はこ
のような問題点を解決するもので、その目的とするとこ
ろは、簡単な構成で、広い音程範囲のすべての音程を出
力する回路を提供するところにある。However, in the above-mentioned conventional technology, the pitch created by the programmable counter can be changed by increasing the focus number.
It is possible to play more than three octaves without hitting a pitch, but scale L? Due to the capacity of the OM, the pitches that can be stored in the scale ROM are limited, and there is a problem in that only 15 to 20 pitches can be output at most. SUMMARY OF THE INVENTION The present invention is intended to solve these problems, and its purpose is to provide a circuit that has a simple configuration and outputs all pitches in a wide pitch range.
本発明の音程発生回路は、NAND回路、複数のインバ
ータ、抵抗、複数のコンデンサ、複数のスイッチからな
るCR発振回路、複数の分周用フリップ・フロップ回路
、プログラマブル・カウンタ及び前記複数のスイッチを
制御する第1のデコーダと前記プログラマブルカウンタ
を制御する第2のデコーダ、及び前記デコーダの入力を
決定するROMから構成されることを特徴とする。The pitch generation circuit of the present invention controls a CR oscillation circuit including a NAND circuit, a plurality of inverters, a resistor, a plurality of capacitors, a plurality of switches, a plurality of frequency dividing flip-flop circuits, a programmable counter, and the plurality of switches. A first decoder that controls the programmable counter, a second decoder that controls the programmable counter, and a ROM that determines the input of the decoder.
〔作用]
本発明の上記の構成によれば、ROMからの信号により
、コンデンサを選択し、CI?発振回路の発振周波数を
決定し、また、同様に120Mからの信号により、プロ
グラマブルカウンタの分周比を決定し、両方の組み合わ
せから自由な音程を派生するものである。[Operation] According to the above configuration of the present invention, a capacitor is selected based on a signal from the ROM, and CI? The oscillation frequency of the oscillation circuit is determined, and the frequency division ratio of the programmable counter is also determined based on the signal from 120M, and a free pitch is derived from the combination of both.
第1図は、本発明の一実施例における回路図であって、
図中、1は抵抗、2はNAND回路、3と4はインバー
タ、5〜16はコンデンサ、17〜28は、選択スイッ
チ、29はバッファ、30〜32は3ビツトのプログラ
マブルカウンタ、33は分周用フリップ・フロップ、3
4は第2のデコーダ、35はROM、36は第1のデコ
ーダ、37はインバータ、38はプルダウン抵抗39は
発振制御用端子、4oは出力端子である。抵抗1と、5
〜16までのコンデンサにより、Cn=Bn”(n・整
数〕の12種の音程の倍の周波数を発振させる様に1の
抵抗と5〜16のコンデンサを設定しておき、35のR
OMからの信号により、36の第16デコーダを介して
、17〜28のスイッチの1つをONさせる。そこで発
振したCn〜Bn”のうちの1音程の周波数の倍の発振
周波数は、30〜32のプログラマブルカウンタに入力
される。同時に伝えられる35のROMからの信号は、
34第2のデコーダを介して、30〜32のプログラマ
ブルカウンタにセットをかけ、入力周波数を1/2N(
N・整数)に分周する。それにより、オクターブを決定
し、33の分周用フリップ・フロップで波形整形して、
40の出力端子から出力する。たとえば、CR発振回路
゛で、3.520 Hzを発振させ、その周波数をプロ
グラマブルカウンタで全く分周しなければ、出力端子か
ら1,760Hz (Aa)の音程が得られ、172分
周すれば880H2(A5)の音程が得られる。同様に
1/4 、l/8分周すれば、44011z(八、)、
220Hz(/h)の音程がそれぞれ得られる。つまり
、Cn=Bn”、 Cn/2〜Bn″/2、Cn/4〜
Bn″/4、Cn/8〜Bn”/8のうちのどの音程も
自由に選択できる。FIG. 1 is a circuit diagram in one embodiment of the present invention,
In the figure, 1 is a resistor, 2 is a NAND circuit, 3 and 4 are inverters, 5-16 are capacitors, 17-28 are selection switches, 29 is a buffer, 30-32 is a 3-bit programmable counter, and 33 is a frequency divider. flip-flop, 3
4 is a second decoder, 35 is a ROM, 36 is a first decoder, 37 is an inverter, 38 is a pull-down resistor 39 is an oscillation control terminal, and 4o is an output terminal. Resistance 1 and 5
A resistor of 1 and a capacitor of 5 to 16 are set so that the frequency of the 12 pitches of Cn=Bn" (n/integer) is oscillated by the capacitors of 1 to 16.
A signal from the OM turns on one of the switches 17 to 28 via the 36 16th decoders. The oscillation frequency, which is twice the frequency of one pitch among the oscillated Cn to Bn'', is input to 30 to 32 programmable counters.Signals from 35 ROMs transmitted simultaneously are as follows:
34 Set the programmable counters 30 to 32 through the second decoder, and set the input frequency to 1/2N (
N/integer). As a result, the octave is determined, and the waveform is shaped using 33 frequency dividing flip-flops.
Output from 40 output terminals. For example, if you oscillate 3.520 Hz with a CR oscillation circuit and do not divide that frequency at all with a programmable counter, you will get a pitch of 1,760 Hz (Aa) from the output terminal, and if you divide it by 172, you will get 880 H2. (A5) pitch is obtained. Similarly, if you divide the frequency by 1/4 and l/8, you get 44011z (8),
A pitch of 220 Hz (/h) is obtained respectively. That is, Cn=Bn", Cn/2~Bn"/2, Cn/4~
Any pitch from Bn''/4, Cn/8 to Bn''/8 can be freely selected.
以上述べたように本発明によれば、ROMにより、発振
周波数および分周比を決めることにより、広い音程範囲
のすべての音程を自由に選択でき出力できるという効果
を有する。As described above, according to the present invention, by determining the oscillation frequency and frequency division ratio using the ROM, it is possible to freely select and output all pitches in a wide pitch range.
第1図は、本発明の音程発註路の一実施例を示す回路図
。
第2図は、従来の音程発生回路を示すブロック図。
以 上
出願人 セイコーエプソン株式会社
箋 1 図
喘2 図FIG. 1 is a circuit diagram showing an embodiment of the pitch generating path of the present invention. FIG. 2 is a block diagram showing a conventional pitch generation circuit. Applicant Seiko Epson Co., Ltd. 1 Figure 2 Figure 2
Claims (1)
ンサ複数のスイッチからなるCR発振回路、複数の分周
用フリップ・フロップ回路、プログラマブル・カウンタ
及び、前記複数のスイッチを制御する第1のデコーダと
前記プログラマブルカウンタを制御する第2のデコーダ
、及び前記デコーダの入力を決定するROMから構成さ
れることを特徴とする音程発生回路。A CR oscillation circuit consisting of a NAND circuit, a plurality of inverters, a resistor, a plurality of capacitors and a plurality of switches, a plurality of frequency dividing flip-flop circuits, a programmable counter, a first decoder that controls the plurality of switches, and the programmable A pitch generation circuit comprising: a second decoder that controls a counter; and a ROM that determines an input to the decoder.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62155689A JPS64599A (en) | 1987-06-23 | 1987-06-23 | Musical interval generating circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62155689A JPS64599A (en) | 1987-06-23 | 1987-06-23 | Musical interval generating circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01599A true JPH01599A (en) | 1989-01-05 |
| JPS64599A JPS64599A (en) | 1989-01-05 |
Family
ID=15611397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62155689A Pending JPS64599A (en) | 1987-06-23 | 1987-06-23 | Musical interval generating circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS64599A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7332975B2 (en) * | 2006-02-27 | 2008-02-19 | Silicon Laboratories Inc. | Reference-less clock circuit |
-
1987
- 1987-06-23 JP JP62155689A patent/JPS64599A/en active Pending
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