JPH01599A - 音程発生回路 - Google Patents
音程発生回路Info
- Publication number
- JPH01599A JPH01599A JP62-155689A JP15568987A JPH01599A JP H01599 A JPH01599 A JP H01599A JP 15568987 A JP15568987 A JP 15568987A JP H01599 A JPH01599 A JP H01599A
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- pitch
- decoder
- generation circuit
- circuit
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、メロディＩＣの音程発生回路に関する。
本発明は、メロディＩＣの音程発生回路において、Ｃｎ
ｘＢｎ” （ｎ・整数）の１２種の音程の周波数のに倍
（Ｋ＝整数）の周波数を発振させ、その信号をプログラ
マブルカウンタに入力し、デコーダにより、プログラマ
ブルカウンタにセットまたはリセットをかけて分周比を
変化させ、さらにその信号を分周期で１７にの周波数に
して、Ｌオクターブ（Ｌ＝整数）のすべての音程を発生
させる様にしたものである。
ｘＢｎ” （ｎ・整数）の１２種の音程の周波数のに倍
（Ｋ＝整数）の周波数を発振させ、その信号をプログラ
マブルカウンタに入力し、デコーダにより、プログラマ
ブルカウンタにセットまたはリセットをかけて分周比を
変化させ、さらにその信号を分周期で１７にの周波数に
して、Ｌオクターブ（Ｌ＝整数）のすべての音程を発生
させる様にしたものである。
従来のメロディＩＣの音程発生回路は、第２図の様にな
っており、図中、５１は発振回路、５２はプログラマブ
ルカウンタ、５３は分周回路、５４はスケールＲＯＭ、
５５はメインＲＯＭ 、５６は出力端子である。
っており、図中、５１は発振回路、５２はプログラマブ
ルカウンタ、５３は分周回路、５４はスケールＲＯＭ、
５５はメインＲＯＭ 、５６は出力端子である。
５５のメインＲＯＭのデータにより、５４のスケールＲ
Ｏ門のマドレスが決まり、それに応じて、スケール１？
ＯＭからのデータが出力され５２のプログラマブルカウ
ンタにセットまたは、リセットをかけ、分周比を変化さ
せ、５３の分周回路により、波形整形して、出力してい
た。
Ｏ門のマドレスが決まり、それに応じて、スケール１？
ＯＭからのデータが出力され５２のプログラマブルカウ
ンタにセットまたは、リセットをかけ、分周比を変化さ
せ、５３の分周回路により、波形整形して、出力してい
た。
しかし、前述の従来技術では、プログラマブルカウンタ
によって作成される音程は、ピント数を大きくすれば、
３オクタ一ブ以上の音程を出ずことが可能だが、スケー
ルｌ？ＯＭの容量の関係からスケールＲＯＭに記憶可能
な音程は限られてしまい、最大でも１５〜２０音程しか
出力できないという問題点を有する。そこで本発明はこ
のような問題点を解決するもので、その目的とするとこ
ろは、簡単な構成で、広い音程範囲のすべての音程を出
力する回路を提供するところにある。
によって作成される音程は、ピント数を大きくすれば、
３オクタ一ブ以上の音程を出ずことが可能だが、スケー
ルｌ？ＯＭの容量の関係からスケールＲＯＭに記憶可能
な音程は限られてしまい、最大でも１５〜２０音程しか
出力できないという問題点を有する。そこで本発明はこ
のような問題点を解決するもので、その目的とするとこ
ろは、簡単な構成で、広い音程範囲のすべての音程を出
力する回路を提供するところにある。
本発明の音程発生回路は、ＮＡＮＤ回路、複数のインバ
ータ、抵抗、複数のコンデンサ、複数のスイッチからな
るＣＲ発振回路、複数の分周用フリップ・フロップ回路
、プログラマブル・カウンタ及び前記複数のスイッチを
制御する第１のデコーダと前記プログラマブルカウンタ
を制御する第２のデコーダ、及び前記デコーダの入力を
決定するＲＯＭから構成されることを特徴とする。
ータ、抵抗、複数のコンデンサ、複数のスイッチからな
るＣＲ発振回路、複数の分周用フリップ・フロップ回路
、プログラマブル・カウンタ及び前記複数のスイッチを
制御する第１のデコーダと前記プログラマブルカウンタ
を制御する第２のデコーダ、及び前記デコーダの入力を
決定するＲＯＭから構成されることを特徴とする。
〔作用］
本発明の上記の構成によれば、ＲＯＭからの信号により
、コンデンサを選択し、ＣＩ？発振回路の発振周波数を
決定し、また、同様に１２０Ｍからの信号により、プロ
グラマブルカウンタの分周比を決定し、両方の組み合わ
せから自由な音程を派生するものである。
、コンデンサを選択し、ＣＩ？発振回路の発振周波数を
決定し、また、同様に１２０Ｍからの信号により、プロ
グラマブルカウンタの分周比を決定し、両方の組み合わ
せから自由な音程を派生するものである。
第１図は、本発明の一実施例における回路図であって、
図中、１は抵抗、２はＮＡＮＤ回路、３と４はインバー
タ、５〜１６はコンデンサ、１７〜２８は、選択スイッ
チ、２９はバッファ、３０〜３２は３ビツトのプログラ
マブルカウンタ、３３は分周用フリップ・フロップ、３
４は第２のデコーダ、３５はＲＯＭ、３６は第１のデコ
ーダ、３７はインバータ、３８はプルダウン抵抗３９は
発振制御用端子、４ｏは出力端子である。抵抗１と、５
〜１６までのコンデンサにより、Ｃｎ＝Ｂｎ”（ｎ・整
数〕の１２種の音程の倍の周波数を発振させる様に１の
抵抗と５〜１６のコンデンサを設定しておき、３５のＲ
ＯＭからの信号により、３６の第１６デコーダを介して
、１７〜２８のスイッチの１つをＯＮさせる。そこで発
振したＣｎ〜Ｂｎ”のうちの１音程の周波数の倍の発振
周波数は、３０〜３２のプログラマブルカウンタに入力
される。同時に伝えられる３５のＲＯＭからの信号は、
３４第２のデコーダを介して、３０〜３２のプログラマ
ブルカウンタにセットをかけ、入力周波数を１／２Ｎ（
Ｎ・整数）に分周する。それにより、オクターブを決定
し、３３の分周用フリップ・フロップで波形整形して、
４０の出力端子から出力する。たとえば、ＣＲ発振回路
゛で、３．５２０ Ｈｚを発振させ、その周波数をプロ
グラマブルカウンタで全く分周しなければ、出力端子か
ら１，７６０Ｈｚ （Ａａ）の音程が得られ、１７２分
周すれば８８０Ｈ２（Ａ５）の音程が得られる。同様に
１／４ 、ｌ／８分周すれば、４４０１１ｚ（八、）、
２２０Ｈｚ（／ｈ）の音程がそれぞれ得られる。つまり
、Ｃｎ＝Ｂｎ”、 Ｃｎ／２〜Ｂｎ″／２、Ｃｎ／４〜
Ｂｎ″／４、Ｃｎ／８〜Ｂｎ”／８のうちのどの音程も
自由に選択できる。
図中、１は抵抗、２はＮＡＮＤ回路、３と４はインバー
タ、５〜１６はコンデンサ、１７〜２８は、選択スイッ
チ、２９はバッファ、３０〜３２は３ビツトのプログラ
マブルカウンタ、３３は分周用フリップ・フロップ、３
４は第２のデコーダ、３５はＲＯＭ、３６は第１のデコ
ーダ、３７はインバータ、３８はプルダウン抵抗３９は
発振制御用端子、４ｏは出力端子である。抵抗１と、５
〜１６までのコンデンサにより、Ｃｎ＝Ｂｎ”（ｎ・整
数〕の１２種の音程の倍の周波数を発振させる様に１の
抵抗と５〜１６のコンデンサを設定しておき、３５のＲ
ＯＭからの信号により、３６の第１６デコーダを介して
、１７〜２８のスイッチの１つをＯＮさせる。そこで発
振したＣｎ〜Ｂｎ”のうちの１音程の周波数の倍の発振
周波数は、３０〜３２のプログラマブルカウンタに入力
される。同時に伝えられる３５のＲＯＭからの信号は、
３４第２のデコーダを介して、３０〜３２のプログラマ
ブルカウンタにセットをかけ、入力周波数を１／２Ｎ（
Ｎ・整数）に分周する。それにより、オクターブを決定
し、３３の分周用フリップ・フロップで波形整形して、
４０の出力端子から出力する。たとえば、ＣＲ発振回路
゛で、３．５２０ Ｈｚを発振させ、その周波数をプロ
グラマブルカウンタで全く分周しなければ、出力端子か
ら１，７６０Ｈｚ （Ａａ）の音程が得られ、１７２分
周すれば８８０Ｈ２（Ａ５）の音程が得られる。同様に
１／４ 、ｌ／８分周すれば、４４０１１ｚ（八、）、
２２０Ｈｚ（／ｈ）の音程がそれぞれ得られる。つまり
、Ｃｎ＝Ｂｎ”、 Ｃｎ／２〜Ｂｎ″／２、Ｃｎ／４〜
Ｂｎ″／４、Ｃｎ／８〜Ｂｎ”／８のうちのどの音程も
自由に選択できる。
以上述べたように本発明によれば、ＲＯＭにより、発振
周波数および分周比を決めることにより、広い音程範囲
のすべての音程を自由に選択でき出力できるという効果
を有する。
周波数および分周比を決めることにより、広い音程範囲
のすべての音程を自由に選択でき出力できるという効果
を有する。
第１図は、本発明の音程発註路の一実施例を示す回路図
。 第２図は、従来の音程発生回路を示すブロック図。 以 上 出願人 セイコーエプソン株式会社 箋 １ 図 喘２ 図
。 第２図は、従来の音程発生回路を示すブロック図。 以 上 出願人 セイコーエプソン株式会社 箋 １ 図 喘２ 図
Claims (1)
- ＮＡＮＤ回路、複数のインバータ、抵抗、複数のコンデ
ンサ複数のスイッチからなるＣＲ発振回路、複数の分周
用フリップ・フロップ回路、プログラマブル・カウンタ
及び、前記複数のスイッチを制御する第１のデコーダと
前記プログラマブルカウンタを制御する第２のデコーダ
、及び前記デコーダの入力を決定するＲＯＭから構成さ
れることを特徴とする音程発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62155689A JPS64599A (en) | 1987-06-23 | 1987-06-23 | Musical interval generating circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62155689A JPS64599A (en) | 1987-06-23 | 1987-06-23 | Musical interval generating circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01599A true JPH01599A (ja) | 1989-01-05 |
| JPS64599A JPS64599A (en) | 1989-01-05 |
Family
ID=15611397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62155689A Pending JPS64599A (en) | 1987-06-23 | 1987-06-23 | Musical interval generating circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS64599A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7332975B2 (en) * | 2006-02-27 | 2008-02-19 | Silicon Laboratories Inc. | Reference-less clock circuit |
-
1987
- 1987-06-23 JP JP62155689A patent/JPS64599A/ja active Pending
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