JPH0160980B2 - - Google Patents
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- JPH0160980B2 JPH0160980B2 JP58095809A JP9580983A JPH0160980B2 JP H0160980 B2 JPH0160980 B2 JP H0160980B2 JP 58095809 A JP58095809 A JP 58095809A JP 9580983 A JP9580983 A JP 9580983A JP H0160980 B2 JPH0160980 B2 JP H0160980B2
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- JP
- Japan
- Prior art keywords
- data
- bytes
- communication device
- processing device
- byte
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Communication Control (AREA)
Description
【発明の詳細な説明】
(1) 発明の技術分野
本発明はデータ転送方式に関し、例えば、デイ
ジタルデータ交換機（DDX）や電力オンライン
システム等に適用されるハイレベル伝送制御手順
（HDLC）に用いられるデータの如く、８ビツト
からなる１バイトのデータを最小単位とするデー
タブロツクの回線データ列を、通信装置から、複
数バイト分のデータの授受を行なうインターフエ
ース回路を介して、処理装置に転送するデータ転
送方式に関する。
ジタルデータ交換機（DDX）や電力オンライン
システム等に適用されるハイレベル伝送制御手順
（HDLC）に用いられるデータの如く、８ビツト
からなる１バイトのデータを最小単位とするデー
タブロツクの回線データ列を、通信装置から、複
数バイト分のデータの授受を行なうインターフエ
ース回路を介して、処理装置に転送するデータ転
送方式に関する。
(2) 発明の背景
データ転送方式においては、回線データを出来
るだけ高速で転送すること、収容可能な回線数が
出来るだけ多いこと、および装置の価格が低いこ
とが要求される。
るだけ高速で転送すること、収容可能な回線数が
出来るだけ多いこと、および装置の価格が低いこ
とが要求される。
(3) 従来技術と問題点
従来、上記の如く、８ビツトからなる１バイト
のデータを最小単位とするデータブロツクで構成
される回線データ列を通信装置から処理装置に転
送する方式には、次の２つの方式が存在してい
た。第１の方式は、通信装置から転送されて来た
データを１バイト毎に繰り返し、処理装置に転送
する方式である。第２の方式は、通信装置から転
送されて来たデータを、インターフエース回路の
入出力可能バイト数であるｎバイト（ｎは正の整
数）のデータブロツクだけインターフエース回路
に蓄積し、ｎバイトのデータがインターフエース
回路に蓄積されると、これを並列に処理装置に転
送する方式である。
のデータを最小単位とするデータブロツクで構成
される回線データ列を通信装置から処理装置に転
送する方式には、次の２つの方式が存在してい
た。第１の方式は、通信装置から転送されて来た
データを１バイト毎に繰り返し、処理装置に転送
する方式である。第２の方式は、通信装置から転
送されて来たデータを、インターフエース回路の
入出力可能バイト数であるｎバイト（ｎは正の整
数）のデータブロツクだけインターフエース回路
に蓄積し、ｎバイトのデータがインターフエース
回路に蓄積されると、これを並列に処理装置に転
送する方式である。
しかしながら、上述の従来方式には以下の問題
点がある。
点がある。
すなわち、第１の方式によれば、１バイト毎に
転送するのでインターフエース回路および処理回
路のハードウエアの規模は小さくて済むが、処理
装置側でのデータ受信の頻度が多くなつてしま
い、それによりソフトウエアの負担が大きくなる
ので、高速のデータ転送が出来ず、また１バイト
毎の転送故に収容回線数も限られる。また、第２
の方式によれば、通信装置から転送される有効デ
ータがｎバイト未満の場合、例えばHDLC信号に
おけるフラグパターン（01111110のパターン）の
様なダミーデータを通信装置において上記有効デ
ーチに付加してｎバイトのデータとして転送し、
処理装置例でダミーデータを削除するという、デ
ータのトランスペアレンシーを保障する為の複雑
な手順を必要とし、このようなデータの挿入・削
除のために通信装置および処理装置共にハードウ
エアの規模が大となり、従つて装置の価格が高く
なる。またダミーデータの挿入・削除に時間を要
するためデータの転送速度が遅くなる。さらに、
ダミーデータのために、有効なデータの回線が制
限されるので、収容可能回線数も制限される。
転送するのでインターフエース回路および処理回
路のハードウエアの規模は小さくて済むが、処理
装置側でのデータ受信の頻度が多くなつてしま
い、それによりソフトウエアの負担が大きくなる
ので、高速のデータ転送が出来ず、また１バイト
毎の転送故に収容回線数も限られる。また、第２
の方式によれば、通信装置から転送される有効デ
ータがｎバイト未満の場合、例えばHDLC信号に
おけるフラグパターン（01111110のパターン）の
様なダミーデータを通信装置において上記有効デ
ーチに付加してｎバイトのデータとして転送し、
処理装置例でダミーデータを削除するという、デ
ータのトランスペアレンシーを保障する為の複雑
な手順を必要とし、このようなデータの挿入・削
除のために通信装置および処理装置共にハードウ
エアの規模が大となり、従つて装置の価格が高く
なる。またダミーデータの挿入・削除に時間を要
するためデータの転送速度が遅くなる。さらに、
ダミーデータのために、有効なデータの回線が制
限されるので、収容可能回線数も制限される。
(4) 発明の目的
従つて、本発明の目的は、前述の従来技術にお
ける問題にかんがみ、インターフエース回路で有
効データのバイト数を計数するという構想に基づ
き、１バイトが８ビツトからなるデータを最小単
位とするデータブロツクの回線データ列を、通信
装置と理装置の間で、入出力可能バイト数がｎバ
イトであるインターフエース回路を介して、転送
するデータ転送方式において、転送されるデータ
にダミーデータを挿入することなくｎバイト未満
のデータブロツクの同時転送を可能にし、それに
より高速のデータ転送、収容可能回線数の増大を
図り、合わせて、装置価格の低減を図ることにあ
る。
ける問題にかんがみ、インターフエース回路で有
効データのバイト数を計数するという構想に基づ
き、１バイトが８ビツトからなるデータを最小単
位とするデータブロツクの回線データ列を、通信
装置と理装置の間で、入出力可能バイト数がｎバ
イトであるインターフエース回路を介して、転送
するデータ転送方式において、転送されるデータ
にダミーデータを挿入することなくｎバイト未満
のデータブロツクの同時転送を可能にし、それに
より高速のデータ転送、収容可能回線数の増大を
図り、合わせて、装置価格の低減を図ることにあ
る。
(5) 発明の構成
上記の目的達成のための本発明の要旨は、
１フレームが、８ビツトからなる１バイトのデ
ータを最小単位とする少なくとも１つのデータブ
ロツクと、終端を識別するための終端識別信号と
を含む、複数のフレームの回線データ列を送受信
する通信装置と、 ｎバイト（ｎは２以上の整数）のデータの並列
入出力が可能な処理装置と、 該通信装置と該処理装置との間で回線データ列
を転送するインターフエース手段とを備え、 該インターフエース手段は、該通信装置又は該
処理装置から転送されたデータを蓄積するデータ
蓄積手段と、 該該通信装置又は該処理装置から転送された有
効データのバイト数を計数して出力するバイト数
計数手段と、 該有効データのバイト数が該ｎバイトに達した
時または該有効データのバイト数が該ｎバイト未
満であつても該終端識別信号を検出した時に、受
信要求信号を発生する受信要求信号発生手段とを
具備し、 該処理装置又は該通信装置は、該受信要求信号
と該バイト数計数手段の出力とに基づいて該デー
タ蓄積手段から有効データのみを受け取るように
したことを特徴とするデータ転送方式にある。
ータを最小単位とする少なくとも１つのデータブ
ロツクと、終端を識別するための終端識別信号と
を含む、複数のフレームの回線データ列を送受信
する通信装置と、 ｎバイト（ｎは２以上の整数）のデータの並列
入出力が可能な処理装置と、 該通信装置と該処理装置との間で回線データ列
を転送するインターフエース手段とを備え、 該インターフエース手段は、該通信装置又は該
処理装置から転送されたデータを蓄積するデータ
蓄積手段と、 該該通信装置又は該処理装置から転送された有
効データのバイト数を計数して出力するバイト数
計数手段と、 該有効データのバイト数が該ｎバイトに達した
時または該有効データのバイト数が該ｎバイト未
満であつても該終端識別信号を検出した時に、受
信要求信号を発生する受信要求信号発生手段とを
具備し、 該処理装置又は該通信装置は、該受信要求信号
と該バイト数計数手段の出力とに基づいて該デー
タ蓄積手段から有効データのみを受け取るように
したことを特徴とするデータ転送方式にある。
本発明によれば、データブロツクが連続してい
る場合には、通信装置と処理装置とのインターフ
エースの広がり分であるｎバイトのデータを同時
に転送し、データブロツクが一担終了した様な場
合、すなわち蓄積データがｎバイト未満の状態で
転送する場合にはｎバイト中の有効バイト数の表
示により、データ受信側で有効バイト数のデータ
のみを取り込むという手段により、装置間のデー
タ転送に必要な処理を減らし、それにより、高速
な回線を通信処理装置に収容することが可能にな
り、また、通信装置に収容できる回線数も多くす
ることができる。
る場合には、通信装置と処理装置とのインターフ
エースの広がり分であるｎバイトのデータを同時
に転送し、データブロツクが一担終了した様な場
合、すなわち蓄積データがｎバイト未満の状態で
転送する場合にはｎバイト中の有効バイト数の表
示により、データ受信側で有効バイト数のデータ
のみを取り込むという手段により、装置間のデー
タ転送に必要な処理を減らし、それにより、高速
な回線を通信処理装置に収容することが可能にな
り、また、通信装置に収容できる回線数も多くす
ることができる。
さらに、１フレーム単位に転送する場合に比べ
て、本願発明の如く、ｎバイト単位またはそれ未
満の単位で転送する方式では、他の処理の合間に
ｎバイト単位またはそれ未満のデータを転送でき
るので、ソフトウエアの処理を分割することがで
き、ソフトウエアの負担を軽くすることができ
る。
て、本願発明の如く、ｎバイト単位またはそれ未
満の単位で転送する方式では、他の処理の合間に
ｎバイト単位またはそれ未満のデータを転送でき
るので、ソフトウエアの処理を分割することがで
き、ソフトウエアの負担を軽くすることができ
る。
(6) 発明の実施例
以下、本発明の実施例を図面によつて説明す
る。
る。
第１図はHDLC信号の１フレームのデータフオ
ーマツトを示す図である。第１図ａに示されるよ
うに、HDLC信号の１フレームは、先頭に８ビツ
トのフラグＦがあり、次の８ビツトは転送先を示
すアドレス信号Ａであり、その次の８ビツトはフ
レームのシーケンス番号を示す制御信号Ｃであ
る。制御信号Ｃの後に複数バイトのデータＤが存
在し、その後にエラー検出冗長ビツトFCSが存在
する。第１図ｂに示されるように、データＤは、
１バイトを最小単位とするデータブロツクで構成
されており、例えば、各々がｎバイトからなるデ
ータDa，Db，Dcと、ｎバイトより小さいｍバイ
トからなるDdとからなつている。データＤの長
さは任意である。
ーマツトを示す図である。第１図ａに示されるよ
うに、HDLC信号の１フレームは、先頭に８ビツ
トのフラグＦがあり、次の８ビツトは転送先を示
すアドレス信号Ａであり、その次の８ビツトはフ
レームのシーケンス番号を示す制御信号Ｃであ
る。制御信号Ｃの後に複数バイトのデータＤが存
在し、その後にエラー検出冗長ビツトFCSが存在
する。第１図ｂに示されるように、データＤは、
１バイトを最小単位とするデータブロツクで構成
されており、例えば、各々がｎバイトからなるデ
ータDa，Db，Dcと、ｎバイトより小さいｍバイ
トからなるDdとからなつている。データＤの長
さは任意である。
第２図は本発明の一実施例に係るデータ転送方
式を実施するたの装置を示すブロツク図である。
同図において、１は通信装置、２はインターフエ
ース回路、３は処理装置である。インターフエー
ス回路２は、通信装置１から転送されるｎバイト
のデータを蓄積し得るデータ蓄積回路２−１と、
通信装置１から転送されるデータのバイト数を計
数するバイト数計数回路２−２と、処理装置３に
対して受信要求信号Ｒを発生する受信要求信号発
生回路２−３とを備えている。
式を実施するたの装置を示すブロツク図である。
同図において、１は通信装置、２はインターフエ
ース回路、３は処理装置である。インターフエー
ス回路２は、通信装置１から転送されるｎバイト
のデータを蓄積し得るデータ蓄積回路２−１と、
通信装置１から転送されるデータのバイト数を計
数するバイト数計数回路２−２と、処理装置３に
対して受信要求信号Ｒを発生する受信要求信号発
生回路２−３とを備えている。
通信装置１から、ｎバイト以上のデータブロツ
クが連続して直列に転送されるときは、インター
フエース回路２内のデータ蓄積回路２−１はｎバ
イト毎にデータを格納し、バイト数計数回路２−
２はデータ蓄積回路２−１に入力されたデータの
バイト数を計数してｎバイトに達すると出力バイ
ト数BN＝ｎを処理装置３に通知すると共に、受
信要求信号発生回路２−３に蓄積終了信号Ｅを与
える。受信要求信号発生回路２−３は、蓄積終了
信号Ｅを受け取ると、処理装置３に対して受信要
求信号Ｒを送る。処理装置３は受信要求信号Ｒを
受け取ると、データ蓄積装置２−１からｎバイト
のデータDp〜Do-1を受け取る。ｎバイトのデー
タの転送が終了するとバイト数計数回路２−２は
クリアされ、信号BNおよびＲは消失する。こう
して、例えば第１図ｂに示されるｎバイトのデー
タDa，DbおよびDcは通信装置１から処理装置３
に転送される。このようにｎバイト以上の連続し
たデータの転送を行う場合は、本発明による方式
と前述の従来例の第２の方式とに大差はない。
クが連続して直列に転送されるときは、インター
フエース回路２内のデータ蓄積回路２−１はｎバ
イト毎にデータを格納し、バイト数計数回路２−
２はデータ蓄積回路２−１に入力されたデータの
バイト数を計数してｎバイトに達すると出力バイ
ト数BN＝ｎを処理装置３に通知すると共に、受
信要求信号発生回路２−３に蓄積終了信号Ｅを与
える。受信要求信号発生回路２−３は、蓄積終了
信号Ｅを受け取ると、処理装置３に対して受信要
求信号Ｒを送る。処理装置３は受信要求信号Ｒを
受け取ると、データ蓄積装置２−１からｎバイト
のデータDp〜Do-1を受け取る。ｎバイトのデー
タの転送が終了するとバイト数計数回路２−２は
クリアされ、信号BNおよびＲは消失する。こう
して、例えば第１図ｂに示されるｎバイトのデー
タDa，DbおよびDcは通信装置１から処理装置３
に転送される。このようにｎバイト以上の連続し
たデータの転送を行う場合は、本発明による方式
と前述の従来例の第２の方式とに大差はない。
通信装置１から直列に転送されたデータがｎバ
イト未満の場合、例えば第１図ｂに示されるｍバ
イトのデータDdが転送される場合は、データ蓄
積回路２−１がｍバイトのデータを蓄積すると、
バイト数計数回路２−２はデータDdの次のエラ
ー検出冗長ビツトFCSの最初の１バイトの信号を
受けることにより蓄積終了と判断してデータ蓄積
回路２−１に入力された有効データのバイト数
BN＝ｍを出力すると同時に、受信要求信号発生
回路２−３に蓄積終了信号Ｅを与える。受信要求
信号発生回路２−３はＥを受け取ると、前述と同
様にＲを処理回路を与え、処理回路はデータ蓄積
回路２−１からｍバイトのデータだけを受け取
る。
イト未満の場合、例えば第１図ｂに示されるｍバ
イトのデータDdが転送される場合は、データ蓄
積回路２−１がｍバイトのデータを蓄積すると、
バイト数計数回路２−２はデータDdの次のエラ
ー検出冗長ビツトFCSの最初の１バイトの信号を
受けることにより蓄積終了と判断してデータ蓄積
回路２−１に入力された有効データのバイト数
BN＝ｍを出力すると同時に、受信要求信号発生
回路２−３に蓄積終了信号Ｅを与える。受信要求
信号発生回路２−３はＥを受け取ると、前述と同
様にＲを処理回路を与え、処理回路はデータ蓄積
回路２−１からｍバイトのデータだけを受け取
る。
本実施例によれば、データのブロツクがｎバイ
ト以上連続している時にはデータ蓄積回路２−１
にｎバイトのデータが蓄積されない限り、処理回
路に対してデータの受信要求が出されないので、
処理装置におけるデータ受信処理速度は遅くて済
み、前述の従来の第１の方式の如くソフトウエア
の負担が大かくなることはない。また、送出デー
タDp〜Do-1の中の有効データのバイト数が処理
装置に与えられるので、ｎバイトより小のバイト
数のデータの転送に際しても、従来の第２の方式
の如くダミーデータの挿入および削除という処理
が不要である。
ト以上連続している時にはデータ蓄積回路２−１
にｎバイトのデータが蓄積されない限り、処理回
路に対してデータの受信要求が出されないので、
処理装置におけるデータ受信処理速度は遅くて済
み、前述の従来の第１の方式の如くソフトウエア
の負担が大かくなることはない。また、送出デー
タDp〜Do-1の中の有効データのバイト数が処理
装置に与えられるので、ｎバイトより小のバイト
数のデータの転送に際しても、従来の第２の方式
の如くダミーデータの挿入および削除という処理
が不要である。
なお、本発明は前述の実施例に限定されるもの
ではない。例えば、処理装置から通信装置へのデ
ータの転送も前述の実施例と同様の手法で実現で
きる。
ではない。例えば、処理装置から通信装置へのデ
ータの転送も前述の実施例と同様の手法で実現で
きる。
(7) 発明の効果
以上述べたように、本発明によれば、端末回線
データを処理するための通信装置と処理装置の間
でのバイトデータの転送処理が非常に簡単化され
るので、通信装置あるいは処理装置からのデータ
の転送速度は高速化されるか、または収容可能回
線数が増大し、かつ装置価格は低くなる。
データを処理するための通信装置と処理装置の間
でのバイトデータの転送処理が非常に簡単化され
るので、通信装置あるいは処理装置からのデータ
の転送速度は高速化されるか、または収容可能回
線数が増大し、かつ装置価格は低くなる。
第１図はHDLC信号の１フレームのデータフオ
ーマツトを示す図、第２図は本発明の一実施例に
係るデータ転送方式を実施するための装置を示す
ブロツク図である。 １……通信装置、２……インターフエース回
路、３……処理装置、２−１……データ蓄積回
路、２−２……バイト数計数回路、２−３……受
信要求信号発生回路。
ーマツトを示す図、第２図は本発明の一実施例に
係るデータ転送方式を実施するための装置を示す
ブロツク図である。 １……通信装置、２……インターフエース回
路、３……処理装置、２−１……データ蓄積回
路、２−２……バイト数計数回路、２−３……受
信要求信号発生回路。
Claims (1)
- 【特許請求の範囲】 １ １フレームが、８ビツトからなる１バイトの
データを最小単位とする少なくとも１つのデータ
ブロツクと、終端を識別するための終端識別信号
とを含む、複数のフレームの回線データ列を送受
信する通信装置と、 ｎバイト（ｎは２以上の整数）のデータブロツ
クの並列入出力が可能な処理装置と、 該通信装置と該処理装置との間で回線データ列
を転送するインターフエース手段とを備え、 該インターフエース手段は、該通信装置又は該
処理装置から転送されたデータを蓄積するデータ
蓄積手段と、 該該通信装置又は該処理装置から転送された有
効データのバイト数を計数して出力するバイト数
計数手段と、 該有効データのバイト数が該ｎバイトに達した
時または該有効データのバイト数が該ｎバイト未
満であつても該終端識別信号を検出した時に、受
信要求信号を発生する受信要求信号発生手段とを
具備し、 該処理装置又は該通信装置は、該受信要求信号
と該バイト数計数手段の出力とに基づいて該デー
タ蓄積手段から有効データのみを受け取るように
したことを特徴とするデータ転送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58095809A JPS59223046A (ja) | 1983-06-01 | 1983-06-01 | デ−タ転送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58095809A JPS59223046A (ja) | 1983-06-01 | 1983-06-01 | デ−タ転送方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59223046A JPS59223046A (ja) | 1984-12-14 |
| JPH0160980B2 true JPH0160980B2 (ja) | 1989-12-26 |
Family
ID=14147748
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58095809A Granted JPS59223046A (ja) | 1983-06-01 | 1983-06-01 | デ−タ転送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59223046A (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5391543A (en) * | 1977-01-24 | 1978-08-11 | Hitachi Ltd | Installation system for hdlc circuit |
-
1983
- 1983-06-01 JP JP58095809A patent/JPS59223046A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59223046A (ja) | 1984-12-14 |
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