JPH0195376A - 絶対値回路 - Google Patents
絶対値回路Info
- Publication number
- JPH0195376A JPH0195376A JP62252872A JP25287287A JPH0195376A JP H0195376 A JPH0195376 A JP H0195376A JP 62252872 A JP62252872 A JP 62252872A JP 25287287 A JP25287287 A JP 25287287A JP H0195376 A JPH0195376 A JP H0195376A
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- Japan
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- transistor
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は半導体集積回路において、入力信号の絶対値を
合成し取り出す回路に関するものである。
合成し取り出す回路に関するものである。
従来の技術
従来、この種の絶対値回路は第２図に示す様な構成であ
った。第２図において、反転増幅器として用いた演算増
幅器ＯｐＨの出力と基準電圧源ｖ ｒｅｆとの電位差に
よりＮＰＮ及びＰＮＰのトランジスタＱｕ及びＱ１０を
切換えて絶対値出力を取り出す構成であった。
った。第２図において、反転増幅器として用いた演算増
幅器ＯｐＨの出力と基準電圧源ｖ ｒｅｆとの電位差に
よりＮＰＮ及びＰＮＰのトランジスタＱｕ及びＱ１０を
切換えて絶対値出力を取り出す構成であった。
発明が解決しようとする問題点
このような従来の構成では、演算増幅器の出力電圧が、
ＮＰＮ及びＰＮＰ トランジスタのベース・エミッタ間
電圧より小さいときには、絶対値出力が得られない、い
わゆる、「不感帯」と呼ばれる領域を持つため、出力信
号が歪んでしまうことがある。
ＮＰＮ及びＰＮＰ トランジスタのベース・エミッタ間
電圧より小さいときには、絶対値出力が得られない、い
わゆる、「不感帯」と呼ばれる領域を持つため、出力信
号が歪んでしまうことがある。
また、出力端のバイアス電圧は、基準電圧源よりもトラ
ンジスタのコレクタ・エミッタ間飽和電圧（約０．２Ｖ
）以上低くないと、絶対値出力が得られないといった制
限があった。
ンジスタのコレクタ・エミッタ間飽和電圧（約０．２Ｖ
）以上低くないと、絶対値出力が得られないといった制
限があった。
本発明は、このような問題点を解決するもので、前記問
題点を克服すると共に、部品点数の削減をはかり小型化
をもたらす絶対値回路を提供することを目的とするもの
である。
題点を克服すると共に、部品点数の削減をはかり小型化
をもたらす絶対値回路を提供することを目的とするもの
である。
問題点を解決するための手段
この問題点を解決するために、本発明は、演算増幅器の
出力回路を利用し、同演算増幅器の出力より２倍のベー
ス・エミッタ間電圧弁高い電位と、演算増幅器の出力よ
りベース・エミッタ間電圧弁低い電位を取り出し、それ
ぞれの出力をトランジスタのオン、オフにより切換える
ことにより、絶対値を取り出すものである。
出力回路を利用し、同演算増幅器の出力より２倍のベー
ス・エミッタ間電圧弁高い電位と、演算増幅器の出力よ
りベース・エミッタ間電圧弁低い電位を取り出し、それ
ぞれの出力をトランジスタのオン、オフにより切換える
ことにより、絶対値を取り出すものである。
作用
この構成により、「不感帯」と呼ばれる入力が小さい範
囲における出力が得られない領域を取り除くことができ
、出力信号の歪みを無（すことができる。
囲における出力が得られない領域を取り除くことができ
、出力信号の歪みを無（すことができる。
また、出力端のバイアス電圧も、基準電圧源と同じにで
きる為、別の電圧源を作る必要がなくなる。
きる為、別の電圧源を作る必要がなくなる。
実施例
第１図は本発明の一実施例による絶対値回路であり、第
１図において、演算増幅器ＯＰ１の出力トランジスタＱ
イのベースに、ダイオードＱ０を接続し、演算増幅器Ｏ
ＰＩの出力Ｖｏより、２倍のベース・エミッタ間電圧高
い電位Ｖ、を作る。この電圧は、トランジスタＱＩを介
して、抵抗Ｒ１とトランジスタＱ２により、演算増幅器
の出力信号のうち、基準電圧源Ｖｒｅｆの電圧以上の出
力信号を電流に変換する。その電流を１．とするとＩａ
＝（Ｖ＋−ＶＢＥＩ−Ｖａｐ２）；Ｒ＋ ・・・・・
（１）但し、Ｒ１：抵抗Ｒ＋の抵抗値 ＶＢＥＩ ： トランジスタＱＩのベース・エミッタ間
電圧 ＶｏＥ２：トランジスタＱ２のベース・エミッタ間電圧 また、Ｖ、は次式で表わされる。
１図において、演算増幅器ＯＰ１の出力トランジスタＱ
イのベースに、ダイオードＱ０を接続し、演算増幅器Ｏ
ＰＩの出力Ｖｏより、２倍のベース・エミッタ間電圧高
い電位Ｖ、を作る。この電圧は、トランジスタＱＩを介
して、抵抗Ｒ１とトランジスタＱ２により、演算増幅器
の出力信号のうち、基準電圧源Ｖｒｅｆの電圧以上の出
力信号を電流に変換する。その電流を１．とするとＩａ
＝（Ｖ＋−ＶＢＥＩ−Ｖａｐ２）；Ｒ＋ ・・・・・
（１）但し、Ｒ１：抵抗Ｒ＋の抵抗値 ＶＢＥＩ ： トランジスタＱＩのベース・エミッタ間
電圧 ＶｏＥ２：トランジスタＱ２のベース・エミッタ間電圧 また、Ｖ、は次式で表わされる。
Ｖ＋＝Ｖｏ−Ｖｒｅｒ＋ＶＢＥｎ＋Ｖｓｅｃ −−
（２）但し、ｖｏ：演算増幅器ＯＰＩの出力電圧Ｖｒｅ
４：基準電圧 Ｖｅｇａ：）ランジスタＱ３のベース・エミッタ間電圧 ＶｅＥｃ：）ランジスタＱｃのベース・エミッタ間電圧 変換された電流は、トランジスタＱ４１ ＱＳ、抵抗Ｒ
３，Ｒ４からなる電流ミラー回路により、電流ミラーさ
れて、出力端Ｖａｂより出力される。
（２）但し、ｖｏ：演算増幅器ＯＰＩの出力電圧Ｖｒｅ
４：基準電圧 Ｖｅｇａ：）ランジスタＱ３のベース・エミッタ間電圧 ＶｅＥｃ：）ランジスタＱｃのベース・エミッタ間電圧 変換された電流は、トランジスタＱ４１ ＱＳ、抵抗Ｒ
３，Ｒ４からなる電流ミラー回路により、電流ミラーさ
れて、出力端Ｖａｂより出力される。
次に、基準電圧以下に演算増幅器入力が下がった時には
前述したトランジスタＱｌ、Ｑ２はオンからオフになり
、反対に、トランジスタＱ３がオフからオンになり、演
算増幅器ＯＰＩの出力トランジスタＱｂのベース電位ｖ
２が、トランジスタＱ３と抵抗Ｒ２により、電流Ｉｂに
変換される。
前述したトランジスタＱｌ、Ｑ２はオンからオフになり
、反対に、トランジスタＱ３がオフからオンになり、演
算増幅器ＯＰＩの出力トランジスタＱｂのベース電位ｖ
２が、トランジスタＱ３と抵抗Ｒ２により、電流Ｉｂに
変換される。
出力端Ｖ２ｂの電圧を、基準電圧源Ｖｒｅｆの電圧と同
電位にすることにより、出力電流１ｂは次式％式％ 但し、Ｖｓｂ：出力端Ｖａｂの電圧で、特に基準電圧源
電圧ｖ ｒｅｆと同電位にする。
電位にすることにより、出力電流１ｂは次式％式％ 但し、Ｖｓｂ：出力端Ｖａｂの電圧で、特に基準電圧源
電圧ｖ ｒｅｆと同電位にする。
ｖＢＥ３：トランジスタＱ３のベース・エミッタ間電圧
Ｒ２：抵抗Ｒ２の抵抗値
また、ｖ２は次式で表わされる。
Ｖ２＝ ＶＯＶｒｅｆ ｖＢＥｂ ・・
・・・・（４）但し、ＶＢＥｂ：トランジスタＱｂのベ
ース・エミッタ間電圧 以上、２つの電流Ｌ＋ Ｉｂが、演算増幅器の出力に
より、自動的に切換わり、出力端Ｖａｂより電流吸込の
型で得られる。
・・・・（４）但し、ＶＢＥｂ：トランジスタＱｂのベ
ース・エミッタ間電圧 以上、２つの電流Ｌ＋ Ｉｂが、演算増幅器の出力に
より、自動的に切換わり、出力端Ｖａｂより電流吸込の
型で得られる。
一般には、出力端Ｖ ’ａ ｂを別の演算増幅器の仮想
接地端に接続することにより、電圧変換し使用する。
接地端に接続することにより、電圧変換し使用する。
発明の効果
以上のように、本発明によれば少ない素子数で、出力信
号波形に歪みのない高精度の絶対値回路が得られ制御回
路の高精度化が可能となる。
号波形に歪みのない高精度の絶対値回路が得られ制御回
路の高精度化が可能となる。
第１図は本発明の一実施例による絶対値回路を示す回路
図、第２図は従来の絶対値回路を示す回路図である。 Ｑ１〜Ｑ５・・・・・・トランジスタ、Ｑａ、 Ｑｂ・
・・・・・トランジスタ、Ｑｏ・・・・・・ダイオード
、Ｒ１−Ｒ４・・・・・・抵抗、ＣＣ１’＝ＣＣ２・・
・・・・電流源、ＯＰ ＋・・・・・・演算増幅器。 代理人の氏名 弁理士 中尾敏男 ほか１名第１図 第 ２ｒＩＪ
図、第２図は従来の絶対値回路を示す回路図である。 Ｑ１〜Ｑ５・・・・・・トランジスタ、Ｑａ、 Ｑｂ・
・・・・・トランジスタ、Ｑｏ・・・・・・ダイオード
、Ｒ１−Ｒ４・・・・・・抵抗、ＣＣ１’＝ＣＣ２・・
・・・・電流源、ＯＰ ＋・・・・・・演算増幅器。 代理人の氏名 弁理士 中尾敏男 ほか１名第１図 第 ２ｒＩＪ
Claims (1)
- 演算増幅器の出力電圧より単位のベース・エミッタ間電
圧の２倍分高い電位点に、第１のトランジスタのベース
を接続し、その第１のトランジスタのエミッタを、第１
の抵抗を介して第２のトランジスタのエミッタに接続し
、そのコレクタよりの出力を第１、第２の電流ミラー対
を介し第１の出力とし、さらに、前記演算増幅器の出力
より単位のベース・エミッタ間電圧分低い電位点に、第
３のトランジスタのベースを接続し、その第３のトラン
ジスタのエミッタを第２の抵抗を介して、第２の出力と
して取り出し、前記第１、第２の出力を切換えることに
より、入力の絶対値を取り出す絶対値回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62252872A JPH0195376A (ja) | 1987-10-07 | 1987-10-07 | 絶対値回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62252872A JPH0195376A (ja) | 1987-10-07 | 1987-10-07 | 絶対値回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0195376A true JPH0195376A (ja) | 1989-04-13 |
Family
ID=17243340
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62252872A Pending JPH0195376A (ja) | 1987-10-07 | 1987-10-07 | 絶対値回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0195376A (ja) |
-
1987
- 1987-10-07 JP JP62252872A patent/JPH0195376A/ja active Pending
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