JPH02105739A - Isdn terminal adapter device - Google Patents
Isdn terminal adapter deviceInfo
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- JPH02105739A JPH02105739A JP63258532A JP25853288A JPH02105739A JP H02105739 A JPH02105739 A JP H02105739A JP 63258532 A JP63258532 A JP 63258532A JP 25853288 A JP25853288 A JP 25853288A JP H02105739 A JPH02105739 A JP H02105739A
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Abstract
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はＩＳＤＮ端末アダプタ装置に関す゛る。[Detailed description of the invention] [Industrial application field] The present invention relates to an ISDN terminal adapter device.
ＩＳＤＮ端末アダプタ装置は加入者宅内に設置され、既
存端末をＩＳＤＮ網に収容するための装置である。回線
交換データ端末、パケット交換データ端末、テレクス端
末および音声端末等に関する呼制御信号をＩＳＤＮ用Ｄ
チヤネルプロトコールに変換するとともに、既存端末の
ユーザ速度とＩＳＤＮにおける伝送レートの変換、電気
的２機械的インタフェースの変換を行う。An ISDN terminal adapter device is installed in a subscriber's premises and is a device for accommodating existing terminals to the ISDN network. Call control signals for circuit-switched data terminals, packet-switched data terminals, telex terminals, voice terminals, etc.
In addition to converting to a channel protocol, it also converts the user speed of existing terminals and the transmission rate in ISDN, and converts electrical and mechanical interfaces.
従来のＩＳＤＮ端末アダプタ装置において複数個の既存
端末を収容する場合、第２図に示す構成である。第２図
を参照し従来のＩＳＤＮ端末アダプタ装置の説明を行う
。ＩＳＤＮ端末アダプタ装置ＴＡは共通部ＣＯＭ、端末
インタフェース部ＲＩＮＦ’１−Ｉ−ＲＩＮＦｎに分け
ることができ、共通部はマイクロプロセッサＭＰＵ３、
メモリ回路４とその周辺回路５とから成り、周辺回路５
は割込回路、タイマー回路、ダイレクトメモリアクセス
コントロールＤＭＡＣ回路等から成、ｊ）、ＩＳＤＮ網
へのアクセス回路としてはＳインタフェース回路１とＬ
ＡＰＤ回路２とがある。一方、端末インフェース部几Ｉ
ＮＦＩ〜ＲＩＮＦｎは既存端末装置ＤＴＥ１〜ＤＴＥｎ
を収容する端末収容回路８ａ〜８ｎ、速度変換回路７ａ
〜７ｎ、Ｂチャネル選択回路５ ａ −，５ｎとから構
成される。When accommodating a plurality of existing terminals in a conventional ISDN terminal adapter device, the configuration is shown in FIG. A conventional ISDN terminal adapter device will be explained with reference to FIG. The ISDN terminal adapter device TA can be divided into a common part COM and terminal interface parts RINF'1-I-RINFn, and the common part includes microprocessors MPU3,
Consisting of a memory circuit 4 and its peripheral circuit 5, the peripheral circuit 5
j) consists of an interrupt circuit, a timer circuit, a direct memory access control DMAC circuit, etc., and S interface circuits 1 and L are used as access circuits to the ISDN network.
There is an APD circuit 2. On the other hand, the terminal interface part I
NFI~RINFn are existing terminal devices DTE1~DTEn
Terminal accommodation circuits 8a to 8n and speed conversion circuit 7a that accommodate
7n, and B channel selection circuits 5a-, 5n.
この構成において、例えば既存端末ＤＴＥＩがＣＣＩＴ
Ｔ勧告Ｘ、２１のプロトコールを持つ端末とした時、Ｔ
Ａの端末収容回路８ａは電気的２機械的変換を行う機能
と、Ｘ、２１プロトコールをハード的にサポートする機
能にて構成させ、上記構成において既存端末ＩＪＴＥＩ
からの発呼又は着呼に対し共通部ＣＯＭのＭＰ［ＪはＸ
、２１のプロトコール処理を行ない、又ＩＳＤＮ網との
間においてＬＡＰＤ回路２、Ｓインタフニース回路ｌを
用い、Ｃ０ＩＴＴ勧告１．４３０に勧告されているＳ７
’ｌ’点のＤチャネルを介しｌ５Ｌ）Ｎプロトコール処
理を行う。上記プロトコール処理によジ、ＣＣＩＴＴ勧
告１．４３０に勧告されているＳ／Ｔ点の８１チヤネル
、Ｂ２チャネルを用い、データ送受信が可能となるとＭ
ＰＵからの指示に従い速度変換回路７ａにおいて既存端
末のユーザ速度とＩＳＤＮにおける伝送レートの変換を
行ない、Ｂチャネル選択回路６ａを動作させＢｌチャネ
ル又はＢ２チャネルを選択してデータの送受信を行う。In this configuration, for example, the existing terminal DTEI is
When a terminal has a protocol of T recommendation X, 21, T
The terminal accommodating circuit 8a of A is configured with a function of performing electrical to mechanical conversion and a function of supporting the X, 21 protocol in hardware.
MP of the common part COM [J is X
, 21 protocol processing, and uses LAPD circuit 2 and S interface circuit 1 between the ISDN network and S7 as recommended in C0ITT Recommendation 1.430.
15L)N protocol processing is performed via the D channel at point 'l'. Through the above protocol processing, it becomes possible to send and receive data using the 81 channels and B2 channels at the S/T point recommended in CCITT Recommendation 1.430.
In accordance with instructions from the PU, the speed conversion circuit 7a converts the user speed of the existing terminal and the transmission rate in ISDN, and operates the B channel selection circuit 6a to select the B1 channel or the B2 channel to transmit and receive data.
以下、既存端末装置ＤＴＥ２〜ＤＴＥｎについては、イ
ンタフェースのプロトコールが端末種類により異なって
くるが、動作としては上述と同じである。Hereinafter, regarding the existing terminal devices DTE2 to DTEn, although the interface protocols differ depending on the terminal type, the operations are the same as described above.
上述した従来の■ＳＤＮ端末アダプタ装置は１つのマイ
クロプロセッサでいくつもの既存端末装置のプロトコー
ル処理を行うため、全体の処理能力が低下する。In the conventional SDN terminal adapter device described above, one microprocessor processes protocols for a number of existing terminal devices, resulting in a decrease in overall processing capacity.
本発明は共通部と複数個の異なった端末インタフ、−ス
回路とから成るＩＳＤＮ端末アダプタ装置において、前
記共通部はマイクロプロセッサ。The present invention provides an ISDN terminal adapter device comprising a common part and a plurality of different terminal interface and bus circuits, wherein the common part is a microprocessor.
メモリ回路２周辺回路、Ｓインタフェース回路。Memory circuit 2 peripheral circuit, S interface circuit.
ＬＡＰＤ回路とから構成さｎ１前記端末インタフ工−ス
回路はマイクロプロセッサ、メモリ回路。The terminal interface circuit N1 is composed of an LAPD circuit, a microprocessor, and a memory circuit.
周辺回路、端末収容回路、速度変換回路、Ｂチャネル選
択回路、共通部インタフェース回路とから構成さｎる。It consists of a peripheral circuit, a terminal accommodation circuit, a speed conversion circuit, a B channel selection circuit, and a common part interface circuit.
次に、本発明について図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.
本発明の一実施例を示す第１図を参照すると、ＩＳＤＮ
端末アダプタ装置ＴＡは共通部ＣＯＭと端末インタフェ
ース部ＲＩ Ｎ Ｆ １− ＲＩ Ｎ Ｆ ｎとに分け
ることができ、共通部ＣＯＭはマイクロプロセッサＨＰ
Ｕ３ 、メモリ回路４．その周辺回路５とから成る。周
辺回路５は割込回路、タイマー回路、ＤＭＡＣ回路等を
含む。ｌ８１）Ｎ網へのアクセス回路としてはＳインタ
フェース回路１トＬＡＰＤ回路２とがある。また、端末
インタフェース部几Ｉ Ｎ ｋ’ １−ルＩ Ｎ ｎは
マイクロプロセッサＭＰＵ３ａ〜３ｎ、メモリ回路４ａ
〜４ｎ、その周辺回路５ａ〜５ｎから成る。周辺回路５
ａ〜５ｎは割込回路、タイマー回路、ときにはＤＭＡＣ
等を含み、共通部ｅＯＭへのインタフェースにはデュア
ルポートメモリ回路９ａ〜９ｎ、 コントロールレジ
スタ１０ａ−Ｉｏｎによりインタフェースされる。端末
インタフェース部１（、ＩＮＦＩ〜ｉｔ ＩＮＦｎは既
存端末装置ＤＴＥＩ−ＤＴＥｎを収容する端末収容回路
８３〜３ｎ、速度変換回路７８〜７ｎ、Ｂチャネル選択
回路６ａ〜６ｎとから構成される。Referring to FIG. 1 illustrating one embodiment of the present invention, ISDN
The terminal adapter device TA can be divided into a common part COM and a terminal interface part RINF1-RINFn, and the common part COM is a microprocessor HP.
U3, memory circuit 4. It consists of a peripheral circuit 5. The peripheral circuit 5 includes an interrupt circuit, a timer circuit, a DMAC circuit, and the like. 181) As an access circuit to the N network, there is an S interface circuit 1 and an LAPD circuit 2. In addition, the terminal interface section I N k' 1 - I N n includes the microprocessors MPU3a to 3n and the memory circuit 4a.
4n and its peripheral circuits 5a to 5n. Peripheral circuit 5
a to 5n are interrupt circuits, timer circuits, and sometimes DMAC
etc., and is interfaced to the common part eOM by dual port memory circuits 9a to 9n and control registers 10a to Ion. The terminal interface unit 1 (INFI to INFn is composed of terminal accommodation circuits 83 to 3n that accommodate existing terminal devices DTEI to DTEn, speed conversion circuits 78 to 7n, and B channel selection circuits 6a to 6n.
この構成において、例えば既存端末１）ＴＥＩがＣＣＩ
ＴＴ勧告Ｘ、２１のプロトコールを持つ端末とした時、
ＴＡの端末収容回路８ａｆｉ電気的９機械的変換を行う
機能と、Ｘ、２１プロトコールをハード的にサポートす
る機能にて構成させ、既存端末ＤＴＥ１からの発呼又は
着呼に対して端末インタフェースＲ工ＮＦｌのＭＰＵ３
ａはＸ、２１のプロトコール処理を行ない、共通部ＣＯ
ＭのＭＰＵ３との間において、デュアルポートメモリ回
路９ａ又はコントロールレジスタｌｏａを介し共通部Ｃ
ＯＭにて必要とするデータのみのインタフェースを行う
。共通部ＣＯＭのＭＰＵ３は端末インタフェースＲＩＮ
Ｆｔからの情報に従いＩＳＤＮ網との間においてＬＡＰ
Ｄ回路２．Ｓインタフニース回路ｌを用いＣ０ＩＴＴ勧
告１．４３０に勧告されているＳ／Ｔ点のＤチャネルを
介しＩＳＤＮプロトコール処理を行う。In this configuration, for example, existing terminal 1) TEI is CCI
When the terminal has the protocol of TT Recommendation X, 21,
TA's terminal accommodation circuit 8afi is configured with a function to perform electrical and mechanical conversion, and a function to support X and 21 protocols in hardware. NFl MPU3
a performs the protocol processing of X, 21, and the common part CO
The common part C is connected to the MPU 3 of the M via the dual port memory circuit 9a or the control register loa.
OM interfaces only the necessary data. MPU3 of common part COM is terminal interface RIN
LAP between ISDN network according to information from Ft.
D circuit 2. ISDN protocol processing is performed using the S interface circuit 1 via the D channel at the S/T point recommended in C0ITT Recommendation 1.430.
上記プロトコール処理によｐｃｃＩＴＴ勧告Ｉ。pccITT Recommendation I by processing the above protocol.
４３０に勧告されているＢ１チャネル、Ｂ２チャネルを
用いデータの送受信が可能となると、共通部ＣＯＭのＭ
ＰＵ３から端末インタフェースＲＩＮＦ１に対し指示を
出し、端末インタフェース几ＩＮＦＩのＭＰＵ３ａの下
で速度変換回路７ａにおいて既存端末のユーザ速度とＩ
ＳＤＮにおける伝送レートとの変換を行ない、Ｂチャネ
ル選択回路６ａを動作させてＢｌチャネル又はＢ２チャ
ネルを選択しデータの送受信を行う。以下、既存端末ｉ
置ＤＴＥ２〜ＤＴＥｎについてはインタフェースのプロ
トコールが端末種類により異なってくるが、基本的動作
としては上述と同様である。When it becomes possible to send and receive data using the B1 channel and B2 channel recommended in 430, the M of the common part COM
The PU3 issues an instruction to the terminal interface RINF1, and the speed conversion circuit 7a converts the user speed and I of the existing terminal under the MPU3a of the terminal interface INFI.
Conversion with the transmission rate in SDN is performed, and the B channel selection circuit 6a is operated to select the B1 channel or the B2 channel to transmit and receive data. Below, existing terminal i
Regarding the terminals DTE2 to DTEn, the interface protocols differ depending on the type of terminal, but the basic operations are the same as described above.
以上説明したように本発明によれば、共通部とそれぞれ
の端末インタフェース部とにマイクロプロセッサ、メモ
リ回路とその周辺回路を分散することにより、処理能力
を向上できる。また、端末インタフェース部をユニット
化し予め定められた端末種別情報を持つことにより、既
存端末の収容構成を自由に選択することができる。As described above, according to the present invention, processing performance can be improved by distributing the microprocessor, memory circuit, and peripheral circuits to the common section and each terminal interface section. Furthermore, by unitizing the terminal interface section and having predetermined terminal type information, it is possible to freely select the accommodation configuration for existing terminals.
第１図は本発明の一実施例を示す構成図、ｗＪ２図は従
来のＩＳＤＮ端末アダプタ装置の構成図である。
ＴＡ・・・・・・ＩＳＤＮ端末アダプタ装置、１）ＴＥ
１〜ＤＴＥｎ・・・・・・既存端末装置、ＣＯＭ・・
・・・・共通部、ＲＩＮＦ１〜ＲＩＮＦｎ・・・・・・
端末インタフェース部、１・°°・°・Ｓインタフェー
ス回路、２・・・・・・ＬＡＰＤ回路、３・・・・・・
マイクロプロセッサ、３ａ〜３ｎ・・・・・・マイクロ
プロセッサ、４・・・・・・メモリ回路、４ａ〜４ｎ・
・・・・・メモリ回路、５・・・・・・周辺回路、５ａ
〜５ｎ・・・・・・周辺回路、６ａ〜６ｎ・・・・・・
Ｂチャネル選択回路、７ａ〜７ｎ・・・・・・速度変換
回路、８ａ〜８ｎ・・・・・・端末収容回路、９ａ〜９
ｎ・・・・・・チーアルポートメモリ回路、Ｉ Ｑ ａ
−１Ｏｎ ”°・°゛コントロールレジスタＣＢＵＳ・
・・・・・共通部バス、ＲＢＵＳｌ〜ＲＢＵ８ｎ・・・
・・・端末インタフェースバス。
代理人 弁理士 内 原 晋FIG. 1 is a block diagram showing an embodiment of the present invention, and FIG. wJ2 is a block diagram of a conventional ISDN terminal adapter device. TA...ISDN terminal adapter device, 1) TE
1~DTEn...Existing terminal device, COM...
...Common part, RINF1 to RINFn...
Terminal interface section, 1.°°.°.S interface circuit, 2... LAPD circuit, 3...
Microprocessor, 3a-3n... Microprocessor, 4... Memory circuit, 4a-4n.
...Memory circuit, 5...Peripheral circuit, 5a
~5n...Peripheral circuit, 6a~6n...
B channel selection circuit, 7a-7n... speed conversion circuit, 8a-8n... terminal accommodation circuit, 9a-9
n...Cheer port memory circuit, IQ a
-1On ”°・°゛Control register CBUS・
...Common section bus, RBUSl~RBU8n...
...terminal interface bus. Agent Patent Attorney Susumu Uchihara
Claims (1)
ら成るＩＳＤＮ端末アダプタ装置において、前記共通部
はマイクロプロセッサ、メモリ回路、周辺回路、Ｓイン
タフェース回路、ＬＡＰＤ回路とから構成され、前記端
末インタフェース回路はマイクロプロセッサ、メモリ回
路、周辺回路、端末収容回路、速度変換回路、Ｂチャネ
ル選択回路、共通部インタフェース回路とから構成され
ることを特徴とするＩＳＤＮ端末アダプタ装置。In an ISDN terminal adapter device comprising a common part and a plurality of different terminal interface circuits, the common part comprises a microprocessor, a memory circuit, a peripheral circuit, an S interface circuit, and an LAPD circuit, and the terminal interface circuit comprises a microprocessor, a memory circuit, a peripheral circuit, an S interface circuit, and an LAPD circuit. An ISDN terminal adapter device comprising a processor, a memory circuit, a peripheral circuit, a terminal accommodation circuit, a speed conversion circuit, a B channel selection circuit, and a common part interface circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63258532A JPH02105739A (en) | 1988-10-14 | 1988-10-14 | Isdn terminal adapter device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63258532A JPH02105739A (en) | 1988-10-14 | 1988-10-14 | Isdn terminal adapter device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02105739A true JPH02105739A (en) | 1990-04-18 |
Family
ID=17321527
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63258532A Pending JPH02105739A (en) | 1988-10-14 | 1988-10-14 | Isdn terminal adapter device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02105739A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003061729A (en) * | 2001-08-21 | 2003-03-04 | Yoshinobu Ito | Multifunctional bag |
-
1988
- 1988-10-14 JP JP63258532A patent/JPH02105739A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003061729A (en) * | 2001-08-21 | 2003-03-04 | Yoshinobu Ito | Multifunctional bag |
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